JPS6184863A - イメ−ジセンサ - Google Patents

イメ−ジセンサ

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JPS6184863A
JPS6184863A JP59207455A JP20745584A JPS6184863A JP S6184863 A JPS6184863 A JP S6184863A JP 59207455 A JP59207455 A JP 59207455A JP 20745584 A JP20745584 A JP 20745584A JP S6184863 A JPS6184863 A JP S6184863A
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JP
Japan
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thin film
amorphous silicon
electrode
film transistor
type amorphous
Prior art date
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JP59207455A
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English (en)
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JPH0628308B2 (ja
Inventor
Fujio Okumura
藤男 奥村
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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Expired - Lifetime legal-status Critical Current

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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10FINORGANIC SEMICONDUCTOR DEVICES SENSITIVE TO INFRARED RADIATION, LIGHT, ELECTROMAGNETIC RADIATION OF SHORTER WAVELENGTH OR CORPUSCULAR RADIATION
    • H10F39/00Integrated devices, or assemblies of multiple devices, comprising at least one element covered by group H10F30/00, e.g. radiation detectors comprising photodiode arrays
    • H10F39/10Integrated devices
    • H10F39/12Image sensors
    • H10F39/191Photoconductor image sensors

Landscapes

  • Solid State Image Pick-Up Elements (AREA)
  • Facsimile Heads (AREA)
  • Light Receiving Elements (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は非晶質シリコンを用いたイメージセンサ、さら
に詳しくは、非晶質シリコンを用いた薄膜トランジスタ
をスイッチング素子とするイメージセンナに関する。
〔従来技術〕
ファクシミ’)やOCR等の光学読取系に用いられるイ
メージセンサには、現在主にCCD(1!荷結合デバイ
ス)ヤΔIDS型のICセンサがある。しかし、ICセ
ンナは小型であるため、原稿を縮少投影するための大き
な光学系が必要であり、それが装置の小型化に対する大
きな障害となっていた。
この問題を解決するために原稿と同一サイズの密着型イ
メージセンサが開発された。特に近年周辺回路との接続
を簡単にするため、同一基板上に薄膜のフォトダイオー
ドとスイッチング素子とを形成したイメージセンサが開
発されてきている。
スイッチング素子としてはブロッキングダイオードを使
ったもの(第15口面体素子と材料コンファレンス・イ
クステンデイド・アブストラクト1983年 ページ2
05〜208)や、薄膜トランジスタを使ったもの(第
15口面体素子と材料ニンフアレンス イクステンデイ
ド・アブストラクト 1983年 ページ201〜20
9)がある、この薄膜トランジスタを使ったイメージセ
ンナの例を第4図に示す0図において、邸はガラス基板
、26は0かもなるゲート電極、がは厚さ0.3μmの
5iNzからなるゲート絶縁膜、28は厚さ0.3μm
のノンドーグ非晶質シリコン、幻は非晶質シリコン四と
後述の金属30 、31との間にオーミック接触を持た
せるためのn型とした非晶質シリコン、30はMからな
るドレイン電極、31は同じくMからなる個別電極、3
2はインジウム酸化スズからなる透明電極、羽は厚さ3
00 人のEiNz膜、あけ高抵抗化するため3〜5四
のB、Lをドープした厚さ2.5μmの非晶質シリコン
膜、語は厚さ0.2μmのp型非晶質シリコン膜、36
は信号光である。
〔発明が解決しようとする問題点〕
薄膜トランジスタを使り九イメージセンナは以上のよう
な構成で充分な明暗比及び動作速度を得ているが、この
構造には以下に述べる欠点がある。
すなわち、このイメージセンサでは薄膜トランジスタと
フォトダイオードの半導体部分との構造が異なるため、
薄膜トランジスタとフォトダイオードとの非晶質シリコ
ンは別々に形成しなくてはならない、従って、近接した
場所に素子を形成することが非常に難しい。このため従
来はフォトダイオードと薄膜トランジスタとの間を長く
とり、メタルマスクを用いて両者を別々に形成し、それ
ぞれの半導体膜が重なり合わないようにしていた。
しかし、このような方法によるときには素子の高密度化
や2次元化が困難であるのはいうまでもない。
本発明の目的は上記従来型イメージセンサの欠点を除去
せしめ、プロセスが簡単でしかも高密度化が可能なイメ
ージセンナを提供することにある。
〔問題点を解決するための手段〕
本発明は、絶縁性基板l上に一体化されたp−1−nフ
ォトダイオード11と薄膜トランジスタ臣とを有し、該
p−1−nフォトダイオードUは絶縁性基板l上に帯状
に形成した共通電極2t−おおうようにp型、1型、n
型の順序で形成した非晶質シリコン3.4.5と該n型
非晶質シリコン5の上に形成した透明導電膜9とからな
り、該薄膜トランジスタ12は前記透明導電膜9をソー
ス電極とし、前記n型非晶質シリコン5をオーミック接
触層とするドレイン電極8を有し、p−1−nフォトダ
イオード11と同時に形成されたl型非晶質シリコン4
上の前記ゲート絶縁膜6とゲート電極7とからなること
を特徴とするイメージセンナである。
〔実施例〕
以下図に示す実施例について、本発明のイメージセンナ
を説明する。
第1図は本発明の一実施例の基本構成の断面図を示して
いる。図において、lはガラス、セラミック等の絶縁性
基板、2は共通電極、3はBを高濃度ドーピングしたp
型非晶質シリコン(p−a−8l:H)、4はノンドー
プか、あるいはBを〜5四程度ドーピングして真性とし
たi型非晶質シリコン(1−a−3t:H)、5はpを
高濃度ドニピングしたn型非晶質シリ:f y (n−
a−31:H)、6は全体のパッシベーションを兼ねた
5iNzからなるゲート絶縁膜、7はゲート電極、8は
ドレイン電極、9は透明導電膜、IOは信号光である。
本発明のイメージセンナは絶縁性基板lに一体化された
p−1−nフォトダイオード11と、薄膜トランジスタ
12とを有するものであるop  1−n7オトダイオ
ードllは、p型非晶質シリコ/3、l型非晶質シリコ
ン4、n型非晶質シリコン5からなり、薄膜トランジス
タLはこのp−1−nフォトダイオード11の上面につ
けた透明導電膜9をソース電極とし、pinフォトダイ
オード11と同時に形成されたl型非晶質シリコン4上
に形成したゲート絶縁膜6、ゲート電極7、及び非晶質
シリコ75fCオーミツク接触層としたドレイン電極8
からなっている。なお、l型非晶質シリコン4はチャネ
ルの活性層となる。
第1図の等何回路を第2図に示す6図において、点線で
囲んだ部分が本発明のイメージセンナの基本構成の等何
回路を示している。 13は薄膜トランジスタ12のド
レイン側にできるpi−nダイオード、14は負荷抵抗
、15は電源である。
その動作は以下のとおりである。すなわち、薄膜トラン
ジスタ認をONL、p−1−nフォトダイオード11に
電荷を蓄積し、薄膜トランジスタL2をOFF した後
、信号光によってp−L−nフォトダイオード11上の
電荷を消去し、再び薄膜トランジスタ12をONする時
p−1−nフォトダイオード12に流れ込む電荷を負荷
抵抗14全通して読み取るものであるop  1−nダ
イオード13は出力の容量を増加させるだけで基本的な
動作には影響を与えない。実際にはこの点線で囲った部
分がアレイ化され1次元や2次元のイメージセンサとな
る・次に第3図(a)〜(f)に本発明のイメージセン
ナの!R遺プロセスの一例を示す、まず、第3図(a)
に示すようにガラス基板1上に共通電極2となるCrを
0.1μm程度蒸着し帯状にパターンニングする0次に
この上に共通電極2をおおうようにp−a−8t二H3
+ 1−a−8i:H4+ n型非晶質シリコン5t一
連続□形成する(第3図(b) ) 、これらの非晶質
シリコンはp−a−8t:Hの場合、BtHsをtoo
o pr@+ i−&−81:Hはノンドープ、n−a
−8i:HはPH,を1100OPIII。
Si几と混合し、グロー放電法により分解形成する。
次に第3図(e)に示すようK、エツチングを行って各
基本素子を島状に分離する。また、薄膜トランジスタの
チャネル部分のn−a−8i:Hと1−a−8i:Hの
上面を0.05〜0.1μm程度除去する。次に第3図
(d)に示すように全体のパッシベーションを兼ねたS
 iNZからなるゲート絶縁膜6を形成し、ソース電極
を兼ねたp−1−nフォトダイオード用の窓と、ドレイ
ン電極用の窓を開ける。この5iNzは5IH4と凪あ
るいは5iHa −NHsとN、の混合ガスをグロー放
電法により分解して形成する。厚さiiO,2〜0.4
μm程度である。次に第3図(e)に示すようにゲート
電極7、ドレイン電極8となるMを蒸着し、それぞれ所
望の形状にパターニングする。最後にインジウム酸化ス
ズ等の透明導電膜9を蒸着し、p−1−nフォトダイオ
ードの上面に該薄膜トランジスタのソース電極を兼ねる
ような形状にパターンニングする(第3図(f))。透
明電極Q fin型非晶質シリコンが比較的高い抵抗値
(比抵抗が〜103Ω1程度)を持つため、これをおぎ
ない、確実KM薄膜トランジスタP−1−nフォトダイ
オードのコンタクトをとるために入れたものである。
〔発明の効果〕 上記実施例で説明したように、本発明のイメージセッサ
ではフォトダイオードと薄膜トランジスタが一体化して
いるため、従来のものに比べはるかに高密度なイメージ
センサを得ることができる・例えば従来例ではグロー放
電法で非晶質シリコンを形成する際、メタルマスクを用
いてフォトダイオードと薄膜トランジスタの部分を別々
に形成していたため、フォトダイオードと薄膜トランジ
スタとの間隔は少くとも5〜15龍程度離さなくてはな
らなかったが、本発明のイメージセンナではこれが一体
化しているため、数百μm以内におさめることが可能で
ある。これにより装置の小型化や従来例では困難であっ
た2次元化も容易になる6ま次、製造プロセスも従来の
ものよシ簡単で、製造に要する時間は少くとも2〜3割
短縮できる。
以上述べたように1本発明のイメージセンサは高密度化
が容易で、生産性が高く、工業的に非常に有益である。
【図面の簡単な説明】
第1図は本発明の一実施例の断面図、第2図は本発明の
イメージセンサの等価回路、第3図(a)〜(f)は本
発明のイメージセンナの形成プロセスの一例を工程順に
示す図、第4図は従来例を示す図である。 l・−・絶縁性基板、2・−・共通電極、3・・・p型
非晶質シリコン、4・・・1型非晶質シリコン、5・・
・n型非晶質シリコン、6・・・5INz(絶縁膜)、
7・・・ゲート電極、8・・・ドレイン電極、9・・・
透明導電膜、10・・・信号光 特許出願人  日本電気株式会社 P3JtIFL服反]

Claims (1)

    【特許請求の範囲】
  1. (1)絶縁性基板上に一体化されたp−i−nフォトダ
    イオードと薄膜トランジスタとを有し、該p−i−nフ
    ォトダイオードは絶縁性基板上に帯状に形成した共通電
    極をおおうようにp型、i型、n型の順序で形成された
    非晶質シリコンと、該n型非晶質シリコン上に形成され
    た透明導電膜とからなり、該薄膜トランジスタは、前記
    透明導電膜をソース電極とし、且つ前記n型非晶質シリ
    コンをオーミック接触層とするドレイン電極を有し、前
    記p−i−nフォトダイオードと同時に形成された前記
    i型非晶質シリコン上のゲート絶縁膜とゲート電極とか
    らなることを特徴とするイメージセンサ。
JP59207455A 1984-10-03 1984-10-03 イメ−ジセンサ Expired - Lifetime JPH0628308B2 (ja)

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JP59207455A JPH0628308B2 (ja) 1984-10-03 1984-10-03 イメ−ジセンサ

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JPH0628308B2 JPH0628308B2 (ja) 1994-04-13

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6329971A (ja) * 1986-07-23 1988-02-08 Hamamatsu Photonics Kk 放射線撮像装置

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* Cited by examiner, † Cited by third party
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JPS6329971A (ja) * 1986-07-23 1988-02-08 Hamamatsu Photonics Kk 放射線撮像装置

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