JPS62105221A - メモリの格納順序変更装置 - Google Patents
メモリの格納順序変更装置Info
- Publication number
- JPS62105221A JPS62105221A JP60245684A JP24568485A JPS62105221A JP S62105221 A JPS62105221 A JP S62105221A JP 60245684 A JP60245684 A JP 60245684A JP 24568485 A JP24568485 A JP 24568485A JP S62105221 A JPS62105221 A JP S62105221A
- Authority
- JP
- Japan
- Prior art keywords
- code
- read
- key
- order
- codes
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Automatic Embroidering For Embroidered Or Tufted Products (AREA)
- Input From Keyboards Or The Like (AREA)
- Sewing Machines And Sewing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、メモリの格納順序変更袋こに関する。
メモリ、例えば、マイクロコンピュータ制御の刺繍機に
おいて、入力されたコードを格納するＲＡ阿では、デー
タ等は、書き込んだ順番に読み出すようになっている。
おいて、入力されたコードを格納するＲＡ阿では、デー
タ等は、書き込んだ順番に読み出すようになっている。
このため、一旦、格納してしまったデータ等の読み出し
順番を変更するには、読み出す順番に従って、新しくデ
ータ等を書き直さなければならず、データ等が多い場合
は非常にわずられしかった。
順番を変更するには、読み出す順番に従って、新しくデ
ータ等を書き直さなければならず、データ等が多い場合
は非常にわずられしかった。
この発明は、データ等を新しく書き直さずに、読み出し
順番を変更できるようにすることを目的としており、コ
ード入力手段により入力されたコードを格納した第１の
格納手段から、読み出し手段によりコードを１個づつ読
み出し、読み出したコードを告知手段により告知する。
順番を変更できるようにすることを目的としており、コ
ード入力手段により入力されたコードを格納した第１の
格納手段から、読み出し手段によりコードを１個づつ読
み出し、読み出したコードを告知手段により告知する。
この時、古き込み手段を動作させると第２の格納手段に
告知されていたコードが格納される。このような動作を
繰り返して第２の格納手段にコードを格納してゆき、コ
ード読み出し時には、第２の格納手段から書き込んだ順
番に読み出すようにしている。
告知されていたコードが格納される。このような動作を
繰り返して第２の格納手段にコードを格納してゆき、コ
ード読み出し時には、第２の格納手段から書き込んだ順
番に読み出すようにしている。
第１図はこの発明の一実施例を示す図である、図におい
て、ｌはコード入力手段としてのキーボード、２は第１
の格納′ｆ段としてのＲＡＭで、キーボードｌから入力
されたコードを格納する。３は第２の格納手段としての
ＲＡＭ 、 ４は前記ＲＡＮ ２からコードを読み出す
読み出し手段をｃｐｕ ｓとともに構成しているキー、
６は前記ＲＡＭ ２から読み出されたコードを読み出さ
れた順に１個づつ告知する告知手段としてのディスプレ
イ、７は告知されているコードを前記ＲＡＭ ３に占き
込む９き込み手段としてのキー、８は前記コードを付し
た運針データが格納されている外部記憶装置、９は運針
データ記憶用のＲＡＭで、前記外部記憶装置８から読み
出された運針データを格納している。１０は刺繍機構、
１１は前記ＲＡＭ ９、刺繍機構１０等を制御するＣＰ
Ｕである。
て、ｌはコード入力手段としてのキーボード、２は第１
の格納′ｆ段としてのＲＡＭで、キーボードｌから入力
されたコードを格納する。３は第２の格納手段としての
ＲＡＭ 、 ４は前記ＲＡＮ ２からコードを読み出す
読み出し手段をｃｐｕ ｓとともに構成しているキー、
６は前記ＲＡＭ ２から読み出されたコードを読み出さ
れた順に１個づつ告知する告知手段としてのディスプレ
イ、７は告知されているコードを前記ＲＡＭ ３に占き
込む９き込み手段としてのキー、８は前記コードを付し
た運針データが格納されている外部記憶装置、９は運針
データ記憶用のＲＡＭで、前記外部記憶装置８から読み
出された運針データを格納している。１０は刺繍機構、
１１は前記ＲＡＭ ９、刺繍機構１０等を制御するＣＰ
Ｕである。
次に、第２図に示すフローチャートに基づき作用を説明
する。
する。
ＲＡＮ ２に、キーボードｌのキー操作順に、コードＡ
、Ｂ、Ｃ，Ｄ、Ｅの順に格納したものとする（ＳＴＥＰ
−１，２） この場合、このままコードを読み出すと、コードＡ、Ｂ
、Ｃ，Ｄ、Ｅの順に読み出される。
、Ｂ、Ｃ，Ｄ、Ｅの順に格納したものとする（ＳＴＥＰ
−１，２） この場合、このままコードを読み出すと、コードＡ、Ｂ
、Ｃ，Ｄ、Ｅの順に読み出される。
いま、コードをＡ、Ｃ，Ｂ、Ｅ、Ｄの順に読み出そうと
すると、１番目に読み出すコードをＲＡ）１３に格納す
るに当って、キー４を操作すると（８ＴＥＰ−３）、Ｒ
ＡＭ２カラ＝＋−ドＡが読み出すレル（ＳＴＥＰ−４，
５）、このとき、ディスプレイ６には、コードＡが表示
される（ＳＴＩＥＰ−Ｅｉ）、そこで、操作者はディス
プレイ６に表示されたコードＡは最初に読み出すコード
であるか否かを判断する。コードＡは最初に読み出すコ
ードであるため、操作者はキー７を操作しく５ＴＨＰ−
７）、このコードＡをＲＡ）！ ３に格納する（８ＴＥ
Ｐ−８）。
すると、１番目に読み出すコードをＲＡ）１３に格納す
るに当って、キー４を操作すると（８ＴＥＰ−３）、Ｒ
ＡＭ２カラ＝＋−ドＡが読み出すレル（ＳＴＥＰ−４，
５）、このとき、ディスプレイ６には、コードＡが表示
される（ＳＴＩＥＰ−Ｅｉ）、そこで、操作者はディス
プレイ６に表示されたコードＡは最初に読み出すコード
であるか否かを判断する。コードＡは最初に読み出すコ
ードであるため、操作者はキー７を操作しく５ＴＨＰ−
７）、このコードＡをＲＡ）！ ３に格納する（８ＴＥ
Ｐ−８）。
ついで、２番目に読み出すコードをＲＡＭ ３に格納す
るに当って、キー４を操作すると（ＳＴＥＰ−９，１０
） 、 ＲＡＭ ２からコードＢが読み出され（ＳＴＥ
Ｐ−５）、同時に、ニードＢがディスプレイ６に表示さ
れる（ＳＴＥＰ−８）、表示されたコードＢは、第２番
目に読み出すコードでないため（ＳＴＥＰ−７） 、操
作者は、再度、キー４を操作する（ＳＴＩ！Ｐ−９，１
０）。すると、 ＲＡＭ２からコードＣが読み出され（
ＳＴＥＰ−５）、コードＢがディスプレイ６から消えて
コードＣが表示される（ＳＴＥＰ−８）、コードＣは第
２番目に読み出すコードであるため、操作者は、キー７
を操作しく５ＴＥＰ−７）このコードＣをＲＡＭ ３に
書き込む（ＳＴＥＰ−８）。
るに当って、キー４を操作すると（ＳＴＥＰ−９，１０
） 、 ＲＡＭ ２からコードＢが読み出され（ＳＴＥ
Ｐ−５）、同時に、ニードＢがディスプレイ６に表示さ
れる（ＳＴＥＰ−８）、表示されたコードＢは、第２番
目に読み出すコードでないため（ＳＴＥＰ−７） 、操
作者は、再度、キー４を操作する（ＳＴＩ！Ｐ−９，１
０）。すると、 ＲＡＭ２からコードＣが読み出され（
ＳＴＥＰ−５）、コードＢがディスプレイ６から消えて
コードＣが表示される（ＳＴＥＰ−８）、コードＣは第
２番目に読み出すコードであるため、操作者は、キー７
を操作しく５ＴＥＰ−７）このコードＣをＲＡＭ ３に
書き込む（ＳＴＥＰ−８）。
さらに、第３番目に読み出すコードをＲＡＮ ３に格納
するに当って、キー４を操作すると（ＳＴＥＰ−９。
するに当って、キー４を操作すると（ＳＴＥＰ−９。
１０）、コードＤが読み出され（ＳＴＥＰ−５）、同時
に。
に。
ディスプレイ６にはコードＤが表示される（ＳＴＥＰ−
６）、コードＤは第３番目に読み出すコードでないため
（ＳＴＥＰ−７）、操作者は、再度キー４を操作するこ
とになる。再度キー４を操作すると、コードＥが読み出
され（ＳＴＥＰ−５） 、ディスプレイ６にコードＥが
表示される（ＳＴＥＰ−８）、コードＥは：５３番ｌ］
に読み出されるコードでないため（ＳＴＥＰ−７）、再
度キー４を操作する。この操作を操り返した後、今度は
、コードＢが読み出されると（８ＴＥＰ−５）、同時に
、ディスプレイ６にコードＢが表示される（８ＴＥＰ−
６）、コードＢは第３番目に読み出されるコードである
ため（８ＴＥＰ−７）、操作者は、キー７を操作する、
コードＢがＲＡＮ ３に格納される（８ＴＥＰ−８）。
６）、コードＤは第３番目に読み出すコードでないため
（ＳＴＥＰ−７）、操作者は、再度キー４を操作するこ
とになる。再度キー４を操作すると、コードＥが読み出
され（ＳＴＥＰ−５） 、ディスプレイ６にコードＥが
表示される（ＳＴＥＰ−８）、コードＥは：５３番ｌ］
に読み出されるコードでないため（ＳＴＥＰ−７）、再
度キー４を操作する。この操作を操り返した後、今度は
、コードＢが読み出されると（８ＴＥＰ−５）、同時に
、ディスプレイ６にコードＢが表示される（８ＴＥＰ−
６）、コードＢは第３番目に読み出されるコードである
ため（８ＴＥＰ−７）、操作者は、キー７を操作する、
コードＢがＲＡＮ ３に格納される（８ＴＥＰ−８）。
以後、同様にしてコードＥ、コードＤをＲＡＭ ３に書
き込む（ＳＴＥＰ−５〜５ＴＥＰ−１０）。
き込む（ＳＴＥＰ−５〜５ＴＥＰ−１０）。
従って、刺繍に当っては、まず、コードＡが付された運
針データがＣＰＵ １１により外部記憶装ご８から読み
出されてＲＡＭ ９に格納されるとともにこれから読み
出された運針データに基づいて刺繍機構１０がＣＰＩＪ
１１により制御され、刺繍が行なわれる。ついで、コ
ードＣ，Ｂ、Ｅ、Ｄが付された運針データがこの順に外
部記憶装２１８から読み出されてＲＡＭ ９に格納され
ることになる。刺繍は上記と同様にしてこれらの運針デ
ータに基づき、ＣＰＵ １１により刺繍機構１０を制御
して行なう。
針データがＣＰＵ １１により外部記憶装ご８から読み
出されてＲＡＭ ９に格納されるとともにこれから読み
出された運針データに基づいて刺繍機構１０がＣＰＩＪ
１１により制御され、刺繍が行なわれる。ついで、コ
ードＣ，Ｂ、Ｅ、Ｄが付された運針データがこの順に外
部記憶装２１８から読み出されてＲＡＭ ９に格納され
ることになる。刺繍は上記と同様にしてこれらの運針デ
ータに基づき、ＣＰＵ １１により刺繍機構１０を制御
して行なう。
キー登録のコードをキー４操作時に、読み出されないよ
うに、 ５ＴＥＰ−１０につづいて、キー登録判断およ
びそれに伴なう処理を行なうようにしてもよい。
うに、 ５ＴＥＰ−１０につづいて、キー登録判断およ
びそれに伴なう処理を行なうようにしてもよい。
この発明は、上記のような構成としたため、デ−夕等を
新しく書き直さずに、メモリからの読み出し順序を変更
できるという効果がある。
新しく書き直さずに、メモリからの読み出し順序を変更
できるという効果がある。
第１図はこの発明の一実施例を示す図、第２図は動作フ
ローチャートである。 図において、１はキーボード、２，３はＲＡＭ、４はキ
ー、５はＣＰＵ 、 ６はディスプレイ、７はキーであ
る。 出 願 人 東京重機工Ｘ株式会社 第１図
ローチャートである。 図において、１はキーボード、２，３はＲＡＭ、４はキ
ー、５はＣＰＵ 、 ６はディスプレイ、７はキーであ
る。 出 願 人 東京重機工Ｘ株式会社 第１図
Claims (1)
- コード入力手段と、これにより入力されたコードを格納
する第１の格納手段と、この格納手段からコードを読み
出す読み出し手段と、読み出されたコードを読み出され
た順に１個づつ告知する告知手段と、告知されているコ
ードを第２の格納手段に書き込む書き込み手段とを備え
てなるメモリの格納順序変更装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60245684A JPS62105221A (ja) | 1985-10-31 | 1985-10-31 | メモリの格納順序変更装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60245684A JPS62105221A (ja) | 1985-10-31 | 1985-10-31 | メモリの格納順序変更装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62105221A true JPS62105221A (ja) | 1987-05-15 |
Family
ID=17137273
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60245684A Pending JPS62105221A (ja) | 1985-10-31 | 1985-10-31 | メモリの格納順序変更装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62105221A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57137960A (en) * | 1981-02-20 | 1982-08-25 | Casio Comput Co Ltd | Electronic interpreter |
| JPS59154529A (ja) * | 1983-02-22 | 1984-09-03 | Ricoh Co Ltd | データ入力装置 |
-
1985
- 1985-10-31 JP JP60245684A patent/JPS62105221A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57137960A (en) * | 1981-02-20 | 1982-08-25 | Casio Comput Co Ltd | Electronic interpreter |
| JPS59154529A (ja) * | 1983-02-22 | 1984-09-03 | Ricoh Co Ltd | データ入力装置 |
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