JPS62114536U - - Google Patents
Info
- Publication number
- JPS62114536U JPS62114536U JP1986000974U JP97486U JPS62114536U JP S62114536 U JPS62114536 U JP S62114536U JP 1986000974 U JP1986000974 U JP 1986000974U JP 97486 U JP97486 U JP 97486U JP S62114536 U JPS62114536 U JP S62114536U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- input data
- circuit
- selection
- delay
- Prior art date
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- Pending
Links
- 230000003111 delayed effect Effects 0.000 claims 2
- 230000001934 delay Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Information Transfer Systems (AREA)
- Pulse Circuits (AREA)
Description
第１図は本考案に係る信号シフト回路ブロツク
図、第２図は従来の信号シフト回路ブロツク図、
第３図ａ，ｂ，ｃは第１図図示ブロツク図の詳細
回路図である。 １……信号選択回路、２……信号遅延指示回路
、３……信号遅延回路。
図、第２図は従来の信号シフト回路ブロツク図、
第３図ａ，ｂ，ｃは第１図図示ブロツク図の詳細
回路図である。 １……信号選択回路、２……信号遅延指示回路
、３……信号遅延回路。
Claims (1)
- セレクト信号に同期してデータバスのデータ信
号をラツチ・解読し、遅延すべき入力データの選
択を指示する入力データ選択信号と遅延時間の設
定を指示する遅延指示信号を出力する信号遅延指
示回路と、上記入力データ選択信号に従つて入力
データを選択し、該入力データを信号遅延回路に
出力すると共に、該信号遅延回路より出力される
遅延データ信号を出力ラインを介して出力される
信号選択回路と、該信号選択回路より出力された
上記入力データを上記遅延指示信号に従つて遅延
させると共に、上記信号選択回路へ出力する信号
遅延回路とを有することを特徴とする信号遅延回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1986000974U JPS62114536U (ja) | 1986-01-08 | 1986-01-08 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1986000974U JPS62114536U (ja) | 1986-01-08 | 1986-01-08 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62114536U true JPS62114536U (ja) | 1987-07-21 |
Family
ID=30778445
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1986000974U Pending JPS62114536U (ja) | 1986-01-08 | 1986-01-08 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62114536U (ja) |
-
1986
- 1986-01-08 JP JP1986000974U patent/JPS62114536U/ja active Pending