JPS62119893A - 制御系の帰還方式 - Google Patents
制御系の帰還方式Info
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- JPS62119893A JPS62119893A JP26041885A JP26041885A JPS62119893A JP S62119893 A JPS62119893 A JP S62119893A JP 26041885 A JP26041885 A JP 26041885A JP 26041885 A JP26041885 A JP 26041885A JP S62119893 A JPS62119893 A JP S62119893A
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- Japan
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- circuit
- control system
- control
- timing
- input power
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- Pending
Links
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- 238000010586 diagram Methods 0.000 description 6
- 230000006698 induction Effects 0.000 description 5
- 230000004043 responsiveness Effects 0.000 description 5
- 238000006243 chemical reaction Methods 0.000 description 4
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- 238000013459 approach Methods 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 2
- FBOUIAKEJMZPQG-AWNIVKPZSA-N (1E)-1-(2,4-dichlorophenyl)-4,4-dimethyl-2-(1,2,4-triazol-1-yl)pent-1-en-3-ol Chemical compound C1=NC=NN1/C(C(O)C(C)(C)C)=C/C1=CC=C(Cl)C=C1Cl FBOUIAKEJMZPQG-AWNIVKPZSA-N 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
イ）産業上の利用分野
本発明は出力を設定値に等しくする制御を行う制御系の
帰還方式に関する。
帰還方式に関する。
口）従来の技術
従来、出力値を設定値に等しくするように制御を行う電
気機器の制御系Ｉ：おいてはタイミングｔ（：おける設
定値をＲ（ｔｌ 、出力をＰ ｌｔｌ 、調節要素をＴ
（ｔｌとすると１次のタイミングの調節要素Ｔ（ｔｌ
１）を Ｔ（ｔｌ１）雪Ｔ（ｔｔｌ （Ｒ（ｔｌ−Ｐ［ｔｌ １
ハ）発明が解決しようとする問題点 ところで、このような制御方式Ｃ−あってはΔＰが大々
い状態では応答性が良いが不安定な制御（：なる。一方
ΔＰが小さいと制御の安定性はあるが応答性に欠ける。
気機器の制御系Ｉ：おいてはタイミングｔ（：おける設
定値をＲ（ｔｌ 、出力をＰ ｌｔｌ 、調節要素をＴ
（ｔｌとすると１次のタイミングの調節要素Ｔ（ｔｌ
１）を Ｔ（ｔｌ１）雪Ｔ（ｔｔｌ （Ｒ（ｔｌ−Ｐ［ｔｌ １
ハ）発明が解決しようとする問題点 ところで、このような制御方式Ｃ−あってはΔＰが大々
い状態では応答性が良いが不安定な制御（：なる。一方
ΔＰが小さいと制御の安定性はあるが応答性に欠ける。
ところで、こうした制御系を用いた電気機器においては
、制御の開始時には出力Ｐを設定値に速く近づけるため
応答性を良くしなければならず、他方、出力Ｐが設定値
ＲＣ近すいた状態では制御の安定・Ｆ生が必要であった
。
、制御の開始時には出力Ｐを設定値に速く近づけるため
応答性を良くしなければならず、他方、出力Ｐが設定値
ＲＣ近すいた状態では制御の安定・Ｆ生が必要であった
。
二）問題点を解決するための手段
本発明はこのような点に鑑みて為されたもので。
タイミングｔにおける設定値１Ｒ（ｔ）、出力ｅＰｌｔ
＋。
＋。
藺節要素をＴ ｌｔｌとしたとき１次のタイミングの調
節要素Ｔ（ｔｌ１）を Ｔ（ｔｌ１）冨Ｔ（Ｉｌｌ （Ｒ（ｔｌ−Ｐ（ｔｌ １
／Ｎで定めるとともに上記Ｎ（＞０）を可変調整して
いる。
節要素Ｔ（ｔｌ１）を Ｔ（ｔｌ１）冨Ｔ（Ｉｌｌ （Ｒ（ｔｌ−Ｐ（ｔｌ １
／Ｎで定めるとともに上記Ｎ（＞０）を可変調整して
いる。
ホ）作 用
応答性及び安定性のともに秀れた制御系の帰還方式が提
供される。
供される。
へ）実施例
第１図は本発明方式を利用した誘導加熱調理器の制御回
路のブロック図、第２因はこの制御回路で制御されるＮ
４加熱調理器のインバータ回路図を示す。これ等の図に
おいて、（１）は交流電源、（２）は全波整流回路、（
３）はチョークコイル、（４１はバイパスコンデンサ、
（５）は誘棉加熱コイル、（６）は共振コンダンｆ、（
７１はスイッチングトランジスタ、（８）はダンパーダ
イオード、（９）はこのインバータへの交流入力電流を
検出するカレントトランスである。
路のブロック図、第２因はこの制御回路で制御されるＮ
４加熱調理器のインバータ回路図を示す。これ等の図に
おいて、（１）は交流電源、（２）は全波整流回路、（
３）はチョークコイル、（４１はバイパスコンデンサ、
（５）は誘棉加熱コイル、（６）は共振コンダンｆ、（
７１はスイッチングトランジスタ、（８）はダンパーダ
イオード、（９）はこのインバータへの交流入力電流を
検出するカレントトランスである。
（ＩＱは上記カレントトランス（９）からの入力電流を
整流平滑して検出入力電力とする入力電力検出回路。
整流平滑して検出入力電力とする入力電力検出回路。
（Ｉｌｌは入力電力のレベルを設定するレベル設定手段
。
。
０別３は夫々上記入力電力検出回路（１■及びレベル設
定手段に結ばれたアナログスイッチ、 （１４１はこれ
等のアナログスイッチｆｉ３Ｇ３ に結ばれたＡ ／
Ｄ変換回路であってタイミングｔにおいて上記、入力電
力検出回路ｕＩＪでの検出入力電力をデジタル値Ｐ ［
ｔｌに又、レベル設定手段α１での設定レベルをデジタ
ル値Ｒ（ｔ）に変換する。尚、このＡ ／ Ｄ変換は父
流電＃（１）の半波又はその整数倍のｎ期でサイクリッ
クに行われる。α翻９は夫々入力電力Ｐａ１１及び設定
値Ｒ（ｔｌをラッチするラッチ回路、σｅは上記ラッチ
回路ａ４α９からＲ（ｔ）、 Ｐ（ｔｌ’ｅ受け、 Ｒ
ｌｔｌ−Ｐｌｔ）全算出する減算回路、 （１７）は減
算回路αｅから与えられる減算値Ｒ（ｔ） −Ｐ （ｔ
）をＮ（＞０）で割る割算回路、（ｌ咎は上記除算回路
ｒ１Ｄへ与えるＮの値を可変制御する割算制御回路、
（１９は上記割算回路α印から（Ｒ（ｔｌ−Ｐ （ｔｌ
） ／ Ｎを受ける加算回路を示し、その出力Ｔ（ｔ
ｌ１）は次のＡ／ＤＫ換タイミングまでの上記スイッチ
ングトランジスタ（７）のＯＮ時間長として、ＯＮ、Ｏ
ＦＦ制御回路回路群えられる。またこの加算回路０から
の出力は保持回路ＣＩ！１１ζ：与えられ、上記Ｒ（Ｔ
、ｌとＰ ［１−１のサンプリングの１タイミング時間
だけ保持されて加算回路α９へ戻されるようになってい
る。この丸め、加算回路ａｌＩｆｉＴ （ｔ ＋１ ）
−Ｔ（Ｉｌｌ （Ｒ（ｔｌ −Ｐ（を目／Ｎを新喪な
スイッチングトランジスタ（７）の０８時間−として算
出している。これかられかるように設定値Ｒ（ｔ）が入
力電力ｐ（ｔはシ大きいときはＯＮ時間データＴ（ｔｌ
１）は増加するように設定され、ＯＮ、ＯＦＦ制御回路
■がこのＴ（ｔｌ１）に基いてスイッチングトランジス
タ（７）の０８時間が長くなるようスイッチング制御を
する。従って、入力電力Ｐ Ｆｌも増加する。一方、設
定値Ｒ（ｔｌが入力電力Ｐ （ｔｌより小さいときはＴ
（ｔｌ１）は減少するよう設定さ詐。
定手段に結ばれたアナログスイッチ、 （１４１はこれ
等のアナログスイッチｆｉ３Ｇ３ に結ばれたＡ ／
Ｄ変換回路であってタイミングｔにおいて上記、入力電
力検出回路ｕＩＪでの検出入力電力をデジタル値Ｐ ［
ｔｌに又、レベル設定手段α１での設定レベルをデジタ
ル値Ｒ（ｔ）に変換する。尚、このＡ ／ Ｄ変換は父
流電＃（１）の半波又はその整数倍のｎ期でサイクリッ
クに行われる。α翻９は夫々入力電力Ｐａ１１及び設定
値Ｒ（ｔｌをラッチするラッチ回路、σｅは上記ラッチ
回路ａ４α９からＲ（ｔ）、 Ｐ（ｔｌ’ｅ受け、 Ｒ
ｌｔｌ−Ｐｌｔ）全算出する減算回路、 （１７）は減
算回路αｅから与えられる減算値Ｒ（ｔ） −Ｐ （ｔ
）をＮ（＞０）で割る割算回路、（ｌ咎は上記除算回路
ｒ１Ｄへ与えるＮの値を可変制御する割算制御回路、
（１９は上記割算回路α印から（Ｒ（ｔｌ−Ｐ （ｔｌ
） ／ Ｎを受ける加算回路を示し、その出力Ｔ（ｔ
ｌ１）は次のＡ／ＤＫ換タイミングまでの上記スイッチ
ングトランジスタ（７）のＯＮ時間長として、ＯＮ、Ｏ
ＦＦ制御回路回路群えられる。またこの加算回路０から
の出力は保持回路ＣＩ！１１ζ：与えられ、上記Ｒ（Ｔ
、ｌとＰ ［１−１のサンプリングの１タイミング時間
だけ保持されて加算回路α９へ戻されるようになってい
る。この丸め、加算回路ａｌＩｆｉＴ （ｔ ＋１ ）
−Ｔ（Ｉｌｌ （Ｒ（ｔｌ −Ｐ（を目／Ｎを新喪な
スイッチングトランジスタ（７）の０８時間−として算
出している。これかられかるように設定値Ｒ（ｔ）が入
力電力ｐ（ｔはシ大きいときはＯＮ時間データＴ（ｔｌ
１）は増加するように設定され、ＯＮ、ＯＦＦ制御回路
■がこのＴ（ｔｌ１）に基いてスイッチングトランジス
タ（７）の０８時間が長くなるようスイッチング制御を
する。従って、入力電力Ｐ Ｆｌも増加する。一方、設
定値Ｒ（ｔｌが入力電力Ｐ （ｔｌより小さいときはＴ
（ｔｌ１）は減少するよう設定さ詐。
□スイッチングトランジスタ（７）のＯＮ時間長が短く
なり、入力電力ｐ ｔｔ＋が減少するよう作用する。
なり、入力電力ｐ ｔｔ＋が減少するよう作用する。
このような制御系において設定レベルＲ（ｔｌが一定で
あるとしてＮが １ のとき（Ｑ印）、Ｎが２ のとき
（×印〕、Ｎが 牛 のとき（Ａ印）、について入力電
力ｐ （ｔｌの変化を見る第３図のようになる。これか
られかるように、Ｎが小さいとき、勢入力電力ｐ （ｔ
ｌの応答性は良いが、安定性が悪い。一方、Ｎが大きい
とき入力電力ｐ （ｔ）の応答性は悪いが安定性は良い
。
あるとしてＮが １ のとき（Ｑ印）、Ｎが２ のとき
（×印〕、Ｎが 牛 のとき（Ａ印）、について入力電
力ｐ （ｔｌの変化を見る第３図のようになる。これか
られかるように、Ｎが小さいとき、勢入力電力ｐ （ｔ
ｌの応答性は良いが、安定性が悪い。一方、Ｎが大きい
とき入力電力ｐ （ｔ）の応答性は悪いが安定性は良い
。
このため割算制御回路α♂としては動作開始後所定時間
計時するタイマを付設しておき、このタイマ期間中はＮ
は例えばＮ＝２と云うようＩ：小さくしておき、立ち上
がりの応答性を良くするとともに、所定時間後に、Ｎを
例えばＮ−４と大きくしてＰ ｌｔ）の変動を少くし、
安定性を得るよう（：すると良い。
計時するタイマを付設しておき、このタイマ期間中はＮ
は例えばＮ＝２と云うようＩ：小さくしておき、立ち上
がりの応答性を良くするとともに、所定時間後に、Ｎを
例えばＮ−４と大きくしてＰ ｌｔ）の変動を少くし、
安定性を得るよう（：すると良い。
また割算制御回路αυとしてはＲ［ｔｌとｐ （ｔ）の
差を見てこの差Ｒ（ｔＪ−ｐ（を肋絶対値ｌ Ｒ（ｔｌ
−Ｐ（ｔｌ ｌが所定の基準値Ｍ（＞Ｏ）より大きいと
きＮ−２とＮの値を大きくしてＰ（ｔｌがＲ（ｔｌに速
く近づくようにするととも（：、ｌ Ｒ（ｔｌ −Ｐｌ
ｔｌ ｌが上記Ｖより小くなったときＮ＝４とＮの値を
小さくしてＰ ｌｔｌが安定した状態で制御されるよう
にすることも考えられる。
差を見てこの差Ｒ（ｔＪ−ｐ（を肋絶対値ｌ Ｒ（ｔｌ
−Ｐ（ｔｌ ｌが所定の基準値Ｍ（＞Ｏ）より大きいと
きＮ−２とＮの値を大きくしてＰ（ｔｌがＲ（ｔｌに速
く近づくようにするととも（：、ｌ Ｒ（ｔｌ −Ｐｌ
ｔｌ ｌが上記Ｖより小くなったときＮ＝４とＮの値を
小さくしてＰ ｌｔｌが安定した状態で制御されるよう
にすることも考えられる。
（ト）発明の効果
以上述べた如く本発明制御系の帰還方式はタイミング尤
における設定値’ｅＲｔｔ）、出力をｐ （ｔｌ 、調
節要素を’ｒ ［ｔｌとし九とき１次のタイミングのｔ
ＩＡｗＪ要素’ｌ’（ｔｅｌ ）を Ｔ （ｔ ＋ １）＝Ｔ（ｔｌ＋ （ｎＦ＋−ｐ（ｔｌ
）／Ｎで定めるとともに上記Ｎ（ンＯ）を可変―整して
いるので、応答性の必要な制御動作と安定性が必要な制
御動作が自在に選択され、制御範囲の拡大。
における設定値’ｅＲｔｔ）、出力をｐ （ｔｌ 、調
節要素を’ｒ ［ｔｌとし九とき１次のタイミングのｔ
ＩＡｗＪ要素’ｌ’（ｔｅｌ ）を Ｔ （ｔ ＋ １）＝Ｔ（ｔｌ＋ （ｎＦ＋−ｐ（ｔｌ
）／Ｎで定めるとともに上記Ｎ（ンＯ）を可変―整して
いるので、応答性の必要な制御動作と安定性が必要な制
御動作が自在に選択され、制御範囲の拡大。
汎用性の向上が望める。
第１図は本発明制御系の帰還方式を利用した誘導加熱調
理器の制御回路のブロック図、第２図は誘導加熱調理器
のインバータ回路の回路図、第３図は誘導加熱調理器の
入力電力の変化状態を示す特性図である。 （１）・・・交流電源、（２）・・・全波整流回路、（
５）・・・誘導加熱コイル、 （６１・・・共振コンデ
ンサ、 （７）・・・スイッチングトランジスタ、（９
）・・・カレントトランス、α〔・・・入力電力検出回
路、σＤ・・・レベル設定手段、 ａ４１ｔｔｓ・・・
ラッチ回路、（１ｅ・・・減算回路、Ｃ１η・・・割算
回路、住岨・・割算制御回路、 ＣＩ’ｌｌ・・・加算
回路、翰・・・ＯＮ、ＯＦＦ’制御回路、（２Ｉｌ・・
・保持回路。
理器の制御回路のブロック図、第２図は誘導加熱調理器
のインバータ回路の回路図、第３図は誘導加熱調理器の
入力電力の変化状態を示す特性図である。 （１）・・・交流電源、（２）・・・全波整流回路、（
５）・・・誘導加熱コイル、 （６１・・・共振コンデ
ンサ、 （７）・・・スイッチングトランジスタ、（９
）・・・カレントトランス、α〔・・・入力電力検出回
路、σＤ・・・レベル設定手段、 ａ４１ｔｔｓ・・・
ラッチ回路、（１ｅ・・・減算回路、Ｃ１η・・・割算
回路、住岨・・割算制御回路、 ＣＩ’ｌｌ・・・加算
回路、翰・・・ＯＮ、ＯＦＦ’制御回路、（２Ｉｌ・・
・保持回路。
Claims (1)
- 【特許請求の範囲】 １）所定のタイミングで設定値Ｒと出力Ｐとを順次比較
しながらＰを変更せしめるための調節要素Ｔを変更し、
新たに得られる出力を設定値Ｒに近ずける制御系におい
て、タイミングｔにおける設定値をＲ（ｔ）、出力をＰ
（ｔ）、調節要素をＴ（ｔ）としたとき、次のタイミン
グｔ＋１の調節要素Ｔ（ｔ＋１）を Ｔ（ｔ＋１）＝Ｔ（ｔ）＋｛Ｒ（ｔ）−Ｐ（ｔ）｝／Ｎ
と云う関係で設定するとともに、上記Ｎ（＞０）を各タ
イミングに応じて調節して成る制御系の帰還方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26041885A JPS62119893A (ja) | 1985-11-20 | 1985-11-20 | 制御系の帰還方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26041885A JPS62119893A (ja) | 1985-11-20 | 1985-11-20 | 制御系の帰還方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62119893A true JPS62119893A (ja) | 1987-06-01 |
Family
ID=17347659
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26041885A Pending JPS62119893A (ja) | 1985-11-20 | 1985-11-20 | 制御系の帰還方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62119893A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS576902A (en) * | 1980-06-16 | 1982-01-13 | Omron Tateisi Electronics Co | Temperature controller |
| JPS5854409A (ja) * | 1981-09-28 | 1983-03-31 | Yokogawa Hokushin Electric Corp | ヒ−タ温度制御装置 |
| JPS60170185A (ja) * | 1984-02-13 | 1985-09-03 | 三洋電機株式会社 | 誘導加熱装置 |
-
1985
- 1985-11-20 JP JP26041885A patent/JPS62119893A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS576902A (en) * | 1980-06-16 | 1982-01-13 | Omron Tateisi Electronics Co | Temperature controller |
| JPS5854409A (ja) * | 1981-09-28 | 1983-03-31 | Yokogawa Hokushin Electric Corp | ヒ−タ温度制御装置 |
| JPS60170185A (ja) * | 1984-02-13 | 1985-09-03 | 三洋電機株式会社 | 誘導加熱装置 |
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