JPS6213146Y2 - - Google Patents
Info
- Publication number
- JPS6213146Y2 JPS6213146Y2 JP574380U JP574380U JPS6213146Y2 JP S6213146 Y2 JPS6213146 Y2 JP S6213146Y2 JP 574380 U JP574380 U JP 574380U JP 574380 U JP574380 U JP 574380U JP S6213146 Y2 JPS6213146 Y2 JP S6213146Y2
- Authority
- JP
- Japan
- Prior art keywords
- recorder
- signal
- memory
- axis
- converter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000003068 static effect Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 230000006870 function Effects 0.000 description 2
Landscapes
- Analogue/Digital Conversion (AREA)
- Recording Measured Values (AREA)
Description
【考案の詳細な説明】
本考案は、メモリーレコーダの改良に関するも
のである。
のである。
高速現象の記録などに好適な従来のメモリーレ
コーダを第１図に示す。すなわち、メモリーレコ
ーダは波形記憶装置１０とXY記録計２０より構
成されている。波形記憶装置１０は制御部１１、
アナログ・デイジタル変換器（以下AD変換器と
いう）１２、メモリー１３及びデイジタル・アナ
ログ変換器（以下DA変換器という）１４で構成
され、制御部１１の制御に基づきAD変換器１２
によりアナログ入力信号をデイジタル化してメモ
リー１３に記憶したのち、XY記録計２０に対し
制御部１１よりＸ軸入力に時間信号を与えると共
にDA変換器１４を経由して前記時間信号に関連
して入力信号データをメモリー１３から取り出し
てＹ軸入力に供給している。このようにして、高
速現象を高速でサンプルし記憶した後通常の記録
速度の記録計で入力信号を再生記録することがで
きるが、記録の忠実度が悪いという問題が有つ
た。すなわち、誤差を発生する要素として、AD
変換器１２，DA変換器１４及び記録計２０の３
種類もあるため、静的な誤差がこの３要素の静的
誤差の和となる。更に、波形記憶装置からの信号
の出力がXY記録計の動特性とは無関係に行なわ
れるために、記録計２０の動的誤差が記録に現わ
れる。更にまた、２種類の装置を組合せて使用す
るために操作が容易でないなどの欠点があつた。
コーダを第１図に示す。すなわち、メモリーレコ
ーダは波形記憶装置１０とXY記録計２０より構
成されている。波形記憶装置１０は制御部１１、
アナログ・デイジタル変換器（以下AD変換器と
いう）１２、メモリー１３及びデイジタル・アナ
ログ変換器（以下DA変換器という）１４で構成
され、制御部１１の制御に基づきAD変換器１２
によりアナログ入力信号をデイジタル化してメモ
リー１３に記憶したのち、XY記録計２０に対し
制御部１１よりＸ軸入力に時間信号を与えると共
にDA変換器１４を経由して前記時間信号に関連
して入力信号データをメモリー１３から取り出し
てＹ軸入力に供給している。このようにして、高
速現象を高速でサンプルし記憶した後通常の記録
速度の記録計で入力信号を再生記録することがで
きるが、記録の忠実度が悪いという問題が有つ
た。すなわち、誤差を発生する要素として、AD
変換器１２，DA変換器１４及び記録計２０の３
種類もあるため、静的な誤差がこの３要素の静的
誤差の和となる。更に、波形記憶装置からの信号
の出力がXY記録計の動特性とは無関係に行なわ
れるために、記録計２０の動的誤差が記録に現わ
れる。更にまた、２種類の装置を組合せて使用す
るために操作が容易でないなどの欠点があつた。
本考案は、このような欠点を一挙に解決し、高
速現象の忠実な記録が容易に得られるメモリーレ
コーダを実現しようとするものである。
速現象の忠実な記録が容易に得られるメモリーレ
コーダを実現しようとするものである。
以下図面を用いて、本考案を詳しく説明する。
第２図は本考案に係るメモリーレコーダの一実施
例を示す構成図である。第２図において、第１図
と同等部分には同一符号を付し、その説明は省略
する。２１はスイツチ、２２はプロセツサ、２３
は積分器である。プロセツサ２２は少なくとも制
御機能及び演算機能を有するもので、例えばマイ
クロプロセツサなどを使用するのが望ましい。ス
イツチ２１は、プロセツサ２２により制御駆動さ
れ、入力信号か又はXY記録計２０より出力され
るＹ軸位置信号のいづれかを選択してAD変換器
１２に導くようになつている。積分器２３は、プ
ロセツサ２２から送出される３位置信号を積分
し、記録計２０にＹ軸信号として供給するように
なつている。
第２図は本考案に係るメモリーレコーダの一実施
例を示す構成図である。第２図において、第１図
と同等部分には同一符号を付し、その説明は省略
する。２１はスイツチ、２２はプロセツサ、２３
は積分器である。プロセツサ２２は少なくとも制
御機能及び演算機能を有するもので、例えばマイ
クロプロセツサなどを使用するのが望ましい。ス
イツチ２１は、プロセツサ２２により制御駆動さ
れ、入力信号か又はXY記録計２０より出力され
るＹ軸位置信号のいづれかを選択してAD変換器
１２に導くようになつている。積分器２３は、プ
ロセツサ２２から送出される３位置信号を積分
し、記録計２０にＹ軸信号として供給するように
なつている。
このような構成における本考案の動作を次に説
明する。
明する。
(イ) 記憶動作時
プロセツサ２２からの指令により、スイツチ２
１は入力信号Viを選択し、AD変換器１２により
デイジタル信号に変換されたデータはメモリー１
３に順次記憶される。
１は入力信号Viを選択し、AD変換器１２により
デイジタル信号に変換されたデータはメモリー１
３に順次記憶される。
(ロ) 記録動作時
プロセツサ２２からの指令により、スイツチ２
１は記録計２０のＹ軸位置信号を選択し、AD変
換器１２でデイジタル化されたこのＹ軸位置信号
データはプロセツサ２２に導かれる。プロセツサ
２２は第３図に示すフローチヤートに従つて動作
する。すなわち、記録計２０に供給されるＸ軸信
号を初期値に設定する。次いで、メモリー１３か
ら記憶データDmを古い順に読み出し、Ｙ軸位置
データＤYとの大小を比較し、Dm＝ＤY′Dm＞Ｄ
Y′Dm＜ＤYにそれぞれ対応して、０，＋Ｖ，−Ｖ
なる電圧信号が３位置信号として積分器２３に与
えられる。したがつて、Dm＝ＤY以外の場合は
積分器２３の出力は正または負に一定の傾斜で変
化する。これによりＤYが変化しDm＝ＤYになつ
たとき積分器２３の入力は０となり出力は一定値
を維持する。続いて、Ｘ軸信号を所定の１ステツ
プ分だけ増加し、メモリー１３からデータの読み
出し回数をチエツクする。所定の回数に達しない
場合は、メモリー１３から順次のデータを読み出
し前述と同様の動作を繰り返す。
１は記録計２０のＹ軸位置信号を選択し、AD変
換器１２でデイジタル化されたこのＹ軸位置信号
データはプロセツサ２２に導かれる。プロセツサ
２２は第３図に示すフローチヤートに従つて動作
する。すなわち、記録計２０に供給されるＸ軸信
号を初期値に設定する。次いで、メモリー１３か
ら記憶データDmを古い順に読み出し、Ｙ軸位置
データＤYとの大小を比較し、Dm＝ＤY′Dm＞Ｄ
Y′Dm＜ＤYにそれぞれ対応して、０，＋Ｖ，−Ｖ
なる電圧信号が３位置信号として積分器２３に与
えられる。したがつて、Dm＝ＤY以外の場合は
積分器２３の出力は正または負に一定の傾斜で変
化する。これによりＤYが変化しDm＝ＤYになつ
たとき積分器２３の入力は０となり出力は一定値
を維持する。続いて、Ｘ軸信号を所定の１ステツ
プ分だけ増加し、メモリー１３からデータの読み
出し回数をチエツクする。所定の回数に達しない
場合は、メモリー１３から順次のデータを読み出
し前述と同様の動作を繰り返す。
なお、積分器２３が出力するランプ信号の傾斜
は、３位置信号の値Ｖと積分器の時定数で決る
が、この傾斜はXY記録計のＹ軸が応答できる範
囲に選定してある。また、Ｘ軸信号を増加させる
速度は、Ｘ軸が応答できる範囲に選定されてい
る。
は、３位置信号の値Ｖと積分器の時定数で決る
が、この傾斜はXY記録計のＹ軸が応答できる範
囲に選定してある。また、Ｘ軸信号を増加させる
速度は、Ｘ軸が応答できる範囲に選定されてい
る。
以上説明したように、本考案のメモリーレコー
ダによれば、同一のAD変換器を介して入力信号
とＹ軸位置信号とをデイジタル変換し比較してい
るので、記録結果の静的誤差としてはXY記録計
の静的誤差のみしか現われない。また、記録計に
与える信号の変化率を記録計の応答できる範囲内
に選定してあり、その上、記憶データとＹ軸位置
データとの一致を常に確認して記録するので、動
的記録誤差が記録結果に現われることもなく、高
速現象の忠実な記録が容易に得られる。
ダによれば、同一のAD変換器を介して入力信号
とＹ軸位置信号とをデイジタル変換し比較してい
るので、記録結果の静的誤差としてはXY記録計
の静的誤差のみしか現われない。また、記録計に
与える信号の変化率を記録計の応答できる範囲内
に選定してあり、その上、記憶データとＹ軸位置
データとの一致を常に確認して記録するので、動
的記録誤差が記録結果に現われることもなく、高
速現象の忠実な記録が容易に得られる。
第１図は従来のメモリーレコーダの構成図、第
２図は本考案に係るメモリーレコーダの一実施例
を示す構成図、第３図は第２図のメモリーレコー
ダの動作を説明するためのフローチヤートであ
る。 １２……AD変換器、１３……メモリー、２０
……XY記録計、２１……スイツチ、２２……プ
ロセツサ、２３……積分器。
２図は本考案に係るメモリーレコーダの一実施例
を示す構成図、第３図は第２図のメモリーレコー
ダの動作を説明するためのフローチヤートであ
る。 １２……AD変換器、１３……メモリー、２０
……XY記録計、２１……スイツチ、２２……プ
ロセツサ、２３……積分器。
Claims (1)
- プロセツサと、積分器と、前記プロセツサによ
りそれぞれ制御されるスイツチとAD変換器とメ
モリーとXY記録計を具備し、入力信号の記憶動
作時には前記スイツチにより入力信号を選択し前
記AD変換器を介してデイジタル化した入力信号
データを前記メモリーに順次記憶し、記録動作時
には前記スイツチによりXY記録計のＹ軸位置信
号を選択し前記AD変換器を介してデイジタル変
換した後メモリーから読み出された前記入力信号
データと大小比較を行ない、その比較結果に対応
した３位置信号を前記積分器で積分して得られた
信号を前記XY記録計のＹ軸に供給すると共にプ
ロセツサよりXY記録計のＸ軸にＸ軸信号を供給
するように構成したことを特徴とするメモリーレ
コーダ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP574380U JPS6213146Y2 (ja) | 1980-01-21 | 1980-01-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP574380U JPS6213146Y2 (ja) | 1980-01-21 | 1980-01-21 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS56109163U JPS56109163U (ja) | 1981-08-24 |
| JPS6213146Y2 true JPS6213146Y2 (ja) | 1987-04-04 |
Family
ID=29602409
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP574380U Expired JPS6213146Y2 (ja) | 1980-01-21 | 1980-01-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6213146Y2 (ja) |
-
1980
- 1980-01-21 JP JP574380U patent/JPS6213146Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS56109163U (ja) | 1981-08-24 |
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