JPS62145457A - Ｅｐｒｏｍ内蔵１チツプマイクロコンピユ−タ - Google Patents
Ｅｐｒｏｍ内蔵１チツプマイクロコンピユ−タInfo
- Publication number
- JPS62145457A JPS62145457A JP60288734A JP28873485A JPS62145457A JP S62145457 A JPS62145457 A JP S62145457A JP 60288734 A JP60288734 A JP 60288734A JP 28873485 A JP28873485 A JP 28873485A JP S62145457 A JPS62145457 A JP S62145457A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- address
- eprom
- clock signal
- built
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 6
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 1
Landscapes
- Microcomputers (AREA)
- Read Only Memory (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ｇＦＲＯＭを内蔵する１チツプマイクロコン
ビエータに関し、特に内部のプログラムカウンタから発
生されるアドレス信号を使用して。
ビエータに関し、特に内部のプログラムカウンタから発
生されるアドレス信号を使用して。
外部からＥＰＲＯＭにプログラムを書き込み、読み出し
する場合の、アドレス信号制御方式に関する。
する場合の、アドレス信号制御方式に関する。
従来、この種のＢＦ３０Ｍ内蔵１チツプマイクロコンビ
二一タは、外部エリプログラムデータを書き込み、読み
出しする場合に、第３図に示すように、外部クロック信
号４が内部クロック信号発生回路５を介して内部クロッ
ク信号６を発生する。
二一タは、外部エリプログラムデータを書き込み、読み
出しする場合に、第３図に示すように、外部クロック信
号４が内部クロック信号発生回路５を介して内部クロッ
ク信号６を発生する。
６はプログラムカウンタ７に入力してインクリメント動
作をさせ、ＥＰＲＯＭ ２のプログラムアドレス信号８
が７より発生される。またプログラムデータ信号はデー
タ信号線１とＦＲＯＭ制御回路２を通して、外部と２と
の書込み、読み出しされる。
作をさせ、ＥＰＲＯＭ ２のプログラムアドレス信号８
が７より発生される。またプログラムデータ信号はデー
タ信号線１とＦＲＯＭ制御回路２を通して、外部と２と
の書込み、読み出しされる。
上述した従来のＥＰＲＯＭ内蔵１チツプマイクロコンピ
ユータは、外部クロック信号によりインクリメント動作
をするプログラムカウンタの発生するアドレス信号を、
書き込み読み出し時に使用しているために、プログラム
カウンタ回路や、内部クロック信号発生回路が異なると
、アドレス信号が変化するのに必要ｄ外部クロック信号
が異なりでしまう。書き込み読み出し動作はアドレス信
号が決定された後、ＥＰＲＯＭのアドレスを変化させず
に行う必要がありＦＲＯＭライター側からの書き込み読
み出し動作が完了するまでは次のアドレス信号が発生し
ないように、外部クロック信号の供給を停止することが
必要となる。以上の理由によりアドレス信号が変化Ｔる
のに必要な外部クロック信号が異なるＥＰＲＯＭ内蔵１
チツプマイクロコンビ二−タ毎に外部クロック信号供給
数の異なるＦＲＯＭライターが要求され、共通なＦＲＯ
Ｍライターを使用することが不可能になるという欠点が
ある。
ユータは、外部クロック信号によりインクリメント動作
をするプログラムカウンタの発生するアドレス信号を、
書き込み読み出し時に使用しているために、プログラム
カウンタ回路や、内部クロック信号発生回路が異なると
、アドレス信号が変化するのに必要ｄ外部クロック信号
が異なりでしまう。書き込み読み出し動作はアドレス信
号が決定された後、ＥＰＲＯＭのアドレスを変化させず
に行う必要がありＦＲＯＭライター側からの書き込み読
み出し動作が完了するまでは次のアドレス信号が発生し
ないように、外部クロック信号の供給を停止することが
必要となる。以上の理由によりアドレス信号が変化Ｔる
のに必要な外部クロック信号が異なるＥＰＲＯＭ内蔵１
チツプマイクロコンビ二−タ毎に外部クロック信号供給
数の異なるＦＲＯＭライターが要求され、共通なＦＲＯ
Ｍライターを使用することが不可能になるという欠点が
ある。
本発明のＥＰＲＯＭ内蔵１チップマイクロコンビエータ
は、書き込み読み出し時において、外部クロック信号に
よりインクリメント動作をするプログラムカウンタの発
生するアドレス信号が変化Ｔる毎に外部にアドレス信号
が変化したことを示す信号を出力する回路を有している
。
は、書き込み読み出し時において、外部クロック信号に
よりインクリメント動作をするプログラムカウンタの発
生するアドレス信号が変化Ｔる毎に外部にアドレス信号
が変化したことを示す信号を出力する回路を有している
。
次に、本発明について図面を参照してｔｉｔ明する。
第１図は本発明の一実施例である。データ信号線１、Ｆ
ＲＯＭ制御回路２、ＤＦＲＯＭ３、外部クロック信号４
、内部クロック信号発生回路５、内部クロック信号６．
プログラムカウンタ７、プログラムアドレス・ｔＳ号８
の動作は第３図で説明しｔのと同じである。本発明にお
いては第３図にアドレス変化ｑ号発生回路９を付加する
ことにより、ＥＰＲ，ＯＭの書き込み、読み出し時には
、７より９へ８を出力し、９は８が変化する毎に外部ヘ
アドレス変化信号１０を出力Ｔる。
ＲＯＭ制御回路２、ＤＦＲＯＭ３、外部クロック信号４
、内部クロック信号発生回路５、内部クロック信号６．
プログラムカウンタ７、プログラムアドレス・ｔＳ号８
の動作は第３図で説明しｔのと同じである。本発明にお
いては第３図にアドレス変化ｑ号発生回路９を付加する
ことにより、ＥＰＲ，ＯＭの書き込み、読み出し時には
、７より９へ８を出力し、９は８が変化する毎に外部ヘ
アドレス変化信号１０を出力Ｔる。
第２図は第１図の４．８．１０の信号の関係を示すタイ
ムチャートである。外部クロック信号４が０発入力する
と、８はＡ、Ｂ、Ｃ，Ｄと変化をし、そのつど外部に１
０が出力される。
ムチャートである。外部クロック信号４が０発入力する
と、８はＡ、Ｂ、Ｃ，Ｄと変化をし、そのつど外部に１
０が出力される。
ＦＲＯＭ ライター側においては、１０を検出Ｔること
によりアドレス信号の変化をとらえることができ、１０
がでない時には４を供給し、ｌＯがでた時には４の供給
を停止し、書き込み読み出し動作をさせ、書き込み読み
出し動作完了後４を供給し次のアドレス信号を発生させ
る。
によりアドレス信号の変化をとらえることができ、１０
がでない時には４を供給し、ｌＯがでた時には４の供給
を停止し、書き込み読み出し動作をさせ、書き込み読み
出し動作完了後４を供給し次のアドレス信号を発生させ
る。
このような方式にするＣとになり、アドレス信号が変化
Ｔるのに必要な外部クロック信号が異なるｇＰｌ（、Ｏ
Ｍ内蔵１チップマイクロコンピュータ間に８いても共通
の２１０Ｍライターの使用が可能になる。
Ｔるのに必要な外部クロック信号が異なるｇＰｌ（、Ｏ
Ｍ内蔵１チップマイクロコンピュータ間に８いても共通
の２１０Ｍライターの使用が可能になる。
以上説明したように本発明は、外部よりプログラムデー
タを書き込み、読み出しする場合に、プログラムカウン
タの発生するアドレス信号が変化する毎に外部に信号を
供給する機能をもたせることにより、共通のＦＲＯＭラ
イターの使用を可能にし、ＰＲ，０Ｍライターの価格を
低減し、管理を容易にし、内部クロック回路の設計を自
由にできるＥＰＲＭ １チツプマイクロコンビーータを
供給でき、その効果は大である。
タを書き込み、読み出しする場合に、プログラムカウン
タの発生するアドレス信号が変化する毎に外部に信号を
供給する機能をもたせることにより、共通のＦＲＯＭラ
イターの使用を可能にし、ＰＲ，０Ｍライターの価格を
低減し、管理を容易にし、内部クロック回路の設計を自
由にできるＥＰＲＭ １チツプマイクロコンビーータを
供給でき、その効果は大である。
第１図は本発明のｇＰＲＯＭ内蔵１チップマイクロコン
ビエータの実施例を示す図、第２図は外部クロックとア
ドレス信号と、アドレス変化信号との関係図であり、第
３図は従来のＥＰＲＯＭ内蔵１チップマイクロコンピュ
ータの例を示す図である。 １・・・・・・ＤＡＴＡ信号線、２・・・・・・ｇＰＲ
ＯＭ制御回路、３・・・・・・ＢＰ凡ＯＭ、４・・・・
・・外部クロック信号、５・・・・・・内部りαツク信
号発生回路、６・・・・・・内部クロツク信号、７・・
・・・・プログラムカウンタ、８・・・・・・プログラ
ムアドレス信号、９・・・・・・アドレス変化信号発生
回路、１０・・・・・・アドレス変化信号。 ・、−１＼ 代理人 弁理士 内 原 晋、 ”′）箭 ｌ
図 筋２図 ８３凶
ビエータの実施例を示す図、第２図は外部クロックとア
ドレス信号と、アドレス変化信号との関係図であり、第
３図は従来のＥＰＲＯＭ内蔵１チップマイクロコンピュ
ータの例を示す図である。 １・・・・・・ＤＡＴＡ信号線、２・・・・・・ｇＰＲ
ＯＭ制御回路、３・・・・・・ＢＰ凡ＯＭ、４・・・・
・・外部クロック信号、５・・・・・・内部りαツク信
号発生回路、６・・・・・・内部クロツク信号、７・・
・・・・プログラムカウンタ、８・・・・・・プログラ
ムアドレス信号、９・・・・・・アドレス変化信号発生
回路、１０・・・・・・アドレス変化信号。 ・、−１＼ 代理人 弁理士 内 原 晋、 ”′）箭 ｌ
図 筋２図 ８３凶
Claims (1)
- ＥＰＲＯＭと、外部クロックにより通常インクリメン
ト動作し、前記ＥＰＲＯＭのアドレス信号を発生するプ
ログラムカウンタを搭載し、外部から前記ＥＰＲＯＭに
プログラムの書き込み、読み出しをする場合にアドレス
信号として、前記プログラムカウンタの発生するアドレ
ス信号を使用するＥＰＲＯＭ内蔵１チップマイクロコン
ピュータにおいて、前記の書き込み、読み出しの時に前
記アドレス信号が変化する毎に外部に前記アドレス信号
が変化したことを示す信号を供給する機能を有すること
を特徴とするＥＰＲＯＭ内蔵１チップマイクロコンピュ
ータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60288734A JPS62145457A (ja) | 1985-12-20 | 1985-12-20 | Ｅｐｒｏｍ内蔵１チツプマイクロコンピユ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60288734A JPS62145457A (ja) | 1985-12-20 | 1985-12-20 | Ｅｐｒｏｍ内蔵１チツプマイクロコンピユ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62145457A true JPS62145457A (ja) | 1987-06-29 |
Family
ID=17733995
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60288734A Pending JPS62145457A (ja) | 1985-12-20 | 1985-12-20 | Ｅｐｒｏｍ内蔵１チツプマイクロコンピユ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62145457A (ja) |
-
1985
- 1985-12-20 JP JP60288734A patent/JPS62145457A/ja active Pending
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