JPS6215829B2 - - Google Patents
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- Publication number
- JPS6215829B2 JPS6215829B2 JP56161584A JP16158481A JPS6215829B2 JP S6215829 B2 JPS6215829 B2 JP S6215829B2 JP 56161584 A JP56161584 A JP 56161584A JP 16158481 A JP16158481 A JP 16158481A JP S6215829 B2 JPS6215829 B2 JP S6215829B2
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- JP
- Japan
- Prior art keywords
- alarm
- circuit
- signal
- frequency
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- 239000002131 composite material Substances 0.000 claims description 6
- 230000010355 oscillation Effects 0.000 claims description 4
- 230000003111 delayed effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 3
- 230000014509 gene expression Effects 0.000 description 1
- 230000005236 sound signal Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G04—HOROLOGY
- G04G—ELECTRONIC TIME-PIECES
- G04G13/00—Producing acoustic time signals
- G04G13/02—Producing acoustic time signals at preselected times, e.g. alarm clocks
- G04G13/021—Details
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Electromechanical Clocks (AREA)
- Electric Clocks (AREA)
Description
【発明の詳細な説明】
本発明は、時刻表示手段が指針によるアナログ
表示部と電気光学的手段によつて構成されるアラ
ーム機能付き複合電子時計のアラーム制御回路に
関する。
表示部と電気光学的手段によつて構成されるアラ
ーム機能付き複合電子時計のアラーム制御回路に
関する。
アラーム機能付き複合電子時計は、低温時に電
源としての小型電池の内部抵抗が上昇する。この
ときアラームを鳴鐘すると、アラーム回路へ流れ
る大電流のため電池の電圧が低下する。また、ア
ラームと同時にアナログ表示部の駆動源としての
モーターを駆動しようとすると、電圧が低いため
モーターが動かない可能性がある。したがつて、
一般にアラーム制御回路はモーター駆動とアラー
ム駆動が同時に行なわれないようになつている。
しかし、従来のアラーム付電子時計は、アラーム
がチヤイム音やメロデイ音のようにいくつもの音
が連続して１つのブロツクを構成し、さまざまな
表現をしている場合、モーター駆動のため、その
連続した音の巾に区切りを入れると、聴感上、不
快感をユーザーに与えてしまい製品としては不完
全なものになつてしまう。また、アラーム音をモ
ーター駆動に同期させようとすると、デジタル時
計とアナログ時計の秒の運針にずれがあつた場合
デジタル時計のアラーム時刻が一致してから、最
大１秒間待たないと、アラームが鳴り始めない。
これは、精度の高い時計においては、時計の使用
上、イメージ上で大きなデイメリツトとなる。
源としての小型電池の内部抵抗が上昇する。この
ときアラームを鳴鐘すると、アラーム回路へ流れ
る大電流のため電池の電圧が低下する。また、ア
ラームと同時にアナログ表示部の駆動源としての
モーターを駆動しようとすると、電圧が低いため
モーターが動かない可能性がある。したがつて、
一般にアラーム制御回路はモーター駆動とアラー
ム駆動が同時に行なわれないようになつている。
しかし、従来のアラーム付電子時計は、アラーム
がチヤイム音やメロデイ音のようにいくつもの音
が連続して１つのブロツクを構成し、さまざまな
表現をしている場合、モーター駆動のため、その
連続した音の巾に区切りを入れると、聴感上、不
快感をユーザーに与えてしまい製品としては不完
全なものになつてしまう。また、アラーム音をモ
ーター駆動に同期させようとすると、デジタル時
計とアナログ時計の秒の運針にずれがあつた場合
デジタル時計のアラーム時刻が一致してから、最
大１秒間待たないと、アラームが鳴り始めない。
これは、精度の高い時計においては、時計の使用
上、イメージ上で大きなデイメリツトとなる。
本発明はかかる欠点を除去したもので、その目
的は、アナログ時計とデジタル時計の秒が完全に
同期していない場合でも、アナログ時計のモータ
ー駆動に影響を与えずに、デジタル時計のアラー
ム時刻が一致すると、ほとんど遅れないでアラー
ムが鳴り始めるアラーム付き複合電子時計のアラ
ーム制御回路を提供することにある。
的は、アナログ時計とデジタル時計の秒が完全に
同期していない場合でも、アナログ時計のモータ
ー駆動に影響を与えずに、デジタル時計のアラー
ム時刻が一致すると、ほとんど遅れないでアラー
ムが鳴り始めるアラーム付き複合電子時計のアラ
ーム制御回路を提供することにある。
以下実施例に基づいて本発明を詳しく説明す
る。第１図は本発明によるアラーム付き複合電子
時計のブロツク図である。１は基準信号を出力す
る発振回路、２はその基準信号を分周する分周回
路、３はアナログ部分周回路、４はモーター駆動
回路、５はモーター、６はデジタル部分周回路、
７はデジタルデコーダー、８は表示ドライバー、
９は表示部、１０はアラーム制御回路、１１はア
ラームドライバー、１２はスピーカーである。前
記時計は、ある分周段以降、デジタル部、アナロ
グ部に分かれ、単独な別時計を構成している。ス
ピーカ１２等の音響発生装置を制御する音響信号
を出力する１０のアラーム制御回路において、デ
ジタルのアラーム時刻が一致すると、チヤイム音
の信号を発生し、１２のスピーカーより、第２図
のような１秒を１ブロツクとしたチヤイム音が発
生する。縦軸は音圧、横軸は時間の経過を表わ
す。t1の区間は0.25秒で4096Hzを出力する。t2の
区間は0.75秒で3276.8Hzを出力する。t3は0.0625
秒、t4は0.5秒、t5は0.125秒、t6，t7はそれぞれ
0.0625秒である。このチヤイム音に注目すると１
３，１４，１５，１６の位置にモーターの駆動パ
ルス程度の休止区間を設けても、聴感上、ほとん
ど影響がないことがわかる。またこれは、実験に
よつても確認することができた。したがつて、本
時計の回路は、このチヤイム音の位置に休止区間
を設け、モーター駆動をするしくみになつてい
る。第３図はモーターの駆動タイミング、デジタ
ルのアラーム一致タイミングとアラームの鳴り始
めのタイミングを示したものである。ここで３５
は、モーター駆動パルスを示す。いまt8の区間
で、デジタル時計のアラーム時刻が一致し、アラ
ーム一致信号が出力されると１７の位置からアラ
ームがスタートする。つまり、第３図の１７の位
置から第２図にあるようなパターンのチヤイム音
が発せられる。すると、モーター駆動パルス３５
の位置には、第２図の１６のタイミングの位置が
重なるので、１６の位置にモーター駆動が入る。
以下同様にして、t9の区間でアラームが一致する
と１８でアラームがスタートし、１５の位置にモ
ーターの駆動が入る。t10の区間でアラームが一
致すると１９でアラームがスタートし、１４の位
置にモーターの駆動が入る。t11の区間でアラー
ムが一致すると２０でアラームがスタートし、１
３の位置にモーターの駆動が入る。したがつて、
アラーム一致後最大でも0.5秒遅れでアラームが
鳴り始める。第４図はアナログ部の分周信号とデ
ジタル部の分周信号よりアラームのスタート信号
を出力するアラーム制御回路の具体的な回路図で
ある。２１，２２，２３，２４はクロツクの立ち
下がりで出力データが変化する1/2分周回路、２
５，２６はAND回路、２７はOR回路、２８は
NOT回路、２９はデータ入力付き1/2分周回路、
３０はNOT回路、３１，３２，３３はNAND回
路、３４はAND回路である。S1はアナログ部の
８Hz信号、S2は同じく４Hz信号、S3は同じく２Hz
信号、S4は同じく１Hz信号である。S5はアラーム
スタートトリガー信号、S′5はデータ入力付き1/2
分周回路２９の出力信号、S6はデジタル部の１
Hzのキヤリー時の微分信号、S7はアナログ部の16
Hz信号、S8はアナログ部リセツト信号、S9はアラ
ーム一致信号、S10はアラーム鳴り命令信号、S11
はアラームスタート信号である。第５図は第４図
の回路のタイミングチヤートである。このタイミ
ングチヤートはアラームが一致してから0.125秒
でアラームが鳴り始める場合である。モーター駆
動はS4の立ち下がりに同期して行なわれている。
S9の信号が立ち上がり、デジタルのアラーム一致
を示すと、それと同時にS6の微分信号が出力さ
れ、２９の1/2分周回路をリセツトする。このと
きデータ入力付き1/2分周回路の出力であるS′5
は、論理レベルＨ（以下略してＨとする、同様に
論理レベルＬをＬと示す。）となる。次にS5の出
力がＨとなると、出力であるS′5はＨのままな
ので、S11の出力はＬとなる。そしてS5の出力が
Ｌとなると、出力であるS′5もVDDをデータと
してラツチするのでＬとなるので、S11の出力は
Ｈとなる。つまり、デジタル部からのアラーム一
致信号が出力されてから最初のS11の出力の立ち
上がりに同期してS10の出力がＨとなりアラーム
がスタートするのである。S10とS11はアラーム発
生回路に入力し、S11の信号がアラーム発生回路
の初期設定トリガー信号となり、S10がアラーム
の出力状態を示す信号となる。アラーム発生回路
では第２図のような信号が出力される。第５図の
場合はアラーム一致後0.125秒でアラームがスタ
ートし、第２図の１３の位置でモーター駆動が行
なわれる。したがつて、アラーム発生回路では第
２図の１３の部分のアラーム出力を休止したアラ
ーム信号が出力される。このアラーム発生回路
は、1/2分周回路、AND回路、OR回路とNOT回
路等によつて構成することができる。また第４図
の回路は本発明の一例であり、他の回路構成によ
つても、本発明の実施は可能である。チヤイム音
の他にもメロデイー等にも広く応用が可能であ
る。
る。第１図は本発明によるアラーム付き複合電子
時計のブロツク図である。１は基準信号を出力す
る発振回路、２はその基準信号を分周する分周回
路、３はアナログ部分周回路、４はモーター駆動
回路、５はモーター、６はデジタル部分周回路、
７はデジタルデコーダー、８は表示ドライバー、
９は表示部、１０はアラーム制御回路、１１はア
ラームドライバー、１２はスピーカーである。前
記時計は、ある分周段以降、デジタル部、アナロ
グ部に分かれ、単独な別時計を構成している。ス
ピーカ１２等の音響発生装置を制御する音響信号
を出力する１０のアラーム制御回路において、デ
ジタルのアラーム時刻が一致すると、チヤイム音
の信号を発生し、１２のスピーカーより、第２図
のような１秒を１ブロツクとしたチヤイム音が発
生する。縦軸は音圧、横軸は時間の経過を表わ
す。t1の区間は0.25秒で4096Hzを出力する。t2の
区間は0.75秒で3276.8Hzを出力する。t3は0.0625
秒、t4は0.5秒、t5は0.125秒、t6，t7はそれぞれ
0.0625秒である。このチヤイム音に注目すると１
３，１４，１５，１６の位置にモーターの駆動パ
ルス程度の休止区間を設けても、聴感上、ほとん
ど影響がないことがわかる。またこれは、実験に
よつても確認することができた。したがつて、本
時計の回路は、このチヤイム音の位置に休止区間
を設け、モーター駆動をするしくみになつてい
る。第３図はモーターの駆動タイミング、デジタ
ルのアラーム一致タイミングとアラームの鳴り始
めのタイミングを示したものである。ここで３５
は、モーター駆動パルスを示す。いまt8の区間
で、デジタル時計のアラーム時刻が一致し、アラ
ーム一致信号が出力されると１７の位置からアラ
ームがスタートする。つまり、第３図の１７の位
置から第２図にあるようなパターンのチヤイム音
が発せられる。すると、モーター駆動パルス３５
の位置には、第２図の１６のタイミングの位置が
重なるので、１６の位置にモーター駆動が入る。
以下同様にして、t9の区間でアラームが一致する
と１８でアラームがスタートし、１５の位置にモ
ーターの駆動が入る。t10の区間でアラームが一
致すると１９でアラームがスタートし、１４の位
置にモーターの駆動が入る。t11の区間でアラー
ムが一致すると２０でアラームがスタートし、１
３の位置にモーターの駆動が入る。したがつて、
アラーム一致後最大でも0.5秒遅れでアラームが
鳴り始める。第４図はアナログ部の分周信号とデ
ジタル部の分周信号よりアラームのスタート信号
を出力するアラーム制御回路の具体的な回路図で
ある。２１，２２，２３，２４はクロツクの立ち
下がりで出力データが変化する1/2分周回路、２
５，２６はAND回路、２７はOR回路、２８は
NOT回路、２９はデータ入力付き1/2分周回路、
３０はNOT回路、３１，３２，３３はNAND回
路、３４はAND回路である。S1はアナログ部の
８Hz信号、S2は同じく４Hz信号、S3は同じく２Hz
信号、S4は同じく１Hz信号である。S5はアラーム
スタートトリガー信号、S′5はデータ入力付き1/2
分周回路２９の出力信号、S6はデジタル部の１
Hzのキヤリー時の微分信号、S7はアナログ部の16
Hz信号、S8はアナログ部リセツト信号、S9はアラ
ーム一致信号、S10はアラーム鳴り命令信号、S11
はアラームスタート信号である。第５図は第４図
の回路のタイミングチヤートである。このタイミ
ングチヤートはアラームが一致してから0.125秒
でアラームが鳴り始める場合である。モーター駆
動はS4の立ち下がりに同期して行なわれている。
S9の信号が立ち上がり、デジタルのアラーム一致
を示すと、それと同時にS6の微分信号が出力さ
れ、２９の1/2分周回路をリセツトする。このと
きデータ入力付き1/2分周回路の出力であるS′5
は、論理レベルＨ（以下略してＨとする、同様に
論理レベルＬをＬと示す。）となる。次にS5の出
力がＨとなると、出力であるS′5はＨのままな
ので、S11の出力はＬとなる。そしてS5の出力が
Ｌとなると、出力であるS′5もVDDをデータと
してラツチするのでＬとなるので、S11の出力は
Ｈとなる。つまり、デジタル部からのアラーム一
致信号が出力されてから最初のS11の出力の立ち
上がりに同期してS10の出力がＨとなりアラーム
がスタートするのである。S10とS11はアラーム発
生回路に入力し、S11の信号がアラーム発生回路
の初期設定トリガー信号となり、S10がアラーム
の出力状態を示す信号となる。アラーム発生回路
では第２図のような信号が出力される。第５図の
場合はアラーム一致後0.125秒でアラームがスタ
ートし、第２図の１３の位置でモーター駆動が行
なわれる。したがつて、アラーム発生回路では第
２図の１３の部分のアラーム出力を休止したアラ
ーム信号が出力される。このアラーム発生回路
は、1/2分周回路、AND回路、OR回路とNOT回
路等によつて構成することができる。また第４図
の回路は本発明の一例であり、他の回路構成によ
つても、本発明の実施は可能である。チヤイム音
の他にもメロデイー等にも広く応用が可能であ
る。
以上のように、本発明は、デジタル部とアナロ
グ部が一致していない場合においても、アラーム
一致後、ほとんど時間的な遅れがなく、アラーム
が鳴り始める。しかも、チヤイム音等の音色に最
も影響の少ない部分にモーター駆動のためのアラ
ーム休止区間を入れるため、チヤイム音等の音色
も切れ目がなく、スムーズである等、すぐれた効
果を有するものである。
グ部が一致していない場合においても、アラーム
一致後、ほとんど時間的な遅れがなく、アラーム
が鳴り始める。しかも、チヤイム音等の音色に最
も影響の少ない部分にモーター駆動のためのアラ
ーム休止区間を入れるため、チヤイム音等の音色
も切れ目がなく、スムーズである等、すぐれた効
果を有するものである。
第１図は本発明によるアラーム付き複合電子時
計のブロツク図、第２図は本発明によるアラーム
音の一例、第３図は本発明によるモーターの駆動
タイミング、デジタルのアラーム一致のタイミン
グ、アラームの鳴り始めのタイミングを示した
図、第４図は本発明によるアラーム制御回路の具
体例、第５図は第４図のタイミングチヤートであ
る。 １…発振回路、２…分周回路、３…アナログ部
分周回路、４…モーター駆動回路、５…モータ
ー、６…デジタル部分周回路、７…デジタルデコ
ーダー、８…表示ドライバー、９…表示部、１０
…アラーム制御回路、１１…アラームドライバ
ー、１２…スピーカー、１３，１４，１５，１６
…チヤイム音の休止区間、１７，１８，１９，２
０…アラームの鳴り始め、２１，２２，２３，２
４…1/2分周回路、２５，２６…AND回路、２７
…OR回路、２８…NOT回路、２９…データ入力
付き1/2分周回路、３０…NOT回路、３１，３
２，３３…NAND回路、３４…AND回路、S1…
アナログ部の８Hz信号、S2…アナログ部の４Hz信
号、S3…アナログ部の２Hz信号、S4…アナログ部
の１Hz信号、S5…アラームスタートトリガ信号、
S6…デジタル部の１Hzの微分信号、S7…アナログ
部の16Hz信号、S8…アナログ部のリセツト信号、
S9…アラーム一致信号、S10…アラーム鳴り命令
信号。
計のブロツク図、第２図は本発明によるアラーム
音の一例、第３図は本発明によるモーターの駆動
タイミング、デジタルのアラーム一致のタイミン
グ、アラームの鳴り始めのタイミングを示した
図、第４図は本発明によるアラーム制御回路の具
体例、第５図は第４図のタイミングチヤートであ
る。 １…発振回路、２…分周回路、３…アナログ部
分周回路、４…モーター駆動回路、５…モータ
ー、６…デジタル部分周回路、７…デジタルデコ
ーダー、８…表示ドライバー、９…表示部、１０
…アラーム制御回路、１１…アラームドライバ
ー、１２…スピーカー、１３，１４，１５，１６
…チヤイム音の休止区間、１７，１８，１９，２
０…アラームの鳴り始め、２１，２２，２３，２
４…1/2分周回路、２５，２６…AND回路、２７
…OR回路、２８…NOT回路、２９…データ入力
付き1/2分周回路、３０…NOT回路、３１，３
２，３３…NAND回路、３４…AND回路、S1…
アナログ部の８Hz信号、S2…アナログ部の４Hz信
号、S3…アナログ部の２Hz信号、S4…アナログ部
の１Hz信号、S5…アラームスタートトリガ信号、
S6…デジタル部の１Hzの微分信号、S7…アナログ
部の16Hz信号、S8…アナログ部のリセツト信号、
S9…アラーム一致信号、S10…アラーム鳴り命令
信号。
Claims (1)
- １ 基準信号を出力する発振回路、該発振回路か
らの基準信号を分周する第１分周回路、該第１分
周回路からの出力信号を入力し、アナログ部の分
周をする第２分周回路、該第２分周回路からの出
力信号を入力し、モーターを駆動するモーター駆
動信号を出力するモーター駆動回路、前記第１分
周回路からの出力信号を入力し、デジタル部の分
周をする第３分周回路、アラーム鳴り命令信号を
入力し、音の鳴らない休止期間のあるアラーム音
を発生する音響発生装置、前記アラーム音を前記
休止期間が前記モーター駆動信号と一致したタイ
ミングで発生させるためのアラーム鳴り命令信号
を出力するアラーム制御回路を有し、該アラーム
制御回路は、前記第２分周回路からの出力信号を
入力し、前記アラーム音に設けられた休止期間を
前記モーター駆動信号と一致させるアラームスタ
ートトリガー信号を出力する第１のゲート回路
と、該第１のゲート回路からのアラームスタート
トリガー信号及び前記第３分周回路にもとづく時
刻信号を入力し、アラームスタート信号を出力す
る第２のゲート回路と、該第２のゲート回路から
のアラームスタート信号及び前記第３分周回路に
もとづくアラーム一致信号を入力し、前記アラー
ム一致信号を前記アラームスタート信号により遅
延させて前記アラーム鳴り命令信号を出力する第
３のゲート回路とを具備することを特徴とする複
合電子時計のアラーム制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56161584A JPS5862578A (ja) | 1981-10-09 | 1981-10-09 | 複合電子時計のアラ−ム制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56161584A JPS5862578A (ja) | 1981-10-09 | 1981-10-09 | 複合電子時計のアラ−ム制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5862578A JPS5862578A (ja) | 1983-04-14 |
| JPS6215829B2 true JPS6215829B2 (ja) | 1987-04-09 |
Family
ID=15737898
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56161584A Granted JPS5862578A (ja) | 1981-10-09 | 1981-10-09 | 複合電子時計のアラ−ム制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5862578A (ja) |
-
1981
- 1981-10-09 JP JP56161584A patent/JPS5862578A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5862578A (ja) | 1983-04-14 |
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