JPS6217849Y2 - - Google Patents
Info
- Publication number
- JPS6217849Y2 JPS6217849Y2 JP1982148703U JP14870382U JPS6217849Y2 JP S6217849 Y2 JPS6217849 Y2 JP S6217849Y2 JP 1982148703 U JP1982148703 U JP 1982148703U JP 14870382 U JP14870382 U JP 14870382U JP S6217849 Y2 JPS6217849 Y2 JP S6217849Y2
- Authority
- JP
- Japan
- Prior art keywords
- case
- memory unit
- control unit
- main body
- connector
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Feedback Control In General (AREA)
Description
【考案の詳細な説明】
本考案はメモリユニツトをコネクタにより取換
え可能なシーケンス制御装置に関し、その目的と
するところは、操作性が良く、プログラムの交換
が容易で、しかも静電破壊されない小型のシーケ
ンス制御装置を提供するにある。
え可能なシーケンス制御装置に関し、その目的と
するところは、操作性が良く、プログラムの交換
が容易で、しかも静電破壊されない小型のシーケ
ンス制御装置を提供するにある。
以下本考案の実施例について第１図乃至第３図
を参照し説明する。
を参照し説明する。
制御ユニツトＤは、本体Ａの絶縁器体の中央部
に入力回路２、出力回路４、電源回路７からなる
電子ブロツクを収納してあり、両側に入力端子１
と出力端子５が互いに反対側に対設してあり、
夫々入力回路２と出力回路４に接続してある。本
体Ａの端部の両端子の配置されない部位に囲壁で
かこんだくぼみＢを設け壁の一部に面取りＣを形
成して後述のメモリユニツト１０の差込方向が一
定となるようにしており、このくぼみＢの底部に
雄側の差込ピンを持つコネクタ３が設けてあり、
このコネクタ３は入、出力回路２，４に接続して
ある。
に入力回路２、出力回路４、電源回路７からなる
電子ブロツクを収納してあり、両側に入力端子１
と出力端子５が互いに反対側に対設してあり、
夫々入力回路２と出力回路４に接続してある。本
体Ａの端部の両端子の配置されない部位に囲壁で
かこんだくぼみＢを設け壁の一部に面取りＣを形
成して後述のメモリユニツト１０の差込方向が一
定となるようにしており、このくぼみＢの底部に
雄側の差込ピンを持つコネクタ３が設けてあり、
このコネクタ３は入、出力回路２，４に接続して
ある。
メモリユニツト１０は、Ｅ・Ｐ−ROM１２
（消去可能・再プログラム可能なROM）と雌側の
刃受ばねを持つコネクタ３′をケース１４内に収
納し、コネクタ３′をケース１４の開口部１１か
らのぞかせ、Ｅ・Ｐ−ROM１２の紫外線による
消去窓部分を、ケース１４の開口部１１′にのぞ
かせたもので、ケース１４には抜差し操作に便利
なようにつば１３が設けてあり、メモリユニツト
取出し時に本体Ａとのすき間１５に指や工具の入
るようにしてある。
（消去可能・再プログラム可能なROM）と雌側の
刃受ばねを持つコネクタ３′をケース１４内に収
納し、コネクタ３′をケース１４の開口部１１か
らのぞかせ、Ｅ・Ｐ−ROM１２の紫外線による
消去窓部分を、ケース１４の開口部１１′にのぞ
かせたもので、ケース１４には抜差し操作に便利
なようにつば１３が設けてあり、メモリユニツト
取出し時に本体Ａとのすき間１５に指や工具の入
るようにしてある。
また本体Ａには、レール取付孔８と盤取付用孔
９が設けてある。また入力端子１に並んで電源端
子６が配設せられている。
９が設けてある。また入力端子１に並んで電源端
子６が配設せられている。
しかしてメモリユニツト１０をコネクタ３，
３′を介して制御ユニツトＤに装着すれば、入力
端子１の起動端子１ａに起動信号を入れると、セ
ンサ入力信号によりメモリユニツト１０のプログ
ラムに従い出力回路４を介して出力端子５にシー
ケンス出力が出力される。また必要により任意の
ステツプで停止端子１ｂより停止信号を入力する
と停止する。尚１ｃは共通端子である。そして別
のメモリユニツト１０を差し換えるか或は開口部
１１′からの紫外線照射でプログラムを消去し、
図外ROMライタで新たなプログラムを書きこめ
る。このＥ・Ｐ−ROM１２は、この入、出力端
子を短絡回路で結んで自己保持回路を形成して、
より複雑な論理演算を可能としたものである。
３′を介して制御ユニツトＤに装着すれば、入力
端子１の起動端子１ａに起動信号を入れると、セ
ンサ入力信号によりメモリユニツト１０のプログ
ラムに従い出力回路４を介して出力端子５にシー
ケンス出力が出力される。また必要により任意の
ステツプで停止端子１ｂより停止信号を入力する
と停止する。尚１ｃは共通端子である。そして別
のメモリユニツト１０を差し換えるか或は開口部
１１′からの紫外線照射でプログラムを消去し、
図外ROMライタで新たなプログラムを書きこめ
る。このＥ・Ｐ−ROM１２は、この入、出力端
子を短絡回路で結んで自己保持回路を形成して、
より複雑な論理演算を可能としたものである。
コネクタ３′は刃受ばねの露出しないものなの
で手が触れることなく静電破壊されない。
で手が触れることなく静電破壊されない。
また雄側の差込ピンのコネクタ３も囲壁内なの
で変形からまもられ、メモリユニツト１０の挿脱
も囲壁にガイドされて滑らかでかつ差込ピンも変
形しない。更に両端子のない囲壁内につば１３つ
きメモリユニツト１０を挿脱するものであるから
操作が容易である。第３図はメモリユニツト１０
の本体Ａへの装着状態を示す。また装着時のメモ
リユニツト１０の上面は本体Ａの上端面と略同一
平面となつている。
で変形からまもられ、メモリユニツト１０の挿脱
も囲壁にガイドされて滑らかでかつ差込ピンも変
形しない。更に両端子のない囲壁内につば１３つ
きメモリユニツト１０を挿脱するものであるから
操作が容易である。第３図はメモリユニツト１０
の本体Ａへの装着状態を示す。また装着時のメモ
リユニツト１０の上面は本体Ａの上端面と略同一
平面となつている。
本考案は上述のように構成したメモリユニツト
の雌側コネクタを制御ユニツトの雄側コネクタに
接続してメモリユニツトのケースを制御ユニツト
の本体のくぼみ内に収納した状態で開口部内に向
いて閉じられるようにしてあるからROMにＥ・
Ｐ−ROMを使用している場合でも部外からの紫
外線入光によるプログラム破壊が生じず、しかも
メモリユニツトのケースがくぼみ内に収納される
から装置全体の大きさが取付メモリユニツトの装
着時においても嵩高とならず小型となり、ケース
の片側に形成せる開口部に雌側コネクタとプログ
ラムを記憶したROMとを対応させて制御ユニツ
トの雄側コネクタにメモリユニツトの雌側コネク
タを接続してケースをくぼみ内に収納した状態で
開口部が内方向に向いて閉じるようにするととも
に閉じた状態でメモリユニツトのケースの上端面
と制御ユニツトの本体の上端面とが略同一平面と
るようにケースを構成したから、メモリユニツト
のケースを制御ユニツトの本体に装着した際に制
御ユニツトとメモリユニツトとが一体的な外観を
呈することとなり、更にケースと本体との間で一
体感を呈する役割を果たすつばがメモリユニツト
を制御ユニツトから取り外す際の役割をも果たす
ことができるものであり、しかもケースが本体に
対して一体的な外観を呈していてもメモリユニツ
トを制御ユニツトから取り外す際にすき間を利用
してつば部位を押し上げる操作が容易に行えると
いう利点を有する。更にメモリユニツト側に雌側
コネクタを使用しているから刃受ばねが外部から
接触されないように絶縁器体中に収納されている
状態となつて、ROMが誤つて静電破壊される恐
れも少ないという利点がある。
の雌側コネクタを制御ユニツトの雄側コネクタに
接続してメモリユニツトのケースを制御ユニツト
の本体のくぼみ内に収納した状態で開口部内に向
いて閉じられるようにしてあるからROMにＥ・
Ｐ−ROMを使用している場合でも部外からの紫
外線入光によるプログラム破壊が生じず、しかも
メモリユニツトのケースがくぼみ内に収納される
から装置全体の大きさが取付メモリユニツトの装
着時においても嵩高とならず小型となり、ケース
の片側に形成せる開口部に雌側コネクタとプログ
ラムを記憶したROMとを対応させて制御ユニツ
トの雄側コネクタにメモリユニツトの雌側コネク
タを接続してケースをくぼみ内に収納した状態で
開口部が内方向に向いて閉じるようにするととも
に閉じた状態でメモリユニツトのケースの上端面
と制御ユニツトの本体の上端面とが略同一平面と
るようにケースを構成したから、メモリユニツト
のケースを制御ユニツトの本体に装着した際に制
御ユニツトとメモリユニツトとが一体的な外観を
呈することとなり、更にケースと本体との間で一
体感を呈する役割を果たすつばがメモリユニツト
を制御ユニツトから取り外す際の役割をも果たす
ことができるものであり、しかもケースが本体に
対して一体的な外観を呈していてもメモリユニツ
トを制御ユニツトから取り外す際にすき間を利用
してつば部位を押し上げる操作が容易に行えると
いう利点を有する。更にメモリユニツト側に雌側
コネクタを使用しているから刃受ばねが外部から
接触されないように絶縁器体中に収納されている
状態となつて、ROMが誤つて静電破壊される恐
れも少ないという利点がある。
第１図乃至第３図は本考案の実施例を示し、第
１図は分解斜視図、第２図は組立状態の正面図、
第３図は要部断面図である。 １：入力端子、２：入力回路、３：コネクタ、
３′：コネクタ、４：出力回路、５：出力端子、
６：電源端子、７：電源回路、１０：メモリユニ
ツト、１１：開口部、１１′：開口部、１２：
Ｅ・Ｐ−ROM、１３：つば、１４：ケース、
Ａ：本体、Ｄ：制御ユニツト。
１図は分解斜視図、第２図は組立状態の正面図、
第３図は要部断面図である。 １：入力端子、２：入力回路、３：コネクタ、
３′：コネクタ、４：出力回路、５：出力端子、
６：電源端子、７：電源回路、１０：メモリユニ
ツト、１１：開口部、１１′：開口部、１２：
Ｅ・Ｐ−ROM、１３：つば、１４：ケース、
Ａ：本体、Ｄ：制御ユニツト。
Claims (1)
- 略矩形の本体内に、入力回路、出力回路等から
なる電子ブロツクを収納し、本体両側には入力端
子と出力端子とを互いに対設するように配設する
とともに電源端子を配設し、各端子の配置されな
い本体にくぼみを設け、前記くぼみ中に出力回路
と入力回路に接続した雄側コネクタを配設してな
る制御ユニツトと、前記制御ユニツトのコネクタ
に着脱自在に挿着して入、出力回路に接続する雌
側コネクタ及びROMをケースに収納したメモリ
ユニツトとを備え、ケースの片側に形成せる開口
部に雌側コネクタとプログラムを記憶したROM
とを対応させて制御ユニツトの雄側コネクタにメ
モリユニツトの雌側コネクタを接続してケースを
くぼみ内に収納した状態で開口部が内方向に向い
て閉じるようにするとともに閉じた状態でメモリ
ユニツトのケースの上端面と制御ユニツトの本体
の上端面とが略同一平面となるようにケースを構
成し、且つ該ケースの上端面と同一平面となるよ
うにケースの上端面より突設したつばと本体間に
メモリユニツト取外し用のすき間を形成して成る
シーケンス制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14870382U JPS5885203U (ja) | 1982-09-30 | 1982-09-30 | シ−ケンス制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14870382U JPS5885203U (ja) | 1982-09-30 | 1982-09-30 | シ−ケンス制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5885203U JPS5885203U (ja) | 1983-06-09 |
| JPS6217849Y2 true JPS6217849Y2 (ja) | 1987-05-08 |
Family
ID=29941510
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14870382U Granted JPS5885203U (ja) | 1982-09-30 | 1982-09-30 | シ−ケンス制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5885203U (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6228998A (ja) * | 1985-07-29 | 1987-02-06 | Akai Electric Co Ltd | 情報記録再生装置用の外部記憶媒体 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5431672U (ja) * | 1977-08-03 | 1979-03-01 | ||
| JPS5922563Y2 (ja) * | 1978-11-09 | 1984-07-05 | 株式会社ターダ | プログラム式制御装置のコントロ−ラユニツト |
| JPS603211B2 (ja) * | 1978-12-27 | 1985-01-26 | オムロン株式会社 | シ−ケンスプログラマ |
-
1982
- 1982-09-30 JP JP14870382U patent/JPS5885203U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5885203U (ja) | 1983-06-09 |
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