JPS6225301A - シ−ケンス制御装置 - Google Patents
シ−ケンス制御装置Info
- Publication number
- JPS6225301A JPS6225301A JP16436585A JP16436585A JPS6225301A JP S6225301 A JPS6225301 A JP S6225301A JP 16436585 A JP16436585 A JP 16436585A JP 16436585 A JP16436585 A JP 16436585A JP S6225301 A JPS6225301 A JP S6225301A
- Authority
- JP
- Japan
- Prior art keywords
- rom
- system program
- sequence control
- external socket
- program
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
本発明は、負荷(設備、機械など)をシーケシスプログ
ラムに基いて制御するシーケンス制御装置に関するもの
である。
ラムに基いて制御するシーケンス制御装置に関するもの
である。
ロジウムを記憶するシステムプログラム用のRAMと、
シーケンス制御プログラムを記憶する制御プログラム用
のRAMとよりなるこの秤のシーケンス制御装置におい
て、中央演算回路、ROM 。
シーケンス制御プログラムを記憶する制御プログラム用
のRAMとよりなるこの秤のシーケンス制御装置におい
て、中央演算回路、ROM 。
RA M、インターフェイス(同辺装置)などのハード
ウェアは、筐体内に組込まれているのが普通である。と
ころで、このような従来例において、何らかのトラブル
でシーケンス制御異常が発生するか、あるいは新たな機
能を付加する場合、筐体内のシステムプログラム用のR
OMを交換するようにしていた。しかしながら、このよ
うな従来例におけるR OMの交換は筐体内の部品を交
換することになるので、交換作業が面倒であるという問
題があった。
ウェアは、筐体内に組込まれているのが普通である。と
ころで、このような従来例において、何らかのトラブル
でシーケンス制御異常が発生するか、あるいは新たな機
能を付加する場合、筐体内のシステムプログラム用のR
OMを交換するようにしていた。しかしながら、このよ
うな従来例におけるR OMの交換は筐体内の部品を交
換することになるので、交換作業が面倒であるという問
題があった。
本発明は上記の点に鑑みて為されたものであシ、その目
的とするところは、シーケンス制御のシステム″′jo
ジラムを容易に変更することができるシーケンス制御装
置を提供することにある。
的とするところは、シーケンス制御のシステム″′jo
ジラムを容易に変更することができるシーケンス制御装
置を提供することにある。
(実施例)
第1図乃至第3図は本発明一実施例を示すもので、CP
Uよりなる中央演算回路il+と、システムプログラム
を記憶するR OM F2+と、シーケンスづ0クラム
を記憶するR A M +31とよりなるシーケンス制
御装置において、システムプログラム用の第2のROM
(2a)が装着される外付用ソケット(4)を筐体(
6)の外面(例えば上面)に設けるとともに、この外付
用ソケット(4)に第2のROM (2a)が装着され
たとき第2のROM (2a)から読出されたシステム
プログラムに基いてシーケンス動作を行なうようにメモ
リを切換えるメモリ切換回路(6)を設けたものである
。なお、実施例にあってメ℃り切換回路(6)は、イン
バータ回路11と、オア回路01,02と、抵抗Rとで
形成されており、A点は第2のROM (2a)が装着
されたときに0L“レベルKtツトされるようになって
いる。図中、ヂコータ(7)は、中央演算回路TI)か
ら出力されるアクセス信号(アドレスデータ)によりR
OM +21. (2a)、RA M +31のチップ
選択信号を発生させるものである。また、第2のROM
(2a)はオア回路02と一体化されたROMカセッ
ト(8)として外付用ソケット(4)Kコネクタ(8a
)にて装着自在となっており、ソケット(4)を介して
アドレスバス(AB) 、データバス(DB) 、コン
トロールバス(CB)が接続されている。
Uよりなる中央演算回路il+と、システムプログラム
を記憶するR OM F2+と、シーケンスづ0クラム
を記憶するR A M +31とよりなるシーケンス制
御装置において、システムプログラム用の第2のROM
(2a)が装着される外付用ソケット(4)を筐体(
6)の外面(例えば上面)に設けるとともに、この外付
用ソケット(4)に第2のROM (2a)が装着され
たとき第2のROM (2a)から読出されたシステム
プログラムに基いてシーケンス動作を行なうようにメモ
リを切換えるメモリ切換回路(6)を設けたものである
。なお、実施例にあってメ℃り切換回路(6)は、イン
バータ回路11と、オア回路01,02と、抵抗Rとで
形成されており、A点は第2のROM (2a)が装着
されたときに0L“レベルKtツトされるようになって
いる。図中、ヂコータ(7)は、中央演算回路TI)か
ら出力されるアクセス信号(アドレスデータ)によりR
OM +21. (2a)、RA M +31のチップ
選択信号を発生させるものである。また、第2のROM
(2a)はオア回路02と一体化されたROMカセッ
ト(8)として外付用ソケット(4)Kコネクタ(8a
)にて装着自在となっており、ソケット(4)を介して
アドレスバス(AB) 、データバス(DB) 、コン
トロールバス(CB)が接続されている。
以下、実施例の動作について説明する。いま、ROMカ
セット(8)を装着していない場合には、A点がHレベ
ルとなり、B点がゝXL“レベルとなってデータ(7)
から出力されるメモリ選択信号にてROM +21が選
択される。したがって、ROM+21に記憶されている
システムプログラムに基いて中央演算回路filの演算
動作が行なわれ、RAM+3+に記憶されているシーケ
ンス制御づOシラ乙により、負荷がシーケンス制御され
る。一方、ROMカセット(8)が外付用ソケット(4
)K装着された場合には、A点かHレベルになってB点
がゝゝH“レベルになるとともに、6点がゝ′L“レベ
ル例なってヂコータ(7)から出力されるメモリ選択信
号によってROM(2a)が選択され、ROM(2a)
K記憶されているシステムづ0ジラムによって中央演算
回路[1)の演算動作が制御されることKなる。この場
合、筐体(6)内の部品を交換することなくシーケンス
制御のシステムプログラムを容易に変更することができ
るようになっている。したがって、シーケンス#社′が
おかしい場合において、自己診断の機能を有するシステ
ムプログラムにてシーケンス制御動作を行ないたい場合
、あるいは新たな機能を付加したバージョンアップ時の
ROM交換(ROM+21→ROM (2a) )を容
易に行なうことができるようKなる。
セット(8)を装着していない場合には、A点がHレベ
ルとなり、B点がゝXL“レベルとなってデータ(7)
から出力されるメモリ選択信号にてROM +21が選
択される。したがって、ROM+21に記憶されている
システムプログラムに基いて中央演算回路filの演算
動作が行なわれ、RAM+3+に記憶されているシーケ
ンス制御づOシラ乙により、負荷がシーケンス制御され
る。一方、ROMカセット(8)が外付用ソケット(4
)K装着された場合には、A点かHレベルになってB点
がゝゝH“レベルになるとともに、6点がゝ′L“レベ
ル例なってヂコータ(7)から出力されるメモリ選択信
号によってROM(2a)が選択され、ROM(2a)
K記憶されているシステムづ0ジラムによって中央演算
回路[1)の演算動作が制御されることKなる。この場
合、筐体(6)内の部品を交換することなくシーケンス
制御のシステムプログラムを容易に変更することができ
るようになっている。したがって、シーケンス#社′が
おかしい場合において、自己診断の機能を有するシステ
ムプログラムにてシーケンス制御動作を行ないたい場合
、あるいは新たな機能を付加したバージョンアップ時の
ROM交換(ROM+21→ROM (2a) )を容
易に行なうことができるようKなる。
本発明は上述のように1中央演算回路と、システムプロ
グラムを記憶するシステムプログラム用のROMと、シ
ーケンス制御プロジラムを記憶する制御プロシラ乙用の
RAMとよりなるシーケンス制御装置において、システ
ムづ0グラム用の第2のROMが装着される外付用ソケ
ットを筐体外面に投けるとともに1外付用ソケツトに第
2のROMが装着されたとき第2のROMから読出され
たシステムづ0ジラムに基いてシーケンス制御動作を行
なうようにメモリを切換えるメモリ切換回路を設けたも
のであり、シーケンス制御のシステムプログラムを容易
に変更することができるという効果がある。
グラムを記憶するシステムプログラム用のROMと、シ
ーケンス制御プロジラムを記憶する制御プロシラ乙用の
RAMとよりなるシーケンス制御装置において、システ
ムづ0グラム用の第2のROMが装着される外付用ソケ
ットを筐体外面に投けるとともに1外付用ソケツトに第
2のROMが装着されたとき第2のROMから読出され
たシステムづ0ジラムに基いてシーケンス制御動作を行
なうようにメモリを切換えるメモリ切換回路を設けたも
のであり、シーケンス制御のシステムプログラムを容易
に変更することができるという効果がある。
第1図は本発明一実施例のブロック回路図、第2図は同
上の要部正面図、第3図は同上の要部正面図アある。 +l)は中央演算回路、(2)はRoM、(2a)H第
2のROM、+31はRAM、illはソケット、(5
)は筐体である。 代理人 弁理士 石 1)長 七 第2図 手続補正書(自発) 昭和60年10月29日
上の要部正面図、第3図は同上の要部正面図アある。 +l)は中央演算回路、(2)はRoM、(2a)H第
2のROM、+31はRAM、illはソケット、(5
)は筐体である。 代理人 弁理士 石 1)長 七 第2図 手続補正書(自発) 昭和60年10月29日
Claims (1)
- (1)中央演算回路と、システムプログラムを記憶する
システムプログラム用のROMと、シーケンス制御プロ
グラムを記憶する制御プログラム用のRAMとよりなる
シーケンス制御装置において、システムプログラム用の
第2のROMが装着される外付用ソケットを筐体外面に
設けるとともに、外付用ソケットに第2のROMが装着
されたとき第2のROMから読出されたシステムプログ
ラムに基いてシーケンス制御動作を行なうようにメモリ
を切換えるメモリ切換回路を設けたことを特徴とするシ
ーケンス制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16436585A JPS6225301A (ja) | 1985-07-25 | 1985-07-25 | シ−ケンス制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16436585A JPS6225301A (ja) | 1985-07-25 | 1985-07-25 | シ−ケンス制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6225301A true JPS6225301A (ja) | 1987-02-03 |
Family
ID=15791757
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16436585A Pending JPS6225301A (ja) | 1985-07-25 | 1985-07-25 | シ−ケンス制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6225301A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01114736A (ja) * | 1987-10-28 | 1989-05-08 | Shimadzu Corp | 材料試験機 |
| JPH01209340A (ja) * | 1988-02-17 | 1989-08-23 | Shimadzu Corp | 材料試験機 |
-
1985
- 1985-07-25 JP JP16436585A patent/JPS6225301A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01114736A (ja) * | 1987-10-28 | 1989-05-08 | Shimadzu Corp | 材料試験機 |
| JPH01209340A (ja) * | 1988-02-17 | 1989-08-23 | Shimadzu Corp | 材料試験機 |
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