JPS6228512B2 - - Google Patents

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Publication number
JPS6228512B2
JPS6228512B2 JP11110180A JP11110180A JPS6228512B2 JP S6228512 B2 JPS6228512 B2 JP S6228512B2 JP 11110180 A JP11110180 A JP 11110180A JP 11110180 A JP11110180 A JP 11110180A JP S6228512 B2 JPS6228512 B2 JP S6228512B2
Authority
JP
Japan
Prior art keywords
chip
wafer
chips
bubble memory
blocks
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP11110180A
Other languages
English (en)
Other versions
JPS5736495A (ja
Inventor
Yoshihiro Imazeki
Mikio Segawa
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP11110180A priority Critical patent/JPS5736495A/ja
Publication of JPS5736495A publication Critical patent/JPS5736495A/ja
Publication of JPS6228512B2 publication Critical patent/JPS6228512B2/ja
Granted legal-status Critical Current

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Classifications

    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C19/00Digital stores in which the information is moved stepwise, e.g. shift registers
    • G11C19/02Digital stores in which the information is moved stepwise, e.g. shift registers using magnetic elements
    • G11C19/08Digital stores in which the information is moved stepwise, e.g. shift registers using magnetic elements using thin films in plane structure

Landscapes

  • Thin Magnetic Films (AREA)
  • Semiconductor Integrated Circuits (AREA)

Description

【発明の詳細な説明】 本発明は磁気バルブメモリチツプの設計法の改
良に関する。
磁気バブルメモリ装置は不揮発性・大容量メモ
リとして甚だ有用であり、今後ますます大容量化
される傾向にある。
この磁気バブルメモリ装置に用いられるメモリ
チツプの製造方法は、第1図に示す如く直径が3
インチ程度の非磁性ガーネツト基板の上に磁性ガ
ーネツトをエピタキシヤル成長させたウエーハ1
の上に磁気バブルの発生器、伝播路、検出器等を
有する数mm角のチツプ2を複数個形成したのち
個々のチツプに切断するのである。ところがチツ
プのメモリ容量が大容量化されてチツプの単位面
積が大きくなると、結晶欠陥による不良チツプ面
積が増加して歩留り率が低下する。本発明はこの
欠点を改良するために案出されたものである。
このため本発明においては、ウエーハに複数個
の同一バブルメモリチツプを形成する磁気バブル
メモリチツプの設計法において、単一チツプのメ
モリ容量を、それぞれが単独で書き込み、記憶、
読み出し等の各機能を備えた複数個のブロツクに
分割し、ウエーハ完成時点で隣接した良品ブロツ
クを組合わせて必要容量のチツプとすることがで
きるようにしたことを特徴とするものである。
以下添付図面に基づいて本発明の実施例につき
詳細に説明する。
第2図に実施例を示す。本実施例は図の如くウ
エーハ1に複数個のチツプ2(実線で示す)を形
成するとき、各チツプをそれぞれ1/2、1/3……
1/nというように複数個のブロツクに分割す
る。図においては点線で示す如く2個のブロツク
3に分割している。そして各ブロツク3の構成は
第3図に示す書き込みパターン4、記憶用パター
ン5、読出し用パターン6等を備え、各ブロツク
a,b,c,d……間の書込みパターン4、トラ
ンスフアゲート7,7′を連結パターンa1,a2
a3……b1,b2,b3……c1,c2,c3……により接続
している。
このような設計法により形成されたウエーハ
は、例えば結晶欠陥等によりcブロツクが不良の
ときはaブロツクとbブロツクとを組合わせて1
個のチツプAを構成することができる。またaブ
ロツクが不良のときはbブロツクとcブロツクと
を組合わせて1個のチツプBを構成することもで
きる。このように不良ブロツクを除いて、隣り合
う良品同士を組合わせることにより歩留り率は向
上する。例えば第2図において、P列のみを採り
上げた場合×印部に欠陥があるものとすると従来
の設計法ならば不良チツプ(ハツチングを入れて
示す)は4個、良品(丸印を付す)は3個であ
り、その歩留り率は3/7≒43%であるが、これに比 して本発明方法によれば、Q列においてP列と同
じ位置に欠陥があるとしても良品は5個(丸印を
付す)となりその歩留り率は5/7≒71%となる。な お分割を1/3、1/4……と分割数を増して行けば更
に歩留り率は向上する。
以上説明した如く本発明のバブルメモリチツプ
設計法はウエーハより取り出すチツプの歩留り率
の向上を可能としたものであつて磁気バブルメモ
リ装置のコスト低下に寄与するものである。
【図面の簡単な説明】
第1図は従来の磁気バブルメモリチツプの設計
法を実施したウエーハの平面図、第2図は本発明
にかかる実施例の設計法を実施したウエーハの平
面図、第3図はそのチツプを分割したブロツクの
構成図である。 1……ウエーハ、2,A,B……チツプ、3,
a,b,c……ブロツク、4……書込み用パター
ン、5……記憶用パターン、6……読出し用パタ
ーン、7,7′……トランスフアーゲート、a1
a2,a3,b1,b2,b3,c1,c2,c3……連結パター
ン。

Claims (1)

    【特許請求の範囲】
  1. 1 ウエーハに複数個の同一バブルメモリチツプ
    を形成する磁気バブルメモリチツプの設計法にお
    いて、単一チツプのメモリ容量を、それぞれが単
    独で書き込み・記憶・読み出し等の各機能を備え
    た複数個のブロツクに分割し、ウエーハ完成時点
    で隣接した良品ブロツクを組合わせて必要容量の
    チツプとすることができるようにしたことを特徴
    とする磁気バブルメモリチツプの設計法。
JP11110180A 1980-08-14 1980-08-14 Jikibaburumemorichitsupunosetsukeiho Granted JPS5736495A (ja)

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JP11110180A JPS5736495A (ja) 1980-08-14 1980-08-14 Jikibaburumemorichitsupunosetsukeiho

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JP11110180A JPS5736495A (ja) 1980-08-14 1980-08-14 Jikibaburumemorichitsupunosetsukeiho

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Publication Number Publication Date
JPS5736495A JPS5736495A (ja) 1982-02-27
JPS6228512B2 true JPS6228512B2 (ja) 1987-06-20

Family

ID=14552411

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JP11110180A Granted JPS5736495A (ja) 1980-08-14 1980-08-14 Jikibaburumemorichitsupunosetsukeiho

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Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6254889A (ja) * 1985-09-04 1987-03-10 Fujitsu Ltd 磁気バブルデバイス
JP2538353B2 (ja) * 1989-10-31 1996-09-25 三洋電機株式会社 燃焼装置の消火方法

Also Published As

Publication number Publication date
JPS5736495A (ja) 1982-02-27

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