JPS62292040A - ル−プバス制御方式 - Google Patents
ル−プバス制御方式Info
- Publication number
- JPS62292040A JPS62292040A JP13670686A JP13670686A JPS62292040A JP S62292040 A JPS62292040 A JP S62292040A JP 13670686 A JP13670686 A JP 13670686A JP 13670686 A JP13670686 A JP 13670686A JP S62292040 A JPS62292040 A JP S62292040A
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- JP
- Japan
- Prior art keywords
- frame
- circuit
- control
- information
- loop bus
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005540 biological transmission Effects 0.000 claims abstract description 33
- 238000000034 method Methods 0.000 claims description 8
- 230000001960 triggered effect Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 4
- 230000001174 ascending effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000010365 information processing Effects 0.000 description 1
Landscapes
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の詳細な説明
〔産業上の利用分野〕
本発明、はループバス制御方式に関し、特に個有の局ア
ドレスを持つ複数のデータ処理装置が接続されるループ
バスにおける情報フレームの送信契機が制御フレームの
受信によるものであるループバス制御方式に関する。
ドレスを持つ複数のデータ処理装置が接続されるループ
バスにおける情報フレームの送信契機が制御フレームの
受信によるものであるループバス制御方式に関する。
従来、個有の局アドレスを持つ複数のデータ処理装置が
接続されているループバスにおいては、これらのデータ
処理装置のうちのあるデータ処理装置が情報フレームを
ループバス上に送信しょうとしなとき、ループバス上に
ただ１つ存在する制御フレームの受信を待ち、この制御
フレームの受信を契機として情報フレームの送信を行っ
ていた。
接続されているループバスにおいては、これらのデータ
処理装置のうちのあるデータ処理装置が情報フレームを
ループバス上に送信しょうとしなとき、ループバス上に
ただ１つ存在する制御フレームの受信を待ち、この制御
フレームの受信を契機として情報フレームの送信を行っ
ていた。
上述した従来のループバス制御方式では、情報フレーム
の送信の契機となる制御フレームがループバス上にただ
１つしか存在しないため、１つのデータ処理装置が送信
を行っていると、たとえループバス上にフレームの流れ
ていない区間があっても、他のデータ処理装置は情報フ
レームの送信を行うことができないので、ループバス上
を流れる情報フレームが多くなる程待ち時間が長くなり
伝送効率が悪くなるという欠点がある。
の送信の契機となる制御フレームがループバス上にただ
１つしか存在しないため、１つのデータ処理装置が送信
を行っていると、たとえループバス上にフレームの流れ
ていない区間があっても、他のデータ処理装置は情報フ
レームの送信を行うことができないので、ループバス上
を流れる情報フレームが多くなる程待ち時間が長くなり
伝送効率が悪くなるという欠点がある。
本発明のループバス制御方式は、それぞれ個有の局アド
レスを割り当てられている複数のデータ処理装置が所定
の規則に従ってループバスを介して接続されてなり該各
データ処理装置の間で授受される情報フレームが前記ル
ープバス内を常に回っている制御フレームの受信を契機
として送信されるループバス制御方式において、前記各
データ処理装置は制御フレームを受信するフレーム受信
回路と、前記制御フレームを送信する制御フレーム送信
回路と、前記情報フレームを送信する情報フレーム送信
回路と、前記制御フレーム送信回路と前記情報フレーム
送信回路とを切替える送信フレーム切替回路と、前記制
御フレームの受信を記憶する制御フレーム記憶回路と、
自データ処理装置に割り当てられる局アドレスを生成す
る自局アドレス生成回路と、前記情報フレーム送信回路
内の情報フレームの宛先局アドレスと前記自局アドレス
生成回路が生成する自局アドレスとを比較する比較回路
と、該比較回路の比較結果に従って前記制御フレームを
前記ループバス内に複数存在させる処理手段とを備えて
いる。
レスを割り当てられている複数のデータ処理装置が所定
の規則に従ってループバスを介して接続されてなり該各
データ処理装置の間で授受される情報フレームが前記ル
ープバス内を常に回っている制御フレームの受信を契機
として送信されるループバス制御方式において、前記各
データ処理装置は制御フレームを受信するフレーム受信
回路と、前記制御フレームを送信する制御フレーム送信
回路と、前記情報フレームを送信する情報フレーム送信
回路と、前記制御フレーム送信回路と前記情報フレーム
送信回路とを切替える送信フレーム切替回路と、前記制
御フレームの受信を記憶する制御フレーム記憶回路と、
自データ処理装置に割り当てられる局アドレスを生成す
る自局アドレス生成回路と、前記情報フレーム送信回路
内の情報フレームの宛先局アドレスと前記自局アドレス
生成回路が生成する自局アドレスとを比較する比較回路
と、該比較回路の比較結果に従って前記制御フレームを
前記ループバス内に複数存在させる処理手段とを備えて
いる。
次に、本発明について第１図および第２図を参照して説
明する。
明する。
第１図は本発明のループバス制御方式の一実施例を示す
ブロック図、第２図は第１図におけるループバスを流れ
るフレームフォーマットの一例を示す図である。
ブロック図、第２図は第１図におけるループバスを流れ
るフレームフォーマットの一例を示す図である。
第１図において、複数のデータ処理装置２ａ。
２ｂ、２ｃ、〜２ｎはループバス１に接続されている。
これらデータ処理装置２ａ、２ｂ、２ｃ。
〜２ｎにはそれぞれ個有の局アドレスが割り当てられ、
それぞれフレームの流れる方向に対して局アドレスの値
が昇順になるように接続されている。
それぞれフレームの流れる方向に対して局アドレスの値
が昇順になるように接続されている。
また、第２図において、フレームはフラグパターンＦ、
宛先局アドレスＤＡ、自局アドレスＳＡ。
宛先局アドレスＤＡ、自局アドレスＳＡ。
制御フィールドＣ，データＤ、フレームチェックシーケ
ンスＦＣＳからなる。
ンスＦＣＳからなる。
続いて本実施例の動作について第２図を併用して説明す
る。
る。
例えば、データ処理装置２ａの情報フレーム送信回路８
から情報フレームを送信しようとした場き、自局アドレ
ス生成回路６により生成された自局アドレスＳＡと情報
フレーム送信回路８内の情報フレームの宛先局アドレス
ＤＡを比較回路５により比較し、この宛先局アドレスＤ
Ａを持つデータ処理装置のループバス１内における自局
からの相対位置が例えばデータ処理装置２Ｃのようにフ
レームの流れる方向に対しループバス１の半周より近け
れば、制御フレームの受信をフレーム受信回路３で検出
した時を契機にして送信フレーム切替回路９を制御し、
情報フレーム送信回路８から送信される情報フレームを
ループバス１に流す。
から情報フレームを送信しようとした場き、自局アドレ
ス生成回路６により生成された自局アドレスＳＡと情報
フレーム送信回路８内の情報フレームの宛先局アドレス
ＤＡを比較回路５により比較し、この宛先局アドレスＤ
Ａを持つデータ処理装置のループバス１内における自局
からの相対位置が例えばデータ処理装置２Ｃのようにフ
レームの流れる方向に対しループバス１の半周より近け
れば、制御フレームの受信をフレーム受信回路３で検出
した時を契機にして送信フレーム切替回路９を制御し、
情報フレーム送信回路８から送信される情報フレームを
ループバス１に流す。
この情報フレームの送信が終了したならば、送信フレー
ム切替回路９を制御して制御フレーム送信回路７から送
信される制御フレームをループバス１に流す。
ム切替回路９を制御して制御フレーム送信回路７から送
信される制御フレームをループバス１に流す。
また、宛先局アドレスＤＡを持つデータ処理装置のルー
プバス１内における自局からの相対位置が例えばデータ
処理装置２ｎのようにフレームの流れる方向に対しルー
プバス１の半周より遠ければ、制御フレームの受信をフ
レーム受信回路３で検出したとき制御フレーム記憶回路
４により制御フレームを受信したことを記憶する。そし
て再び制御フレームを待ち次の制御フレームを受信した
ならば、送信フレーム切替回路９を制御して情報フレー
ム送信回路８から送信される情報フレームをループバス
１に流す。この情報フレームの送信が終了したならば、
送信フレーム切替回路９を制御して制御フレーム送信回
路７から送信される制御フレームをループバス１に流す
。さらに、制御フレームがループバス１を半周したタイ
ミングで再び制御フレームをループバス１に流す。
プバス１内における自局からの相対位置が例えばデータ
処理装置２ｎのようにフレームの流れる方向に対しルー
プバス１の半周より遠ければ、制御フレームの受信をフ
レーム受信回路３で検出したとき制御フレーム記憶回路
４により制御フレームを受信したことを記憶する。そし
て再び制御フレームを待ち次の制御フレームを受信した
ならば、送信フレーム切替回路９を制御して情報フレー
ム送信回路８から送信される情報フレームをループバス
１に流す。この情報フレームの送信が終了したならば、
送信フレーム切替回路９を制御して制御フレーム送信回
路７から送信される制御フレームをループバス１に流す
。さらに、制御フレームがループバス１を半周したタイ
ミングで再び制御フレームをループバス１に流す。
以上説明したように本発明のループバス制御方式は、個
有の局アドレスが割り当てられている複数のデータ処理
装置において、宛先局アドレスと自局アドレスの関係か
ら導き出される条件に従い複数の制御フレームをループ
バス上に存在させることにより、ループバス上のデータ
の流れていない区間内であれば同時に多数のデータ処理
装置が情報フレームを送信することが可能となるので、
情報フレームが多量になっても待ち時間の増大は少なく
伝送効率も悪くならないという効果がある。
有の局アドレスが割り当てられている複数のデータ処理
装置において、宛先局アドレスと自局アドレスの関係か
ら導き出される条件に従い複数の制御フレームをループ
バス上に存在させることにより、ループバス上のデータ
の流れていない区間内であれば同時に多数のデータ処理
装置が情報フレームを送信することが可能となるので、
情報フレームが多量になっても待ち時間の増大は少なく
伝送効率も悪くならないという効果がある。
第１図は本発明のループバス制御方式の一実施例を示す
ブロック図、第２図は第１図におけるループバスを流れ
るフレームフォーマットの一例を示す図である。
ブロック図、第２図は第１図におけるループバスを流れ
るフレームフォーマットの一例を示す図である。
Claims (1)
- それぞれ個有の局アドレスを割り当てられている複数の
データ処理装置が所定の規則に従つてループバスを介し
て接続されてなり該各データ処理の間で授受される情報
フレームが前記ループバス内を常に回っている制御フレ
ームの受信を契機として送信されるループバス制御方式
において、前記各データ処理装置は制御フレームを受信
するフレーム受信回路と、前記制御フレームを送信する
制御フレーム送信回路と、前記情報フレームを送信する
情報フレーム送信回路と、前記制御フレーム送信回路と
前記情報フレーム送信回路とを切替える送信フレーム切
替回路と、前記制御フレームの受信を記憶する制御フレ
ーム記憶回路と、自データ処理装置に割り当てられる局
アドレスを生成する自局アドレス生成回路と、前記情報
フレーム送信回路内の情報フレームの宛先局アドレスと
前記自局アドレス生成回路が生成する自局アドレスとを
比較する比較回路と、該比較回路の比較結果に従つて前
記制御フレームを前記ループバス内に複数存在させる処
理手段とを備えることを特徴とするループバス制御方式
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13670686A JPS62292040A (ja) | 1986-06-11 | 1986-06-11 | ル−プバス制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13670686A JPS62292040A (ja) | 1986-06-11 | 1986-06-11 | ル−プバス制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62292040A true JPS62292040A (ja) | 1987-12-18 |
Family
ID=15181580
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13670686A Pending JPS62292040A (ja) | 1986-06-11 | 1986-06-11 | ル−プバス制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62292040A (ja) |
-
1986
- 1986-06-11 JP JP13670686A patent/JPS62292040A/ja active Pending
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