JPS6244444B2 - - Google Patents

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JPS6244444B2
JPS6244444B2 JP53042021A JP4202178A JPS6244444B2 JP S6244444 B2 JPS6244444 B2 JP S6244444B2 JP 53042021 A JP53042021 A JP 53042021A JP 4202178 A JP4202178 A JP 4202178A JP S6244444 B2 JPS6244444 B2 JP S6244444B2
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JP
Japan
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circuit
pulse
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error
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Expired
Application number
JP53042021A
Other languages
English (en)
Other versions
JPS54133866A (en
Inventor
Akio Sabato
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP4202178A priority Critical patent/JPS54133866A/ja
Publication of JPS54133866A publication Critical patent/JPS54133866A/ja
Publication of JPS6244444B2 publication Critical patent/JPS6244444B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00Baseband systems
    • H04L25/02Details ; arrangements for supplying electrical power along data transmission lines
    • H04L25/03Shaping networks in transmitter or receiver, e.g. adaptive shaping networks
    • H04L25/03006Arrangements for removing intersymbol interference
    • H04L25/03012Arrangements for removing intersymbol interference operating in the time domain
    • H04L25/03019Arrangements for removing intersymbol interference operating in the time domain adaptive, i.e. capable of adjustment during data reception
    • H04L25/03038Arrangements for removing intersymbol interference operating in the time domain adaptive, i.e. capable of adjustment during data reception with a non-recursive structure

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Filters That Use Time-Delay Elements (AREA)
  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)

Description

【発明の詳細な説明】 本発明は主として多値パルス信号を伝送する通
信方式に使用され、信号波形を等化するための自
動等化器の改良に関する。特にトランスバーサル
形自動等化器の初期引込時間を短縮する改良に関
するものである。
トランスバーサル形自動等化器とは、入力信号
を一連の遅延回路に与え、その遅延回路の複数の
タツプから重みをつけた信号を取り出し、この信
号を合成して出力とするとともに、この各タツプ
の重みを、自動等化器への入力または出力波形
と、出力波形の識別誤差との相関を演算すること
により制御する自動等化器である。このようなト
ランスバーサル形自動等化器では、その起動時に
各タツプの重みは任意になつているので、これが
出力波形により制御されて適正な動作に移行する
まで、いわゆる引込時間を必要とする。
従来、この引込時間を短縮するための方法はい
くつか知られているが、その最も一般的なもの
は、引込過程の初期には1回のタツプ重み修正量
を大きい値に設定しておき、引込が進んだ時点で
これを小さい値に切換えるものである。これを回
路上実現するためには、各タツプ重み修正量の制
御利得を変化させることが必要である。従つてそ
の制御回路の構成が複雑になるとともに、定常時
の精度が劣化することにもなる。
本発明はこれを改良するもので、相関演算回路
あるいは各タツプ重み修正回路には無関係に、初
期引込時間を短縮することのできる簡単な構成の
自動等化器を提供することを目的とする。
本発明は、受信多値信号が通過するタツプ付き
の遅延回路と、この遅延回路の入力または出力も
しくはタツプからそれぞれ分岐された複数の信号
がそれぞれ通過するタツプ重み回路と、このタツ
プ重み回路を通過した各信号の合成出力を得る回
路手段と、この合成出力から出力信号を得るとと
もに、この合成出力の多値パルス信号を識別して
識別誤差をその極性を示す極性情報および修正量
を示す識別誤差パルスとして検出する多値パルス
識別回路と、この多値パルス識別回路の出力にし
たがつて上記タツプ重み回路に与える制御信号を
演算する演算手段とを備えたトランスバーサル形
自動等化器において、上記出力信号の誤りを監視
する誤り監視回路を設け、上記多値パルス識別回
路は、上記識別誤差パルスとして一つの誤差に対
応して占有率が異なる二種類のパルスを発生させ
る構成であり、この二種類のパルスの一方を上記
誤り監視回路の検出出力にしたがつて、誤りが多
いときには占有率の大きい方を選択し誤りが少な
いときには占有率の小さい方を選択して上記演算
手段に供給する選択回路を設けたことを特徴とす
る。
本発明による装置が使用される多値パルス信号
による通信方式では、多値信号の冗長性を利用し
て多値信号の誤りを監視することが広く行われて
いるので、この誤り検出の状況から自動等化器の
引込過程の初期であるか否かの情報を容易に得る
ことができる。
次に実施例図面を用いて詳しく説明する。
第1図は本発明実施例の自動等化器回路構成図
である。等化前の信号は入力端子INに与えら
れ、等化された信号は出力端子OUTに得られ
る。信号は多値パルス信号である。
入力端子INには多数の遅延回路1a,1b…
1n-1が縦続接続され、その端末は終端器2に与
えられている。各遅延回路1a,1b…1n-1
接続点からタツプが引出され、それぞれタツプ重
み回路3a,3b…3nを介して、加算増幅回路
4の入力に結合されている。加算増幅回路4の出
力は、多値パルス識別回路5を介して、出力端子
OUTに導かれている。
この多値パルス識別回路5からは、多値識別信
号の極性情報Pが相関器6に与えられている。ま
た、二種の識別誤差パルスAおよびBが、選択回
路7に与えられ、この出力の一方が選択されて、
相関器6に与えられるよう構成されている。出力
OUTから分岐された信号は、誤り監視回路8に
与えられ、その出力は選択回路7の制御入力に結
合されている。
相関器6にはシフトパルスSHが与えられ、そ
のn個の出力R1〜Roは、それぞれ平均化回路9
a〜9nを介して、前述のタツプ重み回路3a〜
3nの制御入力に結合されている。
このように構成された回路では、入力端子IN
の信号は各遅延回路1a〜1n-1を経由して次第
に大きな遅延を受け、各タツプに現われる。これ
をそれぞれ重み回路3a〜3nにより重みをつけ
て取り込み、加算することによつて等化が行なわ
れる。各重み回路3a〜3nの減衰量は相関器6
の出力により制御される。この相関器6は多値識
別信号の極性情報Pと識別誤差パルス(Aまたは
B)の相関を演算することにより出力R1〜Ro
送出する。この一般的な動作は公知であるので詳
しい説明は省略するが、本発明の特徴とする引込
過程の動作については、動作波形図を用いてさら
に詳しく説明する。
第2図A,Bはそれぞれ前述の多値識別誤差パ
ルスA,Bの1周期の波形図である。それぞれイ
は識別誤差が正のとき、ロは同じく負のときを表
わす。このように占有率の異なる2種類のパルス
A,Bを予め用意して選択回路7に与えておき、
この一方を選択して相関を演算する。
第3図はこのうち多値識別誤差パルスAが選択
されたとき、第4図は同じくBが選択されたとき
の動作波形図の例を示す。Pは前述の極性情報、
oは相関器6の出力、Ro′は平均化回路9nの
出力をそれぞれ示す。第3図と第4図を比較する
とわかるように、1周期毎の平均化回路9nの出
力Ro′は、第3図の場合は第4図の場合の2倍に
なる。従つて、誤り監視回路8で多くの誤りが検
出される引込の初期ではパルスAを選択し、引込
が行なわれて誤りが少なくなつたときには自動的
にパルスBに切換えられるように構成しておけ
ば、引込の初期段階でタツプ重み回路3nに与え
られる修正信号振幅が大きく、引込完了後は小さ
くすることができる。これにより、引込時間を短
縮させるとともに、引込が完了された定常時に
は、タツプ重み回路のゆらぎによる雑音の小さ
い、安定な動作を行なうことができる。
ここで、シフトパルスSHについて言及する。
相関器6の内部ではシフトパルスSHによつて、
識別誤差パルスがシフトされてゆくが、第2図に
示すように2種類の識別誤差パルスを使用する
と、従来のシフトパルスのままでは、これに応じ
てシフトパルスも2種類のものを切換えて使用し
なければならないことになる。もちろん、このよ
うにして本発明を実施することもできるが、次の
ような工夫することにより、このシフトパルス
SHは一種類でよいことになる。
すなわち、第5図に示すように、シフトパルス
SHとして、識別誤差パルス1周期のはじめの部
分と終りの部分に2個のパルスを有するパルス列
を使用する。これにより識別誤差パルスがAの場
合もBの場合も等しく、相関器6の内部のシフト
レジスタによりシフトされる。第5図で、Aは識
別誤差パルスA、Bは識別誤差パルスBについ
て、パルス情報の位置を示す。SHはシフトパル
スである。以上述べたように、本発明によれば、
相関器、平均化回路、あるいはタツプ重み回路等
の制御回路に変更を必要とせずに、外部のデジタ
ル回路の簡単な改良のみで、自動等化器の定常特
性を劣化することなく引込時間を短縮した自動等
化器を得る。
【図面の簡単な説明】
第1図は本発明実施例の自動等化器回路構成
図。第2図は多値識別誤差パルスAおよびBの1
サイクルの波形図。イは識別誤差が正のとき、ロ
は負のときを示す。第3図は多値識別誤差パルス
Aが選択されたときの動作波形図。第4図は多値
識別誤差パルスBが選択されたときの動作波形
図。第5図はシフトパルスSHと多値識別誤差パ
ルスAまたはBとの時間関係を示す図。 1a,1b…1n-1……遅延回路、2……終端
器、3a,3b…3n……タツプ重み回路、4…
…加算増幅回路、5……多値パルス識別回路、6
……相関器、7……選択回路、8……誤り監視回
路、9……平均化回路。

Claims (1)

  1. 【特許請求の範囲】 1 受信多値信号が通過するタツプ付きの遅延回
    路1a〜1n-1と、 この遅延回路の入力または出力もしくはタツプ
    からそれぞれ分岐された複数の信号がそれぞれ通
    過するタツプ重み回路3a〜3nと、 このタツプ重み回路を通過した各信号の合成出
    力を得る回路手段と、 この合成出力から出力信号OUTを得るととも
    に、この合成出力の多値パルス信号を識別して識
    別誤差をその極性を示す極性情報Pおよび修正量
    を示す識別誤差パルスとして検出する多値パルス
    識別回路5と、 この多値パルス識別回路の出力にしたがつて上
    記タツプ重み回路に与える制御信号を演算する演
    算手段6,9と を備えたトランスバーサル形自動等化器におい
    て、 上記出力信号の誤りを監視する誤り監視回路8
    を設け、 上記多値パルス識別回路は、上記識別誤差パル
    スとして一つの誤差に対応して占有率が異なる二
    種類のパルス(AおよびB)を発生させる構成で
    あり、 この二種類のパルスの一方を上記誤り監視回路
    の検出出力にしたがつて、誤りが多いときには占
    有率の大きい方を選択し誤りが少ないときには占
    有率の小さい方を選択して上記演算手段に供給す
    る選択回路7を設けた ことを特徴とするトランスバーサル形自動等化
    器。
JP4202178A 1978-04-10 1978-04-10 Automatic equalizer Granted JPS54133866A (en)

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JP4202178A JPS54133866A (en) 1978-04-10 1978-04-10 Automatic equalizer

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JP4202178A JPS54133866A (en) 1978-04-10 1978-04-10 Automatic equalizer

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Publication Number Publication Date
JPS54133866A JPS54133866A (en) 1979-10-17
JPS6244444B2 true JPS6244444B2 (ja) 1987-09-21

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ID=12624507

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JP4202178A Granted JPS54133866A (en) 1978-04-10 1978-04-10 Automatic equalizer

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS572136A (en) * 1980-06-04 1982-01-07 Toshiba Corp Demodulating device
JPS5741022A (en) * 1980-08-26 1982-03-06 Nec Corp Automatic equalizer

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5741845B2 (ja) * 1973-05-18 1982-09-06

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JPS54133866A (en) 1979-10-17

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