JPS6247300U - - Google Patents

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JPS6247300U
JPS6247300U JP6273685U JP6273685U JPS6247300U JP S6247300 U JPS6247300 U JP S6247300U JP 6273685 U JP6273685 U JP 6273685U JP 6273685 U JP6273685 U JP 6273685U JP S6247300 U JPS6247300 U JP S6247300U
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JP
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audio signal
address
processing device
time difference
memory
Prior art date
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JP6273685U
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Description

【図面の簡単な説明】
第１図は本考案の一実施例を示すブロツク図、
第２図は第１図におけるメモリの書込み及び読出
しアドレスの位置関係を示す図、第３図は疑似ス
テレオ装置においてオーデイオ信号の遅延を例え
ばデイジタル的に行なつた場合の構成を示すブロ
ツク図である。 主要部分の符号の説明、２……メモリ、３……
書込みアドレス発生回路、４，５……マルチプレ
クサ、１２……読出しアドレス発生回路、１３…
…加算器、１４……増分アドレスカウンタ、１５
，１６……電圧制御増幅器、１８……データ変換
器。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 入力アナログオーデイオ信号に基づいて各
    々所定の時間差を持つ複数のオーデイオ信号を出
    力する遅延回路を含むオーデイオ信号処理装置で
    あつて、前記複数のオーデイオ信号間の時間差に
    応じた制御信号を出力する手段と、前記制御信号
    に応じて前記複数のオーデイオ信号の各信号レベ
    ルを調整する手段とを備えたことを特徴とするオ
    ーデイオ信号処理装置。 (2) 前記遅延回路は、前記入力アナログオーデ
    イオ信号をデイジタル化するＡ／Ｄ（アナログ／
    デイジタル）変換器と、書込み及び読出し自在な
    メモリと、前記Ａ／Ｄ変換器の出力データを前記
    メモリの書込みアドレスで指定されたアドレスに
    書き込みかつ互いに前記時間差に対応したアドレ
    ス分だけ異なる複数の読出しアドレスで指定され
    たアドレスから記憶データを読み出すべく制御す
    るメモリ制御手段とを有することを特徴とする実
    用新案登録請求の範囲第１項記載のオーデイオ信
    号処理装置。
JP6273685U 1985-04-26 1985-04-26 Pending JPS6247300U (ja)

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JP6273685U JPS6247300U (ja) 1985-04-26 1985-04-26

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JPS6247300U true JPS6247300U (ja) 1987-03-23

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JP6273685U Pending JPS6247300U (ja) 1985-04-26 1985-04-26

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50115502A (ja) * 1974-02-20 1975-09-10
JPS5645360A (en) * 1979-09-14 1981-04-25 Chiyoda Koki:Kk Grinding device for lens
JPS61130000A (ja) * 1984-11-28 1986-06-17 Nippon Gakki Seizo Kk 音像位置制御装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50115502A (ja) * 1974-02-20 1975-09-10
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JPS61130000A (ja) * 1984-11-28 1986-06-17 Nippon Gakki Seizo Kk 音像位置制御装置

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