JPS6284744A - 超音波受波整相回路 - Google Patents
超音波受波整相回路Info
- Publication number
- JPS6284744A JPS6284744A JP22360385A JP22360385A JPS6284744A JP S6284744 A JPS6284744 A JP S6284744A JP 22360385 A JP22360385 A JP 22360385A JP 22360385 A JP22360385 A JP 22360385A JP S6284744 A JPS6284744 A JP S6284744A
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- JP
- Japan
- Prior art keywords
- variable delay
- delay
- phasing circuit
- variable
- time
- Prior art date
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- Pending
Links
- 238000013139 quantization Methods 0.000 claims description 8
- 238000002604 ultrasonography Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
- RDYMFSUJUZBWLH-UHFFFAOYSA-N endosulfan Chemical compound C12COS(=O)OCC2C2(Cl)C(Cl)=C(Cl)C1(Cl)C2(Cl)Cl RDYMFSUJUZBWLH-UHFFFAOYSA-N 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
Landscapes
- Ultra Sonic Daignosis Equipment (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は超音波診断装置に係り、特に簡易な受波整相回
路に関する。
路に関する。
従来の簡易受波整相回路の例として第１図に示すように
、 タップ間に固定遅延手段１０１〜１０３を有する主
遅延手段１００と遅延時間を可変としうる前置遅延手段
１１０との間に切換手段Ｓ Ｗｌ 、 Ｓ ｗ２を具備
するものがある。（例えば米国特許第４１１６２２９号
） この切換手段εＷ工。
、 タップ間に固定遅延手段１０１〜１０３を有する主
遅延手段１００と遅延時間を可変としうる前置遅延手段
１１０との間に切換手段Ｓ Ｗｌ 、 Ｓ ｗ２を具備
するものがある。（例えば米国特許第４１１６２２９号
） この切換手段εＷ工。
ＳＷ２はそれぞれ４個の接点のうち任意の１個のみがＯ
Ｎ状態となり他はＯＦＦとなるものである。
Ｎ状態となり他はＯＦＦとなるものである。
この例は整相回路の全遅延量を最小にする利点はあるが
、入力チャンネル数が１０〜２０チヤンネルに増大した
場合、切換手段の回路規模が増大する欠点があった。
、入力チャンネル数が１０〜２０チヤンネルに増大した
場合、切換手段の回路規模が増大する欠点があった。
本発明の目的は超音波診断装置の簡易受波整相回路提供
することにある。
することにある。
本発明は主遅延手段の各タップ間の遅延時間を可変とす
ることにより切換器構成を簡略化するものである。
ることにより切換器構成を簡略化するものである。
ここで、各タップ間の可変遅延手段の時間量子化単位は
、配列素子と各タップ間との間に配置される前置遅延手
段の時間量子化単位より大とするものである。
、配列素子と各タップ間との間に配置される前置遅延手
段の時間量子化単位より大とするものである。
以下９本発明の実施例を詳細に説明する。第２図は超音
波受波整相回路の概略であり、反射源３ｏからの球面音
波を配列振動子３２により圧電変換する。圧電変換後の
受波信号は位相が各チャンネルごとに異なるため、整相
器３４により各素子ごとに遅延時間を調節し、同位相出
力を得た後。
波受波整相回路の概略であり、反射源３ｏからの球面音
波を配列振動子３２により圧電変換する。圧電変換後の
受波信号は位相が各チャンネルごとに異なるため、整相
器３４により各素子ごとに遅延時間を調節し、同位相出
力を得た後。
加算器３６により出力信号を得るものである。
第３図は上記のような球面波の受波において配列素子に
与えるべき補償用遅延時間の例を示す。
与えるべき補償用遅延時間の例を示す。
ここで横軸は配列振動子のチャンネル番号を示し第１チ
ヤンネルは受波口径の中・６、第９チヤンネルは最外側
チャンネルである。曲線４０は口径１６ｍｍ、反射源の
深度５０ｍｍの場合であるの補償用遅延時間を示す。
ヤンネルは受波口径の中・６、第９チヤンネルは最外側
チャンネルである。曲線４０は口径１６ｍｍ、反射源の
深度５０ｍｍの場合であるの補償用遅延時間を示す。
本実施例ではこのような遅延時間分布を主遅延線と前置
延線とで得るが、主遅延線は第３図に線４２で示すよう
にて、の時間量子単位を有する可変遅延とする。
延線とで得るが、主遅延線は第３図に線４２で示すよう
にて、の時間量子単位を有する可変遅延とする。
本発明の第１実施例を第４図に示す。１ｏは主遅延線で
あり、ＴＰはタップ、１１は第１の可変遅延線、１２は
前置遅延である第２の可変遅延線、１３は加算器、１，
２．・・・、ｎは入力端子、１８は出力端子である。
あり、ＴＰはタップ、１１は第１の可変遅延線、１２は
前置遅延である第２の可変遅延線、１３は加算器、１，
２．・・・、ｎは入力端子、１８は出力端子である。
第１可変遅延線１１は固定遅延線１５と第１の切換器１
４とからなり、第２可変遅延線１２はタップ付遅延線１
６と第２の切換器１７とからなる。
４とからなり、第２可変遅延線１２はタップ付遅延線１
６と第２の切換器１７とからなる。
ここで、第１可変遅延線１１の時間量子化単位τ１は第
２可変遅延線１２の時間量子化単位τ２より大とする。
２可変遅延線１２の時間量子化単位τ２より大とする。
第４図において、第１切換器１４および第２切換器１７
の制御回路は省略されている。
の制御回路は省略されている。
かかる構成において、第３図に示すような、主遅延によ
る遅延時間が得られるように第４図の第１切換器１４を
制御する（ただし ｎ＝９）。
る遅延時間が得られるように第４図の第１切換器１４を
制御する（ただし ｎ＝９）。
受波整相器の各チャンネルに必要な補償用遅延時間と、
上記主遅延による遅延時間との差を第４図の第２可変遅
延線１２で得られるように第２切換器１７を制御するこ
とが可能である。
上記主遅延による遅延時間との差を第４図の第２可変遅
延線１２で得られるように第２切換器１７を制御するこ
とが可能である。
第５図は本発明の第２実施例である。１９は前置遅延で
あり、具体構成を（ｃ）、（ｄ）に示す。
あり、具体構成を（ｃ）、（ｄ）に示す。
２０は第３の可変遅延線である。第１可変遅延手段１１
の時間量子化単位で１とすると第１可変手段１１により
得られる遅延時間は０またはτ１である。第２可変遅延
手段１２．第３可変遅延手段１９については第６．第７
図を用いて後述する。
の時間量子化単位で１とすると第１可変手段１１により
得られる遅延時間は０またはτ１である。第２可変遅延
手段１２．第３可変遅延手段１９については第６．第７
図を用いて後述する。
第５図における第１可変遅延手段１１の他の実施例を同
図（ｂ）に示す。第１切換器１４の位置が異なるだけで
ある。第５図の前置遅延１９は同図（ｃ）、（ｄ）に示
すように、第２可変遅延手段１２と加算器１３とにより
それぞれ並列形または直列形により構成される。
図（ｂ）に示す。第１切換器１４の位置が異なるだけで
ある。第５図の前置遅延１９は同図（ｃ）、（ｄ）に示
すように、第２可変遅延手段１２と加算器１３とにより
それぞれ並列形または直列形により構成される。
第６．第７図は上記第２実施例の具体例である。
第６図の補償用遅延時間は第３図と同一の補償用遅延時
間である。第７図に示すように、主遅延の第１可変遅延
１１−２．１１−２の時間量子化単位をτ１（τｔ＝２
００ｎ ｓとする）、第２可変遅延回路１２の遅延時間
をτ２１．τ２２．パ・、τ２Ｂ。
間である。第７図に示すように、主遅延の第１可変遅延
１１−２．１１−２の時間量子化単位をτ１（τｔ＝２
００ｎ ｓとする）、第２可変遅延回路１２の遅延時間
をτ２１．τ２２．パ・、τ２Ｂ。
第３可変遅延回路２０の遅延時間をτ３１．・・・、τ
３とする。
３とする。
かかる構成において、第３可変遅延で３３＝Ｏとし、第
２可変遅延で２７〜τ２９を第６図に示す値とする。第
１可変遅延１１−２の遅延時間をτ、。
２可変遅延で２７〜τ２９を第６図に示す値とする。第
１可変遅延１１−２の遅延時間をτ、。
第３可変遅延τ３□を第６図に示す値とする。−第１可
変遅延時間τ、と第３可変遅延τ３□との和τ１＋τ３
□と全体の補償用遅延時間との差が第２可変遅延に与え
るべき遅延時間である。同様にして各可変遅延の全ての
遅延時間が決定される。
変遅延時間τ、と第３可変遅延τ３□との和τ１＋τ３
□と全体の補償用遅延時間との差が第２可変遅延に与え
るべき遅延時間である。同様にして各可変遅延の全ての
遅延時間が決定される。
本発明によれば、特に複雑な切換器を要することなく、
簡略かつ経済的な超音波受波整相回路を実現できる。
簡略かつ経済的な超音波受波整相回路を実現できる。
第１図は従来方式の説明図、第２図は参考図、第３およ
び第４図は本発明の第１の実施例である。 第５．第６．第７図は本発明の第２実施例である。 １０・・・主遅延線、１１は第１可変遅延線、１２は第
２可変遅延線、２０は第３可変遅延線、１３は加算器、
１４は第１切換器である。 ・′）。 代理人弁理士 小 川 勝 男 １）第４０
び第４図は本発明の第１の実施例である。 第５．第６．第７図は本発明の第２実施例である。 １０・・・主遅延線、１１は第１可変遅延線、１２は第
２可変遅延線、２０は第３可変遅延線、１３は加算器、
１４は第１切換器である。 ・′）。 代理人弁理士 小 川 勝 男 １）第４０
Claims (1)
- 配列振動子の送受波信号の位相を制御して超音波ビーム
の偏向、収束を行なう超音波受波整相回路において、複
数のタップを有し、かつ、タップ間に第１の可変遅延線
を有する主遅延手段と、各配列素子と上記タップとの間
に、第２の可変遅延手段を有し、上記第１の可変遅延手
段の時間量子化単位が上記第２の可変遅延手段の時間量
子化単位より大であることを特徴とする超音波受波整相
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22360385A JPS6284744A (ja) | 1985-10-09 | 1985-10-09 | 超音波受波整相回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22360385A JPS6284744A (ja) | 1985-10-09 | 1985-10-09 | 超音波受波整相回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6284744A true JPS6284744A (ja) | 1987-04-18 |
Family
ID=16800770
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22360385A Pending JPS6284744A (ja) | 1985-10-09 | 1985-10-09 | 超音波受波整相回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6284744A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000033087A (ja) * | 1998-05-28 | 2000-02-02 | Hewlett Packard Co <Hp> | グル―プ内プロセッサを有するフェ―ズドアレイ音響装置 |
-
1985
- 1985-10-09 JP JP22360385A patent/JPS6284744A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000033087A (ja) * | 1998-05-28 | 2000-02-02 | Hewlett Packard Co <Hp> | グル―プ内プロセッサを有するフェ―ズドアレイ音響装置 |
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