JPS6296744U - - Google Patents

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JPS6296744U
JPS6296744U JP18808985U JP18808985U JPS6296744U JP S6296744 U JPS6296744 U JP S6296744U JP 18808985 U JP18808985 U JP 18808985U JP 18808985 U JP18808985 U JP 18808985U JP S6296744 U JPS6296744 U JP S6296744U
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Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す回路図、第２
図は従来のパリテイチエツクの割込制御回路の一
例を示す回路図である。 １ａ，１ｂ……下位及び上位のデータメモリ、
２……パリテイ発生器、３ａ，３ｂ……下位及び
上位のパリテイビツトメモリ、４ａ，４ｂ……下
位及び上位の比較回路、５……マスク回路、６…
…出力回路、１１……データバス、１２ａ，１２
ｂ，１２ｃ……データバツフア、５１……インバ
ータ、５２，５３……オア回路、５４，５５……
アンド回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 下位及び上位のデータを書込み読出しする下位
    及び上位のデータメモリと、前記下位及び上位の
    データの書込むとき又は読出すときに前記下位及
    び上位のデータを入力し下位及び上位のパリテイ
    ビツトを発生するパリテイ発生器と、前記下位及
    び上位のデータを書込むとき前記下位及び下位の
    パリテイビツトをそれぞれ記憶する下位及び上位
    のパリテイビツトメモリと、前記下位及び上位の
    データを読出すときに前記パリテイ発生器の発生
    する下位及び上位のパリテイビツトと前記下位及
    び上位のパリテイピツトメモリから出力される下
    位及び上位のパリテイビツトとをそれぞれ比較し
    下位及び上位のパリテイチエツク信号を出力する
    下位及び上位の比較回路と、読出し要求のある側
    の前記パリテイチエツク信号は通過させ読出し要
    求のない側の前記パリテイチエツク信号はマスク
    するマスク回路と、前記マスク回路を通過した前
    記パリテイチエツク信号を入力し割込信号を出力
    する出力回路とを有することを特徴とするパリテ
    イチエツクを割込制御回路。
JP18808985U 1985-12-05 1985-12-05 Pending JPS6296744U (ja)

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JP18808985U JPS6296744U (ja) 1985-12-05 1985-12-05

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JP18808985U JPS6296744U (ja) 1985-12-05 1985-12-05

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JPS6296744U true JPS6296744U (ja) 1987-06-20

Family

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Family Applications (1)

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JP18808985U Pending JPS6296744U (ja) 1985-12-05 1985-12-05

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6417131A (en) * 1987-07-11 1989-01-20 Fujitsu Ltd Data transfer system
WO2000016198A1 (en) * 1998-09-14 2000-03-23 Fujitsu Limited Method of diagnosing a memory failure and recovering data, and a memory device using this method

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59743A (ja) * 1982-06-26 1984-01-05 Toshiba Corp Ｅｃｃ回路診断方式
JPS6011949A (ja) * 1983-07-01 1985-01-22 Hitachi Ltd デ−タ処理システム

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