JPS63109062A - 画像形成装置 - Google Patents
画像形成装置Info
- Publication number
- JPS63109062A JPS63109062A JP61256546A JP25654686A JPS63109062A JP S63109062 A JPS63109062 A JP S63109062A JP 61256546 A JP61256546 A JP 61256546A JP 25654686 A JP25654686 A JP 25654686A JP S63109062 A JPS63109062 A JP S63109062A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- agc
- sampling point
- automatic gain
- gain control
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Dot-Matrix Printers And Others (AREA)
- Color, Gradation (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、プリンタに関する。
［従来の技術］
入力画像信号に対する自動利得制御を行なった後にヒス
トグラムを作成し、自動階調補正を行なう従来のプリン
タは、ＡＧＣ回路を有し、このＡＧＣ回路はタイマ等を
使用して、１画面分のスキャニングを行なうようにして
いる。つまり、上記従来装置は、ＡＧＣ回路自身が１画
面分のスキャニングを行ない、入力信号レベルの最大値
に基づいて、増幅率を自動的に決定し、入力信ｔ）レベ
ルの調整を行なった後に、ヒストグラム法による階調補
正を行なっている。
トグラムを作成し、自動階調補正を行なう従来のプリン
タは、ＡＧＣ回路を有し、このＡＧＣ回路はタイマ等を
使用して、１画面分のスキャニングを行なうようにして
いる。つまり、上記従来装置は、ＡＧＣ回路自身が１画
面分のスキャニングを行ない、入力信号レベルの最大値
に基づいて、増幅率を自動的に決定し、入力信ｔ）レベ
ルの調整を行なった後に、ヒストグラム法による階調補
正を行なっている。
すなわち１画像出力装置また画像そのものによって、人
力信号レベルが種々に変化するので、入力信号をそのま
まプリントアウトすると１階調性が無いプリント画像で
あったり、ｅ度分布が偏ったプリント画像となる０階調
性を有しかつ濃度分°布に偏りがないプリント画像を作
り出すために、ＡＧＣ（自動利得制御）を行なうととも
に、階調補正を行なっている。
力信号レベルが種々に変化するので、入力信号をそのま
まプリントアウトすると１階調性が無いプリント画像で
あったり、ｅ度分布が偏ったプリント画像となる０階調
性を有しかつ濃度分°布に偏りがないプリント画像を作
り出すために、ＡＧＣ（自動利得制御）を行なうととも
に、階調補正を行なっている。
しかし、上記従来装置においては、ＡＧＣ回路のサンプ
リングポイントが、丘記ＡＧＣ回路の構成に従って決定
され、一義的にサンプリングポイントが決められるため
に、適切な階調補正を行なうことができない場合がある
という問題がある。
リングポイントが、丘記ＡＧＣ回路の構成に従って決定
され、一義的にサンプリングポイントが決められるため
に、適切な階調補正を行なうことができない場合がある
という問題がある。
すなわち、プリントすべき画像の中に文字データが含ま
れている場合、文字データ部分がＡＧＣに大きく影！す
る。ところが、従来装置においては１文字データ部分の
有無に係わらず、所定間隔でサンプリングポイントを取
るようにしているために、適切なＡＧＣを行なうことが
できない場合がある。
れている場合、文字データ部分がＡＧＣに大きく影！す
る。ところが、従来装置においては１文字データ部分の
有無に係わらず、所定間隔でサンプリングポイントを取
るようにしているために、適切なＡＧＣを行なうことが
できない場合がある。
［発明の目的］
本発明は、上記従来装置の問題点に着目して成されたも
ので、入力画像信号に対する自動利得制御を行なった後
にヒストグラムを作成し、自動階調補正を行なうプリン
タにおいて、自動利得制御を適切に行なうことができる
プリンタを提供することを目的とするものである。
ので、入力画像信号に対する自動利得制御を行なった後
にヒストグラムを作成し、自動階調補正を行なうプリン
タにおいて、自動利得制御を適切に行なうことができる
プリンタを提供することを目的とするものである。
［’Ｊ明の実施例］
第１図は、本発明の一実施例を示すブロック図である。
この実施例は、入力画像信号レベルに応じて増幅率を変
化させるＡＧＣ（自動利得１Ｔ１１制御）回路ｌと、Ａ
／Ｄ［検回路２と、階調−変換を行なう／−マライズ回
路３と、メモリ４と１画像処理回路５と、ヘッドドライ
バ６と、印字へラド７と、システム制御回路８と、スイ
ッチ等の操作部９と、センサ部ｌＯと、モータドライバ
１１とを有する。
化させるＡＧＣ（自動利得１Ｔ１１制御）回路ｌと、Ａ
／Ｄ［検回路２と、階調−変換を行なう／−マライズ回
路３と、メモリ４と１画像処理回路５と、ヘッドドライ
バ６と、印字へラド７と、システム制御回路８と、スイ
ッチ等の操作部９と、センサ部ｌＯと、モータドライバ
１１とを有する。
システム制御回路８は、自動利得制御用のサンプリング
ポイントを指示するものである。
ポイントを指示するものである。
次に、上記実施例の動作について説明する。
第２図は、上記実施例の動作を示すフローチャートであ
る。
る。
まず、プリスキャニングルーズの初期設定を行ない（ｓ
Ｂ、操作部９からシステム制御回路８に対してプリント
要求を出すと、システム制御回路８は、ＡＧＣ回路１の
レベル設定を行なうために、プリスキャニング動作を開
始する。
Ｂ、操作部９からシステム制御回路８に対してプリント
要求を出すと、システム制御回路８は、ＡＧＣ回路１の
レベル設定を行なうために、プリスキャニング動作を開
始する。
ＡＧＣ回路回路、システム制御回路８によって指示され
たサンプリングポイントにおける画像信号のレベルを取
り込み、記憶する（Ｓ２）、そして、プリスキャニング
中、前に記憶された信号レベルと、各サンプリングポイ
ントにおける信号レベルの大きさとを比較し、大きな値
を記憶し、次のサンプリングポイント、その次のサンプ
リングポイント、・・・・・・・・・でも、上記と同じ
動作を繰り返す（Ｓ３、Ｓ４）、そして、プリスキャニ
ング終了後に、ＡＧＣ回路回路増幅レベルを設定する（
５５）。
たサンプリングポイントにおける画像信号のレベルを取
り込み、記憶する（Ｓ２）、そして、プリスキャニング
中、前に記憶された信号レベルと、各サンプリングポイ
ントにおける信号レベルの大きさとを比較し、大きな値
を記憶し、次のサンプリングポイント、その次のサンプ
リングポイント、・・・・・・・・・でも、上記と同じ
動作を繰り返す（Ｓ３、Ｓ４）、そして、プリスキャニ
ング終了後に、ＡＧＣ回路回路増幅レベルを設定する（
５５）。
その後、ヒストグラムループの初期設定を行ない（ＳＳ
）、Ｓ２と同様のデータを入力しく５７）、システム制
御回路８は、プリント画像のヒストグラム法による階調
変換動作を行ない（ＳＳ）、これを１ル一プ分（ｌ水平
走査線分）繰り返す（５９，５１０）、そして、ノーマ
ライズ回路３のノーマライズ曲線を選択し、入力画像デ
ータの階調補正を行なう、つまり、ハイライトポイント
とシャドーポイントとの検索を行ない（ｓ ｔ ｉ）
、これらのハイライトポイントとシャドーポイントとの
濃度に基づいて、階調変換テーブルに従って、階調カー
ブを選択し、入力画像データの階調補正を行なう。
）、Ｓ２と同様のデータを入力しく５７）、システム制
御回路８は、プリント画像のヒストグラム法による階調
変換動作を行ない（ＳＳ）、これを１ル一プ分（ｌ水平
走査線分）繰り返す（５９，５１０）、そして、ノーマ
ライズ回路３のノーマライズ曲線を選択し、入力画像デ
ータの階調補正を行なう、つまり、ハイライトポイント
とシャドーポイントとの検索を行ない（ｓ ｔ ｉ）
、これらのハイライトポイントとシャドーポイントとの
濃度に基づいて、階調変換テーブルに従って、階調カー
ブを選択し、入力画像データの階調補正を行なう。
そして、メモ９４１画像処理回路５、ヘッドドライバ６
を通じて、ヘッド７を駆動し、画像のプリントを得る。
を通じて、ヘッド７を駆動し、画像のプリントを得る。
ｈ記実雄側において、ＡＧＣ回路回路サンプリングポイ
ントを、システム制御回路８が指示することによって、
任意のポイントにおける入力画像信号のレベルを調べる
ことができ、ＡＧＣ回路１の増幅率を決定することがで
きる。具体的には、文字部分については、システムｉ’
ｌＪＪｇ４回路８がサンプリングポイントを指示せず、
文字以外の部分で、システム制御回路８がサンプリング
ポイントを指示する。
ントを、システム制御回路８が指示することによって、
任意のポイントにおける入力画像信号のレベルを調べる
ことができ、ＡＧＣ回路１の増幅率を決定することがで
きる。具体的には、文字部分については、システムｉ’
ｌＪＪｇ４回路８がサンプリングポイントを指示せず、
文字以外の部分で、システム制御回路８がサンプリング
ポイントを指示する。
このようにすることによって、文字部分によるＡＧＣの
＋Ｊｅπがなくなり、適切なＡＧＣを行なうことができ
る。
＋Ｊｅπがなくなり、適切なＡＧＣを行なうことができ
る。
また、上記実施例において、カウンタ等のスキャニング
を行なう手段をＡＧＣ回路１が有する必要がないので、
ＡＧＣ回路１の回路構成が簡単になる。
を行なう手段をＡＧＣ回路１が有する必要がないので、
ＡＧＣ回路１の回路構成が簡単になる。
［発明の効果］
本発明によれば、入力画像信号に対する自動利得制御を
行なった後にヒストグラムを作成し、自動階調補正を行
なうプリンタにおいて、自動利得制御を適切に行なうこ
とができるという効果を有する。
行なった後にヒストグラムを作成し、自動階調補正を行
なうプリンタにおいて、自動利得制御を適切に行なうこ
とができるという効果を有する。
第１図は、本発明の一実施例を示すブロック図である。
第２図は、上記実施例における動作を示すフローチャー
トである。 １・・・ＡＧＣ回路、 ３・・・ノーマライズ回路、 ８・・・システム制御回路。 特許出願人 キャノン株式会社 同代理人 用久保 新 − 第１図
トである。 １・・・ＡＧＣ回路、 ３・・・ノーマライズ回路、 ８・・・システム制御回路。 特許出願人 キャノン株式会社 同代理人 用久保 新 − 第１図
Claims (1)
- 【特許請求の範囲】 入力画像信号に対する自動利得制御を行なった後にヒス
トグラムを作成し、自動階調補正を行なうプリンタにお
いて、 前記自動利得制御用のサンプリングポイントを、システ
ム制御回路が指示することを特徴とするプリンタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61256546A JPH07115497B2 (ja) | 1986-10-27 | 1986-10-27 | 画像形成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61256546A JPH07115497B2 (ja) | 1986-10-27 | 1986-10-27 | 画像形成装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63109062A true JPS63109062A (ja) | 1988-05-13 |
| JPH07115497B2 JPH07115497B2 (ja) | 1995-12-13 |
Family
ID=17294138
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61256546A Expired - Lifetime JPH07115497B2 (ja) | 1986-10-27 | 1986-10-27 | 画像形成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07115497B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8687349B2 (en) | 2010-07-21 | 2014-04-01 | Teradyne, Inc. | Bulk transfer of storage devices using manual loading |
| US9001456B2 (en) | 2010-08-31 | 2015-04-07 | Teradyne, Inc. | Engaging test slots |
| US9459312B2 (en) | 2013-04-10 | 2016-10-04 | Teradyne, Inc. | Electronic assembly test system |
| US12699008B2 (en) | 2023-05-15 | 2026-08-04 | Teradyne, Inc. | Test systems configured to test devices at different temperatures |
-
1986
- 1986-10-27 JP JP61256546A patent/JPH07115497B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH07115497B2 (ja) | 1995-12-13 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |