JPS63154013A - 負荷駆動回路 - Google Patents
負荷駆動回路Info
- Publication number
- JPS63154013A JPS63154013A JP61298267A JP29826786A JPS63154013A JP S63154013 A JPS63154013 A JP S63154013A JP 61298267 A JP61298267 A JP 61298267A JP 29826786 A JP29826786 A JP 29826786A JP S63154013 A JPS63154013 A JP S63154013A
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- JP
- Japan
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- phase
- load
- power supply
- phase power
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Landscapes
- Emergency Protection Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［技術分野１
本発明は、３相電源にて駆動される負荷を３端子サイリ
スタにて制御するようにした負荷駆動回路に関するもの
である。
スタにて制御するようにした負荷駆動回路に関するもの
である。
［背景技術］
従来、３相電源にて駆動される負荷を３ｒａ子サイリス
タにて制御するようにしたこの種の負荷駆動回路として
は、第３図に示すように、逆阻止型３端子サイリスタＱ
と負荷りどの直列回路に３相電源のＲ相の電源電圧を印
加し、３ｒａ子サイリスタＱを異常検出回路Ｘ出力にて
トリがするようにしたものがあった。ここに、異常検出
回路Ｘは、電路の異常（例えば、過電流、欠相、反相な
ど）を検出して異常検出信号を出力するものであり、負
荷りは、異常検出信号が出力されたときに、異常を報知
する報知手段（警報ブザ−、警報ランプなど）あるいは
電路を遮断する保護手段（遮断８１も１引き外し用の電
磁石、リレーなど）である。なお、ダイオードプリフッ
ＤＢでは、３相電源を全波整流して直流電源を形成して
いる。
タにて制御するようにしたこの種の負荷駆動回路として
は、第３図に示すように、逆阻止型３端子サイリスタＱ
と負荷りどの直列回路に３相電源のＲ相の電源電圧を印
加し、３ｒａ子サイリスタＱを異常検出回路Ｘ出力にて
トリがするようにしたものがあった。ここに、異常検出
回路Ｘは、電路の異常（例えば、過電流、欠相、反相な
ど）を検出して異常検出信号を出力するものであり、負
荷りは、異常検出信号が出力されたときに、異常を報知
する報知手段（警報ブザ−、警報ランプなど）あるいは
電路を遮断する保護手段（遮断８１も１引き外し用の電
磁石、リレーなど）である。なお、ダイオードプリフッ
ＤＢでは、３相電源を全波整流して直流電源を形成して
いる。
しかしながら、このような従来例にあっては、３端子サ
イリスタＱが導通した場合において、３相電源のＲ相の
半波整流電圧（第４図に示す）が負荷りに印加されるよ
うになっているので、もしもＲ相が欠相している場合に
は負荷りが駆動されなくなってしまうという問題があっ
た。すなわち、３相電源のＲ相が欠相状態になった場合
には、誤動作が発生することになる。そこで、１５図に
示す従来例のように、ダイオードプリツノＤＢにて全波
整流した全波整流電圧（第６図に示す）を３端子サイリ
スタＱと負荷りとの直列回路に印加するようにしたもの
があった。しかしながら、このような従来例にあっては
、３相電源の欠相による上記不都合が解消されるものの
、欠相が発生していない正常状態において３ｆ４子サイ
リスタＱには常に３相電源を全波整流して得られる直流
電源が印加されることになって、３端子サイリスタＱが
一旦動作すると、電源をオフするかリセット手段（図示
せず）を繰作しないかぎり負荷りが動作したままとなり
、異常検出信号が出力されなくなったときに負荷Ｉ−を
自動的にオフ（報知手段あるいは保護手段の自動復帰）
させることができなくなるという問題があった。そこで
、第７図に示すように、３相電源の各相の電源電圧をダ
イオードＤｌｌＤ２ｔＤ、および負荷（例えば、遮断１
ｆＨＦｊ引き外し用の電磁石）Ｌｌ、Ｌ２．Ｌ３を介し
て３ｙ１１子サイリスタＱに印加するようにしたものが
あった。しかしながら、このような従来例にあっては、
いずれの相が欠相してもいずれかの負荷り、、Ｌ２．Ｌ
、が動作し、しかも自動復帰機能をも有しているが、３
個の負荷り、、Ｌ、、Ｌ、を必要とするので、コストが
高くなるという問題があった。
イリスタＱが導通した場合において、３相電源のＲ相の
半波整流電圧（第４図に示す）が負荷りに印加されるよ
うになっているので、もしもＲ相が欠相している場合に
は負荷りが駆動されなくなってしまうという問題があっ
た。すなわち、３相電源のＲ相が欠相状態になった場合
には、誤動作が発生することになる。そこで、１５図に
示す従来例のように、ダイオードプリツノＤＢにて全波
整流した全波整流電圧（第６図に示す）を３端子サイリ
スタＱと負荷りとの直列回路に印加するようにしたもの
があった。しかしながら、このような従来例にあっては
、３相電源の欠相による上記不都合が解消されるものの
、欠相が発生していない正常状態において３ｆ４子サイ
リスタＱには常に３相電源を全波整流して得られる直流
電源が印加されることになって、３端子サイリスタＱが
一旦動作すると、電源をオフするかリセット手段（図示
せず）を繰作しないかぎり負荷りが動作したままとなり
、異常検出信号が出力されなくなったときに負荷Ｉ−を
自動的にオフ（報知手段あるいは保護手段の自動復帰）
させることができなくなるという問題があった。そこで
、第７図に示すように、３相電源の各相の電源電圧をダ
イオードＤｌｌＤ２ｔＤ、および負荷（例えば、遮断１
ｆＨＦｊ引き外し用の電磁石）Ｌｌ、Ｌ２．Ｌ３を介し
て３ｙ１１子サイリスタＱに印加するようにしたものが
あった。しかしながら、このような従来例にあっては、
いずれの相が欠相してもいずれかの負荷り、、Ｌ２．Ｌ
、が動作し、しかも自動復帰機能をも有しているが、３
個の負荷り、、Ｌ、、Ｌ、を必要とするので、コストが
高くなるという問題があった。
［発明の目的］
本発明は上記の点に鑑みて為されたものであり、その目
的とするところは、３相電源のいずれかの欠相しても負
荷を動作させることができ、しかも、自動復帰機能を有
する安価な負荷駆動回路を提供することにある。
的とするところは、３相電源のいずれかの欠相しても負
荷を動作させることができ、しかも、自動復帰機能を有
する安価な負荷駆動回路を提供することにある。
［発明の図示］
（実施例）
ｔｔＳ１図は本発明一実施例を示すもので、制御信号に
て適宜トリがされる逆阻止型３端子サイリスタＱと負荷
りどの直列回路の一端をそれぞれダイオードＤ １−
Ｄ ２を介して３相電源の２ｆｉＲ，Ｓに接続するとと
もに、上記直列回路の他端を上記２ＲＲ，Ｓのうちの１
線Ｓと３相電源の残りの１．＃ｉＴとにそれぞれダイオ
ードＤ、、Ｄ、を介して接続し、第２図に示すような各
相（Ｒ相、Ｓ相、Ｔ相）の半波整流電圧が上記直列回路
の両端ｌ二印加されるようにしたものである。実施例に
あっては、上記３端子サイリスタＱのトリが回路Ｙに、
異常検出回路Ｘから出力される異常検出信号が７オトカ
ツプラＰＣを介して人力されており、異常検出回路Ｘか
ら異常検知信号が７オトカツプラＰＣを介して出力され
たときに、トリガ回路Ｙが動作して３端子サイリスタＱ
が導通し、負荷りが駆動されるようになっている。
て適宜トリがされる逆阻止型３端子サイリスタＱと負荷
りどの直列回路の一端をそれぞれダイオードＤ １−
Ｄ ２を介して３相電源の２ｆｉＲ，Ｓに接続するとと
もに、上記直列回路の他端を上記２ＲＲ，Ｓのうちの１
線Ｓと３相電源の残りの１．＃ｉＴとにそれぞれダイオ
ードＤ、、Ｄ、を介して接続し、第２図に示すような各
相（Ｒ相、Ｓ相、Ｔ相）の半波整流電圧が上記直列回路
の両端ｌ二印加されるようにしたものである。実施例に
あっては、上記３端子サイリスタＱのトリが回路Ｙに、
異常検出回路Ｘから出力される異常検出信号が７オトカ
ツプラＰＣを介して人力されており、異常検出回路Ｘか
ら異常検知信号が７オトカツプラＰＣを介して出力され
たときに、トリガ回路Ｙが動作して３端子サイリスタＱ
が導通し、負荷りが駆動されるようになっている。
以下、実施例の動作について説明する。いま、３相電源
に欠相が発生していない正常状態において、負荷りに印
加される電圧は第２図に示すようになり、０■区間が存
在するので、異常検出回路Ｘから異常検知（ｉｔ号が出
力されなくなって３端子サイリスタＱにトリが信号が印
加されなくなった場合には、直ちに３端子サイリスタＱ
がオフして負荷りの動作が停止され、報知手段および保
護手段の自動復帰が行なわれることになる。
に欠相が発生していない正常状態において、負荷りに印
加される電圧は第２図に示すようになり、０■区間が存
在するので、異常検出回路Ｘから異常検知（ｉｔ号が出
力されなくなって３端子サイリスタＱにトリが信号が印
加されなくなった場合には、直ちに３端子サイリスタＱ
がオフして負荷りの動作が停止され、報知手段および保
護手段の自動復帰が行なわれることになる。
−七 り州！謂＾ｐ州講ａｋｌ侑ＩＪ）−Ｊ番鮨−児寺
玲知信号が出力され、３端子サイリスタＱがトリガされ
てオンした場合には、Ｓ相→ダイオードＤ２→３端子サ
イリスタＱ→ダイオードＤ、→Ｔ相の経路で電流が流れ
て負荷りが動作するようになっており、また、３相電源
のＳ相が欠相した場合には、Ｒ相→ダイオードＤ１→３
端子サイリスタＱ→ダイオードＤ、→Ｔ相の経路で電流
が流れて負荷りが動作するようになっており、また、３
相電源のＴ相が欠相した場合には、Ｒ相→ダイオードＤ
、→３端子サイリスタＱ→グイオードＤ、→Ｓ相の経路
で電流が流れて負荷りが動作、するようになっている。
玲知信号が出力され、３端子サイリスタＱがトリガされ
てオンした場合には、Ｓ相→ダイオードＤ２→３端子サ
イリスタＱ→ダイオードＤ、→Ｔ相の経路で電流が流れ
て負荷りが動作するようになっており、また、３相電源
のＳ相が欠相した場合には、Ｒ相→ダイオードＤ１→３
端子サイリスタＱ→ダイオードＤ、→Ｔ相の経路で電流
が流れて負荷りが動作するようになっており、また、３
相電源のＴ相が欠相した場合には、Ｒ相→ダイオードＤ
、→３端子サイリスタＱ→グイオードＤ、→Ｓ相の経路
で電流が流れて負荷りが動作、するようになっている。
したがって、３相電源のいずれかの相が欠相した場合に
あっても負荷りが動作するようになっている。なお、欠
相時において負荷りに流れる電流は第３図従来例の場合
と同等であり、負荷Ｉ、なる電磁石の吸引力は、引き外
し機構を駆動するのに十分な大きさである。
あっても負荷りが動作するようになっている。なお、欠
相時において負荷りに流れる電流は第３図従来例の場合
と同等であり、負荷Ｉ、なる電磁石の吸引力は、引き外
し機構を駆動するのに十分な大きさである。
［発明の効果］
本発明は上述のように、制御信号にで適宜トリガされる
３端子サイリスクと負荷との直列回路の一端をそれぞれ
ダイオードを介して３相電源の２線に接続するとともに
、上記直列回路の他端を上記２線のうちの１線と３相電
源の残りの１８とに”それぞれダイオードを介して接続
し、各相の半波整流電圧が上記直列回路の両端に印加さ
れるようにしだらのであるので、３相電源のいずれかの
相が欠相しても負荷を動作させることができ、しかも、
自動復帰機能を有する安価な負荷駆動回路を提供するこ
とができるという効果がある。
３端子サイリスクと負荷との直列回路の一端をそれぞれ
ダイオードを介して３相電源の２線に接続するとともに
、上記直列回路の他端を上記２線のうちの１線と３相電
源の残りの１８とに”それぞれダイオードを介して接続
し、各相の半波整流電圧が上記直列回路の両端に印加さ
れるようにしだらのであるので、３相電源のいずれかの
相が欠相しても負荷を動作させることができ、しかも、
自動復帰機能を有する安価な負荷駆動回路を提供するこ
とができるという効果がある。
第１図は本発明一実施例の回路図、第２図は同上の動作
説明図、第３図は従来例の回路図、ＰＩＳ４図は同上の
動作説明図、第５図は他の従来例の回路図、第６図は同
上の動作説明図、第７図はさらに他の従来例の回路図で
ある。 Ｄ、〜Ｄ４はダイオード、Ｌは負荷、Ｑは３端子サイリ
スタである。 代理人 弁理士 石 １）艮 七 １）、〜１）、・・・ダイオード 第３図 第４図 第５ｒＡ 第６図
説明図、第３図は従来例の回路図、ＰＩＳ４図は同上の
動作説明図、第５図は他の従来例の回路図、第６図は同
上の動作説明図、第７図はさらに他の従来例の回路図で
ある。 Ｄ、〜Ｄ４はダイオード、Ｌは負荷、Ｑは３端子サイリ
スタである。 代理人 弁理士 石 １）艮 七 １）、〜１）、・・・ダイオード 第３図 第４図 第５ｒＡ 第６図
Claims (1)
- （１）制御信号にて適宜トリガされる３端子サイリスタ
と負荷との直列回路の一端をそれぞれダイオードを介し
て３相電源の２線に接続するとともに、上記直列回路の
他端を上記２線のうちの１線と３相電源の残りの１線と
にそれぞれダイオードを介して接続し、各相の半波整流
電圧が上記直列回路の両端に印加されるようにしたこと
を特徴とする負荷駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61298267A JPS63154013A (ja) | 1986-12-15 | 1986-12-15 | 負荷駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61298267A JPS63154013A (ja) | 1986-12-15 | 1986-12-15 | 負荷駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63154013A true JPS63154013A (ja) | 1988-06-27 |
Family
ID=17857421
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61298267A Pending JPS63154013A (ja) | 1986-12-15 | 1986-12-15 | 負荷駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63154013A (ja) |
-
1986
- 1986-12-15 JP JP61298267A patent/JPS63154013A/ja active Pending
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