JPS633360A - デユアル・コンピユ−タ方式 - Google Patents
デユアル・コンピユ−タ方式Info
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- JPS633360A JPS633360A JP14761586A JP14761586A JPS633360A JP S633360 A JPS633360 A JP S633360A JP 14761586 A JP14761586 A JP 14761586A JP 14761586 A JP14761586 A JP 14761586A JP S633360 A JPS633360 A JP S633360A
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- Japan
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- computer
- external device
- computers
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- 230000009977 dual effect Effects 0.000 title claims abstract description 11
- 230000005540 biological transmission Effects 0.000 claims abstract description 14
- 238000004891 communication Methods 0.000 claims description 6
- 238000000034 method Methods 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 8
- 238000004590 computer program Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Landscapes
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデュアル運転するコンピュータ・システムに関
する。
する。
従来のこの種のデュアル・コンピュータ方式の一実施例
の系統図を第３図に示す。現用側コンピュータ２１と予
備側コンピュータ２２とは切替回路２４を介して外部装
置２３にシリアルに接続する。切替判断回路２５はコン
ピュータ２１とコンピュータ２２からアラーム信号２９
を受けて、どちらのコンピュータを現用側にするか判断
して、切替信号３０を切替回路２４、コンピュータ２１
、コンピュータ２２へ出力する。切替回路２４は切替信
号３０を受けて外部装置２３の送受信ライン２８を現用
側コンピュータに接続するようにスイッチャ２７を制御
する。第３図ではコンピュータ２１が現用側、コンピュ
ータ２２が予信側であることを示す。コンピュータ２１
とコンピュータ２２のプログラムは時計装置２６から時
刻信号３１を受けて決められた時刻に外部装置２３に対
する制御を行うために、該コンピュータが現用側か予備
側かを意識して、現用側コンピュータは外部装置２３と
通信し、予備側コンピュータは外部装置２３と通信せず
に現用側コンピュータと通信を行い、現用側コンピュー
タから外部装置２３に関する通信情報を受ける方法をと
っていた。
の系統図を第３図に示す。現用側コンピュータ２１と予
備側コンピュータ２２とは切替回路２４を介して外部装
置２３にシリアルに接続する。切替判断回路２５はコン
ピュータ２１とコンピュータ２２からアラーム信号２９
を受けて、どちらのコンピュータを現用側にするか判断
して、切替信号３０を切替回路２４、コンピュータ２１
、コンピュータ２２へ出力する。切替回路２４は切替信
号３０を受けて外部装置２３の送受信ライン２８を現用
側コンピュータに接続するようにスイッチャ２７を制御
する。第３図ではコンピュータ２１が現用側、コンピュ
ータ２２が予信側であることを示す。コンピュータ２１
とコンピュータ２２のプログラムは時計装置２６から時
刻信号３１を受けて決められた時刻に外部装置２３に対
する制御を行うために、該コンピュータが現用側か予備
側かを意識して、現用側コンピュータは外部装置２３と
通信し、予備側コンピュータは外部装置２３と通信せず
に現用側コンピュータと通信を行い、現用側コンピュー
タから外部装置２３に関する通信情報を受ける方法をと
っていた。
上述した従来のデュアル・コンピュータ方式では現用側
コンピュータと予備側コンピュータのプログラム動作が
異なるので、プログラム開発量が大きくなり、また完全
なデュアル動作にならず、動作が複雑になるという欠点
があった。
コンピュータと予備側コンピュータのプログラム動作が
異なるので、プログラム開発量が大きくなり、また完全
なデュアル動作にならず、動作が複雑になるという欠点
があった。
本発明の目的は現用側コンピュータと予備側コンピュー
タとに完全なデュアル動作を行わせるデュアル・コンピ
ュータ方式を提供することにある。
タとに完全なデュアル動作を行わせるデュアル・コンピ
ュータ方式を提供することにある。
本発明は１台の外部装置に現用側及び予備側のコンピュ
ータをシリアルに接続し、外部装置、コンピュータ間に
て通信を行うデュアル・コンピュータ方式において、現
用側コンピュータの送信出力だけを外部装置の受信入力
へ接続する切替回路と、外部装置の送信出力を２台のコ
ンピュータの両方の受信入力へ接続する分配回路とを有
し、２台のコンピュータが外部装置に対して同時刻に同
一の通信を行うようにしたことを特徴とするデュアル・
コンピュータ方式である。
ータをシリアルに接続し、外部装置、コンピュータ間に
て通信を行うデュアル・コンピュータ方式において、現
用側コンピュータの送信出力だけを外部装置の受信入力
へ接続する切替回路と、外部装置の送信出力を２台のコ
ンピュータの両方の受信入力へ接続する分配回路とを有
し、２台のコンピュータが外部装置に対して同時刻に同
一の通信を行うようにしたことを特徴とするデュアル・
コンピュータ方式である。
以下、本発明の一実施例を図により説明する。
第１図は本発明の一実施例の系統図である。コンピュー
タ１とコンピュータ２との送受信ライン８は切替・分配
回路４を介して外部装置３へ接続する。切替判断回路１
０はコンピュータ１とコンピュータ２からアラーム信号
９を受けて２台のコンピュータの現用側、予備側を判断
し、切替・分配回路４のスイッチャ７を制御するための
切替信号１０を出力する。本図では、コンピュータ１が
現用側、コンピュータ２が予備側であることを示す。
タ１とコンピュータ２との送受信ライン８は切替・分配
回路４を介して外部装置３へ接続する。切替判断回路１
０はコンピュータ１とコンピュータ２からアラーム信号
９を受けて２台のコンピュータの現用側、予備側を判断
し、切替・分配回路４のスイッチャ７を制御するための
切替信号１０を出力する。本図では、コンピュータ１が
現用側、コンピュータ２が予備側であることを示す。
時計装置６はコンピュータ１、コンピュータ２へ時刻信
号１１を出力する。
号１１を出力する。
第２図は本発明の一実施例の系統図の制御タイミング図
である。現用側コンピュータ１２、予備側コンピュータ
１３、外部装置１４の送信データ１５、受信データ１６
として、制御信号１７ 、１８、応答信号１９が送受信
されるタイミングを示す 第１図によると、切替・分配回路４は切替判断回路５か
ら切替信号１０を受けて、外部装置３の受信入力を現用
側コンピュータの送信出力へ接続するように、スイッチ
ャ７を制御する。また、外部装置３の送信出力はコンピ
ュータ１とコンピュータ２の両方へ分配接続している。
である。現用側コンピュータ１２、予備側コンピュータ
１３、外部装置１４の送信データ１５、受信データ１６
として、制御信号１７ 、１８、応答信号１９が送受信
されるタイミングを示す 第１図によると、切替・分配回路４は切替判断回路５か
ら切替信号１０を受けて、外部装置３の受信入力を現用
側コンピュータの送信出力へ接続するように、スイッチ
ャ７を制御する。また、外部装置３の送信出力はコンピ
ュータ１とコンピュータ２の両方へ分配接続している。
コンピュータ１とコンピュータ２は時計装置６から時刻
信号１１を受けて、決められた時刻に外部装置３に対す
る制御を行うために外部装置３へ制御信号を送信する。
信号１１を受けて、決められた時刻に外部装置３に対す
る制御を行うために外部装置３へ制御信号を送信する。
第２図の制御タイミング図による′と、現用側コンピュ
ータ１２からの制御信号１７は外部装置１４で受信でき
るが、予備側コンピュータ１３からの制御信号１８は外
部袋［１４へ届かない。次に外部装置１４では制御信号
１７の受信に対する応答信号１９を送信する。応答信号
１９は現用側コンピュータ１２、予備側コンピュータ１
３の両方で受信でき、２台のコンピュータプログラムは
外部装置に対する制御処理を正常に完了できる。
ータ１２からの制御信号１７は外部装置１４で受信でき
るが、予備側コンピュータ１３からの制御信号１８は外
部袋［１４へ届かない。次に外部装置１４では制御信号
１７の受信に対する応答信号１９を送信する。応答信号
１９は現用側コンピュータ１２、予備側コンピュータ１
３の両方で受信でき、２台のコンピュータプログラムは
外部装置に対する制御処理を正常に完了できる。
以上説明したように本発明は現用側コンピュータの送信
出力だけを外部装置の受信入力へ接続し、外部装置の送
信出力を２台のコンピュータの両方の受信入力へ接続し
、２台のコンピュータは外部装置に対して同時刻に同一
の通信を行うことにより、２台のコンピュータは完全な
デュアル運転になり、動作が簡単になること、および同
一のプログラムを使用することにより、プログラム開発
量を少なくできる効果がある。
出力だけを外部装置の受信入力へ接続し、外部装置の送
信出力を２台のコンピュータの両方の受信入力へ接続し
、２台のコンピュータは外部装置に対して同時刻に同一
の通信を行うことにより、２台のコンピュータは完全な
デュアル運転になり、動作が簡単になること、および同
一のプログラムを使用することにより、プログラム開発
量を少なくできる効果がある。
第１図は本発明の一実施例の系統図、第２図は第１図の
制御タイミング図、第３図は従来の一実施例の系統図で
ある。
制御タイミング図、第３図は従来の一実施例の系統図で
ある。
Claims (1)
- （１）１台の外部装置に現用側及び予備側のコンピュー
タをシリアルに接続し、外部装置、コンピュータ間にて
通信を行うデュアル・コンピュータ方式において、現用
側コンピュータの送信出力だけを外部装置の受信入力へ
接続する切替回路と、外部装置の送信出力を２台のコン
ピュータの両方の受信入力へ接続する分配回路とを有し
、２台のコンピュータが外部装置に対して同時刻に同一
の通信を行うようにしたことを特徴とするデュアル・コ
ンピュータ方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14761586A JPS633360A (ja) | 1986-06-24 | 1986-06-24 | デユアル・コンピユ−タ方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14761586A JPS633360A (ja) | 1986-06-24 | 1986-06-24 | デユアル・コンピユ−タ方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS633360A true JPS633360A (ja) | 1988-01-08 |
Family
ID=15434327
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14761586A Pending JPS633360A (ja) | 1986-06-24 | 1986-06-24 | デユアル・コンピユ−タ方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS633360A (ja) |
-
1986
- 1986-06-24 JP JP14761586A patent/JPS633360A/ja active Pending
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