JPS6333733B2 - - Google Patents

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Publication number
JPS6333733B2
JPS6333733B2 JP54056705A JP5670579A JPS6333733B2 JP S6333733 B2 JPS6333733 B2 JP S6333733B2 JP 54056705 A JP54056705 A JP 54056705A JP 5670579 A JP5670579 A JP 5670579A JP S6333733 B2 JPS6333733 B2 JP S6333733B2
Authority
JP
Japan
Prior art keywords
output
input
gate
clock
phase
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP54056705A
Other languages
English (en)
Other versions
JPS55147035A (en
Inventor
Hidemasa Nakaoka
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP5670579A priority Critical patent/JPS55147035A/ja
Publication of JPS55147035A publication Critical patent/JPS55147035A/ja
Publication of JPS6333733B2 publication Critical patent/JPS6333733B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K5/00Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/15Arrangements in which pulses are delivered at different times at several outputs, i.e. pulse distributors
    • H03K5/15013Arrangements in which pulses are delivered at different times at several outputs, i.e. pulse distributors with more than two outputs

Landscapes

  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Manipulation Of Pulses (AREA)
  • Control Of Motors That Do Not Use Commutators (AREA)
  • Control Of Stepping Motors (AREA)

Description

【発明の詳細な説明】 この発明は、パルス発生回路、特に3相パルス
発生回路に関するものである。
従来、例えば誘導型電力量計において、測定量
に比例した3相パルスを得るには、第1図の如き
構成でなされ、そのパルスを、計数・表示してい
た。第1図において、1はスリツトを設けた円板
で、電力量計の誘導円板と同軸上に配され、測定
量に比例した速度で回転する。2〜4は円板1の
スリツトを光あるいは磁気などで感知し、第2図
の如き相順を持つた3相パルスを発生する発信器
である。第2図において、a,b,cは各々発信
器2,3,4の出力パルスで測定量が正の場合、
円板1は正方向に回転し、パルスはa→b→cの
順に発信され、測定量が負になると、円板1は逆
方向に回転、パルスもc→b→aの順に発信され
る。測定量が大きいと、円板1の回転が速くな
り、出力パルスが増加する。
この様な従来装置においては、円板1が回転物
であるので、その機械的寿命の問題、測定量の変
化に対する円板1の応答性の問題、あるいは構造
上、形を小さくすることができないなどの欠点が
ある。またこの3相パルスを受信し、計数・表示
するためにパルスモータなどを使用するが、この
場合2相がON(以下“1”と呼ぶ)で1相が
OFF(以下0と呼ぶ)の状態と、1相がONで2
相がOFFの状態の比が1対1に近くなければ動
作しない場合があるが、その様なパルスにするた
めには発信器2〜4の位置の精密な調整が必要と
なる。さらに又、前述の誘導型電力量計の誘導円
板のような機械的動作を持たない電子式電力量
計、あるいは電力会社の配電盤から需要家が電気
的に信号を借り受けるためのパルス分離装置等に
おいては、前記円板で構成された発信器を用いる
ことは、電気信号を一旦機械動作に変換する必要
があり非常に不経済なものとなつてしまう。
この発明は上記の如き欠点に鑑みなされたもの
で、簡易な回路であるにもかかわらず理想的な3
相パルスが得られる3相パルス発生回路を提供す
るものである。
第3図はこの発明の一実施例である。第3図中
1〜3はJ−Kフリツプフロツプ(以下F/Fと
称す。)、4〜9はイクスクル−シブオアゲート
(以下EORと称す。)、10〜15はアンドゲート
(以下ANDと称す。)、16はノアゲート(以下
NORと称す。)、17はクロツク端子、18は3相
パルスの相順を選択するコントロール端子、19
〜21は3相パルスの出力端子である。クロツク
端子17へは電力量に比例した周波数のクロツク
が加えられる。コントロール端子18へは電力量
の符号に応じて「0」又は「1」が加えられる。
例えば、需要家が電力会社から電力の供給を受け
ている時は「0」、電力会社へ自家発電装置の電
力を供給している時は「1」となる。コントロー
ル端子18はEOR4〜6の入力の一方に接続さ
れており、正転で「0」、逆転で「1」にし、相
順を選択する。EOR4〜6のもう一方の入力は
各々F/F1〜3の出力Qに接続されている。
EOR4〜9は第5図の真理値表に従つて動作す
る。したがつて、正転モードのときコントロール
端子18は「0」にされるのでEOR4〜6は
F/F1〜3の出力Qをそのまま反転させずに出
力する。逆転モードのとき、コントロール端子1
8は「1」となりEOR4〜6はF/F1〜3の
出力Qを反転して出力する。EOR6,5の各出
力はEOR7の入力へ、EOR4,6の各出力は
EOR8の入力へ、EOR5,4の各出力はEOR9
の入力へそれぞれ接続されている。AND10,
11の一方の入力はEOR7の入力へ、AND1
2,13の一方の入力はEOR8の入力へ、AND
14,15の一方の入力はEOR9の入力へそれ
ぞれ接続され、AND10〜15のもう一方の入
力は、各々EOR4〜6の出力へ接続されている。
NOR16はEOR4〜6が初期状態あるいは外来
ノイズ等によつて、すべて0となつた場合次の動
作に進めないため、回路の機能を回復するために
設けたものである。
第4図は、第3図の回路の動作を示すタイミン
グチヤートである。第4図中、T1、T3、T4
T6、T8の区間が正転、それ以外の区間が逆転で
ある。
以下、第3図、第4図に従つて動作を説明す
る。
t1の直前において、F/F1〜3の出力Qは、
各、「0」・「0」・「1」となつており、正転モー
ドであるので、EOR4〜6の出力も「0」・
「0」・「1」となつている。EOR7はEOR6の出
力の「1」とEOR5の出力の「0」を入力して
おり、両入力は不一致であるので出力は「1」と
なり、AND10を開いている。したがつてF/
F1のJはEOR6の出力の「1」が、Kには
EOR5の出力の「0」が入力されており、この
時クロツクt1が到来すると、F/F1の出力Qは
「0」から「1」に変わる(F/F1「0」→
「1」)。EOR8はEOR4の出力の0とEOR6の
出力の「1」を入力しており、EOR7と同様に
両入力は不一致で、AND13を開いている。
F/F2のJはEOR4の出力の0が、Kには
EOR6の出力の「1」が入力されており、この
時クロツクt1が到来すると、出力Qはクロツクt1
が到来する直前まで0であるが、変化せずさらに
0を保ちつづける(F/F2「0」→「0」)。
EOR9は、EOR5の出力の「0」とEOR4の出
力の「0」を入力しているが、両入力共「0」で
一致しているので出力は「0」になり、AND1
4,15を閉じ出力を「0」にする。したがつて
F/F3のJ、K共に「0」であるので、クロツ
クt1が到来しても出力Qはクロツクt1が来る以前
の状態から変わらず1のままである(F/F3
「1」→「1」)。
次にt2の直前では、F/F1〜3は各々
「1」・「0」・「1」で、EOR4〜6も「1」・
「0」・「1」となつている。EOR7の入力は
「1」・「0」で不一致であるので、出力は「1」
となり、AND10は開かれ、F/F1のJは
「1」、Kは「0」になつている。クロツクt2が到
来すると、F/F1の出力Qは前と同じ状態
「1」を保ち変化はない(F/F1「1」→
「1」)。EOR8の入力は「1」・「1」で一致して
いるので、出力は「0」となり、AND12,1
3は閉じられF/F2のJ、K共に「0」で、ク
ロツクt2が到来してもF/F2の出力Qは変化せ
ず「0」を保つ(F/F2「0」→「0」)。
EOR9の入力は「0」・「1」で不一致であるの
で、出力は「1」となりAND15は開かれ、
F/F3のJは「0」、Kは「1」となる。クロ
ツクt2が到来するとF/F3の出力Qは「1」か
ら「0」になる(F/F3「1」→「0」)。コン
トロール端子18が「0」に保たれている間、以
上の動作をくり返し、正転の3相パルスを出力し
つづける。
次にコントロール端子18が「1」になると、
逆転モードになり、EOR4〜6は、F/F1〜
3の出力Qを各々反転させ出力しはじめる。クロ
ツクt3の直前で逆転モードになると、F/F1〜
3の出力Qは「0」・「0」・「1」であるが、
EOR4〜6の出力は「1」・「1」・「0」となる。
EOR7の入力は「0」・「1」で不一致であるの
で出力は「1」となり、AND11を開き、F/
F1のJは「0」、Kは「1」となる。クロツク
t3が到来すると、F/F1の出力Qは、そのまま
変化せず「0」を保つ(F/F1「0」→
「0」)。EOR8の入力は「1」・「0」で、出力は
「1」となり、AND12が開かれ、F/F2のJ
は「1」、Kは「0」となる。クロツクt3が到来
すると、F/F2の出力Qは「0」から「1」に
なる(F/F2「0」→「1」)。EOR9の入力
は「1」・「1」で一致しているので、出力は
「0」となり、AND14,15は閉じられF/F
3のJ、Kは共に「0」になる。したがつてクロ
ツクt3が到来してもF/F3の出力Qは変化せず
「1」のままである(F/F3「1」→「1」)。
t4の直前では、F/F1〜3の出力Qは
「0」・「1」・「1」であるが、逆転モードである
ので、EOR4〜6の出力は「1」・「0」・「0」
となつている。EOR7の入力は「0」・「0」で
一致しているので出力は「0」となり、AND1
0,11は閉じられ、F/F1のJ、Kは共に
「0」となる。したがつてクロツクt4が到来して
もF/F1の出力Qは変化せず「0」を保つ
(F/F1「0」→「0」)。EOR8の入力は、
「1」・「0」で不一致であるので出力は「1」と
なりAND12は開かれF/F2のJは「1」、K
は「0」となる。クロツクt4が到来すると、F/
F2の出力Qは元々「1」であるが、そのまま
「1」を保つ(F/F2「1」→「1」)。EOR9
の入力は「0」・「1」で不一致であるので、出力
は「1」となり、AND15が開かれ、F/F3
のJは「0」、Kは「1」となる。クロツクt4
到来すると、F/F3の出力Qは「1」かから
「0」になる(F/F3「1」→「0」)。
コントロール端子18が逆転モードの間、以上
の動作をくり返し逆転の3相パルスを出力しつづ
ける。
また、測定量に比例した3相パルスを出力する
には、測定量に比例した周波数のクロツクあるい
は、測定量に比例した時間だけ、一定周波数のク
ロツクをクロツク端子17へ入力すれば良い。
なお、上記説明においては、F/F1〜3の出
力Qを、EOR4〜6で、正転時は非反転、逆転
時は反転させて、EOR7〜9およびAND10〜
15へ入力しているが、EOR4〜6の代りに、
セレクタなどで、正転時には出力Qを、逆転時に
はを、EOR7〜9、AND10〜15へ入力す
るようにしても、同様な効果が得られる。あるい
は、F/F1〜3の出力QをEOR4〜6の一方
の入力へ接続しており、コントロール端子18が
「0」で正転、「1」で逆転となるようにしている
が、出力を、EOR4〜6へ入力すれば、コン
トロール端子18が「1」で正転、「0」で逆転
させることもできるのは言うまでもない。
また、3相パルスの相順を変更する必要がない
場合、EOR4〜6を省略し、F/F1〜3の出
力Qあるいはを直接EOR7〜9、AND10〜
15へ入力しても良い。
以上の様にこの発明によれば、簡易な回路であ
るにもかかわらず、全く無調整で、理想的な3相
パルスが得られ、測定量の急激な変化あるいは極
性の変化にも容易に追従する3相パルス発生回路
を提供することができる。また、電子回路で構成
されており、機械的摩耗部分がないので寿命が長
く、形状も小さくすることができるなど、その効
果はきわめて大きいものである。
【図面の簡単な説明】
第1図は従来の3相パルス発生装置を示す構成
図、第2図は第1図のタイミングチヤート、第3
図はこの発明の一実施例を示す回路図、第4図は
第3図のタイミングチヤート、第5図はイクスク
ル−シブオアゲートの真理値を示す真理値図であ
る。 図において、1〜3はJ−Kフリツプフロツ
プ、4〜9はイクスクル−シブオアゲート、10
〜15はアンドゲート、17はクロツク端子、1
8はコントロール端子である。なお、各図中同一
符号は同一または相当部分を示すものとする。

Claims (1)

  1. 【特許請求の範囲】 1 J−Kフリツプフロツプと、このJ−Kフリ
    ツプフロツプのJ端子とK端子のそれぞれに接続
    された第1および第2のアンドゲートと、この第
    1および第2のアンドゲートの入力の一方がそれ
    ぞれ接続された第1のイクスクル−シブオアゲー
    トと、前記J−KフリツプフロツプのQ端子に接
    続された第2のイクスクル−シブオアゲートとか
    らなる回路を3回路と前記第2のイクスクル−シ
    ブオアゲートの出力全てを接続したノアゲートと
    を備え、前記第1のアンドゲートの前記第1のイ
    クスクル−シブオアゲートの出力が接続されてい
    ない方の入力と、前記第1のイクスクル−シブオ
    アゲートの一方の入力とを3相の相順の前位とな
    る第2のイクスクル−シブオアゲートの出力へ接
    続し、前記第2のアンドゲートの前記第1のイク
    スクル−シブオアゲートの出力が接続されていな
    い方の入力と、前記第1のイクスクル−シブオア
    ゲートの他方の入力とを前記3相の相順の後位と
    なる前記第2のイクスクル−シブオアゲートの出
    力へ接続し、前記ノアゲートの出力を前記J−K
    フリツプフロツプの内の1つのS端子と他のJ−
    KフリツプフロツプのR端子に接続したことを特
    徴とする3相パルス発生回路。 2 J−KフリツプフロツプのQ端子と端子と
    を選択して3相パルスの相順を変えるようにした
    ことを特徴とする特許請求の範囲第1項記載の3
    相パルス発生回路。
JP5670579A 1979-05-04 1979-05-04 Three phase pulse generating circuit Granted JPS55147035A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP5670579A JPS55147035A (en) 1979-05-04 1979-05-04 Three phase pulse generating circuit

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP5670579A JPS55147035A (en) 1979-05-04 1979-05-04 Three phase pulse generating circuit

Publications (2)

Publication Number Publication Date
JPS55147035A JPS55147035A (en) 1980-11-15
JPS6333733B2 true JPS6333733B2 (ja) 1988-07-06

Family

ID=13034879

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5670579A Granted JPS55147035A (en) 1979-05-04 1979-05-04 Three phase pulse generating circuit

Country Status (1)

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JP (1) JPS55147035A (ja)

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5231992Y2 (ja) * 1974-09-11 1977-07-21

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JPS55147035A (en) 1980-11-15

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