JPS6338150B2 - - Google Patents
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- Publication number
- JPS6338150B2 JPS6338150B2 JP56147569A JP14756981A JPS6338150B2 JP S6338150 B2 JPS6338150 B2 JP S6338150B2 JP 56147569 A JP56147569 A JP 56147569A JP 14756981 A JP14756981 A JP 14756981A JP S6338150 B2 JPS6338150 B2 JP S6338150B2
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- JP
- Japan
- Prior art keywords
- image signal
- peak value
- line
- conversion means
- reference voltage
- Prior art date
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Image Input (AREA)
- Facsimile Image Signal Circuits (AREA)
Description
【発明の詳細な説明】
本発明は、フアクシミリ送信機等における画情
報読取装置によつて得られた画信号の振幅を、光
源の光量および原稿の地の濃度の変化に応じて自
動的に補正する自動コントラスト補正回路に関す
るものである。
報読取装置によつて得られた画信号の振幅を、光
源の光量および原稿の地の濃度の変化に応じて自
動的に補正する自動コントラスト補正回路に関す
るものである。
一般に、フアクシミリ送信機等の画情報読取装
置においては、原稿を照射する螢光灯等の光源の
立ち上り特性および経年変化による光量変化や、
原稿の地の濃度の変化による影響を除去するた
め、これらの変化に応じて画信号の振幅を補正す
る必要がある。
置においては、原稿を照射する螢光灯等の光源の
立ち上り特性および経年変化による光量変化や、
原稿の地の濃度の変化による影響を除去するた
め、これらの変化に応じて画信号の振幅を補正す
る必要がある。
第１図は、このような補正を行う従来の自動コ
ントラスト補正回路を示す。同図において、画情
報読取装置のイメージセンサ（図示せず）から出
力された画信号は、シエーデイング歪を除去され
て、画信号VINとされる。この画信号VINは、後
述する如く増幅率を制御される可変増幅回路１に
より増幅されることによつて、補正画信号VOUT
に変換されてこの補正回路から出力される。
ントラスト補正回路を示す。同図において、画情
報読取装置のイメージセンサ（図示せず）から出
力された画信号は、シエーデイング歪を除去され
て、画信号VINとされる。この画信号VINは、後
述する如く増幅率を制御される可変増幅回路１に
より増幅されることによつて、補正画信号VOUT
に変換されてこの補正回路から出力される。
また、同時に、前記補正画信号VOUTは標本化
区間選択回路２を通つてピーク値検出回路３に入
力される。このピーク値検出回路３は入力された
補正画信号VOUTからピーク値を検出し、かつ同
ピーク値をホールドする。ここで、前記標本化区
間選択回路２は同回路２に入力される区間選択信
号S1に従つて、補正画信号VOUTの１ライン中の
標本化する区間を選択する（通常は、原稿幅に対
応する区間を選択する）ものであり、前記ピーク
値の検出は、この標本化区間選択回路２によつて
選択された区間において行われる。
区間選択回路２を通つてピーク値検出回路３に入
力される。このピーク値検出回路３は入力された
補正画信号VOUTからピーク値を検出し、かつ同
ピーク値をホールドする。ここで、前記標本化区
間選択回路２は同回路２に入力される区間選択信
号S1に従つて、補正画信号VOUTの１ライン中の
標本化する区間を選択する（通常は、原稿幅に対
応する区間を選択する）ものであり、前記ピーク
値の検出は、この標本化区間選択回路２によつて
選択された区間において行われる。
そして、前記ピーク値検出回路３にホールドさ
れたピーク値は、可変増幅回路１にフイードバツ
クされ、同ピーク値に応じて可変増幅回路１の増
幅率が制御される。なお、ピーク値検出回路３に
ホールドされるピーク値は、所定の時定数により
減衰するようにされているので、同ピーク値は、
それ以前よりも低いピーク値が現われた場合をも
含めて順次更新される（なお第３図における点線
は、前記ピーク値の変化を示す）。
れたピーク値は、可変増幅回路１にフイードバツ
クされ、同ピーク値に応じて可変増幅回路１の増
幅率が制御される。なお、ピーク値検出回路３に
ホールドされるピーク値は、所定の時定数により
減衰するようにされているので、同ピーク値は、
それ以前よりも低いピーク値が現われた場合をも
含めて順次更新される（なお第３図における点線
は、前記ピーク値の変化を示す）。
したがつて、前記補正画信号VOUTは、光源の
光量および原稿の地の濃度の変化に対し、その振
幅を補正されたものとなる。
光量および原稿の地の濃度の変化に対し、その振
幅を補正されたものとなる。
しかし、このような従来のコントラスト補正回
路では、前記時定数を大きく設定すると、光量や
原稿の地の濃度の急激な変化に追従できなくなる
一方、前記時定数を小さく設定すると、第３図の
VB，VCのように１ライン中に複数個のピーク値
が検知され、可変増幅回路１の増幅率の変化が激
しくなり、安定した補正画信号VOUTを得ること
がない欠点があつた。また、前記時定数の大きさ
の如何にかかわらず、第３図のVAのように、１
ラインの途中で、ピーク値検出回路３にホールド
されるピーク値が変化するので、前記増幅率も１
ラインの途中で変化してしまう欠点があつた。
路では、前記時定数を大きく設定すると、光量や
原稿の地の濃度の急激な変化に追従できなくなる
一方、前記時定数を小さく設定すると、第３図の
VB，VCのように１ライン中に複数個のピーク値
が検知され、可変増幅回路１の増幅率の変化が激
しくなり、安定した補正画信号VOUTを得ること
がない欠点があつた。また、前記時定数の大きさ
の如何にかかわらず、第３図のVAのように、１
ラインの途中で、ピーク値検出回路３にホールド
されるピーク値が変化するので、前記増幅率も１
ラインの途中で変化してしまう欠点があつた。
また、従来、上記のようなコントラスト補正動
作を、デイジタル的に行つて精度を上げるコント
ラスト補正回路も提案されているが、これらは高
価なＡ／Ｄ変換器を必要とし、かつ回路規模が大
きくなるため、実用的でない欠点があつた。
作を、デイジタル的に行つて精度を上げるコント
ラスト補正回路も提案されているが、これらは高
価なＡ／Ｄ変換器を必要とし、かつ回路規模が大
きくなるため、実用的でない欠点があつた。
本発明は、前記従来の欠点を解消するべくなさ
れたもので、利得制御処理をデイジタル化するこ
とにより、原稿の地の濃度および光量の急激な変
化に対する追従性が良く、かつ１ライン中に利得
が変化することがなく、安定した補正画信号が得
られ、しかも安価な自動コントラスト補正回路を
提供することを目的とする。
れたもので、利得制御処理をデイジタル化するこ
とにより、原稿の地の濃度および光量の急激な変
化に対する追従性が良く、かつ１ライン中に利得
が変化することがなく、安定した補正画信号が得
られ、しかも安価な自動コントラスト補正回路を
提供することを目的とする。
以下本発明を図面に示す実施例に基づいて説明
する。
する。
第２図は本発明の一実施例を示す。４は画信号
の入力端子であり、前記従来回路の場合と同様の
シエーデイング歪を除去された画信号VINを入力
する。２は前記従来回路の場合と同様の標本化区
間選択回路、３は画信号入力端子４から標本化区
間選択回路２を介して画信号VINを入力するピー
ク値検出回路であり、ホールドしたピーク値をク
リア信号S2によつて１ライン毎にクリアされるこ
とにより、１ライン毎のピーク値を検出する。５
は抵抗ラダー型のＤ／Ａ変換器、６はアナログス
イツチであり、原稿読取区間においては、画信号
入力端子４をＤ／Ａ変換器５の基準電圧入力端子
に接続する一方、ブランキング区間においては、
基準電圧源７の出力端子をＤ／Ａ変換器５の基準
電圧入力端子に接続する。８はピーク値検出回路
３の出力とＤ／Ａ変換器５の出力とを比較するコ
ンパレータ、９は逐次比較レジスタであり、これ
らのコンパレータ８および比較レジスタ９はＤ／
Ａ変換器５とともに逐次比較型Ａ／Ｄ変換回路を
構成する。
の入力端子であり、前記従来回路の場合と同様の
シエーデイング歪を除去された画信号VINを入力
する。２は前記従来回路の場合と同様の標本化区
間選択回路、３は画信号入力端子４から標本化区
間選択回路２を介して画信号VINを入力するピー
ク値検出回路であり、ホールドしたピーク値をク
リア信号S2によつて１ライン毎にクリアされるこ
とにより、１ライン毎のピーク値を検出する。５
は抵抗ラダー型のＤ／Ａ変換器、６はアナログス
イツチであり、原稿読取区間においては、画信号
入力端子４をＤ／Ａ変換器５の基準電圧入力端子
に接続する一方、ブランキング区間においては、
基準電圧源７の出力端子をＤ／Ａ変換器５の基準
電圧入力端子に接続する。８はピーク値検出回路
３の出力とＤ／Ａ変換器５の出力とを比較するコ
ンパレータ、９は逐次比較レジスタであり、これ
らのコンパレータ８および比較レジスタ９はＤ／
Ａ変換器５とともに逐次比較型Ａ／Ｄ変換回路を
構成する。
１０は逐次比較レジスタ９の出力をアドレス入
力とするメモリであり、逐次比較レジスタ９の出
力がとり得る種々の値に対応する補正係数を格納
している。なお、このメモリ１０は、本実施例に
おける補正係数発生回路を構成するものである。
１１はデータセレクタであり、逐次比較レジスタ
９の出力とメモリ１０の出力を選択的にＤ／Ａ変
換器５に入力する。１２はＤ／Ａ変換器５の出力
を増幅する増幅器である。
力とするメモリであり、逐次比較レジスタ９の出
力がとり得る種々の値に対応する補正係数を格納
している。なお、このメモリ１０は、本実施例に
おける補正係数発生回路を構成するものである。
１１はデータセレクタであり、逐次比較レジスタ
９の出力とメモリ１０の出力を選択的にＤ／Ａ変
換器５に入力する。１２はＤ／Ａ変換器５の出力
を増幅する増幅器である。
次に、本実施例の動作を説明する。原稿読取区
間においては、画信号入力端子４から画信号VIN
がアナログスイツチ６を通してＤ／Ａ変換器５の
基準電圧入力端子に入力されるとともに、メモリ
１０から後で詳しく説明する補正係数がデータセ
レクタ１１を通してＤ／Ａ変換器５に入力され
る。したがつて、Ｄ／Ａ変換器５からは、画信号
VINに前記補正係数を掛算した信号が出力され
る。そして、この信号がさらに増幅器１２によつ
て増幅されることにより、補正画信号VOUTが得
られる。
間においては、画信号入力端子４から画信号VIN
がアナログスイツチ６を通してＤ／Ａ変換器５の
基準電圧入力端子に入力されるとともに、メモリ
１０から後で詳しく説明する補正係数がデータセ
レクタ１１を通してＤ／Ａ変換器５に入力され
る。したがつて、Ｄ／Ａ変換器５からは、画信号
VINに前記補正係数を掛算した信号が出力され
る。そして、この信号がさらに増幅器１２によつ
て増幅されることにより、補正画信号VOUTが得
られる。
これと同時に画信号VINは標本化区間選択回路
２を通つてピーク値検出回路３に入力される。こ
れにより、ピーク値検出回路３は、画信号VINの
１ライン中のピーク値を検出する（なお、このピ
ーク値検出回路３は、十分大きな時定数をもつ
て、ピーク値をホールドするものとする）。
２を通つてピーク値検出回路３に入力される。こ
れにより、ピーク値検出回路３は、画信号VINの
１ライン中のピーク値を検出する（なお、このピ
ーク値検出回路３は、十分大きな時定数をもつ
て、ピーク値をホールドするものとする）。
次に、１ラインの原稿読取区間が終了し、ブラ
ンキング区間になると、アナログスイツチ６が区
間切換え信号S1によつて切り換えられて基準電圧
源７から一定の基準電圧VRefがアナログスイツチ
６を通してＤ／Ａ変換器５の基準電圧入力端子に
入力されるようになるとともに、セレクタ１１も
切り換えられてＤ／Ａ変換器５に逐次比較レジス
タ９の出力が入力されるようになり、Ｄ／Ａ変換
器５、コンパレータ８および逐次比較レジスタ９
から構成されるＡ／Ｄ変換回路がＡ／Ｄ変換動作
を開始する。
ンキング区間になると、アナログスイツチ６が区
間切換え信号S1によつて切り換えられて基準電圧
源７から一定の基準電圧VRefがアナログスイツチ
６を通してＤ／Ａ変換器５の基準電圧入力端子に
入力されるようになるとともに、セレクタ１１も
切り換えられてＤ／Ａ変換器５に逐次比較レジス
タ９の出力が入力されるようになり、Ｄ／Ａ変換
器５、コンパレータ８および逐次比較レジスタ９
から構成されるＡ／Ｄ変換回路がＡ／Ｄ変換動作
を開始する。
すなわち、前記Ａ／Ｄ変換回路は、ピーク値検
出回路３にホールドされている１ライン前のピー
ク値とＤ／Ａ変換器５の出力とを逐次比較するこ
とにより、逐次比較レジスタ９の内容を上位桁か
ら決定して行き、最終的に同レジスタ９の内容
を、前記ピーク値に対応するＮビツトのデイジタ
ル値とする。換言すれば、このレジスタ９の内容
は、基準電圧VRefに対する前記ピーク値の比率を
デイジタル値で表わしたものとなる。
出回路３にホールドされている１ライン前のピー
ク値とＤ／Ａ変換器５の出力とを逐次比較するこ
とにより、逐次比較レジスタ９の内容を上位桁か
ら決定して行き、最終的に同レジスタ９の内容
を、前記ピーク値に対応するＮビツトのデイジタ
ル値とする。換言すれば、このレジスタ９の内容
は、基準電圧VRefに対する前記ピーク値の比率を
デイジタル値で表わしたものとなる。
次に、前記レジスタ９の内容がメモリ１０にア
ドレスとして入力されることにより、前記レジス
タ９の内容に対応する補正係数がメモリ１０から
出力される。ここで、この補正係数は、前記ピー
ク値と同一値がＤ／Ａ変換器５の基準電圧入力端
子に入力されたときに、Ｄ／Ａ変換器５の出力が
VRefに対して所定の減衰比を示すこととなる値に
設定されている。
ドレスとして入力されることにより、前記レジス
タ９の内容に対応する補正係数がメモリ１０から
出力される。ここで、この補正係数は、前記ピー
ク値と同一値がＤ／Ａ変換器５の基準電圧入力端
子に入力されたときに、Ｄ／Ａ変換器５の出力が
VRefに対して所定の減衰比を示すこととなる値に
設定されている。
そして、次のラインの読取区間が始まると、ア
ナログスイツチ６およびセレクタ１１が切り換え
られて、再び画信号VINがアナログスイツチ６を
通してＤ／Ａ変換器５の基準電圧入力端子に入力
されるとともに、メモリ１０から前記補正係数が
セレクタ１１を通してＤ／Ａ変換器５に入力され
る。これにより、このラインの画信号VINは、前
ラインのピーク値から求められた前記補正係数に
よつて、その振幅を補正され、増幅器１２から画
信号VOUTとして入力されることになる。
ナログスイツチ６およびセレクタ１１が切り換え
られて、再び画信号VINがアナログスイツチ６を
通してＤ／Ａ変換器５の基準電圧入力端子に入力
されるとともに、メモリ１０から前記補正係数が
セレクタ１１を通してＤ／Ａ変換器５に入力され
る。これにより、このラインの画信号VINは、前
ラインのピーク値から求められた前記補正係数に
よつて、その振幅を補正され、増幅器１２から画
信号VOUTとして入力されることになる。
これをさらに、具体的に説明すると、仮に第４
図のように、あるラインにおける画信号VINのピ
ーク値がVDであつたとすると、このラインの読
取区間終了時には、ピーク値検出回路３にVEが
ホールドされている。そして、次のブランキング
区間で、このVEが前記Ａ／Ｄ変換回路により
Ａ／Ｄ変換され、その結果がメモリ１０に入力さ
れる。
図のように、あるラインにおける画信号VINのピ
ーク値がVDであつたとすると、このラインの読
取区間終了時には、ピーク値検出回路３にVEが
ホールドされている。そして、次のブランキング
区間で、このVEが前記Ａ／Ｄ変換回路により
Ａ／Ｄ変換され、その結果がメモリ１０に入力さ
れる。
これにより、VEがＤ／Ａ変換器５の基準電圧
入力端子に入力されたときに、同Ｄ／Ａ変換器５
の出力がVRefに対して所定の減衰比を示すことと
なる補正係数が、メモリ１０から出力される。す
なわち、例えば前記減衰比を1/2とすれば、（1/2
×VRef／VE）という補正係数がメモリ１０から
出力される。したがつて、第４図のように次のラ
インのピーク値をVFとすると、当該ラインにお
けるＤ／Ａ変換器５の出力のピーク値は（VF×
１／２×VRef／VE）となる。
入力端子に入力されたときに、同Ｄ／Ａ変換器５
の出力がVRefに対して所定の減衰比を示すことと
なる補正係数が、メモリ１０から出力される。す
なわち、例えば前記減衰比を1/2とすれば、（1/2
×VRef／VE）という補正係数がメモリ１０から
出力される。したがつて、第４図のように次のラ
インのピーク値をVFとすると、当該ラインにお
けるＤ／Ａ変換器５の出力のピーク値は（VF×
１／２×VRef／VE）となる。
また、増幅器１２は、前記所定の減衰比の逆数
倍だけＤ／Ａ変換器５の出力を増幅する。すなわ
ち、前述のように前記減衰比を1/2とする場合に
は、増幅器１２は２倍の増幅を行う。したがつ
て、結局、画信号VINにおける前記ピーク値VF
は、補正画信号VOUTにおいては、 （VF×1/2×VRef／VE）×２＝VF×VRef／VE となり、VF＝VEであれば、この補正画信号VOUT
のピーク値はVRefに等しくなる。
倍だけＤ／Ａ変換器５の出力を増幅する。すなわ
ち、前述のように前記減衰比を1/2とする場合に
は、増幅器１２は２倍の増幅を行う。したがつ
て、結局、画信号VINにおける前記ピーク値VF
は、補正画信号VOUTにおいては、 （VF×1/2×VRef／VE）×２＝VF×VRef／VE となり、VF＝VEであれば、この補正画信号VOUT
のピーク値はVRefに等しくなる。
このようにして本回路では、画信号VINの各ラ
インが、その前ラインのピーク値に応じて次々と
補正されて行く。
インが、その前ラインのピーク値に応じて次々と
補正されて行く。
本回路では、このようにして画信号の振幅補正
が行われるので、原稿の地の濃度や光量が安定し
ている場合はもちろん、これらが急激に変化した
場合にも、２ライン以内には必ず追従でき、しか
も１ライン中は常に利得が一定である。また、各
ラインのピーク値をＡ／Ｄ変換する逐次比較型
Ａ／Ｄ変換回路内のＤ／Ａ変換器により補正演算
を行うので、コストを低減することができる。
が行われるので、原稿の地の濃度や光量が安定し
ている場合はもちろん、これらが急激に変化した
場合にも、２ライン以内には必ず追従でき、しか
も１ライン中は常に利得が一定である。また、各
ラインのピーク値をＡ／Ｄ変換する逐次比較型
Ａ／Ｄ変換回路内のＤ／Ａ変換器により補正演算
を行うので、コストを低減することができる。
以上の説明から明らかなように本発明による自
動コントラスト補正回路は、各ライン毎にピーク
値を求め、これらのピーク値をブランキング区間
に逐次比較型Ａ／Ｄ変換回路によりＡ／Ｄ変換
し、このＡ／Ｄ変換結果から前記ピーク値に対す
る補正係数をデイジタル値として求め、この補正
係数を次ラインの画信号に演算することにより、
画信号の振幅補正を行うようにし、かつ前記補正
係数と画信号との演算は、前記逐次比較型Ａ／Ｄ
変換回路内のＤ／Ａ変換器により行わせるように
したことにより、原稿の地の濃度および光量の変
化に対する追従性が非常に良く、かつ１ライン中
に利得が変化することがなく、安定した補正画信
号が得られ、しかも製造コストを安価とすること
ができる優れた効果が得られるものである。
動コントラスト補正回路は、各ライン毎にピーク
値を求め、これらのピーク値をブランキング区間
に逐次比較型Ａ／Ｄ変換回路によりＡ／Ｄ変換
し、このＡ／Ｄ変換結果から前記ピーク値に対す
る補正係数をデイジタル値として求め、この補正
係数を次ラインの画信号に演算することにより、
画信号の振幅補正を行うようにし、かつ前記補正
係数と画信号との演算は、前記逐次比較型Ａ／Ｄ
変換回路内のＤ／Ａ変換器により行わせるように
したことにより、原稿の地の濃度および光量の変
化に対する追従性が非常に良く、かつ１ライン中
に利得が変化することがなく、安定した補正画信
号が得られ、しかも製造コストを安価とすること
ができる優れた効果が得られるものである。
第１図は従来の自動コントラスト補正回路のブ
ロツク図、第２図は本発明の一実施例による自動
コントラスト補正回路のブロツク図、第３図は前
記従来回路における信号波形図、第４図は前記実
施例における信号波形図である。 ３……ピーク値検出回路、５……Ｄ／Ａ変換
器、６……アナログスイツチ、７……基準電圧
源、８……コンパレータ、９……逐次比較レジス
タ、１０……メモリ、１１……データセレクタ。
ロツク図、第２図は本発明の一実施例による自動
コントラスト補正回路のブロツク図、第３図は前
記従来回路における信号波形図、第４図は前記実
施例における信号波形図である。 ３……ピーク値検出回路、５……Ｄ／Ａ変換
器、６……アナログスイツチ、７……基準電圧
源、８……コンパレータ、９……逐次比較レジス
タ、１０……メモリ、１１……データセレクタ。
Claims (1)
- １ 補正すべき読取り画信号の１ライン毎のピー
ク値を検出するピーク値検出手段と、逐次比較型
Ａ／Ｄ変換手段と、このＡ／Ｄ変換手段の出力に
応じたデイジタル値の補正係数を出力する補正係
数発生手段と、一定基準電圧を供給する基準電圧
源とを備え、前記読取り画信号のブランキング区
間中に前記逐次比較型Ａ／Ｄ変換手段内のＤ／Ａ
変換手段の基準電圧入力端子に前記基準電圧源か
ら前記一定基準電圧を入力した状態にて、前記
Ａ／Ｄ変換手段が前記ピーク値検出手段により検
出されたｎライン目のピーク値をＡ／Ｄ変換し、
ｎ＋１ライン目の前記読取り画信号の画信号区間
中には、前記補正係数発生手段から前記Ａ／Ｄ変
換結果に応じた補正係数が前記Ｄ／Ａ変換手段に
入力されるとともに、そのＤ／Ａ変換手段の前記
基準電圧入力端子に当該ｎ＋１ライン目の読取り
画信号が入力され、そのＤ／Ａ変換手段により当
該ｎ＋１ライン目の読取り画信号の補正演算を行
うことを特徴とする自動コントラスト補正回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56147569A JPS5848572A (ja) | 1981-09-17 | 1981-09-17 | 自動コントラスト補正回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56147569A JPS5848572A (ja) | 1981-09-17 | 1981-09-17 | 自動コントラスト補正回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5848572A JPS5848572A (ja) | 1983-03-22 |
| JPS6338150B2 true JPS6338150B2 (ja) | 1988-07-28 |
Family
ID=15433311
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56147569A Granted JPS5848572A (ja) | 1981-09-17 | 1981-09-17 | 自動コントラスト補正回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5848572A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR19980077483A (ko) * | 1997-04-19 | 1998-11-16 | 윤종용 | 콘트라스트 조정방법 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4834412A (ja) * | 1971-09-06 | 1973-05-18 | ||
| JPS5518131A (en) * | 1978-07-24 | 1980-02-08 | Mitsubishi Electric Corp | Signal binary coding device |
| JPS55124360A (en) * | 1979-03-20 | 1980-09-25 | Nec Corp | Setting circuit for picture signal slice level |
-
1981
- 1981-09-17 JP JP56147569A patent/JPS5848572A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5848572A (ja) | 1983-03-22 |
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