JPS6343770A - 高周波パルスア−ク溶接電源 - Google Patents
高周波パルスア−ク溶接電源Info
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- JPS6343770A JPS6343770A JP18653486A JP18653486A JPS6343770A JP S6343770 A JPS6343770 A JP S6343770A JP 18653486 A JP18653486 A JP 18653486A JP 18653486 A JP18653486 A JP 18653486A JP S6343770 A JPS6343770 A JP S6343770A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
「産業−１−の利用分野」
この発明（Ｊ５薄板溶接等に用いて好適な高周波パルス
アーク溶接電源に関する。
アーク溶接電源に関する。
「従来の技術−１
アーク溶接にお（Ｊろ高周波パルス電流は、低電流アー
クの安定を保つ効果があり、薄板溶接なとに広く利用さ
れている。
クの安定を保つ効果があり、薄板溶接なとに広く利用さ
れている。
ここで第５図は、従来の高周波パルスアーク溶接電源の
構成を示−４゛回路図である。図において、＋ ｉＪハ
ノナリ等の直流電源であり、この直流電源１の負側端子
に（」タイオード６のアノードおよびスイッチング素子
４の一端が接続されている。ダイオード６のカソード（
」スイッチング素子３を介して直流電源Ｉの正側端子に
接続され、スイッチング素子４の他端はダイオード７を
逆方向に介して直流電源１の正側端子に接続されている
。ダイオ−１・７とスイッチング素子４との接続点Ｐ１
、およびスイッチング素子３とダイオード６との接続点
Ｐ２の間には、インダクタンス９（配線インダクタンス
を含む）、アークスタータＩ＋、電極１２、アーク１３
、および被溶接＋Ａ’ ＋ ４が順次介挿される構成と
なっている。また、インダクタンス９とアークスタータ
１１の接続点Ｐ３および点Ｐ１の間には、インダクタン
ス１０、スイッチング素子５およびバイアス用直流電源
２が順次介挿されている。８は、アノードがインダクタ
ンスｌＯを介して点Ｐ３に接続され、カソードが点Ｐ１
に接続されているダイオードである。１５．１６は、各
々電流検出器であり、これらの電流検出器１５．１６の
検出値に基づいて制御装置１７がスイッチング素子３，
４．５のオン／オフを制御する。
構成を示−４゛回路図である。図において、＋ ｉＪハ
ノナリ等の直流電源であり、この直流電源１の負側端子
に（」タイオード６のアノードおよびスイッチング素子
４の一端が接続されている。ダイオード６のカソード（
」スイッチング素子３を介して直流電源Ｉの正側端子に
接続され、スイッチング素子４の他端はダイオード７を
逆方向に介して直流電源１の正側端子に接続されている
。ダイオ−１・７とスイッチング素子４との接続点Ｐ１
、およびスイッチング素子３とダイオード６との接続点
Ｐ２の間には、インダクタンス９（配線インダクタンス
を含む）、アークスタータＩ＋、電極１２、アーク１３
、および被溶接＋Ａ’ ＋ ４が順次介挿される構成と
なっている。また、インダクタンス９とアークスタータ
１１の接続点Ｐ３および点Ｐ１の間には、インダクタン
ス１０、スイッチング素子５およびバイアス用直流電源
２が順次介挿されている。８は、アノードがインダクタ
ンスｌＯを介して点Ｐ３に接続され、カソードが点Ｐ１
に接続されているダイオードである。１５．１６は、各
々電流検出器であり、これらの電流検出器１５．１６の
検出値に基づいて制御装置１７がスイッチング素子３，
４．５のオン／オフを制御する。
第５図に示す回路の動作は以下の通りである。
まず、アークスタータ１１に」；つて電極Ｉ２と被溶接
＋オＩ４との間にアーク１３を発生させ、スイ・ソヂン
ク素子３．４を第６図に示すタイミングにより同時にオ
ン／オフして電流１ｐを制御し、また、スイッチング素
子５を高速でオン／オフして電流Ｉ ｌｒを制御する。
＋オＩ４との間にアーク１３を発生させ、スイ・ソヂン
ク素子３．４を第６図に示すタイミングにより同時にオ
ン／オフして電流１ｐを制御し、また、スイッチング素
子５を高速でオン／オフして電流Ｉ ｌｒを制御する。
この場合、溶接電流Ｉｗは電流Ｉｐと１８の和となる。
スイッチング素子３．４がオンの時は、図示のように電
流１ｐか急激に」−昇し、スイッチング素子３．４かオ
フの時は、ダイオード６．７を介して電流１ｐが直流電
源ｌに回生され、これにより、電流ｒｐの値が急激に下
降４′る３、一方、スイッチング素子５の高速オン／オ
フにより、電流１ ｕの値はほぼ一定の低電流値に保持
され、アーク１３が保持される（第６図の拡大部分参照
）。
流１ｐか急激に」−昇し、スイッチング素子３．４かオ
フの時は、ダイオード６．７を介して電流１ｐが直流電
源ｌに回生され、これにより、電流ｒｐの値が急激に下
降４′る３、一方、スイッチング素子５の高速オン／オ
フにより、電流１ ｕの値はほぼ一定の低電流値に保持
され、アーク１３が保持される（第６図の拡大部分参照
）。
［発明が解決しようとする問題点］
どころで、」二連した従来のパルスアーク溶接電源にお
いて（」、スイッチング素子３．４が電流Ｔｐのピーク
値を流し得る電流容量を持っていな（プればなら４′、
７ヤい換え４１ば、スイッチング素子３゜４の電流容量
以１−の振幅を有するパルス電流を発生することができ
ないという欠点があった。
いて（」、スイッチング素子３．４が電流Ｔｐのピーク
値を流し得る電流容量を持っていな（プればなら４′、
７ヤい換え４１ば、スイッチング素子３゜４の電流容量
以１−の振幅を有するパルス電流を発生することができ
ないという欠点があった。
この発明は、−１−述した事情に鑑みてなされたもので
、パルス電流発生用のスイッチング素子の電流容量以１
−の溶接電流を得ろことができる高周波パルス）′−り
溶接電源を提（バすることを１−１的としている。
、パルス電流発生用のスイッチング素子の電流容量以１
−の溶接電流を得ろことができる高周波パルス）′−り
溶接電源を提（バすることを１−１的としている。
１問題点を解決するための手段 １
この発明は、」二連した１−１的を達成ｔろために、直
流電源をスイッチングオろことにより、パルス電流を発
生゛４゛るパルス電流発生部と、２次巻線の為き数が１
次側より少なく設定されるとと６に、１次巻線が前記パ
ルス電流発生部の出力端に接続されるトランスと、この
トランスの２次側に直列に介挿される第１の整流素子、
電極および被溶接＋４と、第２の整流素子および第１の
スイッチング素子を直列接続してなり前記スイッチング
素子がオン状態のききは溶接電流が１１ｆＪ記２次在線
を介さずに環流するバイパス経路とを具備している。
流電源をスイッチングオろことにより、パルス電流を発
生゛４゛るパルス電流発生部と、２次巻線の為き数が１
次側より少なく設定されるとと６に、１次巻線が前記パ
ルス電流発生部の出力端に接続されるトランスと、この
トランスの２次側に直列に介挿される第１の整流素子、
電極および被溶接＋４と、第２の整流素子および第１の
スイッチング素子を直列接続してなり前記スイッチング
素子がオン状態のききは溶接電流が１１ｆＪ記２次在線
を介さずに環流するバイパス経路とを具備している。
［作用 −１
トランスの２次巻線の巻数が１次巻線より少なく設定さ
れているため、パルス電流発生部のスイッチング累ｊ′
−の電流容量以上の溶接電流を流−４′ことかてきる１
、よた、第１のスイッチング素子をオフすると溶接電流
が回生され４−に環流（７、これにより、低電流制御か
可能となろ３．この際において、第１のスイッチング素
ｒには、低電流が流れろのて、第１のスイッチ累ｒの電
流容！ｉｔを人とする８星かム′０３、 Ｉ実施例 １ 以１・、図面を参照しζこの発明の実施例について説明
・する。。
れているため、パルス電流発生部のスイッチング累ｊ′
−の電流容量以上の溶接電流を流−４′ことかてきる１
、よた、第１のスイッチング素子をオフすると溶接電流
が回生され４−に環流（７、これにより、低電流制御か
可能となろ３．この際において、第１のスイッチング素
ｒには、低電流が流れろのて、第１のスイッチ累ｒの電
流容！ｉｔを人とする８星かム′０３、 Ｉ実施例 １ 以１・、図面を参照しζこの発明の実施例について説明
・する。。
第１図（」、ごの発明の−・実施例の構成を示す回路図
であり、１ｉｉｊ述した第５図の各部と対応セろ部分に
ついて（ｊ、同一・の符壮をイ・１しその説明を省略す
る３、 図においで、３−．４−ＬＪ、、各々スイッチング素子
３．４に、１１ｉ列に接続されるスイッチング素子であ
り、制御装置２０によ−〕でオン／オフ制御さイする。
であり、１ｉｉｊ述した第５図の各部と対応セろ部分に
ついて（ｊ、同一・の符壮をイ・１しその説明を省略す
る３、 図においで、３−．４−ＬＪ、、各々スイッチング素子
３．４に、１１ｉ列に接続されるスイッチング素子であ
り、制御装置２０によ−〕でオン／オフ制御さイする。
＋９ｆＪ、１次巻線が点ＩＩ） Ｉ 、 Ｐ２に接続さ
Ａ］るトタンスであり、２次巻線の巻数比が小となるよ
うに設定されている。トランスＩ９の２次在線には、ダ
イオード１７、インダクタンスＩＯ、アークスタータＩ
＋、電極１２、アークＩ３お３にび被溶接＋４１４が順
次直列接続されており、また、グイオートＩ７のカソー
ドと２次巻線の他端との間には、グイオートＩ８とスイ
ッチング素子２４どが直列に介挿され−（二いろ。制御
装置２０は、電流検出器Ｉ５が検出ｌ−る溶接電流１ｗ
に括づき、スイッチング素子３，３−，４．４−．２４
のオン／オフを制御する。
Ａ］るトタンスであり、２次巻線の巻数比が小となるよ
うに設定されている。トランスＩ９の２次在線には、ダ
イオード１７、インダクタンスＩＯ、アークスタータＩ
＋、電極１２、アークＩ３お３にび被溶接＋４１４が順
次直列接続されており、また、グイオートＩ７のカソー
ドと２次巻線の他端との間には、グイオートＩ８とスイ
ッチング素子２４どが直列に介挿され−（二いろ。制御
装置２０は、電流検出器Ｉ５が検出ｌ−る溶接電流１ｗ
に括づき、スイッチング素子３，３−，４．４−．２４
のオン／オフを制御する。
次に、１′、記構成によるごの実施例の動作を説明４゛
ろ３゜ 第２図は、この実施例の動作を示す波形図である。
ろ３゜ 第２図は、この実施例の動作を示す波形図である。
まず、スイ・ソチノグ素子３，４かオンとなると、溶接
電流１ｗｔｊ：、ｌ・ラノスＩ９の１次側に換算さイま
たインピーダンスによ−、て定まる時定数と、直流電源
１の電圧値により決よろ傾きでＩ、、： Ｆｉ＋する（
期間Ｔ Ｉ ） 、、次１．六スイノヂンク素子４がオ
フになると、トクンス１９の１次側で（Ｊｌ スイッチ
ング素子３とダイオ−１’ ７を通ろ経路で１次電流が
環流（２、」ヨだ、２次側しインダクタンスＩ （ｌに
蓄えら１１へ上ネルギーが、アークＩ３およびその他の
回路素ｒ−に、ｊ−ろ損失によ−）てな八らかに減少す
る（朋１ｊビＩ’ ２ ） 、、なお、ごのｊυＩ ｌ
！ｉｆ Ｔ２．の動イ′［は、スイッザノク゛索１′・
４に代えてスイッチング素子３がオフとな−、）こ場合
に１ハ）でも、同様に行わイ１ろ。
電流１ｗｔｊ：、ｌ・ラノスＩ９の１次側に換算さイま
たインピーダンスによ−、て定まる時定数と、直流電源
１の電圧値により決よろ傾きでＩ、、： Ｆｉ＋する（
期間Ｔ Ｉ ） 、、次１．六スイノヂンク素子４がオ
フになると、トクンス１９の１次側で（Ｊｌ スイッチ
ング素子３とダイオ−１’ ７を通ろ経路で１次電流が
環流（２、」ヨだ、２次側しインダクタンスＩ （ｌに
蓄えら１１へ上ネルギーが、アークＩ３およびその他の
回路素ｒ−に、ｊ−ろ損失によ−）てな八らかに減少す
る（朋１ｊビＩ’ ２ ） 、、なお、ごのｊυＩ ｌ
！ｉｆ Ｔ２．の動イ′［は、スイッザノク゛索１′・
４に代えてスイッチング素子３がオフとな−、）こ場合
に１ハ）でも、同様に行わイ１ろ。
次に、スイッチング素子３．４の双方かオフとなると、
グイオート〔３，７を介し７、トランスＩ９の励磁エネ
ルギが直流電源Ｉに回）Ｊされ、ごの結束、１次電流お
よび２次電流が急激に減少４゛ろ（期間’Ｉ’ ３）
、そしで、２次電流が減少する途中でスイッチング累ｒ
−２４をオンとすると、トランスｌりの１次側−Ｑ ｆ
ｉ ｌ”’ｌ ’ｌか続くが、２次側にわ（ビごは、イ
ンダクタンス１０に蓄えられた土ネルＡ−か、スイッチ
ング累１”２４お７１−ひダイオード１８を介しでＩ：
：′）流し、１−ノンス１９の２次巻線才３．１、ひタ
イオート１７に（」流イ１ない。この活眼、溶接電流１
ｗ（」曲流ｌ−１ｉ ７１！；！ ｌに回ｉさイ１４に
血相ろ八め、（１１びｆＪ゛たらかな減衰に変わる。そ
の後、溶接電流１ｗは減少を続（Ｊるが、スイッチング
素子３′、４−を短時間に同時にオンすると、この期間
中は期間ＴＩと同様の傾きで溶接電流１ｗが上昇する。
グイオート〔３，７を介し７、トランスＩ９の励磁エネ
ルギが直流電源Ｉに回）Ｊされ、ごの結束、１次電流お
よび２次電流が急激に減少４゛ろ（期間’Ｉ’ ３）
、そしで、２次電流が減少する途中でスイッチング累ｒ
−２４をオンとすると、トランスｌりの１次側−Ｑ ｆ
ｉ ｌ”’ｌ ’ｌか続くが、２次側にわ（ビごは、イ
ンダクタンス１０に蓄えられた土ネルＡ−か、スイッチ
ング累１”２４お７１−ひダイオード１８を介しでＩ：
：′）流し、１−ノンス１９の２次巻線才３．１、ひタ
イオート１７に（」流イ１ない。この活眼、溶接電流１
ｗ（」曲流ｌ−１ｉ ７１！；！ ｌに回ｉさイ１４に
血相ろ八め、（１１びｆＪ゛たらかな減衰に変わる。そ
の後、溶接電流１ｗは減少を続（Ｊるが、スイッチング
素子３′、４−を短時間に同時にオンすると、この期間
中は期間ＴＩと同様の傾きで溶接電流１ｗが上昇する。
そして、スイッチング索子１．４’がオフとなると、溶
接電流１ｗは、期間Ｔ４と同様のゆるやかな傾きで減少
する。以後、所定のタイミングでスイッチング索子１．
４−がオン７才）を繰り返し、溶接電流１ｗが一定の低
電流値Ｉ８を維持する。
接電流１ｗは、期間Ｔ４と同様のゆるやかな傾きで減少
する。以後、所定のタイミングでスイッチング索子１．
４−がオン７才）を繰り返し、溶接電流１ｗが一定の低
電流値Ｉ８を維持する。
次に、再びスイッチング索子３，４がオン状態となり、
」二記期間Ｔ１〜Ｔ４の動作が繰り返えされる。この場
合、スイッチング索子３，４、および３−９４−のオン
時間が、周期ＴＯの１７２以下であれば、トランス１９
の励磁電流は、色層期毎にリセットされるので、トラン
ス１９に偏磁が生じることはない。
」二記期間Ｔ１〜Ｔ４の動作が繰り返えされる。この場
合、スイッチング索子３，４、および３−９４−のオン
時間が、周期ＴＯの１７２以下であれば、トランス１９
の励磁電流は、色層期毎にリセットされるので、トラン
ス１９に偏磁が生じることはない。
上記動作においては、トランス１９の２次側の巻線数が
１次側より小さいので、スイッチング索子３．４（ある
いは、ｌ、４１を流れる電流は、溶接電流１ｗより小さ
い値となる。すなわち、パルス電流発生用のスイッチン
グ索子の電流容量以］二の溶接電流を得ろことができろ
。
１次側より小さいので、スイッチング索子３．４（ある
いは、ｌ、４１を流れる電流は、溶接電流１ｗより小さ
い値となる。すなわち、パルス電流発生用のスイッチン
グ索子の電流容量以］二の溶接電流を得ろことができろ
。
なお、」二記実施例において、スイッチング索子３．４
のオン／オフタイミングを同時にしてムよく、また、ス
イッチング索子３’、４’の機能をスイッチング索子３
，４に持たせてもよい。
のオン／オフタイミングを同時にしてムよく、また、ス
イッチング索子３’、４’の機能をスイッチング索子３
，４に持たせてもよい。
また、スイッチング索子３．４に対し、第２図（ロ）、
（ハ）に示すようなタイミンク゛をずらしたオン／オフ
制御を行っても良い。
（ハ）に示すようなタイミンク゛をずらしたオン／オフ
制御を行っても良い。
第３図は、この発明の他の実施例の構成を示す回路図で
ある３、この実施例が第１図に示す実施例と異なってい
る点は、ｌ−ランス１９に代えて、２次巻線Ｌ ａが追
加されているトランス１９′か設けられ、ごの巻線Ｌ
ａの一端とインダクタンス１０との間にスイッチング索
子２８とダイオード２９とが直列に介挿されている点で
ある。
ある３、この実施例が第１図に示す実施例と異なってい
る点は、ｌ−ランス１９に代えて、２次巻線Ｌ ａが追
加されているトランス１９′か設けられ、ごの巻線Ｌ
ａの一端とインダクタンス１０との間にスイッチング索
子２８とダイオード２９とが直列に介挿されている点で
ある。
第４図は、ごの実施例の動作を示すための波形図であり
、ごの図から判るように第１図に示す回路とほぼ同様の
動作となる。この実施例の場合において、溶接電流１ｗ
か低電流の時にスイッヂング素子２８をオンすると、事
実上トランス１９゛の２次電圧が高くなるため、外乱等
によりアークが遮断されそうな状態であっても、アーク
電圧が上昇することにより、溶接電流を素早く立ち上げ
、本来制御されるべき値に一致させることができる。
、ごの図から判るように第１図に示す回路とほぼ同様の
動作となる。この実施例の場合において、溶接電流１ｗ
か低電流の時にスイッヂング素子２８をオンすると、事
実上トランス１９゛の２次電圧が高くなるため、外乱等
によりアークが遮断されそうな状態であっても、アーク
電圧が上昇することにより、溶接電流を素早く立ち上げ
、本来制御されるべき値に一致させることができる。
このように、アークの持続性が向」ニし、外乱等による
アーク切れを防止することができる。
アーク切れを防止することができる。
なお、上記各実施例においては、スイッチング素子３．
４（あるいは１．４−）のオン／オフタイミングを適宜
ずらすことにより、最小パルス幅をスムーズに０まで絞
ることができる。
４（あるいは１．４−）のオン／オフタイミングを適宜
ずらすことにより、最小パルス幅をスムーズに０まで絞
ることができる。
また、スイッチング索子３−３４−としてＦＥＴ（電界
効果トランジスタ）等の高速スイ・ソチング素子を用い
て低電流時の制御を行えば、外乱等によるアーク切れに
対処する能力が向」ニする。
効果トランジスタ）等の高速スイ・ソチング素子を用い
て低電流時の制御を行えば、外乱等によるアーク切れに
対処する能力が向」ニする。
さらに、パルス発生用のスイッチング素子（スイッチン
グ索子３．４）により低電流時の制御を行う場合におい
ても、低電流時のスイッチング損失は少ないため、基本
周期以上で駆動することができ、これにより、」二記と
同様にアーク切れ防止能力が向−にする。
グ索子３．４）により低電流時の制御を行う場合におい
ても、低電流時のスイッチング損失は少ないため、基本
周期以上で駆動することができ、これにより、」二記と
同様にアーク切れ防止能力が向−にする。
「発明の効果」
以」二説明したように、この発明によれば、直流電源を
スイッチングすることにより、パルス電流を発生ずるパ
ルス電流発生部と、２次巻線の巻き数カ月次側より少な
く設定されるとともに、１次巻線が前記パルス電流発生
部の出力端に接続されるトランスと、このトランスの２
次側に直列に介挿される第１の整流素子、電極および被
溶接材と、第２の整流素子および第１のスイッチング素
子を直列接続してなり前記スイッチング素子がオン状態
のときは溶接電流が前記２次巻線を介さすに環流ずろバ
イパス経路とを具備したので、パルス電流発生部のスイ
ッチング素子の電流容量以」二の溶接電流を流すことが
できる。また、第１のスイッチング索子をオンすると溶
接電流が回生されずに環流し、これにより、低電流制御
が可能となる。
スイッチングすることにより、パルス電流を発生ずるパ
ルス電流発生部と、２次巻線の巻き数カ月次側より少な
く設定されるとともに、１次巻線が前記パルス電流発生
部の出力端に接続されるトランスと、このトランスの２
次側に直列に介挿される第１の整流素子、電極および被
溶接材と、第２の整流素子および第１のスイッチング素
子を直列接続してなり前記スイッチング素子がオン状態
のときは溶接電流が前記２次巻線を介さすに環流ずろバ
イパス経路とを具備したので、パルス電流発生部のスイ
ッチング素子の電流容量以」二の溶接電流を流すことが
できる。また、第１のスイッチング索子をオンすると溶
接電流が回生されずに環流し、これにより、低電流制御
が可能となる。
この際において、第１のスイッチング素子には、低電流
が流れるので、この第１のスイッチング素子についても
電流容量を犬とする必要がないといｌ利点が得られる。
が流れるので、この第１のスイッチング素子についても
電流容量を犬とする必要がないといｌ利点が得られる。
第１図はこの発明の一実施例の構成を示す回路図、第２
図（Ｊ同実施例の動作を示す波形図、第３図はごの発明
の他の実施例の構成を示す回路図、第４図は他の実施例
の動作を示す波形図、第５図は従来の高周波パルスアー
ク溶接電源の構成を示す回路図、第６図は第５図に示す
回路の動作を示す波形図である。 １ ・・・直流電源、３．４・・・・スイッチング素子
（第２、第３のスイッチング素子）、３−１４−スイッ
チング素子（第４、第５のスイッチング素子）、６．７
・ 整流素子（第３、第４の整流素子）、１７・ 整
流素子（第１の整流素子）、１８・−・・整流素子（第
２の整流素子）、１９，１９′ ・トランス、２４
スイッチング素子（第１のスイッチング素子）、２８
・・スイッチング素子（整流／スイッチ回路）、２９
・ ・整流素子（整流／スイッチ回路）、２９ Ｌ ａ
・・・・昇圧巻線。
図（Ｊ同実施例の動作を示す波形図、第３図はごの発明
の他の実施例の構成を示す回路図、第４図は他の実施例
の動作を示す波形図、第５図は従来の高周波パルスアー
ク溶接電源の構成を示す回路図、第６図は第５図に示す
回路の動作を示す波形図である。 １ ・・・直流電源、３．４・・・・スイッチング素子
（第２、第３のスイッチング素子）、３−１４−スイッ
チング素子（第４、第５のスイッチング素子）、６．７
・ 整流素子（第３、第４の整流素子）、１７・ 整
流素子（第１の整流素子）、１８・−・・整流素子（第
２の整流素子）、１９，１９′ ・トランス、２４
スイッチング素子（第１のスイッチング素子）、２８
・・スイッチング素子（整流／スイッチ回路）、２９
・ ・整流素子（整流／スイッチ回路）、２９ Ｌ ａ
・・・・昇圧巻線。
Claims (5)
- （１）直流電源をスイッチングすることにより、パルス
電流を発生するパルス電流発生部と、２次巻線の巻き数
が１次側より少なく設定されるとともに、１次巻線が前
記パルス電流発生部の出力端に接続されるトランスと、
このトランスの２次側に直列に介挿される第１の整流素
子、電極および被溶接材と、第２の整流素子および第１
のスイッチング素子を直列接続してなり前記第１のスイ
ッチング素子がオン状態のときは溶接電流が前記２次巻
線を介さずに環流するバイパス経路とを具備することを
特徴とする高周波パルスアーク溶接電源。 - （２）前記パルス電流発生部は、直流電源の負側から一
方の出力端に逆方向に介挿される第３の整流素子と、前
記一方の出力端から前記直流電源の正側に介挿される第
２のスイッチング素子と、前記直流電源の負側から他方
の出力端に介挿される第３のスイッチング素子と、前記
他方の出力端から前記直流電源の正側に逆方向に介挿さ
れる第４の整流素子とを具備し、前記第３、第４のスイ
ッチング素子のオン／オフタイミングをスイッチング素
子の遅れ時間だけずらしたことを特徴とする特許請求の
範囲第１項記載の高周波パルスアーク溶接電源。 - （３）前記パルス電流発生部は、直流電源の負側から一
方の出力端に逆方向に介挿される第３の整流素子と、前
記一方の出力端から前記直流電源の正側に介挿される第
２のスイッチング素子と、前記直流電源の負側から他方
の出力端に介挿される第３のスイッチング素子と、前記
他方の出力端から前記直流電源の正側に逆方向に介挿さ
れる第４の整流素子とを具備し、前記第２、第３のスイ
ッチング素子は、パルス電流供給のための基本スイッチ
ング周期と、この基本スイッチング周期内における低電
流制御のためのスイッチング周期とによってオン／オフ
制御されることを特徴とする特許請求の範囲第１項記載
の高周波パルスアーク溶接電源。 - （４）前記パルス電流発生部は、直流電源の負側から一
方の出力端に逆方向に介挿される第３の整流素子と、前
記一方の出力端から前記直流電源の正側に介挿される第
２のスイッチング素子と、前記直流電源の負側から他方
の出力端に介挿される第３のスイッチング素子と、前記
他方の出力端から前記直流電源の正側に逆方向に介挿さ
れる第４の整流素子と、前記第２、第３のスイッチング
素子に各々並列に接続される第４、第５のスイッチング
素子とを具備し、前記第２、第３のスイッチング素子は
パルス電流供給のための基本スイッチング周期によりオ
ン／オフ制御され、前記第４、第５のスイッチング素子
は前記基本スイッチング周期内において低電流制御のた
めにオン／オフ制御されることを特徴とする特許請求の
範囲第１項記載の高周波パルスアーク溶接電源。 - （５）前記トランスの２次側には、前記２次巻線とは別
に２次出力電圧を増加させる方向に電圧を誘起させる昇
圧巻線を設け、さらに、前記昇圧巻線による誘起電圧を
前記アークの電圧を上昇させる方向に与える整流／スイ
ッチ回路を具備したことを特徴とする特許請求の範囲第
１項記載の高周波パルスアーク溶接電源。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18653486A JPS6343770A (ja) | 1986-08-08 | 1986-08-08 | 高周波パルスア−ク溶接電源 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18653486A JPS6343770A (ja) | 1986-08-08 | 1986-08-08 | 高周波パルスア−ク溶接電源 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6343770A true JPS6343770A (ja) | 1988-02-24 |
Family
ID=16190174
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18653486A Pending JPS6343770A (ja) | 1986-08-08 | 1986-08-08 | 高周波パルスア−ク溶接電源 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6343770A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0565265A (ja) * | 1991-09-09 | 1993-03-19 | Mitsubishi Kasei Corp | イソホロンジイソシアネートの製造方法 |
-
1986
- 1986-08-08 JP JP18653486A patent/JPS6343770A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0565265A (ja) * | 1991-09-09 | 1993-03-19 | Mitsubishi Kasei Corp | イソホロンジイソシアネートの製造方法 |
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