JPS6353748B2 - - Google Patents
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- JPS6353748B2 JPS6353748B2 JP54030547A JP3054779A JPS6353748B2 JP S6353748 B2 JPS6353748 B2 JP S6353748B2 JP 54030547 A JP54030547 A JP 54030547A JP 3054779 A JP3054779 A JP 3054779A JP S6353748 B2 JPS6353748 B2 JP S6353748B2
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
- H04N1/40056—Circuits for driving or energising particular reading heads or original illumination means
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/16—Error detection or correction of the data by redundancy in hardware
- G06F11/18—Error detection or correction of the data by redundancy in hardware using passive fault-masking of the redundant circuits
- G06F11/183—Error detection or correction of the data by redundancy in hardware using passive fault-masking of the redundant circuits by voting, the voting not being performed by the redundant components
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N2201/00—Indexing scheme relating to scanning, transmission or reproduction of documents or the like, and to details thereof
- H04N2201/04—Scanning arrangements
- H04N2201/0402—Arrangements not specific to a particular one of the scanning methods covered by groups H04N1/04 - H04N1/207
- H04N2201/0458—Additional arrangements for improving or optimising scanning resolution or quality
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- Theoretical Computer Science (AREA)
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- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
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- Signal Processing (AREA)
- Facsimile Scanning Arrangements (AREA)
- Image Input (AREA)
Description
【発明の詳細な説明】
本発明は、フアクシミリ等に好適な、良好な画
情報を得るための画情報読取方式に関する。
情報を得るための画情報読取方式に関する。
従来から、１ライン分の固体走査素子を用いた
画情報読取方式として、１ラインの主走査終了毎
に副走査を行う方式と、主走査と同時に副走査を
行う方式の２通りが知られている。
画情報読取方式として、１ラインの主走査終了毎
に副走査を行う方式と、主走査と同時に副走査を
行う方式の２通りが知られている。
しかし、前者の方式では、１主走査ラインと次
の主走査ラインとの間に存在する情報が全く得ら
れず、原稿上の主走査方向細線が欠落する場合が
生じることから、最近ではもつぱら後者の方式が
採用されている。
の主走査ラインとの間に存在する情報が全く得ら
れず、原稿上の主走査方向細線が欠落する場合が
生じることから、最近ではもつぱら後者の方式が
採用されている。
このように、主走査と同時に副走査を行う画情
報読取方式において、１主走査ラインの走査時間
をあまり長くすると良好な画情報が得られない。
報読取方式において、１主走査ラインの走査時間
をあまり長くすると良好な画情報が得られない。
即ち、固体走査素子における電荷蓄積時間と暗
信号との間には第１図に示す関係があるため、走
査時間を長くすると暗信号が増し、これが画信号
と共に固体走査素子上に蓄積されるため、Ｓ／Ｎ
が悪くなり、固体走査素子から出力される画情報
に誤情報が含まれることになる。
信号との間には第１図に示す関係があるため、走
査時間を長くすると暗信号が増し、これが画信号
と共に固体走査素子上に蓄積されるため、Ｓ／Ｎ
が悪くなり、固体走査素子から出力される画情報
に誤情報が含まれることになる。
そこで従来は、電荷蓄積時間を短かくしてＳ／
Ｎを改善するために、走査速度をＮ倍にして、第
２図ａに示すように、１ラインの読み取り時間τ
の1/N時間で走査して１ライン分の画情報を取り
出すようにしている。あるいはまた、第２図ｂに
示すように、１ラインの読み取り時間τ内にＮ回
の読み取り走査を行つて、そのうちのの１回の走
査分で得られる１ライン分の画情報を取り出すよ
うにしていた。
Ｎを改善するために、走査速度をＮ倍にして、第
２図ａに示すように、１ラインの読み取り時間τ
の1/N時間で走査して１ライン分の画情報を取り
出すようにしている。あるいはまた、第２図ｂに
示すように、１ラインの読み取り時間τ内にＮ回
の読み取り走査を行つて、そのうちのの１回の走
査分で得られる１ライン分の画情報を取り出すよ
うにしていた。
この結果、S/Nは改善されるものの、主走査は
１ラインの読み取り時間τ中の1/N時間しか行わ
れないことに相当し、一方、副走査はこの間連続
して行われる結果、副走査方向の分解能が悪くな
り、主走査方向の細線が欠落して良好な画情報が
得られない欠点があつた。
１ラインの読み取り時間τ中の1/N時間しか行わ
れないことに相当し、一方、副走査はこの間連続
して行われる結果、副走査方向の分解能が悪くな
り、主走査方向の細線が欠落して良好な画情報が
得られない欠点があつた。
本発明は、上記従来技術の欠点を除去して、主
及び副走査方向の分解能を改善し、S/Nの良い良
好な画情報が得られる画情報読取方式を提供する
ことを目的とする。
及び副走査方向の分解能を改善し、S/Nの良い良
好な画情報が得られる画情報読取方式を提供する
ことを目的とする。
この目的を達成するために、本発明は１ライン
分の読み取り時間内に主走査を複数回行い、得ら
れる各画情報を論理処理して所定の１ライン分の
画情報を得るようにしたことを特徴とする。
分の読み取り時間内に主走査を複数回行い、得ら
れる各画情報を論理処理して所定の１ライン分の
画情報を得るようにしたことを特徴とする。
以下、本発明の一実施例を第３図乃至第５図を
参照して説明する。
参照して説明する。
第３図は本発明の画情報読取方式に適用される
一実施例を示す画情報処理部の回路構成図で、図
示せぬ固体走査素子からのアナログビデオ信号
Sviとスレツシユ．レベル信号Stiを比較して２値
化信号に変換するコンパレータＣ、１ライン分の
容量をもつメモリＭ１〜Ｍ３、このメモリＭ１〜
Ｍ３にアドレスADDを与えるためにビデオクロ
ツクPviを計数するアドレスカウンタADC、メモ
リＭ１〜Ｍ３の出力Di1〜Di3及びコンパレータＣ
の出力Di4の多数決論理をとる多数決論理処理手
段としての多数決論理回路Ｌ、この論理回路Ｌの
出力をビデオクロツクPviによりラツチするフリ
ツプフロツプＦ、１主走査ライン毎に発生するラ
インシンク信号Lsiを計数するラインカウンタ
LNC、このラインカウンタLNCの出力をデコー
ドするデコーダDCD、フリツプフロツプＦから
出力する１ライン分の画情報に同期したビデオク
ロツクPvi′を出力するアンドゲートＡ１及びライ
ンシンク信号Lsi′を出力するアンドゲートＡ２か
ら構成されている。
一実施例を示す画情報処理部の回路構成図で、図
示せぬ固体走査素子からのアナログビデオ信号
Sviとスレツシユ．レベル信号Stiを比較して２値
化信号に変換するコンパレータＣ、１ライン分の
容量をもつメモリＭ１〜Ｍ３、このメモリＭ１〜
Ｍ３にアドレスADDを与えるためにビデオクロ
ツクPviを計数するアドレスカウンタADC、メモ
リＭ１〜Ｍ３の出力Di1〜Di3及びコンパレータＣ
の出力Di4の多数決論理をとる多数決論理処理手
段としての多数決論理回路Ｌ、この論理回路Ｌの
出力をビデオクロツクPviによりラツチするフリ
ツプフロツプＦ、１主走査ライン毎に発生するラ
インシンク信号Lsiを計数するラインカウンタ
LNC、このラインカウンタLNCの出力をデコー
ドするデコーダDCD、フリツプフロツプＦから
出力する１ライン分の画情報に同期したビデオク
ロツクPvi′を出力するアンドゲートＡ１及びライ
ンシンク信号Lsi′を出力するアンドゲートＡ２か
ら構成されている。
ところで、多数決論理回路Ｌは４個の反転回路
Ｉ、５個のアンドゲートAND及びオアゲートOR
が図示の通り結線されて、第４図に示すように、
そこに入力する論理信号Di1〜Di4に基づいて論理
信号Di0を出力するように構成されている。但し、
第４図における“０”は白信号、“１”は黒信号
を表わすものとする。
Ｉ、５個のアンドゲートAND及びオアゲートOR
が図示の通り結線されて、第４図に示すように、
そこに入力する論理信号Di1〜Di4に基づいて論理
信号Di0を出力するように構成されている。但し、
第４図における“０”は白信号、“１”は黒信号
を表わすものとする。
また、デコーダDCDは反転回路Ｉ、アンドゲ
ートANDが図示のように結線されて、ラインシ
ンク信号Lsiが入力する毎に順次メモリＭ１〜Ｍ
３の書き込み及び読み出し状態を切り換える信号
Sa〜Sc及びビデオクロツクPvi′を取り出すため
の信号Sdを出力するように構成されている。
ートANDが図示のように結線されて、ラインシ
ンク信号Lsiが入力する毎に順次メモリＭ１〜Ｍ
３の書き込み及び読み出し状態を切り換える信号
Sa〜Sc及びビデオクロツクPvi′を取り出すため
の信号Sdを出力するように構成されている。
このように構成されて、今、コンパレータＣに
モデムから送出されるデータの伝送速度で決るＩ
ライン分の読み取り時間、例えば4800bpsモデム
の場合には20ms内に、例えば5msの走査速度で
４回主走査を行つて、固体走査素子から伝送速度
の４倍の周波数のビデオクロツクPviに同期して
ｉライン目における４ライン分のアナログビデオ
信号Svi1〜Svi4が次々と入力したものと仮定し、
コンパレータＣから出力される４ライン分の２値
化データDi1〜Di4からｉライン目における所定の
１ライン分のデータDi′を得る動作を、更に第５
図のタイムチヤートを参照して説明する。
モデムから送出されるデータの伝送速度で決るＩ
ライン分の読み取り時間、例えば4800bpsモデム
の場合には20ms内に、例えば5msの走査速度で
４回主走査を行つて、固体走査素子から伝送速度
の４倍の周波数のビデオクロツクPviに同期して
ｉライン目における４ライン分のアナログビデオ
信号Svi1〜Svi4が次々と入力したものと仮定し、
コンパレータＣから出力される４ライン分の２値
化データDi1〜Di4からｉライン目における所定の
１ライン分のデータDi′を得る動作を、更に第５
図のタイムチヤートを参照して説明する。
アナログビデオ信号Sviの入力に同期して、ア
ドレススカウンタADCにはビデオオクロツクPvi
が、また、ラインカウンタLNCにはラインシン
ク信号Lsiが入力する。
ドレススカウンタADCにはビデオオクロツクPvi
が、また、ラインカウンタLNCにはラインシン
ク信号Lsiが入力する。
ラインカウンタLNCにラインシンク信号Lsiが
入力すると、その計数値は「０，０」となり、デ
コーダDCDの出力信号Saを論理「１」状態にす
る。
入力すると、その計数値は「０，０」となり、デ
コーダDCDの出力信号Saを論理「１」状態にす
る。
信号Saが「１」状態になると先ずアンドゲー
トＡ２からは次の処理のため必要となるラインシ
ンク信号Lsi′が出力する。また、メモリＭ１は書
き込みモードになる。これにより、コンパレータ
Ｃから出力される１ライン分のデータDi1はアド
レスカウンタADCから出力されるアドレスADD
に基づいて順次1bitずつメモリＭ１内に書き込ま
れて行く。
トＡ２からは次の処理のため必要となるラインシ
ンク信号Lsi′が出力する。また、メモリＭ１は書
き込みモードになる。これにより、コンパレータ
Ｃから出力される１ライン分のデータDi1はアド
レスカウンタADCから出力されるアドレスADD
に基づいて順次1bitずつメモリＭ１内に書き込ま
れて行く。
この１ライン分のデータDi1の書き込みが終了
すると、続いてコンパレータＣからは次の１ライ
ン分のデータDi2が出力する。
すると、続いてコンパレータＣからは次の１ライ
ン分のデータDi2が出力する。
このとき同期して入力するラインシンク信号
Lsiにより、ラインカウンタLNCの計数値は「０，
１」となる。この結果、デコーダDCDの出力状
態は切り換えられて、今度は信号Sbが「１」状
態になり、メモリＭ２が書き込みモードになる。
Lsiにより、ラインカウンタLNCの計数値は「０，
１」となる。この結果、デコーダDCDの出力状
態は切り換えられて、今度は信号Sbが「１」状
態になり、メモリＭ２が書き込みモードになる。
従つて、２番目のデータDi2はメモリＭ２内に、
同様にして、３番目のデータDi3はメモリＭ３内
に書き込まれる。
同様にして、３番目のデータDi3はメモリＭ３内
に書き込まれる。
コンパレータＣからｉライン目における最後の
１ライン分のデータDi4が出力されると、このデ
ータDi4は直接論理回路Ｌに入力する。これに同
期して、各メモリＭ１〜Ｍ３からは各データDi1
〜Di3が出力され、論理回路Ｌに1bitずつ入力す
る。
１ライン分のデータDi4が出力されると、このデ
ータDi4は直接論理回路Ｌに入力する。これに同
期して、各メモリＭ１〜Ｍ３からは各データDi1
〜Di3が出力され、論理回路Ｌに1bitずつ入力す
る。
論理回路Ｌは、そこに入力する各データDi1〜
Di4に応じて、第４図に示す論理データDi0を出力
する。
Di4に応じて、第４図に示す論理データDi0を出力
する。
即ち、第４図からも明らかなように、入力する
ｉライン目における各データDi1〜Di4の多数決論
理をとり、そのうち２個以上の黒信号論理「１」
が存在すれば、黒信号「１」として、原信号
「１」として、原稿の副走査方向における画情報
を確実に捕捉したデータDi0を出力する。
ｉライン目における各データDi1〜Di4の多数決論
理をとり、そのうち２個以上の黒信号論理「１」
が存在すれば、黒信号「１」として、原信号
「１」として、原稿の副走査方向における画情報
を確実に捕捉したデータDi0を出力する。
このデータDi0はビデオクロツクPviと共にフリ
ツプフロツプＦに入力される結果、フリツプフロ
ツプＦからはｉライン目における所定の１ライン
分のデータDi′が出力する。
ツプフロツプＦに入力される結果、フリツプフロ
ツプＦからはｉライン目における所定の１ライン
分のデータDi′が出力する。
アンドゲートＡ１は、このとき「１」状態とな
るデコーダDCD出力Sdにより開かれ、アンドゲ
ートＡ１からはデータDi′に同期してビデオクロ
ツクPvi′が出力する。
るデコーダDCD出力Sdにより開かれ、アンドゲ
ートＡ１からはデータDi′に同期してビデオクロ
ツクPvi′が出力する。
ところで、フリツプフロツプＦからは常時ある
データが出力されているが、次の処理はアンドゲ
ートＡ２から出力されるラインシンク信号Lsi′、
それに続いてアンドゲートＡ１から出力されるビ
デオクロツクPvi′により行われるため、上記４ラ
イン分のデータDi1〜Di4を論理処理してフリツプ
フロツプＦから出力されるデータのうち、デコー
ダDCDの出力Sdが「１」になつている期間中の
１ライン分のデータDi′だけがｉライン目におけ
る正規のデータとして図示せぬ次の処理回路に取
り込まれる。
データが出力されているが、次の処理はアンドゲ
ートＡ２から出力されるラインシンク信号Lsi′、
それに続いてアンドゲートＡ１から出力されるビ
デオクロツクPvi′により行われるため、上記４ラ
イン分のデータDi1〜Di4を論理処理してフリツプ
フロツプＦから出力されるデータのうち、デコー
ダDCDの出力Sdが「１」になつている期間中の
１ライン分のデータDi′だけがｉライン目におけ
る正規のデータとして図示せぬ次の処理回路に取
り込まれる。
従つて、次の処理回路で符号化等の処理を施
し、モデムを介して受信側に送出すれば、受信側
では良好な記録画像を得ることができる。
し、モデムを介して受信側に送出すれば、受信側
では良好な記録画像を得ることができる。
即ち、１ライン分の読み取り時間内に４回主走
査を行うようにしたので、電荷蓄積時間が短縮さ
れる結果、S/Nが改善される。しかも、その４回
走査して得られた各１ライン分のデータの多数決
論理を取ることにより所定の１ライン分の画情報
を得るようにしたので原稿の主走査方向に存在す
る細線を欠落することなく受信側で再生される。
その上、原稿上に存在する点状の汚れ、あるいは
小さなゴミ等は論理処理の際取り除かれる。ま
た、たまたま走査中に生じた雑音による誤bitも
論理処理の際取り除かれる結果、受信側で原画を
再生するときフライングスポツトが生じることな
く、良好な記録画を得ることができる。
査を行うようにしたので、電荷蓄積時間が短縮さ
れる結果、S/Nが改善される。しかも、その４回
走査して得られた各１ライン分のデータの多数決
論理を取ることにより所定の１ライン分の画情報
を得るようにしたので原稿の主走査方向に存在す
る細線を欠落することなく受信側で再生される。
その上、原稿上に存在する点状の汚れ、あるいは
小さなゴミ等は論理処理の際取り除かれる。ま
た、たまたま走査中に生じた雑音による誤bitも
論理処理の際取り除かれる結果、受信側で原画を
再生するときフライングスポツトが生じることな
く、良好な記録画を得ることができる。
尚、上記実施例では、論理回路Ｌを、そこに入
力されるｉライン目における４ライン分のデータ
Di1〜Di4のうち2bit以上が「１」の場合には出力
データDi0を「１」とする論理構成にしたが、デ
ータDi1とDi4のみが「１」の場合には、前の（ｉ
−１）ライン及び後の（ｉ＋１）ラインにおける
画情報との相関性が強いため、この場合には論理
「０」とする論理構成にする方が好ましい。
力されるｉライン目における４ライン分のデータ
Di1〜Di4のうち2bit以上が「１」の場合には出力
データDi0を「１」とする論理構成にしたが、デ
ータDi1とDi4のみが「１」の場合には、前の（ｉ
−１）ライン及び後の（ｉ＋１）ラインにおける
画情報との相関性が強いため、この場合には論理
「０」とする論理構成にする方が好ましい。
また、論理回路Ｌは、例えば入力されるデータ
のうち3bit以上が「１」の場合に出力データを
「１」とする等適宜に構成することができる。
のうち3bit以上が「１」の場合に出力データを
「１」とする等適宜に構成することができる。
更に、その論理回路をプログラマブルに構成し
ておき、その時の原稿状態即ち走査線密度に応じ
て適宜選択し得るようにしても良い。
ておき、その時の原稿状態即ち走査線密度に応じ
て適宜選択し得るようにしても良い。
また、１ライン分の読み取り時間内に行う主走
査回数、従つてその結果得られるデータを論理回
路に入力するデータの数は任意に設計できる。
査回数、従つてその結果得られるデータを論理回
路に入力するデータの数は任意に設計できる。
以上の記載の通り、本発明によれば、１ライン
分の読み取り時間内に主走査を複数回行うように
したので、固体走査素子の電荷蓄積時間が短かく
なる結果、S/Nが改善される。更に得られた各画
情報を論理処理して所定の１ライン分の画情報を
作り出すようにしたので、副走査方向分解能が改
善され、主走査方向細線も欠落することなく確実
に捕捉され、しかも受信側で再生する際、フライ
ングスポツトを生じることのない良好な画情報が
得られる。
分の読み取り時間内に主走査を複数回行うように
したので、固体走査素子の電荷蓄積時間が短かく
なる結果、S/Nが改善される。更に得られた各画
情報を論理処理して所定の１ライン分の画情報を
作り出すようにしたので、副走査方向分解能が改
善され、主走査方向細線も欠落することなく確実
に捕捉され、しかも受信側で再生する際、フライ
ングスポツトを生じることのない良好な画情報が
得られる。
第１図は、固体走査素子の蓄積時間と暗信号と
の関係を示す特性図、第２図は従来の画情報読み
取り動作を説明するためのタイムチヤート、第３
図は本発明の一実施例を示す画情報処理部の回路
構成図、第４図はその論理回路における入出力関
係を示す関係図、第５図は第３図の動作を説明す
るためのタイムムチヤートである。 Ｃ……コンパレータ、Ｍ１〜Ｍ３……メモリ、
ADC……アドレスカウンタ、LNC……ラインカ
ウンタ、DCD……デコーダ、Ｌ……論露回路、
Ｆ……フリツプフロツプ、Ａ１，Ａ２……アンド
ゲート、Di……入力データ、Pvi……入力ビデオ
クロツク、Lsi……入力ラインシンク信号、Di′…
…出力データ、Pvi′……出力ビデオクロツク、
Lsi′……出力ラインシンク信号。
の関係を示す特性図、第２図は従来の画情報読み
取り動作を説明するためのタイムチヤート、第３
図は本発明の一実施例を示す画情報処理部の回路
構成図、第４図はその論理回路における入出力関
係を示す関係図、第５図は第３図の動作を説明す
るためのタイムムチヤートである。 Ｃ……コンパレータ、Ｍ１〜Ｍ３……メモリ、
ADC……アドレスカウンタ、LNC……ラインカ
ウンタ、DCD……デコーダ、Ｌ……論露回路、
Ｆ……フリツプフロツプ、Ａ１，Ａ２……アンド
ゲート、Di……入力データ、Pvi……入力ビデオ
クロツク、Lsi……入力ラインシンク信号、Di′…
…出力データ、Pvi′……出力ビデオクロツク、
Lsi′……出力ラインシンク信号。
Claims (1)
- １ 主走査方向１ライン分の読み取り時間内に各
１ライン分の画情報を複数回に亘つて読み取る読
み取り手段と、該読み取り手段から出力される上
記各１ライン分の画情報を次々と記憶する記憶手
段と、多数決論理処理手段とを備え、上記読み取
り手段から上記１ライン分の読み取り時間内にお
ける最後の１ライン分の画情報が出力されたと
き、上記記憶手段からそれまでに記憶された各１
ライン分の画情報を同時に取り出し、共に上記多
数決論理処理手段に入力することにより、上記読
み取り手段から得られる各１ライン分の画情報か
ら所定の１ライン分の画情報を得ることを特徴と
する画情報読取方式。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3054779A JPS55124358A (en) | 1979-03-17 | 1979-03-17 | Picture information reading system |
| DE3010243A DE3010243C2 (de) | 1979-03-17 | 1980-03-17 | Verfahren zur zeilenweisen Abtastung einer Bildvorlage und Einrichtung zur Durchführung eines solchen Verfahrens |
| US06/131,277 US4313138A (en) | 1979-03-17 | 1980-03-17 | Image information reading system of facsimile apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3054779A JPS55124358A (en) | 1979-03-17 | 1979-03-17 | Picture information reading system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55124358A JPS55124358A (en) | 1980-09-25 |
| JPS6353748B2 true JPS6353748B2 (ja) | 1988-10-25 |
Family
ID=12306812
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3054779A Granted JPS55124358A (en) | 1979-03-17 | 1979-03-17 | Picture information reading system |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US4313138A (ja) |
| JP (1) | JPS55124358A (ja) |
| DE (1) | DE3010243C2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02108960U (ja) * | 1989-02-17 | 1990-08-30 |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4348593A (en) * | 1981-01-29 | 1982-09-07 | Xerox Corporation | Twisting geometry optical system utilizing imaging array with time delay segments |
| JPS5963869A (ja) * | 1982-10-04 | 1984-04-11 | Fuji Xerox Co Ltd | 原稿読取装置 |
| US4743975A (en) * | 1985-04-01 | 1988-05-10 | Canon Kabushiki Kaisha | Image processing apparatus |
| US4851919A (en) * | 1987-02-03 | 1989-07-25 | Kabushiki Kaisha Toshiba | Picture image data processor |
| JPH01106666A (ja) * | 1987-10-20 | 1989-04-24 | Fuji Photo Film Co Ltd | 画像情報読取方法 |
| US5461491A (en) * | 1993-12-29 | 1995-10-24 | Hewlett-Packard Company | Procedure for reducing processing time for image elements by combining charge of adjacent pixels into a new composite pixel |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| DE2015695A1 (de) * | 1970-04-02 | 1971-12-23 | Bosch Elektronik Gmbh | Verfahren zur Übertragung einer Bildvorlage |
| JPS5515136B2 (ja) * | 1974-10-31 | 1980-04-21 | ||
| JPS5335416A (en) * | 1976-09-14 | 1978-04-01 | Fujitsu Ltd | Picture reader |
-
1979
- 1979-03-17 JP JP3054779A patent/JPS55124358A/ja active Granted
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1980
- 1980-03-17 DE DE3010243A patent/DE3010243C2/de not_active Expired
- 1980-03-17 US US06/131,277 patent/US4313138A/en not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02108960U (ja) * | 1989-02-17 | 1990-08-30 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55124358A (en) | 1980-09-25 |
| DE3010243C2 (de) | 1982-07-15 |
| US4313138A (en) | 1982-01-26 |
| DE3010243A1 (de) | 1980-09-18 |
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