JPS6364674A - 信号処理装置 - Google Patents
信号処理装置Info
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- JPS6364674A JPS6364674A JP61209143A JP20914386A JPS6364674A JP S6364674 A JPS6364674 A JP S6364674A JP 61209143 A JP61209143 A JP 61209143A JP 20914386 A JP20914386 A JP 20914386A JP S6364674 A JPS6364674 A JP S6364674A
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- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0751—Error or fault detection not based on redundancy
- G06F11/0754—Error or fault detection not based on redundancy by exceeding limits
- G06F11/076—Error or fault detection not based on redundancy by exceeding limits by exceeding a count or rate limit, e.g. word- or bit count limit
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/005—Reproducing at a different information rate from the information rate of recording
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/19—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier
- G11B27/28—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording
- G11B27/30—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording
- G11B27/3027—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording used signal is digitally coded
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/93—Regeneration of the television signal or of selected parts thereof
- H04N5/937—Regeneration of the television signal or of selected parts thereof by assembling picture element blocks in an intermediate store
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B2220/00—Record carriers by type
- G11B2220/90—Tape-like record carriers
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- Signal Processing (AREA)
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- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Multimedia (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Television Signal Processing For Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、例えばディジタルビデオテープレコーダに
おいてシャトル（変速）再生を行う場合等に用いて好適
な信号処理装置に関する。
おいてシャトル（変速）再生を行う場合等に用いて好適
な信号処理装置に関する。
この発明は、入力データが書込みアドレスに従って書き
込まれ、読出しアドレスに従って読み出される第１のメ
モリを有する信号処理装置において、第１のメモリにデ
ータが書き込まれたとき夫々の書込みアドレスに対して
データが書き込まれた状態を書込みアドレスに対応して
記憶する第２のメモリを備え、第１のメモリからデータ
が読み出されたとき第２のメモリの対応する読出しアド
レスを読み出された状態にし、第２のメモリの状態に応
じて第１のメモリからのデータを出力するかまたは第１
のメモリ以外から供給されるデータを出力するようにす
ることにより、変速再生時における画面の動きをよくす
るようにしたものである。
込まれ、読出しアドレスに従って読み出される第１のメ
モリを有する信号処理装置において、第１のメモリにデ
ータが書き込まれたとき夫々の書込みアドレスに対して
データが書き込まれた状態を書込みアドレスに対応して
記憶する第２のメモリを備え、第１のメモリからデータ
が読み出されたとき第２のメモリの対応する読出しアド
レスを読み出された状態にし、第２のメモリの状態に応
じて第１のメモリからのデータを出力するかまたは第１
のメモリ以外から供給されるデータを出力するようにす
ることにより、変速再生時における画面の動きをよくす
るようにしたものである。
（従来の技術〕
複数のトラックを走査してｌフィールドを再生するビデ
オテープレコーダにおいて、変速再生を行うためには、
再生基準側と再生信号の間に大きな時間軸のずれが生じ
るため、この補正を行う必要がある。
オテープレコーダにおいて、変速再生を行うためには、
再生基準側と再生信号の間に大きな時間軸のずれが生じ
るため、この補正を行う必要がある。
そこで従来は、第４図に示すように、入力端子＋１）か
らの再生データをシンク再生回路（２〕に供給してデー
タと書込みアドレスを抽出し、抽出した書込みアドレス
に基づいてデータをメモ１月３）に書き込み、これを基
準信号に応答して形成された読出しアドレス発生回路（
４）からの読出しアドレスに基づいて読み出し、出力端
子（５）に取り出すようにしている。出力端子（５）に
取り出されたデータは、図示せずも誤り検出・訂正回路
で誤りを検出して訂正される等所定の信号処理を受けて
出力される。
らの再生データをシンク再生回路（２〕に供給してデー
タと書込みアドレスを抽出し、抽出した書込みアドレス
に基づいてデータをメモ１月３）に書き込み、これを基
準信号に応答して形成された読出しアドレス発生回路（
４）からの読出しアドレスに基づいて読み出し、出力端
子（５）に取り出すようにしている。出力端子（５）に
取り出されたデータは、図示せずも誤り検出・訂正回路
で誤りを検出して訂正される等所定の信号処理を受けて
出力される。
なお、変速再生を行う従来例としては、特開昭５６−１
４４６８２号、特開昭６０−４０５７３号等がある。
４４６８２号、特開昭６０−４０５７３号等がある。
〔発明が解決しようとする問題点〕
ところで、上述の如き従来装置では、メモリ（３）に１
度書き込んだデータは、新しいデータが書き込まれるま
でホールドされるので、変速再生の倍速の関係で長い間
拾えないフィールドのアドレスのデータがあると、その
データがホールドされて画面の他の部分と相関のないデ
ータとなり、誤りのように見えてしまう欠点があると共
に、また画面の動きが恋くなり、動く画面に尾を引くよ
うな症状を呈するような欠点があった。
度書き込んだデータは、新しいデータが書き込まれるま
でホールドされるので、変速再生の倍速の関係で長い間
拾えないフィールドのアドレスのデータがあると、その
データがホールドされて画面の他の部分と相関のないデ
ータとなり、誤りのように見えてしまう欠点があると共
に、また画面の動きが恋くなり、動く画面に尾を引くよ
うな症状を呈するような欠点があった。
この発明は斯る点に鑑みてなされたもので、変速再生時
に相関のない画素が残らないようにすると共に画面が動
いたり画面が切換わったりするときに追従性を良くし、
残像を少なくすることができる信号処理装置を提供する
ものである。
に相関のない画素が残らないようにすると共に画面が動
いたり画面が切換わったりするときに追従性を良くし、
残像を少なくすることができる信号処理装置を提供する
ものである。
この発明による信号処理装置は、入力データが書込みア
ドレスに従って書き込まれ、読出しアドレスに従って読
み出される第１のメモ１月３）を有する信号処理装置に
おいて、上記第１のメモリにデータが書き込まれたとき
夫々の書込みアドレスに対して上記データが書き込まれ
た状態を上記アドレスに対応して記憶する第２のメモリ
（６）を備え、上記第１のメモリからデータが読み出さ
れたとき上記第２のメモリの対応する読出しアドレスを
読み出された状態にし、上記第２のメモリの状態に応じ
て上記第１のメモリからのデータを出方するかまたは上
記第１のメモリ以外から供給されるデータを出力するよ
うに構成している。
ドレスに従って書き込まれ、読出しアドレスに従って読
み出される第１のメモ１月３）を有する信号処理装置に
おいて、上記第１のメモリにデータが書き込まれたとき
夫々の書込みアドレスに対して上記データが書き込まれ
た状態を上記アドレスに対応して記憶する第２のメモリ
（６）を備え、上記第１のメモリからデータが読み出さ
れたとき上記第２のメモリの対応する読出しアドレスを
読み出された状態にし、上記第２のメモリの状態に応じ
て上記第１のメモリからのデータを出方するかまたは上
記第１のメモリ以外から供給されるデータを出力するよ
うに構成している。
入力データが書込みアドレスに従って書き込まれ、続出
しアドレスに従って読み出される第１のメモリ（３）に
データが書き込まれたとき夫々の書込みアドレスに対し
てデータが書き込まれた状態をそのアドレスに対応して
第２のメモリ（６）に記憶する。そして、第１のメモリ
からデータが読み出されたとき第２のメモリに対応する
読出しアドレスを読み出された状態にし、第２のメモリ
の状態に応じて第１のメモリからのデータを出方するか
又は第１のメモリ以外から供給されるデータすなゎち固
定データを出力するようにす゛る。これにより、変速再
生時に相関のない画素が残らないようになり、しかも変
速再生時に画面がりＪいたり、画面が切換ったりすると
きに追従性が良くなって、残像を少なくすることができ
、動く画面に尾を引くような症状がなくなる。
しアドレスに従って読み出される第１のメモリ（３）に
データが書き込まれたとき夫々の書込みアドレスに対し
てデータが書き込まれた状態をそのアドレスに対応して
第２のメモリ（６）に記憶する。そして、第１のメモリ
からデータが読み出されたとき第２のメモリに対応する
読出しアドレスを読み出された状態にし、第２のメモリ
の状態に応じて第１のメモリからのデータを出方するか
又は第１のメモリ以外から供給されるデータすなゎち固
定データを出力するようにす゛る。これにより、変速再
生時に相関のない画素が残らないようになり、しかも変
速再生時に画面がりＪいたり、画面が切換ったりすると
きに追従性が良くなって、残像を少なくすることができ
、動く画面に尾を引くような症状がなくなる。
以下、この発明の一実施例を第１図〜第３図に基づいて
詳しく説明する。
詳しく説明する。
第１図は本実施例の回路構成を示すもので、同図におい
て、第４図と対応する部分には同一符号を付し、その詳
細説明は省略する。
て、第４図と対応する部分には同一符号を付し、その詳
細説明は省略する。
本実施例では°第２のメモリとしてのデータホールドタ
イマ（６）を設け、このタイマ（６）にはシンク再生回
路（２）からの書込みアドレス及び続出しアドレス発生
回路（４）からの読出しアドレスが＜３１給されると共
に端子（７）からの変速再生モード信号が供給されるよ
うになされている。タイマ（６）は端子（７）からの変
速再生モード信号が供給されたときのみ動作し、一度メ
モリ（３）に書き込まれたデータが所定回数読み出され
ると切換信号を発生し、メモリ（３）の出力側に設けら
れたスイッチ（８）を接点ａ側よりｂ側に切換える。こ
れによりデータをホールドする時間を制御している。こ
のデータをホールドする時間は倍速等のモードに応じて
切換えることも可詣である。なお、スイッチ（８）の接
点ａにはメモリ（３）の出力側が接続され、スイッチ（
８）の接点すには固定データが印加されている端子（９
）が接続されている。従ってスイッチ（８）が接点ａ側
に接続されているときは続出しアドレスに応じたメモ１
月３）からのデータが出力端子（５）に出力され、スイ
ッチ（８）が接点す側に接続されているときは端子（９
）からの固定データが出力端子（５）に出力される。
イマ（６）を設け、このタイマ（６）にはシンク再生回
路（２）からの書込みアドレス及び続出しアドレス発生
回路（４）からの読出しアドレスが＜３１給されると共
に端子（７）からの変速再生モード信号が供給されるよ
うになされている。タイマ（６）は端子（７）からの変
速再生モード信号が供給されたときのみ動作し、一度メ
モリ（３）に書き込まれたデータが所定回数読み出され
ると切換信号を発生し、メモリ（３）の出力側に設けら
れたスイッチ（８）を接点ａ側よりｂ側に切換える。こ
れによりデータをホールドする時間を制御している。こ
のデータをホールドする時間は倍速等のモードに応じて
切換えることも可詣である。なお、スイッチ（８）の接
点ａにはメモリ（３）の出力側が接続され、スイッチ（
８）の接点すには固定データが印加されている端子（９
）が接続されている。従ってスイッチ（８）が接点ａ側
に接続されているときは続出しアドレスに応じたメモ１
月３）からのデータが出力端子（５）に出力され、スイ
ッチ（８）が接点す側に接続されているときは端子（９
）からの固定データが出力端子（５）に出力される。
第２図はタイマ（６）の−例を示すもので、タイマ（６
）は例えば２トランクで１フイールドを構成するシンク
の数例えば２５６シかアドレスを持っていない。データ
のホールド回数をｎとするとタイマ（６）は２５６Ｘ
ｎビットの容量を持つことになる。因みに、メモリ（３
）は１シンクを例えば７６８サンプルとすると７６８Ｘ
２５６のアドレスを有し、データを例えば８ビツトと
すると７６８Ｘ ２５６ Ｘ ８ビツトの容量をもつこ
とになる。
）は例えば２トランクで１フイールドを構成するシンク
の数例えば２５６シかアドレスを持っていない。データ
のホールド回数をｎとするとタイマ（６）は２５６Ｘ
ｎビットの容量を持つことになる。因みに、メモリ（３
）は１シンクを例えば７６８サンプルとすると７６８Ｘ
２５６のアドレスを有し、データを例えば８ビツトと
すると７６８Ｘ ２５６ Ｘ ８ビツトの容量をもつこ
とになる。
さて、第２図ではｎビットを４ビツトの場合を例にとり
説明する。タイマ（６）は４ビツトに夫々対応してＲ１
−Ｒ４のレジスタを有し、これ等のレジスタＲ１〜Ｒ４
は変速再生モード時シンク再生回路（２）よりあるシン
クに対応した書込みアドレスが発生されてこの書込みア
ドレスに従ってデータがメモリ（３）に書き込まれると
、これに対応してレジスタのあるシンクに対応した部分
の内容を第２図Ａに示すように全て“０”とする。
説明する。タイマ（６）は４ビツトに夫々対応してＲ１
−Ｒ４のレジスタを有し、これ等のレジスタＲ１〜Ｒ４
は変速再生モード時シンク再生回路（２）よりあるシン
クに対応した書込みアドレスが発生されてこの書込みア
ドレスに従ってデータがメモリ（３）に書き込まれると
、これに対応してレジスタのあるシンクに対応した部分
の内容を第２図Ａに示すように全て“０”とする。
次に、読出しアドレス発生回路（４）より読出しアドレ
スが発生されて上述の如く書き込まれたデータがメモリ
（８）より読み出され、スイッチ（８）の接点ａ側を通
って出力端子（５）に出力されると、その第１回目の読
出しアドレスに対応して例えば第２図Ｂに示すようにレ
ジスタＲ１〜Ｒ３の内容は“Ｏ“に保持するもレジスタ
Ｒ４の内容を“１”とする。
スが発生されて上述の如く書き込まれたデータがメモリ
（８）より読み出され、スイッチ（８）の接点ａ側を通
って出力端子（５）に出力されると、その第１回目の読
出しアドレスに対応して例えば第２図Ｂに示すようにレ
ジスタＲ１〜Ｒ３の内容は“Ｏ“に保持するもレジスタ
Ｒ４の内容を“１”とする。
次に読出しアドレス発生回路（４）からの第２回目の読
出しアドレスによりメモリ（３）より先のデータが読み
出されると、この第２回目の読出しアドレスに対応して
例えば第２図Ｃに示すように、レジスタＲ１，Ｒ２の内
容は０”に保持するもレジスタＲ３，Ｒ４の内容を“１
３とする。
出しアドレスによりメモリ（３）より先のデータが読み
出されると、この第２回目の読出しアドレスに対応して
例えば第２図Ｃに示すように、レジスタＲ１，Ｒ２の内
容は０”に保持するもレジスタＲ３，Ｒ４の内容を“１
３とする。
また、読出しアドレス発生回路（４）がらの第３回目の
読出しアドレスによりメモ１月３）より先のデータが読
み出されると、この第３回目の読出しアドレスに対応し
て例えば第２図りに示すように、レジスタＲ１の内容は
“０”に保持するもレジスタＲ２〜Ｒ→の内容を１”と
する。
読出しアドレスによりメモ１月３）より先のデータが読
み出されると、この第３回目の読出しアドレスに対応し
て例えば第２図りに示すように、レジスタＲ１の内容は
“０”に保持するもレジスタＲ２〜Ｒ→の内容を１”と
する。
更に読出しアドレス発生回路（４）からの第４回目の読
出しアドレスによりメモ１月３）より先のデータが読み
出されると、この第４回目の続出しアドレスに対応して
例えば第２図Ｅに示すように、レジスタＲ１〜Ｒ４の内
容を全て“ｌ”とする、つまり、読出しアドレスがある
たびにレジスタＲ４の内容“１゛をレジスタＲ１に向っ
て順次シフトしてゆく。そしてこの場合レジスタＲ１側
を出力側とすると、レジスタＲ１より“ｌ”が出力され
た時点で、つまり第５回目の読出しアドレスがあった時
点で、この出力を切換信号としてスイッチ（８）に供給
し、スイッチ（８）を接点ａ側よりｂ側に切換える。す
ると、端子（９）からの固定データが出力端子（５）に
出力される。
出しアドレスによりメモ１月３）より先のデータが読み
出されると、この第４回目の続出しアドレスに対応して
例えば第２図Ｅに示すように、レジスタＲ１〜Ｒ４の内
容を全て“ｌ”とする、つまり、読出しアドレスがある
たびにレジスタＲ４の内容“１゛をレジスタＲ１に向っ
て順次シフトしてゆく。そしてこの場合レジスタＲ１側
を出力側とすると、レジスタＲ１より“ｌ”が出力され
た時点で、つまり第５回目の読出しアドレスがあった時
点で、この出力を切換信号としてスイッチ（８）に供給
し、スイッチ（８）を接点ａ側よりｂ側に切換える。す
ると、端子（９）からの固定データが出力端子（５）に
出力される。
従ってこの場合４ビツトのレジスタを用いているので読
出しアドレスに対して４回ホールドを行い、５回目に固
定データを出すことになる。つまり、本実施例では、ｎ
ビットのレジスタを用いた場合読出しアドレスに対して
８回ホールドを行い、ｎ＋１回以上は固定データを出す
ことになる。
出しアドレスに対して４回ホールドを行い、５回目に固
定データを出すことになる。つまり、本実施例では、ｎ
ビットのレジスタを用いた場合読出しアドレスに対して
８回ホールドを行い、ｎ＋１回以上は固定データを出す
ことになる。
第３図はタイマ（６）の他の例を示すもので、こ＼では
例えば２つのレジスタＲ１及びＲ２を２進カウンタとし
て用いる場合である。変速再生モード時シンク再生回路
（２）よりあるシンクに対応した書込みアドレスが発生
されてこの書込みアドレスに従ってデータがメモ１月３
）に書き込まれると、これに対応してレジスタＲ１，Ｒ
２のあるシンクに対応した部分の内容を第３図Ａに示す
ように“００”とする。
例えば２つのレジスタＲ１及びＲ２を２進カウンタとし
て用いる場合である。変速再生モード時シンク再生回路
（２）よりあるシンクに対応した書込みアドレスが発生
されてこの書込みアドレスに従ってデータがメモ１月３
）に書き込まれると、これに対応してレジスタＲ１，Ｒ
２のあるシンクに対応した部分の内容を第３図Ａに示す
ように“００”とする。
次に、続出しアドレス発生回路（４）より読出しアドレ
スが発生されて上述の如き書き込まれたデータがメモリ
（３）より読み出され、スイッチ（８）の接点ａ側を通
って出力端子（５）に出力されると、その第１回目の読
出しアドレスに対応して例えば第３図Ｂに示すように、
レジスタＲ１，Ｒ２の内容は０１”となる。
スが発生されて上述の如き書き込まれたデータがメモリ
（３）より読み出され、スイッチ（８）の接点ａ側を通
って出力端子（５）に出力されると、その第１回目の読
出しアドレスに対応して例えば第３図Ｂに示すように、
レジスタＲ１，Ｒ２の内容は０１”となる。
次に読出しアドレス発生回路（４）からの第２回目の読
出しアドレスによりメモ１月３）より先のデータが読み
出されると、この第２回目の続出しアドレスに対応して
例えば第３図Ｃに示すように、レジスタＲ１，Ｒ２の内
容は“１．０″となる。
出しアドレスによりメモ１月３）より先のデータが読み
出されると、この第２回目の続出しアドレスに対応して
例えば第３図Ｃに示すように、レジスタＲ１，Ｒ２の内
容は“１．０″となる。
更に読出しアドレス発生回路（４）からの第３回目の続
出しアドレスに対応して例えば第３図りに承すように、
レジスタＲ１，Ｒ２の内容は“１１”となる。
出しアドレスに対応して例えば第３図りに承すように、
レジスタＲ１，Ｒ２の内容は“１１”となる。
そこで、この１１”の信号をアンドゲート（図示せず）
を介して取り出すようにすれば切換信号が得られ、この
切換信号をスイッチ（８）に供給して接点ａ側よりｂ側
に切換え、端子（９）からの固定データを出力端子（５
）に出力するようにすればよい。
を介して取り出すようにすれば切換信号が得られ、この
切換信号をスイッチ（８）に供給して接点ａ側よりｂ側
に切換え、端子（９）からの固定データを出力端子（５
）に出力するようにすればよい。
従って、この場合２進カウンタを用いるので続出しアド
レスに対して３回ホールドを行い、４回目に固定データ
を出すことになる。つまり、本実施例ではｎ進カウンタ
を用いた場合読出しアドレスに対して２ｎ−１回ホール
ドを行い、２０回以上は固定データを出すことになる。
レスに対して３回ホールドを行い、４回目に固定データ
を出すことになる。つまり、本実施例ではｎ進カウンタ
を用いた場合読出しアドレスに対して２ｎ−１回ホール
ドを行い、２０回以上は固定データを出すことになる。
なお、上述の各実施例において、ホールド中つまり続出
しアドレスが供給される途中に書込みアドレスが発生さ
れると、その時点でタイマ（６）の各レジスタは全て′
０”となり、従ってメモリ（３）から更新されたデータ
がスイッチ（８）の接点ａ側を介して出力端子（５）に
出力される。
しアドレスが供給される途中に書込みアドレスが発生さ
れると、その時点でタイマ（６）の各レジスタは全て′
０”となり、従ってメモリ（３）から更新されたデータ
がスイッチ（８）の接点ａ側を介して出力端子（５）に
出力される。
上述の如くこの発明によれば、第１のメモリのデータが
書き込まれたとき夫々の書込みアドレスに対してデータ
が書き込まれた状態をアドレスに対応して第２のメモリ
に記憶し、第１のメモリからデータが読み出されたとき
第２のメモリの対応する読出しアドレスを読み出された
状態にし、第２のメモリの状態に応じて第１のメモリか
らのデータを出力するかまたは第１のメモリ以外から供
給されるデータを出力するようにしたので、変速再生時
に相関のない画素が残らないようになり、しかも変速再
生時に画面が動いたり、画面が切換ったりするときに追
従性が良くなって、残像が少なくなり、動く画面に尾を
引くような症状がなくなる。
書き込まれたとき夫々の書込みアドレスに対してデータ
が書き込まれた状態をアドレスに対応して第２のメモリ
に記憶し、第１のメモリからデータが読み出されたとき
第２のメモリの対応する読出しアドレスを読み出された
状態にし、第２のメモリの状態に応じて第１のメモリか
らのデータを出力するかまたは第１のメモリ以外から供
給されるデータを出力するようにしたので、変速再生時
に相関のない画素が残らないようになり、しかも変速再
生時に画面が動いたり、画面が切換ったりするときに追
従性が良くなって、残像が少なくなり、動く画面に尾を
引くような症状がなくなる。
第１図はこの発明の一実施例を示す回路構成図、第２図
はこの発明の要部の一例を示す線図、第３図はこの発明
の要部の他の例を示す線図、第４図は従来装置の一例を
示す回路構成図である。 （２）はシンク再生回路、（３）はメモリ、（４）は続
出しアドレス発生回路、（６）はデータホールドタイマ
、（８）はスイッチ、（９）は固定データ印加端子であ
る。 第４図
はこの発明の要部の一例を示す線図、第３図はこの発明
の要部の他の例を示す線図、第４図は従来装置の一例を
示す回路構成図である。 （２）はシンク再生回路、（３）はメモリ、（４）は続
出しアドレス発生回路、（６）はデータホールドタイマ
、（８）はスイッチ、（９）は固定データ印加端子であ
る。 第４図
Claims (1)
- 【特許請求の範囲】 入力データが書込みアドレスに従って書き込まれ、読出
しアドレスに従って読み出される第１のメモリを有する
信号処理装置において、 上記第１のメモリにデータが書き込まれたとき夫々の書
込みアドレスに対して上記データが書き込まれた状態を
上記アドレスに対応して記憶する第２のメモリを備え、 上記第１のメモリからデータが読み出されたとき上記第
２のメモリの対応する読出しアドレスを読み出された状
態にし、 上記第２のメモリの状態に応じて上記第１のメモリから
のデータを出力するかまたは上記第１のメモリ以外から
供給されるデータを出力するようにしたことを特徴とす
る信号処理装置。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61209143A JP2522258B2 (ja) | 1986-09-05 | 1986-09-05 | 信号処理装置 |
| GB8720692A GB2194851B (en) | 1986-09-05 | 1987-09-03 | Apparatus for processing digital data |
| US07/092,542 US4799113A (en) | 1986-09-05 | 1987-09-03 | Apparatus for processing digital data |
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