JPS6367209B2 - - Google Patents
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- Publication number
- JPS6367209B2 JPS6367209B2 JP59279182A JP27918284A JPS6367209B2 JP S6367209 B2 JPS6367209 B2 JP S6367209B2 JP 59279182 A JP59279182 A JP 59279182A JP 27918284 A JP27918284 A JP 27918284A JP S6367209 B2 JPS6367209 B2 JP S6367209B2
- Authority
- JP
- Japan
- Prior art keywords
- input
- board
- circuit section
- analog
- signal circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Description
【発明の詳細な説明】
［発明の利用分野］
この発明は、多数のアナログ信号を取り込んで
記録する記録計等に使用されるアナログ入力装置
に関するものである。
記録する記録計等に使用されるアナログ入力装置
に関するものである。
［従来の技術］
従来の多点記録計では、端子板から入力切換器
（マルチプレクサ）まで入力配線ケーブルにより
接続し、入力切換器で選択された信号を再びケー
ブルまたはプリント基板を介して増幅器（プリア
ンプ）・Ａ−Ｄ変換器に入力している。また、Ａ
−Ｄ変換器と演算を行うマイクロコンピユータの
ようなデジタル回路が一体となつており、同じマ
ザーボード基板上に増幅器等のアナログ回路部と
デジタル回路部等が混在していたりしていた。
（マルチプレクサ）まで入力配線ケーブルにより
接続し、入力切換器で選択された信号を再びケー
ブルまたはプリント基板を介して増幅器（プリア
ンプ）・Ａ−Ｄ変換器に入力している。また、Ａ
−Ｄ変換器と演算を行うマイクロコンピユータの
ようなデジタル回路が一体となつており、同じマ
ザーボード基板上に増幅器等のアナログ回路部と
デジタル回路部等が混在していたりしていた。
［発明が解決しようとする問題点］
しかしながら、このように、アナログ回路、デ
ジタル回路、さらには電源回路を混在させると、
入力配線に、電源ノイズが重畳されたり、デジタ
ル回路の発生するパルスノイズが重畳されたりし
て測定誤差の原因となつている。
ジタル回路、さらには電源回路を混在させると、
入力配線に、電源ノイズが重畳されたり、デジタ
ル回路の発生するパルスノイズが重畳されたりし
て測定誤差の原因となつている。
この発明の目的は、以上の点に鑑み、アナログ
信号回路部を電気的に、機械的に分離し、ユニツ
ト構成とするようにし、より高精度の測定を可能
としたアナログ入力装置を提供することである。
信号回路部を電気的に、機械的に分離し、ユニツ
ト構成とするようにし、より高精度の測定を可能
としたアナログ入力装置を提供することである。
［問題点を解決するための手段］
この発明は、端子板に供給された複数の入力信
号を切換選択して取り込む入力切換器と、この入
力切換器で取り込まれた信号を増幅する増幅器、
この増幅器の出力をデジタル信号に変換するＡ−
Ｄ変換器を含むアナログ信号回路部と、このアナ
ログ信号回路部の出力が供給されるデジタル信号
回路部とを分離するようにしたアナログ入力装置
である。
号を切換選択して取り込む入力切換器と、この入
力切換器で取り込まれた信号を増幅する増幅器、
この増幅器の出力をデジタル信号に変換するＡ−
Ｄ変換器を含むアナログ信号回路部と、このアナ
ログ信号回路部の出力が供給されるデジタル信号
回路部とを分離するようにしたアナログ入力装置
である。
［実施例］
第１図は、この発明の一実施例を示す記録計に
ついての構成説明図である。
ついての構成説明図である。
図において、１は、複数の入力信号e1，…，eo
が供給される複数の端子を含む端子板、２は、端
子板１からの入力信号を切換選択して取り込む複
数のスイツチを含む入力切換器（マルチプレク
サ）、３は、入力切換器２で取り込まれた信号を
増幅する増幅器（プリアンプ）、４は、増幅器３
の出力をデジタル信号に変換するＡ−Ｄ変換器
で、入力切換器２、増幅器３、Ａ−Ｄ変換器４で
アナログ信号回路部Ａを構成している。Ａ−Ｄ変
換器４の出力は、マイクロコンピユータのような
演算手段５を含むデジタル信号回路部Ｄに供給さ
れ、演算手段５は、設定手段６による設定値、メ
モリ７のプログラム等に従つて演算処理、その他
の処理を行い、表示手段８、記録手段９に指示、
記録を行わせる。
が供給される複数の端子を含む端子板、２は、端
子板１からの入力信号を切換選択して取り込む複
数のスイツチを含む入力切換器（マルチプレク
サ）、３は、入力切換器２で取り込まれた信号を
増幅する増幅器（プリアンプ）、４は、増幅器３
の出力をデジタル信号に変換するＡ−Ｄ変換器
で、入力切換器２、増幅器３、Ａ−Ｄ変換器４で
アナログ信号回路部Ａを構成している。Ａ−Ｄ変
換器４の出力は、マイクロコンピユータのような
演算手段５を含むデジタル信号回路部Ｄに供給さ
れ、演算手段５は、設定手段６による設定値、メ
モリ７のプログラム等に従つて演算処理、その他
の処理を行い、表示手段８、記録手段９に指示、
記録を行わせる。
そして、アナログ信号回路部Ａと、デジタル信
号回路部Ｄとを電気的、機械的に分離し、ユニツ
ト構成とし、入力部分に不要なノイズが重畳しな
いようにしている。
号回路部Ｄとを電気的、機械的に分離し、ユニツ
ト構成とし、入力部分に不要なノイズが重畳しな
いようにしている。
第２図は、アナログ回路部Ａのユニツト構成の
ためのより具体的な端子板１の構成を示し、図に
おいて、端子板１には複数の端子１０が設けら
れ、端子１０のピン１０ａは直接マザーボード基
板１１に接続している。マザーボード基板１１に
は、入力切換器用プリント基板１２、増幅器・Ａ
−Ｄ変換器用プリント基板１３が、コネクタC1，
…，C4により互いに着脱可能に固定されている。
これらマザーボード基板１１、入力切換器用プリ
ント基板１２、増幅器・Ａ−Ｄ変換器用プリント
基板１３のアナログ信号回路部Ａの全体に金属等
の導体のカバー１４が設けられ、電磁シールドが
施こされ、増幅器・Ａ−Ｄ変換器用プリント基板
１３は、ケーブル１５によりデジタル信号回路
部、電源回路Ｄに接続している。
ためのより具体的な端子板１の構成を示し、図に
おいて、端子板１には複数の端子１０が設けら
れ、端子１０のピン１０ａは直接マザーボード基
板１１に接続している。マザーボード基板１１に
は、入力切換器用プリント基板１２、増幅器・Ａ
−Ｄ変換器用プリント基板１３が、コネクタC1，
…，C4により互いに着脱可能に固定されている。
これらマザーボード基板１１、入力切換器用プリ
ント基板１２、増幅器・Ａ−Ｄ変換器用プリント
基板１３のアナログ信号回路部Ａの全体に金属等
の導体のカバー１４が設けられ、電磁シールドが
施こされ、増幅器・Ａ−Ｄ変換器用プリント基板
１３は、ケーブル１５によりデジタル信号回路
部、電源回路Ｄに接続している。
［発明の効果］
以上述べたように、この発明は、アナログ信号
回路部をデジタル信号回路部と分離し、ユニツト
化を図つているので、不要なノイズがアナログ信
号回路部に影響を与えることが少く、高精度の測
定を可能としている。また、アナログ信号回路部
は、端子板と一体とされ、配線のひきまわしを無
くしているので、いつそうノイズに強く、小型、
高信頼性のものとなる。
回路部をデジタル信号回路部と分離し、ユニツト
化を図つているので、不要なノイズがアナログ信
号回路部に影響を与えることが少く、高精度の測
定を可能としている。また、アナログ信号回路部
は、端子板と一体とされ、配線のひきまわしを無
くしているので、いつそうノイズに強く、小型、
高信頼性のものとなる。
第１図、第２図は、この発明の一実施例を示す
構成説明図である。 １……端子板、２……入力切換器、３……増幅
器、４……Ａ−Ｄ変換器、５……演算手段、Ａ…
…アナログ信号回路部、Ｄ……デジタル信号回路
部。
構成説明図である。 １……端子板、２……入力切換器、３……増幅
器、４……Ａ−Ｄ変換器、５……演算手段、Ａ…
…アナログ信号回路部、Ｄ……デジタル信号回路
部。
Claims (1)
- １ 端子板の入力端子の一端を直接マザーボード
基板に接続させ、このマザーボード基板、端子板
の端子に供給された入力信号を切換選択して取り
込む入力切換器用プリント基板、入力切換器で取
り込まれた信号を増幅してデジタル信号とする増
幅器・Ａ−Ｄ変換器用プリント基板とを一体的に
互いにコネクタで直接接続し全体に導体カバーが
設けられたアナログ信号回路部と、このアナログ
信号回路部の出力が供給されるデジタル信号回路
とを分離し、ユニツト構成としたことを特徴とす
るアナログ入力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27918284A JPS61157932A (ja) | 1984-12-28 | 1984-12-28 | アナログ入力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27918284A JPS61157932A (ja) | 1984-12-28 | 1984-12-28 | アナログ入力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61157932A JPS61157932A (ja) | 1986-07-17 |
| JPS6367209B2 true JPS6367209B2 (ja) | 1988-12-23 |
Family
ID=17607584
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27918284A Granted JPS61157932A (ja) | 1984-12-28 | 1984-12-28 | アナログ入力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61157932A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6392899B1 (en) * | 2000-09-29 | 2002-05-21 | Intel Corporation | Processor power delivery system |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58140146A (ja) * | 1982-02-15 | 1983-08-19 | Seiko Epson Corp | 集積回路装置 |
-
1984
- 1984-12-28 JP JP27918284A patent/JPS61157932A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61157932A (ja) | 1986-07-17 |
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