JPS636876U - - Google Patents
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- Publication number
- JPS636876U JPS636876U JP10021886U JP10021886U JPS636876U JP S636876 U JPS636876 U JP S636876U JP 10021886 U JP10021886 U JP 10021886U JP 10021886 U JP10021886 U JP 10021886U JP S636876 U JPS636876 U JP S636876U
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- JP
- Japan
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- circuit board
- conductive layer
- power supply
- memory card
- contacted
- Prior art date
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- Pending
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- 230000002093 peripheral effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
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Description
第１図は本考案のメモリカードの一実施例を示
す断面図、第２図はその回路構成図である。 １……回路基板、２……メモリ素子、４……電
源端子、５……絶縁性ケース、６……導電層。
す断面図、第２図はその回路構成図である。 １……回路基板、２……メモリ素子、４……電
源端子、５……絶縁性ケース、６……導電層。
Claims (1)
- 同一回路基板上に搭載された複数のメモリ素子
の電源端子をそれぞれ独立して前記回路基板上に
配設するとともに、これらを、外部接続用端子に
接続された導電層が上部内周面上に形成された絶
縁性ケース内に気密に納め、かつ前記導電層を前
記電源端子に圧接して成ることを特徴とするメモ
リカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10021886U JPS636876U (ja) | 1986-06-30 | 1986-06-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10021886U JPS636876U (ja) | 1986-06-30 | 1986-06-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS636876U true JPS636876U (ja) | 1988-01-18 |
Family
ID=30969831
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10021886U Pending JPS636876U (ja) | 1986-06-30 | 1986-06-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS636876U (ja) |
-
1986
- 1986-06-30 JP JP10021886U patent/JPS636876U/ja active Pending