JPS6377185A - 半導体レ−ザの製造方法 - Google Patents
半導体レ−ザの製造方法Info
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- JPS6377185A JPS6377185A JP22259086A JP22259086A JPS6377185A JP S6377185 A JPS6377185 A JP S6377185A JP 22259086 A JP22259086 A JP 22259086A JP 22259086 A JP22259086 A JP 22259086A JP S6377185 A JPS6377185 A JP S6377185A
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- carrier concentration
- semiconductor laser
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- Pending
Links
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- 238000004519 manufacturing process Methods 0.000 title abstract description 3
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Landscapes
- Semiconductor Lasers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(イ)産業上の利用分野
本発明は半導体レーザの製造方法に関する。
(ロ)従来の技術
現在、半導体レーザはVD(ビデオディスク)、CD(
コンパクトディスク)、文書ファイル等の光源として広
く普及しつつある。
コンパクトディスク)、文書ファイル等の光源として広
く普及しつつある。
このような半導体レーザに要求きれる特性としては単一
モード発振、高真円率が挙げられる。これらの特性を満
足させるレーザとしては活性層の両側を活性層より光屈
折率が小なる】で埋込む、いわゆる埋込み型の半導体レ
ーザが提案きれている。
モード発振、高真円率が挙げられる。これらの特性を満
足させるレーザとしては活性層の両側を活性層より光屈
折率が小なる】で埋込む、いわゆる埋込み型の半導体レ
ーザが提案きれている。
第2図は、特公昭59−43839号公報で提案された
この種レーザを示し、(IOQ)面を鏡面仕上げしたn
型GaAs基板(1)上にはその中央部にストライプ状
のn型Ga+−XAlXAs(0< x< 1)からな
る第1クラツド!(2)、ノンドープGa1−JlyA
s(0≦Y<1、y<x)からなる活性層〈3)及びp
型Ga l−xAl、Asからなる第2クラツド贋(4
)が順次猜層され、また上記各層の両側には上記各層を
埋込むようにノンドープGa+−zA1zAs(0<
2< 1、Z> Y)からなる埋込層(5)が積N啓れ
ている。斯る埋込Ffj(5)表面にはAltos膜(
6)とケイリン酸ガラス膜(7)とからなる電流狭窄J
+1(8)が形成されている。また、基板(1)の裏面
にはAu−Ge−Ni合金電極(9)が形成され、上記
電流狭窄届(8)及び第2グランド暦(4)表面にはA
u−Cr合金電極(10)が形成きれている。
この種レーザを示し、(IOQ)面を鏡面仕上げしたn
型GaAs基板(1)上にはその中央部にストライプ状
のn型Ga+−XAlXAs(0< x< 1)からな
る第1クラツド!(2)、ノンドープGa1−JlyA
s(0≦Y<1、y<x)からなる活性層〈3)及びp
型Ga l−xAl、Asからなる第2クラツド贋(4
)が順次猜層され、また上記各層の両側には上記各層を
埋込むようにノンドープGa+−zA1zAs(0<
2< 1、Z> Y)からなる埋込層(5)が積N啓れ
ている。斯る埋込Ffj(5)表面にはAltos膜(
6)とケイリン酸ガラス膜(7)とからなる電流狭窄J
+1(8)が形成されている。また、基板(1)の裏面
にはAu−Ge−Ni合金電極(9)が形成され、上記
電流狭窄届(8)及び第2グランド暦(4)表面にはA
u−Cr合金電極(10)が形成きれている。
斯る半導体レーザでは活性層(3)の水平方向の光の閉
じ込めが埋込層(4)により良好に行われるため上記各
特性を満足することが可能である。
じ込めが埋込層(4)により良好に行われるため上記各
特性を満足することが可能である。
(ハ)発明が解決しようとする問題煮
熱るに、上記半導体レーザでは第1クラツド漕(2)、
活性層(3)及び第2クラッド層く4)を構成する各層
を基板(1)上に一旦形成した後、各層をエツチングに
より第2図に示す如きストライブ状となし、その後上記
エツチング除去部分に埋込層(4)を形成するものであ
る。従って、上記ストライプ状の活性層(3)の両側が
上記エツチング時に空気に晒されるため、酸化による劣
化を招くと共に、上記埋込層(4)形成時の熱的影響に
より活性!(3)がダメージを受けしきい値’を流が6
0+nA以上と高くなるという問題があった。
活性層(3)及び第2クラッド層く4)を構成する各層
を基板(1)上に一旦形成した後、各層をエツチングに
より第2図に示す如きストライブ状となし、その後上記
エツチング除去部分に埋込層(4)を形成するものであ
る。従って、上記ストライプ状の活性層(3)の両側が
上記エツチング時に空気に晒されるため、酸化による劣
化を招くと共に、上記埋込層(4)形成時の熱的影響に
より活性!(3)がダメージを受けしきい値’を流が6
0+nA以上と高くなるという問題があった。
(ニ)問題点を解決するための手段
本発明は斯る問題点に鑑みてなされたもので、その構成
的特徴は、互いに平行に延在する1対のGa+−zA1
□As(o< Z< 1)からなり垂直壁の面方位が(
100)面以外となるストライブ領域が形成されたGa
As基板の一主面上にGa+−xAlxA9(0< X
< 1)からなる第1クラツド暦、Ga+−YAIYA
9(0≦Y<1.Y<X、y<z)からなる活性層、G
a、−、Al□Asからなる第2クラッド着を分子線エ
ピタキシャル成長法を用いて順次積着することにある。
的特徴は、互いに平行に延在する1対のGa+−zA1
□As(o< Z< 1)からなり垂直壁の面方位が(
100)面以外となるストライブ領域が形成されたGa
As基板の一主面上にGa+−xAlxA9(0< X
< 1)からなる第1クラツド暦、Ga+−YAIYA
9(0≦Y<1.Y<X、y<z)からなる活性層、G
a、−、Al□Asからなる第2クラッド着を分子線エ
ピタキシャル成長法を用いて順次積着することにある。
(ホ) 作用
斯る方法によれば、活性層の側面が空気に晒されたり、
熱的な影響を受けることはない。
熱的な影響を受けることはない。
(へ)実施例
第1図(a )(b )は本発明の実施例を示す工程別
断面図である。
断面図である。
まず、第1図(a)に示す如く、−主面が(100)面
であるn型GaAs基板(11)上に4μmの間隔をお
いて紙面垂直方向に互いに平行に延在する1対のストラ
イブ領域(12)を形成する。
であるn型GaAs基板(11)上に4μmの間隔をお
いて紙面垂直方向に互いに平行に延在する1対のストラ
イブ領域(12)を形成する。
斯る形成は、基板(11)上全面にp型Gaa、tAl
o、*Asからなる層を液相成長法、気相成長法等の周
知の成長法により約1μm成長させ、その後、フッ酸を
用いて上記ストライブ領域(12)以外のp型Gao
、 zAle 、 sAs層をエツチング除去すること
により行なえる。尚このとき形成されたストライブ領域
(12)の垂直壁(12a)の面方位は(110)とな
る。
o、*Asからなる層を液相成長法、気相成長法等の周
知の成長法により約1μm成長させ、その後、フッ酸を
用いて上記ストライブ領域(12)以外のp型Gao
、 zAle 、 sAs層をエツチング除去すること
により行なえる。尚このとき形成されたストライブ領域
(12)の垂直壁(12a)の面方位は(110)とな
る。
次いで、第1図(b)に示す如く、基板(11)上にキ
ャリアa度2×to17c+n−sのn型Gao、tA
le、sA5からなる第1クラツドN (13)、キャ
リア濃度1×lQ17cm−’のノンドープGa*、5
A1o、+Asからなる活性!(14)、キャリア濃F
!!5 X 10” cm−3のp型Ga、、。
ャリアa度2×to17c+n−sのn型Gao、tA
le、sA5からなる第1クラツドN (13)、キャ
リア濃度1×lQ17cm−’のノンドープGa*、5
A1o、+Asからなる活性!(14)、キャリア濃F
!!5 X 10” cm−3のp型Ga、、。
A、16 、 +Asからなる第2クラツドji(15
)及びキャリア濃度3×10宜8Cm”’のp型GaA
sからなるキャップ層〈16)を順次分子線エピタキシ
へ・ル成長法(MBE>により積層する。尚、上記各成
長層の成長条件は周知であるので説明を省略する。
)及びキャリア濃度3×10宜8Cm”’のp型GaA
sからなるキャップ層〈16)を順次分子線エピタキシ
へ・ル成長法(MBE>により積層する。尚、上記各成
長層の成長条件は周知であるので説明を省略する。
また、上記各Jul(13)〜(16)はその最大層厚
が夫々、1.0μm、 0.1μm、 1.0μm、0
.3μmとなるように形成される。
が夫々、1.0μm、 0.1μm、 1.0μm、0
.3μmとなるように形成される。
更にこのようにして形成啓れた各層(13)〜(16)
の1厚は基板中央部では夫々上述の最大層厚となってい
るが、ストライブ領域(12)近傍では各層共に上記最
大層厚の半分以下の層厚となっている。これは、上述し
たエツチング時にストライブ領域(12)表面にA1酸
化膜が生じると共に垂直壁(12g)の面方位が結晶成
長に不適な(110)となっているためである。
の1厚は基板中央部では夫々上述の最大層厚となってい
るが、ストライブ領域(12)近傍では各層共に上記最
大層厚の半分以下の層厚となっている。これは、上述し
たエツチング時にストライブ領域(12)表面にA1酸
化膜が生じると共に垂直壁(12g)の面方位が結晶成
長に不適な(110)となっているためである。
従って、活性層(14)の水平方向(紙面左右方向)の
形状は両側において屈曲した形状となり、活性N 04
)の水平な平坦部分(14a)(図中、斜線で明示)は
四方が活性層(14)よりバンドキルツブエネルギーが
犬でかつ光屈折率が小の第1、第2クラッド層(13)
(15>により囲繞されることとなる。
形状は両側において屈曲した形状となり、活性N 04
)の水平な平坦部分(14a)(図中、斜線で明示)は
四方が活性層(14)よりバンドキルツブエネルギーが
犬でかつ光屈折率が小の第1、第2クラッド層(13)
(15>により囲繞されることとなる。
またこのときストライブ領域(12)上にも上記各>1
(13)〜(16)を構成する各材料からなる居(13
a)〜(16a)が成長するが、斯る各層(13a)〜
(16a)は上述したA1酸化膜の影響により結晶性の
悪い高抵抗層となる。
(13)〜(16)を構成する各材料からなる居(13
a)〜(16a)が成長するが、斯る各層(13a)〜
(16a)は上述したA1酸化膜の影響により結晶性の
悪い高抵抗層となる。
而して、キャップ層〈16)表面及び基板(11〉裏面
にオーミック性の第1、第2電極(17)(18)を形
成し、断る電極間に順方向バイアスを印加すると、正孔
及び電子が活性層(14)の平坦部分(14a)に集中
し、斯る部分で再結合光を生じると共に斯る光は平坦部
分(14a)に良好に閉じ込められることとなるので、
従来の埋込み型半導体レーザと同様に、単一モード発振
、高真円率の緒特性を示すこととなる。また、本実施例
装置ではしきい値電流が50μmAと従来に較べて10
mA程度低くなる。
にオーミック性の第1、第2電極(17)(18)を形
成し、断る電極間に順方向バイアスを印加すると、正孔
及び電子が活性層(14)の平坦部分(14a)に集中
し、斯る部分で再結合光を生じると共に斯る光は平坦部
分(14a)に良好に閉じ込められることとなるので、
従来の埋込み型半導体レーザと同様に、単一モード発振
、高真円率の緒特性を示すこととなる。また、本実施例
装置ではしきい値電流が50μmAと従来に較べて10
mA程度低くなる。
尚、本実施例ではストライプ領域(12)をp型Gao
、*A1゜、Asで構成したが、実質的にはエツチング
工程時に自然にA11l化膜が発生するようなA1組成
比を有するGaAlAsであれば良い、また、垂直壁(
12a)の面方位も(110)に限られるわけではなく
、結晶成長に適する(100)面以外であれば良い。
、*A1゜、Asで構成したが、実質的にはエツチング
工程時に自然にA11l化膜が発生するようなA1組成
比を有するGaAlAsであれば良い、また、垂直壁(
12a)の面方位も(110)に限られるわけではなく
、結晶成長に適する(100)面以外であれば良い。
(ト)発明の効果
本発明によれば、上下左右方向の四方をバンドキャップ
エネルギーが大でかつ、光屈折率が/J%なる層で囲繞
された活性層を有する埋込みを半導体レーザを活性層表
面を空気に晒さず、かつ活性層自身に熱的影響を与える
ことなく形成できるので、低しきい値、電流、単一モー
ド発振、高真円率の半導体レーザが得られる。
エネルギーが大でかつ、光屈折率が/J%なる層で囲繞
された活性層を有する埋込みを半導体レーザを活性層表
面を空気に晒さず、かつ活性層自身に熱的影響を与える
ことなく形成できるので、低しきい値、電流、単一モー
ド発振、高真円率の半導体レーザが得られる。
第1図(a)(b)は本発明の実施例を示す工程別断面
図、第2図は従来例を説明するための断面図である。 (11)・・・GaAs基板、(12)・・・ストライ
ブ領域、(12a)・・・垂直壁、(13)・・・第1
クラッド層、〈14)・・・活性層、(15)・・・第
2クラツド暦。
図、第2図は従来例を説明するための断面図である。 (11)・・・GaAs基板、(12)・・・ストライ
ブ領域、(12a)・・・垂直壁、(13)・・・第1
クラッド層、〈14)・・・活性層、(15)・・・第
2クラツド暦。
Claims (1)
- (1)Ga_1_−_ZAl_ZAs(0<Z<1)か
らなり垂直壁の面方位が(100)面以外となる1対の
ストライプ領域をGaAs基板の一主面上に互いに平行
に離隔して形成し、次いで上記1対のストライプ領域内
にある。上記基板の一主面上にGa_1_−_XAl_
XAs(0<X<1)からなる第1クラッド層、Ga_
1_−_YAl_YAs(0≦Y、1、Y<X、Y<Z
)からなる活性層、Ga_1_−_XAl_XAsから
なる第2クラッド層を分子線エピタキシャル成長法を用
いて順次積層することを特徴とする半導体レーザの製造
方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22259086A JPS6377185A (ja) | 1986-09-19 | 1986-09-19 | 半導体レ−ザの製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22259086A JPS6377185A (ja) | 1986-09-19 | 1986-09-19 | 半導体レ−ザの製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6377185A true JPS6377185A (ja) | 1988-04-07 |
Family
ID=16784855
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22259086A Pending JPS6377185A (ja) | 1986-09-19 | 1986-09-19 | 半導体レ−ザの製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6377185A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5360763A (en) * | 1992-09-07 | 1994-11-01 | Nec Corporation | Method for fabricating an optical semiconductor device |
-
1986
- 1986-09-19 JP JP22259086A patent/JPS6377185A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5360763A (en) * | 1992-09-07 | 1994-11-01 | Nec Corporation | Method for fabricating an optical semiconductor device |
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