NO175122B - Databehandlingssystem - Google Patents

Description

Foreliggende oppfinnelse angår databehandlingssystem innbefattende en systembuss av den art som angitt i inn-ledningen til krav 1.

US-patent nr. 4.030.075 beskriver et databehandlingsssytem ved hvilke et antall delsystemer er koplet sammen med en systembuss. Del systemene kommuniserer med hverandre ved å sende kommandoer ut på systembussen. En kommando kan innbefatte et kanalnummer som identifiserer en mottagerenhet, et kanalnummer som identifiserer et sendedelsystem og en funksjonskode som spesifiserer en operasjon som skal bli utført ved å motta delsystemet. Funksjonskoden kan kreve at det mottagende delsystemet genererer en reaksjonskommando. Denne reaksjonen eller den andre busshalvsykluskommandoen innbefatter kanalnummeridentifiseringen av sendedelsystemet. Sendingen av delsystemet reagerer på dens kanalnummer og kvitterer for mottagelsen av den andre busshalvsykluskommandoen .

Et formål med oppfinnelsen er å tilveiebringe et forbedret databehandlingssystem.

Et annet formål med oppfinnelsen er å forbedre et databehand-lingssytem hvor alle delsystemene er koplet sammen med en systembuss.

Et ytterligere formål med oppfinnelsen er å tilveiebringe et databehandlingssystem med et mer allsidig kommandosystem for sending av kommandoer over systembussen.

Videre er det et formål med foreliggende oppfinnelse å tilveiebringe et databehandlingssystem hvor en master bevirker en slave til å utføre kommandoer på vegne av et andre delsystem til det bussorienterte systemet. Det skal i denne sammenheng bemerkes at ovenfornevnte US-patent viser et bussorientert system med overføring av kommandoer fra et master-delsystem til et slave-delsystem og utførelse av slike kommandoer av slaven på vegne av masteren.

Ovenfornevnte tilveiebringes ved hjelp av det innledningsvis nevnte databehandlingssystemet hvis karakteristiske trekk fremgår av krav 1. Ytterligere trekk ved oppfinnelsen fremgår av de øvrige uselvstendige kravene.

Et hovedlager, et sentraldelsystem (CSS) og en systemlederinnretning (SMF) er alle koplet sammen til en systembuss. SMF'en kan sende en lagerreferanse-lesekommando til hovedlageret og motta innholdene til lagerstedene spesifisert av kommandoen. Kommandoen innbefatter en adresse i hovedlageret og et kanalnummer for SMF. Dette gjør det mulig å innbefatte i hovedlageret SMF-kanalnummer i den andre busshalvsykluskommandoen som sender data til SMF fra hovedlageret.

SMF kan imidlertid sende lagerreferanse-lesekommandoen som innbefatter kanalnummeret til en port i CSS'en som sendeenheten. Hovedlageret vil sende den andre busshalvsykluskommandoen som inneholder adressedataordet til CSS'en. SMF'en innbefatter anordning for tilbakestilling av lesekommandoen når den mottar kvitteringssignalet fra hovedlageret som indikerer at kommandoen ble mottatt. Normal drift er for sendeenheten å holde lesekommandologikken aktiv inntil den andre busshalvsykluskommandoen er mottatt av sendeenheten.

I det påfølgende skal foreliggende oppfinnelse beskrives nærmere med henvisning til tegningene, hvor: Fig. 1 viser et blokkdiagaram av databehandlings

systemet.

Fig. 2 viser et blokkdiagram av systemlederinnret- ningen . Fig. 3 viser et blokkdiagram av et systembussgrense snitt. Fig. 4 viser et blokkdiagram av et sentraldelsystem.

Fig. 5A

til 5E viser formater for forskjellige kommandoer som

er tilført en systembuss.

Fig. 6 viser et flytdiagram av fastvaren som laster

styrelageret.

Fig. 7 viser et tidsdiagram av sentraldelsystemsignaler som styrer lastingen og verifiseringen av styrelagerlastingen. Fig. 1 viser en fast koplet multiprosessordatabehandlings-enhet (DPU) 1 som innbefatter flere sentrale delsystemer (CSS) 3 til 5 koplet med et systembussgrensesnitt 2-10A og 2-10B henholdsvis, og flere hovedlagere 10 til 12, flere ytre styrere 14 til 16 og en systemlederinnretning (SMF) 20, alle koplet sammen med en systembuss 2 via deres respektive systembussgrensesnitt 2-10.

Flere av anordningene 1 18 er koplet med periferstyreren 1 14 og flere anordninger N 17 er koplet med den ytre styreren N 16. De ytre styrerne 14 til 16 kan innbefatte diskstyrere, båndstyrere, kommunikasjonsstyrere og enhetsopptegnings-styrere, som er koplet med deres respektive diskdrev, båndanordninger, kommunikasjonslinjer og enhetsopp-tegningsanordninger.

Organisasjonen av hver av CSS 3 til CSS 5 er de samme. CSS 3 innbefatter en sentral behandlingsenhet (CPU1A 4 og en CPU1B 6) som begge opererer uavhengig av hverandre med et hurtiglager 1 8 som er koplet til systembussen 2. CSS 5 innbefatter en CPUNA 24 og en CPUNB 26 som begge opererer uavhengig av hverandre med et hurtiglager N 28 som er koplet til systembussen 2. CPUNA 24 og CPUNB 26 får tilgang til hovedlageret 10 til hovedlageret 12 via hurtiglageret N 28. CSS 3 til CSS 5 opereres som fast koplet multiprosessor siden de utfører et felles operasjonssystem og deler et felles hovedlager.

Det skal bemerkes at CPU1A og CPU1B 6 er identifisert heretter som CPU 4 og CPU 6. Likeledes er CPUNA 24 og CPUNB 26 identifisert som CPU 24 og CPU 26. En port 0 og en port 1 kopler henholdsvis CPU 4 og CPU 6 med grensesnittet 2-10A og en port 2 og en port 3 kopler henholdsvis CPU 24 og CPU 26 med grensesnittet 2-10B.

SMF'en 20 sørger for sentralisert styring av DPU 1. Denne sentraliserte styringen innbefatter initialisering av det totale DPU 1-systemet, sentralisert styring av kvalitets-logikktest-QLT)-operasjonen, systemtidsentraliséringen, og tilveiebringelsen av strømforsyningstilførselen og kabinet-temperaturalarmer til delsystemene koplet til systembussen 2. Et antall styresignaler er tilveiebragt mellom et strømfor-syningssystem 22 og SMF 20 via et strømforsyningsstyre-grensesnitt (PCI) 21. Styresignaler fra strømforsynings-systemet 22 indikerer til SMF'en 20 statusen for DPU 1 strømforsyningen. Styresignaler fra SMF 20 til strømfor-syningssystemet 22 over PCI 21 spesifiserer foreskrevne spenningsmarginer ved hvilke strømforsyningssystemet 22 skulle opereres for å teste DPU'en 1. SMF'en 20 vil kjøre QLT-operasjonen ved foreskrevne spenningsmarginer for å isolere og identifisere de logiske marginalelementene.

En fremvisningskonsoll 34 tillater en operatør å kommunisere med DPU'en 1 via et fremvisningsterminalgrensesnitt (DTI) 29 til SMF'en 20. SMF'en 20 mottar informasjon fra fremvisningskonsollen 34 og tilfører denne til en systembuss 2 via et konsolladaptergrensesnitt (CAI) 31 og en konsolladapter 30. Informasjon fra DPU 1 mottas av fremvisningskonsollen 34 via systembussen 2, konsolladapteren 30, CAI 31, SMF 20 og DTI 29. Fremvisningskonsollen 34 kan typisk være en Honeywell VIP 7300-terminal med et manuelt tastatur og en katodestråle-rør (CRT)-fremvisningsinnretning. CAI 31 og DTI 29 er typiske kommunikasjonsgrensesnitt av typen RS232 eller RS422.

SMF 20 understøtter en fjernvedlikeholdsmulighet. Et fjerntliggende konsoll 42 kan bli operert av en styrt fremvisningsterminal eller . en ikke-betjent datamaskin. Fjernkonsollen 42 er forbundet med SMF 20 via et MODEM 38, en kommunikasjonslinje 40, et MODEM 36 og et fjerntliggende vedlikeholdsvalggrensesnitt(RMO) 37. MODEMENE 36 og 38 er typiske RIXON MODEMER, f.eks., et T113C MODEM som opprinnelig krever 300 baud, T103J MODEM som frembringer og svarer anrop ved 300 baud, et T212A MODEM som frembringer og svarer anrop ved 1200 baud.

Den fjerntliggende vedlikeholdsoperasjonen tillater det fjerntliggende stedet å løse software- og operasjonsfeil, og identifisere hardware-feil, og sende informasjon slik som software-lapper (patches) til sentral DPU 1-systemet og for å tilveiebringe reserveassistanse til en på-sete vedlikeholds-operasj on.

SMF 20 vil gi tilgang til det fjerntliggende tilgangsstedet til DPU 1 gjennom SMF 20 for å tilveiebringe sentralisert styring kun dersom riktig passord er mottatt av SMF 20.

En hjelpegrensesnittanordning (ADI) 33, typisk et RS232C-grensesnitt, forbinder en hjelpeanordning 32 med SMF 20. Hjelpeanordningen 32 er typisk en skriver for logging av statusinformasjon eller for tilveiebringelse av utskrift av informasjonen fremvist på CRT'en til fremvisningskonsollen 34.

SMF 20 i løpet av DPU 1 oppstartingen vil initiere logiske kvalitetstester (QLT'er) for å sikre at alle delsystemene er koplet til systembussen og er utført korrekt. Dersom testene er ikke tilfredsstillende, signaliserer SMF 20 strømfor-syningssystemet via PCI 21 for å indikere tilstanden og også for å fremvise feil på fremvisningskonsollen 34, fjernkonsollen 42 og hjelpeanordningen 32.

Alle delsystemene ber om tilgang til systembussen 2 idet delsystemet med høyest prioritet får tilgang. På grunn av kravet om at SMF 20 skal reagere hurtig på visse samtids-systemtilstander, slik som strømforsyningsfeildetektering, er det nødvendig at SMF 20 gis den høyeste prioriteten med hensyn til tilgang til systembussen 2.

Fig. 2 viser et blokkdiagram over SMF 20 koplet til systembussen 2. Systembussen 2 er vist som systembuss (styre) 2-2, systembussen (data) 2-4 og systembussen (adresse) 2-6. Systembussgrensesnittet 2-10 opererer generelt som beskrevet i US-patent nr. 3 995 258. En mikroprosessor 20-2 styrer SMF 20/systembussen 2-grensesnittet via software-rutiner lagret i en mikroprosessors direktelager (RAM) 20-44. Mikroprosessoren 20-2 er en Zilog Z80 CPU beskrevet i "Zilog Gold Book 1983/1984 Components Data Book", volum 3, 10. utgave. Mikroprossessoren 20-2 er i seg selv styrt av software-varen lagret i en mikroprosessors programmerbare leselager (PROM) 20-38. Både RAM'en 20-44 og PR0M'en 20-38 mottar adressesignalet A0 til A15 fra mikroprosessoren 20-2 over en 16 bits mikroprosessoradressebuss 20-54 via en driver 20-24. Datasignalene DO til D7 overføres mellom RAM 20-44 og mikroprosessoren 20-2 og fra PROM 20-38 via en 8-bits mikroprosessordatabuss 20-56 og en sender/mottaker 20-26.

Når SMF 20 har tilgang til systembussen 2 kan trettito datasignaler BSDT 00-31 bli mottatt av mottakerene 20-68 og lagret i et inngangsdataregister 20-16 fra systemdatabussen 2-4. Under mikroprosessorens 20-2 styring blir data lest fra registeret 20-16 og lagret et sted i RAM 20-44, 8 biter om gangen via en multiplekser (MUX) 20-17, en databuss 20-52, en sender/mottaker 20-22, en sender/mottaker 20-26 og en databuss 20-56. Trettito adressesignaler BSAD A-H, 00-23 blir mottatt fra systemadressebussen 2-6 av mottakerene 20-70 og et inngangsadresseregister 20-36 og lagret et sted i RAM 20-44, 8 biter om gangen under mikroprosessorens 20-2 styring, og trettito styresignaler blir mottatt av systemstyrebussen 2-2 av mottakerene 20-64 og et inngangsstyreregister 20-12 og lagret i lagersteder i RAM 20-44, 8 biter om gangen på en lignende måte som datasignalene. Mikroprosessoren 20-2 identifiserer inngangsregistrene 20-36, 20-16 og 20-12 som lagersteder i RAM 20-44 og sender den egnede adressen til RAM 20-44 via driveren 20-24 og adressebussen 20-54.

Mikroprosessoren 20-2 initierer lastingen av datasignaler BSDT00-31 inn i et 32 biters utgangsdataregister 20-14 ved adressering korresponderende ' lagersteder i RAM 20-44 og utlesning av data, 8 biter om gangen. En 32 bits utgangs-adresseteller 20-34 lastes med adressesignaler BSAD00-31 avmikroprosessoren 20-2 som adresserer korresponderende lagersteder i RAM 20-44 og leser ut adressesignaler, 8 biterom gangen. Et 32 bits utgangsstyreregister 20-10 er lastet med busstyreinformasjon av mikroprosessoren 20-2 som adresserer korresponderende lagersteder i RAM 20-44 og leser ut styreinformasjon, 8 biter om gangen.

En opptart og QLT ROM 20-39 lagrer testmønstere og software-testrutiner som er skrevet i hovedlageret 10 til 12. CSS 3 til 5 gir tilgang til disse testmønstrene og software-testrutinene for å verifisere at CSS 3 til 5 er operativ. ROM 20-39 blir lastet direkte inn i utgangsdataregisteret 20-14 under mikroprosessor 20-2-styring. Når SMF 20 ber om og får tilgang til systembussen 2 blir informasjon lagret i utgangsdataregisteret 20-14, utgangsstyreregisteret 20-10 og utgangsadressetelleren 20-34 ovrført til systembussen 2 ved hjelp av driverne 20-66, 20-62 og 20-72 som klargjøres ved hjelp av en my datacyklus nå-signal MYDCNN.

Systemtidsmålere 20-32 tilveiebringer sentralisert tids-styring av alle delsystemene og innbefatter en sanntids-klokke, en vakthundklokke og en tidsklokke og en antall tids-avbruddsklokke.

Sanntidsklokken blir lastet av en kommando fra enhver av CPU 4 til CPU 26 til CSS 3 til 5 med en verdi lik forskjellen mellom løpende tid og oppstarttiden for prosessen ved toppen av sanntidskøen. Når løpende tid er lik oppstarttiden blir et sanntidsklokkeavbruddsignal generert. Dette signalet bevirker at SMF 20 genererer en kommando for å avbryte CPU'en som lastet tidsleseklokken for å alarmere operasjonssystemet om start av prosessen ved toppen av køen og for å laste på nytt sanntidsklokken for neste prosess. Den maksimale tiden er tilnærmet 8,4 sekunder.

Vakthundklokken anvendes for å beskytte DPU 1 mot visse software-feilfunksjoner som er manifestert av en prosess som kjører "for lang". En kommando fra enhver CPU 4 til CPU 26 laster dekrementerende vakthund-tidsklokke med en forutbestemt tid. Dersom vakthundtidsklokken ikke blir lastet på nytt før den dekrementeres til null, blir et avbruddsignal generert som bevirker at SMF 20 genererer en kommando til CPU 4 til CPU 26 for å alarmere operasjonssystemet at en prosess har blitt hengende i en uendelighetssløyfe. Maksimal tidsvarighet er tilnærmet 8,95 minutter.

Tidsuret lastes fra en batteridrevet reservesanntidskalender og blir inkrementert en gang hvert mikrosekund. Sanntids-kalenderen lagrer i 12 binærkodede desimalsiffre, løpende år, løpende måned, løpende dato, time, minutt og sekund.

SMF 20 kan operere som en master eller en slave på systembuss 2 operasjoner. SMF 20 virker som en master når den initierer og sender kommando til de andre delsystemene koplet til systembussen 2. Som en master initierer SMF generelle kommandoer på systembussen 2 til ethvert delsystem og initierer spesielle kommandoer til CPU 4 til CPU 26.

SMF 20 virker som en slave når den mottar en ikke-påkalt kommando fra enhver CPU 4 til CPU 26, og også når den mottar en uventet reaksjon på noen av de andre delsystemene koplet til systembussen 2.

SMF virker som både en master og en slave i løpet av en systembuss 2 sin rundtom testoperasjon hvor SMF 20 sender data ut på systembussen 2 som en master og mottar samme data fra systembussen 2 som en slave. Med henvisning til fig. 2 blir i løpet av rundtom testoperasjonen 32 biter med data lastet inn i utgangsdataregisteret 20-14 fra RÅM 20-44. SMF 20 starter en ikke-lagret anmodning om systembussen 2 til segt selv. SMF 20 vil gjenkjenne denne anmodningen og forbinde systembussen 2 med overføring av innholdene i utgangsdataregisteret 20-14 til inngangsdataregisteret 20-16 via driverne 20-66, systemdatabussen 2-4 og mottagerene 20-68. En komparator 20-20 kontrollerer at innholdene til de to registerene 20-14 og 20-16 er like for riktig drift.

SMF 20 genererer kommandoer til de andre delsystemene koplet med systembussen 2 som standardkommandoer med busstyresignalet BSYELO lavt. SMF 20 genererer spesielle kommandoer til CPU1A 4 til CPUNB 26 med busstyresignalet BSYELO høyt og styresignalet BSMREF lavt, som indikerer at adressesignalene representerer en CPU kanaladresse og en funksjonskode og ikke en lageradresse 10 til 12.

Systembussanmodningen og reaksjonsstyringen 20-18 innbefatter tre tidsavbruddskretser. Dersom SMF 20 som master anmoder om tilgang til bussen 20 og tre mikrosekunder passerer uten reaksjon fra det anmodede delsystemet, slaven, så blir systembusscyklusen avsluttet.

Dersom en av de andre delsystemene, som master, ber om tilgang til systembussen 2 og der er ikke noen reaksjon fra slaven innen 5 mikrosekunder, så blir systembusscyklusen avsluttet.

Dersom en SMF 20 lesecyklus startes og en ventet system-bussreaksjonscyklus (andre halvbusscyklus) ikke er mottatt i løpet av et millisekund, så blir systembussoperasjonen avsluttet.

Når SMF 20 reagerer på en systembussanmodning som en slave genererer SMF 20 enten bussignaler BSACKR for å kvittere for anmodningen eller BSNAKR for å avvise anmodningen.

Fremvisningskonsollen 34 er koplet med en kommunikasjonsstyrer 20-8 via DTI grensesnittet 29. Kommunikasjonsstyreren 20-8 er koplet med systembussen 2 via grensesnittet CAI 31 og styrekonsolladapteren 30. Denne anordningen tillater SMF 20 å styre kommunikasjonen mellom konsollen og DPU 1 systemet.

SMF 20 styrer det fjerntliggende vedlikeholdet via grensesnittet RM0 37 koplet med en kommunikasjonsstyrer 20-6. Kommunikasjonsstyreren 20-6 styrer også hjelpeanordningen 32 via ADI 33 grensesnittet. Kommunikasjonsstyrerene 20-6 og 20-8 styres av adressesignaler A14 og A15 fra mikroprosessoren 20-2, driveren 20-24 og adressebussen 20-60. Signalet A14 velger kanal A eller kanal B. Signalet A15 virker enten at datainformasjon eller styreinformasjon anbringes på databussens 20-58 linjer. Data eller styreinformasjon blir overført mellom mikroprosessoren 20-2 og kommunikasjonsstyreren 20-6 og 20-8 og databussen 20-58.

En operatør skrivbar E<2> PROM 20-46 lagrer informasjon som innbefatter passord for å forhindre ikke autorisert tilgang via det fjerntliggende vedlikeholdsgrensesnittet, identifiserer anordningen som lagrer oppstart-sofwaren og også hovedlageret 10 til 12, lagersteder i hvilke oppstart-softwaren er skrevet for utførelsen, styrebiter for å indikere forskjellige QLT testfunksjoner som skal bli utført av DPU 1 systemet og identifiserer hvilken periferanordning som lagrer softwaren for å styre CSS 3 til 5 og hovedlageret 10 til 12 sine lagersteder i hvilke denne softwaren er skrevet.

Et modusregister 20-30 er koplet med databussen 20-52 og utfører følgende funksjoner: 1. definerer SMF 20 diagnosestyringen av systembussens prioritetsbiter, 2. styring av opp/ned-tellingen av utgangsadressetelleren 20-34, 3. klargjøring av komparatoren 20-20 for å utføre datasystembussens sammenligninger, 4. styreren SMF 20 reagerer på CSS 3 til 5 kommandoer, og 5. styrer spesielt systembussens 2 operasjoner i løpet av QLT og strømforsyningsinitialiseringen.

Modusregisteret 20-30 er skrevet inn og lest av mikroprosessoren 20-2 via sender/mottaker 20-22 og databussen 20-52.

Modusregisteret 20-30 klargjøres av signalet ENBLIX hvis boolske ligning er: A8.A9.U0.All .A0.A1.A2.A3.A4.MI .MREQ. Modusregisterets 20-30 klokkesignaler CFMDBO-2 genereres av det boolske uttrykket:

ENBLIX .~ A12 . WR .~ A13 . (A14.A15).

(For CKMDB0, A14.A15, for CKMDBI, A15.Al~4Tog for CKMDB2,

A14 .115. )

Strømforsyningssystemets 22 grensesnitt PCI 21 signaler 5 mottas av SMF 20. Disse signalene indikerer et antall tilstander.

Et strømforsynings PÅ/feilsignal SYSPWN indikerer for SMF 20 at vekselstrøminngangsspenningen og de logiske utgangs-spenningene er innenfor kravene. SMF 20 starter så DPU 1 systeminitialiseringsoperasjonene. Dersom vekselstrøm-forsyningen fjernes blir strømforsyningen PÅ/feilsignalet SYSPWN lavt. Den logiske utgangsspsenningen vil imidlertid forbli innenfor kravene for tre millisekunder, som gir DPU 1 systemet tid til å kjøre ned på ordinær måte for å unngå tap av data.

Et strømforsyningsstatussignal PWRYLO indikerer at all strømforsyning tilsvarer kravene. Strømforsyningsstatus-signalet blir lavt, som indikerer en ikke-operativ strøm-forsyning.

Strømforsyningen 22 kan innbefatte reservebatteristrøm-forsyning for å holde data i hovedlageret 10 til 12 gyldig hele tiden. Et lagergyldig signal BBUATV, dersom lavt, indikerer at på tross av batterireservestrømforsyning ble lagerspenningen lav, og informasjonen i hovedlageret 10 til 12 kan være ugyldig og lageromlastning blir startet.

Et tastlåssignal fra en bryter på strømforsyningssystemets 22 styrepanel starter et panellåst signal for å styre opera-tørens funksjonsmessige tilgang til DPU 1 systemet.

Signalene mottatt av SMF 20 fra PCI 21 sitt grensesnitt tilføres en multiplekser 20-28. Mikroprosessoren 20-2 mottar signalene via databussen 20-2 og senderen/mottakeren 20-22 for å foreta egnet tiltak.

SMF 20 sender et strømforsyning-PÅ-signal BSPWON ut på systembussen 2 for å indikere for alle delsystemene koplet til systembussen 2 at strømforsyningen er innenfor de gitte krav. Signalene BSPWON som går av gir alle delsystemene tre millisekunder for å rydde opp.

Også strømforsyningen på/feilsignal SYSPWN som går høyt i løpet av strømforsyningen-På tvinger et mastersluttsignal

BSMCLR over systembussen 2 via en driver 20-63 til å tilbakestille alle hensiktsmessige logiske funksjoner.

SMF 20 sender et antall signaler til strømforsyningssystemet 22 over PCI 21 grensesnittet. Et høyspenningsutgangsmargin-styresignal HIMARG og et utgangsmargin-styresignal av lav spenning LOMARG genereres av mikroprosessoren 20-2 i løpet av testoperasjonen for å variere utgangsmarginene på alle strømforsyningsdelsystemene med ± 2$.

Et systembussignal BSQLTI indikerer at alle andre delsystémer koplet til systembussen 2 er tilkoplet riktig, tilkoplet strømforsyningen og har fullført alle testprogrammene QLT'er på en tilfredsstillende måte. QLT-logikken 90 mottar bussignalet BSQLTI og et datasignal for databussen 20-52 som indikerer at SMF 20 utfører sin QLT på riktig måte og genererer signalet BSQLTA som blir sendt til strøm-forsyningssystemet 22 og grensesnittet 21, og som indikerer at DPU 1 systemet er fullstendig kontrollert. Signalet BSQLTA er sant alltid når enhver enhet kjører sin QLT eller når noen QLT feiler. BSQLTA er feil alltid når QLT-testen er tilfredsstillende.

SMF 20 innbefatter en temperaturavfølingsanordning 20-40 for å overvåke DPU 1 systemets kabinettemperatur og genererer et signal TMPYLO for høy temperatur dersom kabinettemperaturen er over maksimumstemperaturen på 38°C. Dersom kabinettemperaturen blir unormalt høy vil en termisk sensor (ikke vist) åpne, og som slår av strømforsyningen. Dette bevirker at strømforsynings-på/feilsignalet SYSPWN genererer system-busslgnalet BSPWON for å indikere for alle delsystemene på systembussen 2 at det skal gå til deres respektive strøm-forsyninger nedre sekvens.

Signalet TMPYLO for høy temperatur tilføres MUX 20-28 for å gjøre den tilgjengelig for mikroprosessoren 20-2.

Signalene fra kommunikasjonsstyrerene 20-6 og 20-8 blir også tilført MUX 20-28 for å tillate mikroprosessoren 20-2 å sample linjene for sending av data og også for å detektere når mottakeranordningen er klar for å motta data.

MUX 20-28 klargjøres av signalet ENBMUX som genereres av følgende boolske uttrykk:

Signalet MREQ genereres av mikroprosessoren 20-2 for å indikere adressebussen 20-54 ikke inneholder en RÅM 20-44 adresse. Signalet MI genereres av mikroprosessoren 20-2 for å indikere at dette ikke er en op kodehenteoperasjon.

Adressebussen 20-54 signaliserer A14 og A15 til å velge hver av de fire MUX 20-28 utgangssignalene.

SMF 20 sine utgangsregistere, utgangsdataregisteret 20-14, utgangsstyreregisteret 20-10 og utgangsadressetelleren 20-34 er koplet til systembussen 2 (2-4, 2-2, 2-6) via inverterende drivere 20-66, 20-62 og 20-72 henholdsvis.

Data blir ført til disse utgangsregistrene med en byte om gangen fra databussen 20-52. Disse utgangsregistrene blir adressert av mikroprosessoren 20-2 som RAM 20-44 lagersteder. Utgangsdatagisteret 20-14 kan også bli lastet på bredsiden fra systemtidsklokken 20-32 eller oppstart og QLT ROM 20-39. Et utgangsadresseregister 20-41 lastes også med suksessive adresser av mikroprosessoren 20-2 for en blokkoverføring med data til hovedlageret 10 til 12.

Signaler for å laste utgangsregistrene genereres ved å dekode egnede adresselinjer og kombinere dem med styresignalet fra mikroprosessoren 20-2. Logikken som viser generering og kontroll av paritet er ikke innbefattet i beskrivelsen siden den ikke angår oppfinnelsen, men det skulle være klart for enhver fagmann på området at pariteten kontrolleres etter hver byte overføring.

Utgangsdataregisteret 20-14, som ikke innbefatter paritet, er fremstilt av typiske åtte 74LS298 multipleksregistere med "null"-inngangen koplet med databussen 20-52 og "en"-inngangen koplet med oppstart og QLT ROM 20-39 utgangen. Registeret 20-14 er lastet av logikken i adressedekoderene 20-4 som angitt ved hjelp av følgende boolske uttrykk:

Et klargjøringssignal ENBLOX =

MI . MREQ . A0 . Al . A2 . A3 . A4 . A8 . A9 . A10 . All

Det skal bemerkes at alle de boolske uttrykkene i beskrivelsen representerer de logiske adressedekoderene 20-4. Inngangssignalene til adressekoderene er adressesignaler A0 til A15 og til mikroprosessoren 20-2 er signalene MI, MREQ, I0RQ, WR og RD. Adressedekoderene 20-4 genererer logiske styresignaler som styrer SMF 20 sine logiske elementer.

Multiplekserregisterene 20-24 lastes to om gangen (en byte om gangen) siden hvert multiplekserregister lagrer 4 biter med klokkesignalene CKDTB0, CKDTB1, CKDTB2 og CKDTB3.

CKDTBO = ENBLOX A12 A13 A14 A15

CKDTB1 = ENBLOX A12 A13 Ali Al5

CKDTB2 = ENBLOX A12 A13 A14 A15

CKDTB3 = ENBLOX A12 A13 A14 A15

Signalet BPTDOT velger utgangen til ROM 20-39 eller utgangen til systemtidsurene 20-32. De boolske uttrykkene for BPTDOT er:

(A8 . A9 . A10 . All . A12 . A13 . I0RQ . MI + TODRWST)

Mikroprosessorens 20-2 signaler indikerer følgende. MI sammen med MREQ indikerer at der er ikke en op kodehenteoperasj on. MREQ indikerer at adressebussen ikke holder en gyldig adresse for en lagerlese- eller skriveoperasjon.

RD indikerer at mikroprosessoren 20-2 ønsker å lese data fra lageret eller en I/O-anordning. WR indikerer at mikroprosessorens 20-2 databuss holder gyldig data for lagring ved adresselagerstedene eller I/O-lagerstedene.

IORQ . MI indikerer at der ikke er tilstede en inngangs/- utgangsanordningsadresse eller en op kodehentecyklus for mikroprosessoren 20-2. Signalet TODRWT indikerer et system-tidsur 20-32 tid for dagsoverføring av systembussen 2 via utgangsdataregisteret 20-14.

For bredsidet lasting av utgangsdataregisteret 20-14 indikerer et signal MYDTCK fra systemtidsuret 20-32 som indikerer et tidspunkt for overføring eller et mikroprosessor 20-2-generert signal BP2MDT som genererer klokkesignalet CKDTBO til CKDTB3 parallelt.

Det boolske uttrykket for signalet BP2MDT er:

(A8 . A9 . A10 . All . A12 . A12 . A13 . IORQ . MI)

Utgangsstyreregisteret 20-10 er fremstilt av typiske to 74LS273 registere, et 74LS174 register og et 74LS374 register, alle koplet til 8 bit databussen 20-52. Styre-signalene er klokket i registerene ved hjelp av signalene CKCMBO til CKCMB3 henholdsvis. De boolske uttrykkene er:

Et signal TDSEBD sperrer utgangen til 74LS374 registeret klokket av signalet CKCMBO i løpet av en tidspunkt-klokkeoverføring. Systemtilbakestillingssignalet CLRFLP tilbakestiller øvrige tre registere.

74LS374 registeret lagrer åtte kommandosignaler vist på fig. 5A-5E. De er signalene BSYELO, BSBYTE, BSDBPL, BSDBWD, BSSHBC, BSLOCK, BSWRIT og BSMREF. I løpet av tiden hvor det ikke er noen tidsmessig overføring blir disse bussignalene tilført direkte til driveren 20-62.

Utgangsadressetelleren 20-34 innbefatter fire 74AS869 tellere beskrevet i "Texas Instruments ALS/AS Logic Circuits Data Book 1983 (Advanced Low-Power Schottky/Advanced Schottley). Tellerene har fire operasjonsmodier: slett, dekrement, last og inkrement. En lastetellers operasjon er startet av signalet MYADUP tilført de fire tellerene over signalene CKADBp til CKADB3 tilført respektive tellere. De boolske uttrykkene er:

Signalet MYADUP er lagret i modusregisteret 20-30 av mikroprosessoren 20-2 for å indikere en laste- eller inkrementoperasjonsmodus. I løpet av en start- og QLT-operasjon vil tellerene bli lastet til å begynne med med en byte om gangen og så inkrementert i sekvens med adresseregisteret 20-41 som leser ut data fra ROM 20-39 for overføring til utgangsdataregisteret 20-14.

Et klokkesignal MYADCK tilføres en klokkeinngangsterminal for hver teller 20-34 for å takte telleren. Signalet MYADCK genereres av et forsinket kvitteringssignal BSACKR.

Inngangsdataregisteret 20-16 -er dannet av fire 74S374 registere. Inngangsadresseregisteret 20-36 er dannet av fire 74LS374 registere og inngangsstyreregisteret 20-12 er dannet av to 74LS374 registere, et 74LS374 register og et 74AS823 register. 74AS823 registeret mottar åtte bussignaler BSYELO,

BSBYTE, BSDBPL, BSDBWD, BSSHBC, BSLOCK, BSWRIT og BSMREF som

styrer en SMF 20 sine kommandoer satt ut på systembussen 2.

Alle ovenfornevnte inngangsregistere 20-16, 20-36 og 20-12 er lastet under styring av et klokkesignal MBIPCK som er generert under tre tilstander: 1. Systembussanmodning og reaksjonsstyring 20-18 virker som en slave og mottar et kvitteringskommandosignal BSACKR eller et andre halvbusscyklus-kommandosignal BSSHBC fra systembussen 2. 2. Reaksjonsstyreren 20-18 detekterer et 3 mikro-sekunders tidsavbrudd i løpet av en rundhopp-test.

3. SMF 20 kvitterer seg selv i løpet av en testmodus.

De trettito utgangsdatasignalene fra inngangsdataregisteret 20-16 tilføres komparatoren 20-20 i løpet av rundhopp-testmod-usen. Datasignalene "blir også tilført en MUX 20-17 for overføring til databussen 20-52 en byte om gangen under mikroprosessorens 20-2 styring. Utgangene til MUX 20-17 klargjøres av signalet ENBL2X, hvis boolske uttrykk er:

A0 .Al . A2 . A3 . A4 . A8. A9 . A10 . All . MI . MREQ

MUX 20-17 valget blir gjort av signalene REGSL0, REGSL1 og REGSL2. De boolske uttrykkene er:

De fire registerene som utgjør inngangsadresseregisteret 20-36 har sine utgangssignaler tilført databussen 20-52 under styring av signalene RDD024, RDD025, RDD026 og RDD027 henholdsvis. De fire registerene utgjør inngangsstyreregisteret 20-12 med deres utgangssignaler tilført databussen 20-52 under styring av henholdsvis signalene RDD020, RDD021, RDD022 og RDD023 henholdsvis. Signalet MBIPCK klokker adressesignalene inn i registeret 20-36.

Det boolske uttrykket for RDD02X hvor X varierer fra 0 til 7 er: ENBL2X . RD . A12 . A13 . A14 . A15 hvor binær A13 . A14 . A15 = X

Mikroprosessoren 20-2 lagrer adressebyter, databyter og kommandobyter mottatt på databussen 20-52 i forutbestemte lagersteder RÅM 20-44 for senere bruk under software-styring.

Følgende styresignaler blir anvendt som en del av kommandoene sendt over og mottatt fra systembussen 2 av SMF 20:

BSYELO ( gul)

Dette signalet, når sant i løpet av en andre halvbusscyklus, indikerer at medfølgende overførte informasjon har blitt korrigert. Det har således forekommet en midlertidig feil og det betyr at muligens skulle vedlikehold foretas før feilen blir permanent. Dette signalet blir anvendt av hovedlageret 10 til 12 ved en lesereaksjon for å indikere en feil som har blitt funnet og korrigert.

Dette signalet når sant i løpet av lagerleseanmodning kvalifiserer leseanmodningen. Reaksjonen på BSYELO sant i løpet av en leseanmodning avhenger av lageret og adressene som er involvert.

Når sann i løpet av en SMF 20 kommando til CSS 3 til 5 identifiserer BSYELO SMF 20 kommandoen som frembringer BSMREF feil som indikerer at adresseføringen inneholder en kanaladresse og en funksjonskode.

BSBYTE ( Byte)

Dette signalet indikerer når sant at løpende overføring er en byteoverføring istedenfor en ordoverføring.

BSDBWD ( Dobbeltord)

Dette signalet og SSDBPL anvendes i løpet av leseanmodningen for å indikere hvor mange ord med data, og i hvilken form er ventet fra hovedlageret 10 til 12. I løpet av lesereaksjonscyklusen (fra lageret til anmoder) indikerer BSDBWD om eller ikke ett eller to ord med data er på systembussen 2.

Ved skriveanmodningen blir signalet anvendt i kombinasjon med BSAD23, BSBYTE, og BSDBPL for å identifisere hvilken kombinasjon med byter ved en 32-bit operand skulle bli skrevet i lageret.

BSDBPL ( Dobbelttrekk)

Dette signalet skulle bli anvendt i forbindelse med BSDBWD. I løpet av lesereaksjonscyklusen indikerer BSDBPL om reaksjonen er ikke den siste eller det siste anmodede dataelementet.

BSSHBC ( Andre halvbusscyklus)

Dette signalet kan enten tjene til å identifisere den andre busscyklusen som en reaksjon på en leseanmodning eller som informasjon for å innstille eller tilbakestille låsingen i forbindelse med BSLOCK.

BSLOCK ( Lås)

Dette signalet når sant indikerer at denne cyklusen er bragt til tilstanden for låse-flip-flopen i slaven, vanligvis hovedlageret 10 til 12, for å indikere at denne cyklusen vil enten teste og innstille eller tilbakestille låse-flip-flopen i forbindelse med BSSHBC for å synkronisere systemprosessene.

BSWRIT ( BusskriveV

Dette signalet indikerer når sant at overføringen er fra master til slave. Når dette signalet er feil ledsagende en overføring anmoder masteren om informasjon fra slaven. Informasjonen, når den blir tilgjengelig, vil bli tilført som en separat overføring.

BSMREF ( Lagerreferanse1

Dette signalet indikerer når sant at adresseledningen inneholder en lageradresse. Når feil indikerer dette signalet at adresseledningen inneholder et kanalnummer og en funksjonskode .

BSREDL ( rødt venstre)

Dette signalet, når sant, indikerer at ledsagende overført informasjon er feil. Dette signalet er anvendt av lageret ved lesereaksjonen for å indikere en ikke-korrigerbar feil i det mest til venstre liggende returnerte ordet (dersom to ord er returnert parallelt) eller i et enkelt ord.

BSREDR ( rød høvre)

Dette signalet, når sant, indikerer at ledsagende overført informasjon er beheftet med feil. Dette signalet blir anvendt av lageret ved lesereaksjonen for å indikere en ikke-korrigerbar feil i det lengst til høyre returnerte ordet (dersom to ord er returnert parallelt).

BSLKNC ( Lås: Ingen lagercyklus)

Dette signalet har betydning kun i løpet av låste lager-leseanmodninger (BSLOCK sann). Når sann instruerer lageret til å sperre de aktuelle leseoperasjonsanmodningene mens samtidig tillater de andre operasjonene er forbundet med anmodninger om å fortsette. Reaksjonen på anmodningen, BSACKR eller BSNAKR, vil være de samme om BSLKNC er sann eller feil, og innstillingen, slettingen og testingen av lase-flip-flopen i hovedlageret 10 til 12 vil bli utført. Cyklusføringen av lagermodulen vil bli sperret, ingen andre halvbusscykluser vil forekomme, og lageret vil ikke bli opptatt.

BSRINT ( Resymeavbrudd)

Dette signalet er vanligvis sendt ut av CSS 3 til 5 (det kan i noen tilfeller bli sendt ut av SMF-20) når det er, igjen, i en tilstand for å motta avbrudd. Etter å ha blitt gitt negativt kvitteringstegn på en eller flere tidligere avbruddsanmodninger blir avbruddet (S) "stakkført" i de perifere styrerene 14 til 16. Ved detekteringen av en sann overgang av BSRINT vil disse styrerene igjen forsøke å sende avbruddet til CSS 3 til 5 (som kan resultere i en annen NACK-reaksjon).

Det skal bemerkes at dette signalet blir behandlet av mottakerstyrerene 14 til 16 som asynkrone, men en sender for BSRINT må bli synkronisert med en systembusscyklus for å forhindre mer enn en driverkilde fra å bli aktivert på systembussen 2 om gangen i et multiprosessorsystem.

BSRINT må være gyldig i minimum 100 nanosekunder og kan ha uregelmessig systemoppførsel fra uskarpe endekantoverganger for BSRINT.

BSPWON ( Busstrømforsyning På)

Dette asynkrone signalet er normalt sant når all strømfor-syningstilførsel er innenfor reguleringen og den interne kabinettemperaturen er innenfor akseptable operasjonsgrenser. Signalet blir feil når et system (dvs. strømforsynings-styringsfeil, overbelastning, "Rødt nivå", overtemperatur etc.) feil forekommer.

Signalet BSPWON er normalt generert av SMF 20 via informasjon tilveiebragt av strømforsyningssystemet 22, men kan i noen tilfeller bli drevet av visse kommunikasjonsstyrere 20-6 og 20-8 for å simulere en systemgjenvinning fra en "opp-linjevert". I løpet av en strømforsyning-På-overgang indikerer en positiv gående kant av BSPWON at systemstrøm-forsyningen har blitt slått på og blir stabil og en sys-teminitialisering kan finne sted. Påfølgende initialiseringen indikerer en stabil strømforsyning På-tilstand et stabilt sett med systemoperasjonstilstander. Ved avføling av en feil eller strømforsyning AV-tilstand vil BSPWON overga til AV og alle perifere styrere 14 til 16 må øke all trafikk på bussen og utføre en selvinitialisering for å klargjøre CSS 3 til 5 for å lagre systemtilstanden og gjenvinne informasjon i hovedlageret 10 til 12 (lageret må være ikke-flyktig for tilstandene starting på nytt). En feilgående overgang for BSPWON må forutgå det aktuelle tapet i likestrømsreguleringen ved et minimum på 3,0 millisekunder og lagerstyrerene må gå inn i en beskyttet tilstand (ingen busscykluser akseptert) ved 2,5 til 3,0 millisekunder etter at en feil er avfølt, for å ta vare på systemtilstandsinformasjonen.

BSACKR ( ACK)

Slaven signaliserer til masteren at den aksepterer denne overføringen ved å gjøre signalet sant.

BSNAKR ( NAK)

Slaven signaliserer til masteren at den avslår denne overføringen ved å gjøre dette signalet sant.

BSWAIT ( WAIT)

Slaven signaliserer til masteren at den midlertidig avviser overføringen ved å gjøre signalet sant.

BSDCNN ( Datacyklusen nå)

Når sant indikerer dette signalet at en bestemt master utfører en systembussoverføring og har anbragt informasjon på systembussen 2 ved en bestemt slave. Når feil, er systembussen i ro eller mellom busscyklusene.

BSMCLR ( Bussmastersletting)

Dette asynkrone signalet er normalt feil og blir sant når en systemtilstand er detektert som krever systemoperasjonen til å bli fullstendig avbrutt og en "hold"-, "gjenstart"- eller "gjenoppstart"-operasjon skal bli utført av SMF 20. Kilden for masterslettingen er normalt utledet fra strømforsyning-På-sekvensen og styrepanelslettetrykknappen (begge opprinnelig SMF 20), men kan komme fra visse kommunikasjonsstyrere som har muligheten til å utføre en nedlinjelasting fra en tilknyttet vert.

Når BSMCLR er sann vil alle enhetene på systembussen 2 initialiseres. Enhetene er dessuten i stand til å gjøre dette mens de kjører deres QLT'er. Tilfredsstillende fullførelse av QLT'ene blir indikert når SMF 20 mottar BSQLTA signalet.

BSRESQ (Reaksjonskvalifiserer)

Dette signalet vil bli drevet i forbindelse med BSACKR for å indikere til den anmodende bussmasteren at slaven gjenkjenner anmodningen om funksjonalitet og reagerer tilsvarende. Tre typer anmodninger kan velge denne kvalifiserte reaksjonen: leser anmodninger som kan resultere i en to-ords,

andre-halvbusscyklus (angitt med BSDBV/D--sann),

skriveanmodning som forsøker å skrive datasignaler

BSDT16 til BSDT31 (indikert med BSDBWD—sann), og

leser anmodninger som forsøker å låse eller låse opp et lager uten å cyklusføre det (indikert med BSLKNC-sann).

Systembussanmodning og reaksjonsstyrelogikk 20-18 innbefatter masterstyrelogikk for å gi styring av systembussen 2 for SMF 20 og for å sende SMF 20 kommandoen eller reaksjonen til en kommando over systembussen 2 til slaveenheten.

Siden SMF 20 opptar den høyeste prioritetsposisjonen på systembussen 2 vil SMF 20, når den ber om tilgang til systembussen 2, få denne innvilget neste cyklus så snart som foreliggende busscyklus er fullført. Logikken 20-18 vil generere signalet MYDCNN som blir tilført driverene 20-66, 20-62 og 20-72 for å føre data, adresse og styreinformasjon på systembussen 2. Logikken 20-18 sender også busssignalet BSDCNN over systembussen 2 for å indikere til alle delsystemene at systembussen 2 er i bruk.

Logikken 20-18 venter nå på et antall reaksjoner for systembussen 2. De mulige reaksjonene er:

1. Ingen reaksjon er mottatt i 3jjs.

2. Ventreaksjon er mottatt (BSWAIT).

3. En ikke-kvitteringsreaksjon er mottatt (BSNAKR).

4. En låse-ingen-cyklus (LKNC) er kvittert for (BSLKNC)

(BSACKR).

5. En skriving (et ord skrives eller BSRESQ mottatt) er kvittert for (BSACKR). 6. En skriving (BSRESQ ikke mottatt og dobbeltord) er kvittert for (BSACKR):

7. En lesecyklus er kvittert for (BSACKR).

Logikken 20-18 vil avslutte denne systembusscyklusen og igjen anmode om tilgang til systembussen 2 dersom en BSWAIT eller BSNAKR reaksjon er mottatt eller dersom en BSACKR reaksjon ble mottatt for å skrive en dobbeltord-anmodning.

Logikken 20-18 innbefatter slavestyrelogikk som er aktivert når en andre halvbusscyklus er ventet som reaksjon på en lesekommando sendt av SMF 20 til hovedlageret 10 til 12, CSS 3 til 5, eller periferstyrerene 14 til 16. Slavestyrelogikken er også aktivert når en busscyklus innbefatter SMF 20 kanalnummerheksadesimalen OF. Den andre halvbusscyklusen er akseptert av SMF 20 dersom ingen feiltilstander er tilstede og en kvitteringsreaksjon BSACKR er sendt ut av systembussen 2 ved hjelp av SMF 20 til masteren.

Dersom en andre halvbusscyklus er akseptert så vil signaler fra modusregisterets styre inkrementeringen eller de-krementeringen av utgangsadressetelleren 20-34 avhengig av antall dataord som blir overført som angitt av busstyresignalet BSDBwU.

SMF 20 vil akseptere en ikke-påkalt kommando dersom kanalnummeret er heksadesimalt OF, der er ingen paritetsfeil, der er ikke en andre halvbusscyklus (BSSHBC-feil, falsk), bussadressesignaler inneholder en funksjonskode og kanalnummer (BSMREF falsk) og funksjonskoden er legal for SMF 20. SMF 20 vil reagere over systembussen 2 med et kvitteringssignal BSACKR, et ikke-kvitteringssignal BSNAKR eller vil ignorere kommandoen dersom dårlig paritet eller det finnes en illegal funksjonskode.

SMF 20 kan sende kommando for å lese et hovedlagers 10 til 12 lagersted og sende innholdene til det lagerstedet til et annet delsystem typisk CSS 3 eller CSS 5. I dette tilfellet vil den andre halvbusscyklusen ikke bli adressert til SMF 20. Hovedlageret 10 til 12 vil sende kvitteringssignalet BSACKE ut på bussystemet 2 og sende den andre halvbusscykluskommandoen ut på systembussen 2 med kanalnummeret til det utpekte delsystemet. Siden SMF 20 ikke vil motta den andre halvbusscyklusen må den avslutte kommandoen.

Kvitteringssignalet BSACKR mottas av systembussslutten til cyklusstyrelogikken 20-19. Mikroprosessoren 20-2 genererer adressesignaler som er dekodert av adressedekodere 20-4 for å generere signalet CKMD02. Også mikroprosessoren 20-2 genererer datasignalet D00 over databussen 20-52. Signaler BSACKR, CKMD02, og D00 tilbakestiller SMF 20 cyklusen på signalet SMFCLY som tilfører systemtidsuret 20-32 for å tilbakestille tidsavbruddet for derved å avslutte kommandoen. I løpet av normal drift verifiserer tidsavbruddene at den ventede andre halvbusscykluskommandoen er mottatt av SMF 20 innenfor en forutbestemt tid. Dersom kommandoen ikke er mottatt innenfor den forutbestemte tiden vil et andre tidsavbruddsignal bevirke at SMF 20 gjentar leselagerkomman-doen.

ADI 33 grensesnittet kopler kommunikasjonsstyreren s 20-6 B-kanal til hjelpeanordningen 32. Dette er et standard EIA RS-232C grensesnitt av typen Z med en datahastighet på opptil 1200 baud. Grensesnittsignalene er et typisk sendedata, mottakerdata, data satt klar og anmodning om å sende.

CAI 31 grensesnittet kopler kommunikasjonsstyrerens 20-8 A-kanal til konsolladapteren 30. Dette grensesnittet kan være RS232C asynkrongrensesnittet på RS 422 asynkrongrensesnittet. RS 232C grensesnittsignalene er sendedata, mottakerdata, slette for å sende og data satt klar. RS 422 grensesnitt-signalet er sendedata, mottakerdata og datastrømstyring.

RMO 37 grensesnittet kopler kommunikasjonsstyrerens 20-6 A-kanal til fjernkonsollen 42.

RMO 37 grensesnittet koples med et typisk modem 36 som beskrevet med henvisning til fig. 1.

DTI 29 grensesnittet kopler kommunikasjonsstyrerens 20-8 B-kanal og tilpasser CAI 31 grensesnittet.

Kommunikasjonsstyreren 20-6 og 20-8 er styrere av typen Zilog Z80 SIO/0 serie inngangs/utgangsstyrere beskrevet i tidligere nevnte "Zilog Gold Book".

Kommunikasjonsstyrerene 20-6 og 20-8 avbryter mikroprosessoren 20-2 over en felles avbruddslinje. Mikroprosessoren

20-2 reagerer på avbrudd ved å sende ut MI og I00RQ signaler såvel som signalene A14 og A15. Avbrudsstyreren 20-6 eller 20-8 reagerer ved å sende status over databussen 20-58. Mikroprosessoren 20-2 forgrener så en software-rutine basert på statusen for å behandle aktiviteten. Typiske funksjoner utføres av softwaren ved å reagere på kommunikasjonsstyrer-enes 20-6 og 20-8 statussignaler er sendebuffer tom, utvide statusendring, motta tegntilgjengelighet og spesielle mottakertilstander.

Lastemodus

Fig. 3 viser et blokkdiagram av systembussgrensesnittet 2-10A. Kommandoene fra systembussen 2 blir tilført et først-inn-først-ut (FIFO) register 2-34 til mottakerene 2-30. Formatet på de forskjellige kommandoene er vist på figurene 5A - 5E. Kommandoene innbefatter et kanalnummer som spesifiserer kommandoutpekningsenheten og en funksjonskode som bestemmer operasjonen mottakerenheten vil utføre.

En FIFO styrer 2-33 mottar bestemte kommandosignaler fra systembussen 2 via mottakerene 2-30. De bestemte kommando-signalene klargjør FIFO styreren 2-33 til å ha de bestemte kommandoene lastet inn i FIFO 2-34.

Dersom SMF til hovedlagerkommandoen på fig. 5C har kanalnummeret i heksadesimal 00, så reagerer FIFO styreren 2-33 på datasignalene 0-9 for å generere et signal for å lastee kommandoen inn i FIFO. FIFO styreren 2-33 er også betinget til å motta en andre halvbusscyklus.

FIFOstyreren 2-33 reagerer på SHBC til CPU kommandokanalnum-mer heksadesimal 00 spesifisert av adressesignalene 8-17 for å laste innholdene til hovedlageret inn i FIFO 2-34 for påfølgende lagring i styrelageret 3-2 på fig. 4.

Masterslettesignalet BSMCLR tilføres styrelogikken CNTL 0 2-15 og CNTL 1 2-25 for å generere mastersynkrosignaler henholdsvis P0MSYN og P1MSYN for å styre normaloperasjonen av CSS 3. Lastemodusen genereres av SMF 20 som sender en lastekommando som innbefatter en lastekommando som innbefatter et kanalnummer og en funksjonskode. Styrelogikken CNTL 0 2-15 klargjøres av kanalnummer heksadesimal 00. Styrelogikken CNTL 1 2-25 klargjøresav kanalnummerbit heksadesimal 01. Lignende styrelogikk ved systembussgrensesnittet 2-10B reagerer på kanalnummerene heksadesimal 02 og 03 henholdsvis.

CNTL 0 2-15 reagerer på lastekommandofunksjonskode heksadesimalen OD og genererer signalet P0CSLD dersom kanalnummer heksadesimalen 00 spesifiseres. CNTL 1 2-25 reagerer på funksjonskode heksadesimalen OD for å generere signalet P1CSLD dersom kanalnummer heksadesimalen 01 er spesifisert.

Likeledes reagerer CNTL 0 2-15 og CNTL 1 2-25 på deres respektive kanalnummer og en funksjonskode i heksadesimal 11 som spesifiserer en laststyrelager-adressetelleroperasjon for å generere signalene P0LADD og P0LSYN eller PlLADD og P1LSYN.

I løpet av overføringsoperasjonen av laststyrt lagret data blir data fra hovedlageret 10 til 12 lagret i SMF interndata (PO) registeret 2-12 dersom lastekommandoene spesifiserer kanalnummer heksadesimal 00. Lastelagerstyringen av opera-sjonsdata fra hovedlageret 10-12 lagres i SMF dataav-bruddsregisteret 2-22 dersom lastekommandoer spesifiserer kanalnummer heksadesimal 01. Registeret 2-12 og registeret 2-22 er lastet fra systembussen 2 via mottakeren/senderen 2-30 og FIFO 2-34.

Et syndromregister 2-13 lagrer informasjon mottatt fra porten 0, og et syndromregister 2-23 lagrer informasjon mottatt fra porten 1. Signalet P0PRES lagret i syndromregisteret 2-13 indikerer at CPU0 4 er tilstede i systemet, signalet P0LERR indikerer at der var en styrelagerlastefeil og signalet P0CSBY indikerer at lasteopereasjonen ikke blir fullført. Signalet P1PRES, P1LERR og P1CSBY lagret i syndromregisteret 2-23 indikerer disse tilstandene for CPU1 6.

En lesesyndromregisterkommando med funksjonskoden til heksadesimalen 00 vil resultere i en CNTL 0 2-15 som genererer signalet P0SSYE for et kanalnummer med heksadesimal 00 og CNTL 1 2-25 genererende signal P1SSYE for et kanalnummer med heksadesimalen 01. Innholdene til syndromregisteret 2-13 når klargjort av signalet P0SSYE vil fremkomme på systembussen 2 via et register 2-14, et data-ut-register 2-11 og drivere 2-32.

Syndromregisteret 2-13 lagrer et hardware-revisjonsnummer som indikerer personligheten CSS 3 vil ha. Den blir lastet fra logikken 2-16. Hardware-revisjonsnummeret blir anvendt i løpet av lasteoperasjonen for å velge fastvaren lastet inn i styrelageret 3-2 på fig. 4. Det skal bemerkes at kun syndromregisteret 2-13 til porten 0 lagrer hardware-revisjonsnummeret. Dersom hardware-revisjonsnummeret ikke blir lest fra porten 0, så blir porten 1 ikke anvendt og fastvare-lastingen for CSS 3 blir avbrutt.

SMF dataavbruddsregistrene 2-12 og 2-22 ffrembringer et utgangssignal når styrelogikken CNTL 0 2-15 mottar en kommando som har kanalnummer med heksadesimal 00 og funksjonskoden med heksadesimal 06 for å generere signalet CNO. CNTL 1 2-25 mottar kanalnummer med heksadesimal 01 og funksjonskoden med heksadesimal 06 for å generere signalet CN1. Signalet CNO klargjør registeret 2-12 og signalet CN1 klargjør registeret 2-22. I løpet av lastemodusen er ved normaltilfellet signalet CNO eller CN1 klargjort med mindre SMF 20 sender en funksjonskode med heksadesimal 00. I løpet av styrelagerlastemodusen blir data lastet inn i 32 bit registerene 2-12 eller 2-22 på 4 busscykluser for å overføre 104 databiter til styrelageret 3-2 fig. 4. Hver cyklus genererer et P0LSYN eller P1LSYN signal.

SMF 20 sender en lesekommando for å aktivere porten 0 eller porten 1 med en funksjonskode med heksadesimal 00 for å lese innholdene til respektive syndromregistere 2-13 eller 2-23.

Signalene P0SSYE eller P1SSYE klargjør utgangen til det valgte syndromregisteret 2-13 eller 2-23 for å anbringe innholdene på systembussen 2 via registeret 2-14 eller 2-24, datautgangsregisteret 2-11 eller 2-21 og driveren 2-32.

Fig. 4 viser et blokkdiagram av CSS 3 som er koplet med systembussgrensesnittet 2-10A ved hjelp av porten 0 og porten 1. Porten 0 opereres med CPU0 4-2 og VMMU0 4-4 til CPU1A 4, jfr. fig. 1. Porten 1 opererer med CPU1 6-2 og VMMU1 6-4 til CPU1B 6. CSS 5 opereres på lignende måte via portene 2 og 3.

Styrelageret 3-2 lagrer fastvaren for å styre operasjonen av CPU0 4-2 og VMMU0 4-4 og deres tilknyttede registere og logikk, og også operasjonen av CPTJ1 6-2 og VMMU1 6-4 og deres tilknyttede registere og logikk. Styrelageret 3-2 lagrer 16K ord med 104 biter pr. ord.

En adresseteller 3-4 frembringer adressesignaler som velger lagersteder for styrelageret 3-2 i hvilket styrelagerdataen blir skrevet. Et lasteregister 0 4-14 koples til registeret PO 2-14, fig. 3, til porten 0 for å motta en startstyrelageradresse og styrelagerdataord som er skrevet i styrelageret 3-2 ved lagerstedene spesifisert av telleren 3-4, når lastekommandoen innbefatter kanalnummeret med heksadesimal 00. På lignende måte er et lasteregister 1 6-14 koplet til registeret Pl 2-24, fig. 3, til porten 1 for å motta startstyrelageradressen og styrelagerdataordene som er skrevet i styrelagrene 3-2 ved lagerstedene spesifisert av telleren 3-4 av lastekommandoen innbefattende desimalnummer med heksadesimal 01.

En tidsgenerator 3-8 avgir tidssignaler og et styrelager-lastestyring 3-6 frembringer styresignaler som i forbindelse med tidssignalene styrer lasteoperasjonen. Tidsgeneratoren 3-8 reagerer også på signalet POMSYN og P1MSYN for å generere tidssignaler til styring av normale operasjoner.

Pariteten L 3-18 genererer et lastefeilsignal PXLDER i løpet av lasteoperasjonen dersom styrelagerordene ut fra registeret 0 4-14 eller register 1 6-14 indikerer en paritetsfeil.

Paritetsfeillogikken 3-20 genererer et paritetsfeilsignal PXVFER i løpet av verifisering av styrelagerets lasteopera-sjon når signalene mottatt fra en eller flere paritetskon-trollkretser 3-12, 3-14, 3-16, CPU 0 4-2, VMMU 0 4-4, CPU 1 6-2 og VMMU 1 6-4 indikerer en paritetsfeil ved å generere signalene G, M, A, CO V0; eller signalene G, M, A, Cl og VI henholdsvis i løpet av den verifiserende lasteoperasjonen.

1 løpet av normal drift blir styrelageret 3-2 adressert av innholdene til et adresseregister 0 4-6 eller av innholdene til adresseregisteret 1 6-6. Registrene 4-6 og 6-6 lastes fra henholdsvis CPUO 4-2 eller CPU1 6-2. I løpet av laste- og verifiseringsoperasjonen blir styrelageret 3-2 adressert av innholdene til telleren 3-4. Ved både normal og verifiserende operasjon blir adresselagerstedene til styrelageret 3-2 lastet inn i et register C 3-10 og hvert register PO 4-12 eller register Pl 6-12.

CPTJO 4-2, VMMUO 4-4, CPU 1 6-2 og VMMU 1 6-4 mottar styrelagersignalene fra registeret C 3-10. CPUO 4-2 mottar styrelagersignalene fra registeret 4-12 og CPU 1 6-2 mottar styrelagersignaler fra register 6-12.

CPUO 4-2 genererer signalet CO og VMMUO 4-4 genererer signalet V0. Signalene CO og V0 tilføres paritetsfeillogikken 3- 20. Signalene CO og V0 er resulterende paritet av styrelagerbitene mottatt av respektive enheter.

På lignende måte genererer CPU1 6-2 signalet Cl og VMMU1 6-4 genererer signalet VI. Signalene Cl og VI tilføres paritetsfeillogikken 3-20, idet signalene Cl og VI er resultat-pariteten til styrelagerbitene mottatt av respektive enheter.

Registrene 3-10, 4-12 og 6-12 er lastet ved hjelp av klokkesignalet PXADLA. Utgangene til registrene 4-12 og 6-12 er tilgjengelige ved henholdsvis P0TMC4 tiden og P1TMC4 tiden. Utgangen til registeret 3-10 er tilgjengelig når lastet. Signalet PXADLA er tilgjengelig ved PXTME2 tiden og PXTME4 tiden. Registrene 4-12 og 6-12 blir lastet ved frontflanken til "2-tiden" for CPU1 6-2 og VMMU1 6-4 og lastet ved frontflanken til "4-tiden" for CPUO 4-2 og VMMUO 4- 4 og tilgjengelig ved den bakre flanken til "2-tiden" for CPU1 6-2 og VMMU1 6-4, tilgjengelig ved den bakre flanken til "4-tiden" for CPUO 4-2 og VMMUO 4-4.

I løpet av normal drift kopler et datautgangsregister FO 4-8 og et datainngangsregister TO 4-10 CPUO 4-2 og VMMUO 4-4 til systembussgrensesnittet 2-10A via porten 0. Likeledes kopler et datautgangsregister Fl 6-8 og et datainngangsregister Tl 6-10 CPU1 6-2 og VMMU1 6-4 til systembussgrensesnittet 2-10A via porten 1.

Dersom lastekommandoen innbefatter kanalnummeret med heksadesimal 00 så blir signalet POLSYN generert av CNTL 0 2-15, jfr. fig. 3, og tilført tidsgeneratoren 3-8 som reagerer på et frittløpende klokkesignal CLK og genererer en sekvens med signaler som innbefatter klokkesignalet CST1 via klokkesignalet CST5.

Signalene POCSLD eller P1CSLD tilføres logikken 3-6 for å generere signalet PXCSLD. Signalet PXCSLD klargjør både registerene 4-14 og 6-14. Også signalet POCSLD genererer signalet P0T0CS for å klargjøre utgangen til registeret 4-14. Signalet P1CSLD genererer signalet P1T0CS for å klargjøre utgangen til registeret 6-14. Klokkesignalet CST1 klokker startadressen eller lagrer lagerdataordene i registerene 4-14 og 6-14. PXCSLD genererer også klokkesignalet CSACLK ved tidspunktet CST5.

Signalene POLADD og PlLADD tilføres lastestyreren 3-6 for å generere lasteadressesignalet PXLADD ved tidspunktet CST1 dersom begge signalene og signalet PXCSLD er satt. Telleren 3-4 lastes av signalet PXLADD og inkrementeres ved hjelp av klokkesignalet CSACLK. Skriveklargjøringssignalene CSV/1 til CSW4 genererer sekvensmessig hver CST4 tidspunkt på suksessive dobbelordoverføringer fra hovedlageret 10 til 12. Signalene blir behandlet av en intern teller som fremføres ved CST5 tidspunktet ved hjelp av klokkesignalet CSACLK.

Lasteoperasjonen blir utført på følgende måte. Til å begynne med genererer SMF 20 et systemslettesignal BSMCLR som genererer mastersynkrosignaler P0MSYN og P1MSYN i løpet av systemsletteoperasjonen og sperrer disse signalene når systemsletteoperasjonen er fullført. Dette forhindrer CPUO 4-2 og VMMUO 4-4 og CPU1 6-2 og VMMU1 6-4 sin operasjon. Porten 0 antas å være tilgjengelig og SMF 20 genererer en styre-lagerlastekommando med et kanalnummer med heksadesimal 00 og en funksjonskode med heksadesimal OD. Systembussgrensesnittet 2-10A reagerer på det heksadesimale kanalnummeret og funksjonskodesignalene for å generere lastestyrelagersignalet POCSLD som betinger portens 0 logikk. Lastesignalet PXCSLD og laste- og verifiseringssignalet PXCSLV blir så generert av lastestyreren 3-6.

SMF 20 sender så en kommando som har et kanalnummer med heksadesimal 00, en funksjonskode med heksadesimal 11 og en startstyrelageradresse med typisk heksadesimal 0000. Funksjonskodesignalene tilføres CNTL 0 2-15 for å generere signalene P0LADD og P0LSYN. Adressen lagres i telleren 3-4 via registeret 4-14, registeret 2-14, registeret 2-12, FIFO 2-34, mottakerene 2-30 og systembussen 2.

SMF 20 sender så en rekke med lesekommandoer for å opp-rettholde lageret 10 til 12 med portkanalnummer med heksadesimal 00 som initiering av delsystemet. Lesekommandoen innbefatter hovedlagerets 10 til 12 adresselagersteder ved hvilke er lagret et dobbeltord for styrelagerets 3-2 data.

Hovedlageret 10 til 12 sender en halvbusscykluskommando som har et kanalnummer med heksadesimal 00 i adressefeltet og 32 biter i datafeltet. Dataen mottas av registeret 4-14 via registeret 2-14, registeret 2-12, FIFO 2-34, mottakeren 2-30 og systembussen 2. Telleren 3-4 tilfører adressen til lagerstedet i styrelageret 3-2 som vil lagre dobbelordet. TElleren 3-4 inkrementerer en gang for hvert dobbeltord mottatt av registeret 4-14. Telleren 3-4 genererer skrive-klargjøringssignalet CSWE1 for det første dobbeltordet, skriveklargjøringssignalet CSWE2 for det andre dobbeltordet, skriveklargjøringssignalet CSWE3 for det tredje dobbeltordet og skriveklargjøringssignalet CSWE4 for for det fjerde dobbeltordet.

Det første dobbeltordet lagres i bitdelene 00-31 til styrelageret 3-2, det andre dobbeltordet lagres i bitposisjonen 32-63, det tredje dobbeltordet lagrees i bitposisjonen 64 til 95 og delene til det fjerde dobbeltordet lagres i bitposisjonene 96 til 103. Hvert 104 bitord innbefatter en paritetsbit som lagres i styrelageret 3-2. SMF 20 sender et tilstrekkelig antall hovedlagere 10 til 12 lesekommandoe3r for å laste styrelagrene 3-2 med nødvendige styrelagerord.

Verifiseringsmodus

Masterslettesignalet BSMCLR har tidligere forhindret signalet P0MSYN og P1MSYN fra cyklusføring for derved å sperre operasjonen til CPUO 4-2, VMMUO 4-4 og CPU1 6-2, VMMU1 6-4. Signalene P0LSYN og P1LSYN tilført styrelogikken 3-6 aktiverer imidlertid lastemodustidssignalene CST1 og CST4 og CST5 .

Etter at det nødvendige antall dobbeltord er sendt fra hovedlageret 10 til 12 under styring av SMF 20 sin leselagerkommando genererer SMF 20 tilbakestillingslastekommandoen som spesifiserer funksjonskoden med heksadesimal OF. Dette tilbakestiller signalet PXCSLD siden signalet POCSLD tilbakestilt ved styreren 0 2-15. Laste- og verifiseringssignalet PXCSLV forblir imidlertid innstilt. Signalet PXCSLV ble sendt ved starten av lasteoperasjonen ved lastestyreren 3-6 når enten signalene POCSLD eller P1CSLD fra styreren 0 2-15 eller styreren 1 2-25 ble satt.

Når lastesignalet PXCSLD er tilbakestilt og verifiseringssignalet PXCSLV forblir satt, generes SMF 20 porten på direktekoblings-kommandofunksjonskoden med heksadesimalet OB til å generere signalet P0MSYC eller P1MSYN i hhv. CNTL 0 2-15 eller CNTL 1 2-25. Disse signalene tilført til tidsgeneratoren 3-8 starter CPU-tidskjeden som innbefatter tidssignalene P0TM4 og P1TM4 da adressetelleren 3-14 er tilbakestilt til heksadesimal 0000 av tellerslettesignalet PXACLR fra lastestyreren 3-6 på første forekomst av signalene P0MSYN eller P1MSYN. Dette genererer signalet POCSVF eller signalet P1CSVF for å avslutte adressetellerens 3-4 tilbakestil-lingsoperasjon, når signalet PXACLR er tilbakestilt og klokkesignalet CSACLK begynner syklusføringen. I løpet av verifiseringsoperasjonen blir klokkesignalet CSACLK aktivert ved hvert klokkesignal for å inkrementere telleren 3-4 ved P0TM4 tidspunktet ved å verifisere signalet PXCSLV etter at lastesignalet PXCSLD er tilbakestilt.

Verifiseringsmodusen fortsetter inntil adressetelleren 3-4 genererer et CSDONE-signal som indikerer at adressetelleren 3-4 har lest innholdene til hvert lagersted til styrelageret 3-2 og har verifisert pariteten til hvert ord. Feilsignalet PXVFEE genereres dersom en paritetsfeil avføles. Dette bevirker at opptattsignalene POCSBY og P1CSBY fortsetter å indikere at porten er opptatt og forblir lagret i respektive syndromregister 2-13 eller 2-23.

SMF venter 10 millisekunder på at verifiseringen av operasjonen skal bli fullført og sender så kommandoen for å lese syndromregisteret 2-13 og 2-23. Kommandoen innbefatter funksjonskodens heksadesimal 00. Dersom det ikke har vært noen paritetsfeil, ville opptattbiten i adressesyndrom-registeret blitt tilbakestilt og normaloperasjonen ville fortsette.

Verifiseringsoperasjonen blir fullført når CSDONE-signalet genererer styrelagertilbakestillingssignalet POCSRT eller P1CSRT ved klokkesignaltiden P0TM4 avhengig av om porten 0 eller porten 1 var valgt. Tilbakestillingssignalet POCSRT eller P1CSRT tilbakestiller verifiseringssignalet PXCSLV og signalene POCSVF eller P1CSVF og POCSBY og P1CSBY.

Dersom SMF 20 finner at opptattbiten fremdeles er satt når syndromregisteret er lest, blir den egnede fastvaresekvensen på fig. 6 fulgt, dvs der kan være et nytt forsøk ved porten eller den andre porten til CSS kan bli forsøkt.

Kommandof ormater

Fig. 5A til 5E viser formater av forskjellige kommandoer anvendt ved den foretrukne utførelsesformen. Fig. 5A viser en leseportkommando. De mottagende CPU-kanalnummerne er spesifisert i adressebussens 2-6 bitposisjoner 8-17. Funksjonskodene er spesifisert i adressebussens 2-6 bitposisjoner 18-23. Kanalnummeret til SMF 20, det anmodende delsystemet, er spesifisert av databussens 2-4 bitposisjoner 0-9. Styrebussen 2-2 signaliserer BSYELO og BSMREF ved "1" og "0" indikerer hhv. at dette er en SMF 20 generert kommando. Signalet BSDBWD indikerer at 32 biter med data, et dobbeltord, fremkommer på databussen 2-4. Signalet BSDBPL indikerer at dobbeltordet er det siste dataordet til denne kommandoen. Bruken av denne kommandoen som en lesesyndromregisterkommando er vist på fig. 7. CPU-kanalnummeret er heksadesimal 00, som adresserer porten 0. Funksjonskoden er heksadesimalen 00 som initierer en lesesyndromregister-operasjon. SMF-kanalnummeret med heksadesimalen OF (posi-sjonert som heksadesimal 03C0) er mottagerstedet for innholdene til syndromregisteret som er sendt som en halvbussyklus (SHBC) kommando til SMF 20. SMF-kanalnummeret med heksadesimal OF er innbefattet i adressebussens 2-6 bitposisjoner 8-17 og inneholdene til syndromregisteret til porten 0 fremkommer ved databussens 2-4 bitposisjoner 0-31. Kommandobussens 2-2 signaler BSWRIT spesifiserer en busskriveoperasjon og BSSHBC spesifiserer at det er en reaksjon på en anmodning (en andre halvbussyklus). Fig. 5B viser en skriveportkommando. Et antall kommandoer vist i tidsdiagrammet på fig. 7 er ved formatet på fig. 5B. Lastemoduskommandoen, funksjonskoden med heksadesimal OD, innbefatter et datafelt med heksadesimal 0000 0000. Las-teadressetellerens kommandofunksjonskode med heksadesimal 11 innbefatter et datafelt som lagrer adressen til startlager-stedet for styrelageret 3-2 i hvilke det første 104 bitstyre-lagerordet er skrevet. Adressetelleren 3-4 er vanligvis lastet med heksadesimal 0000. Dersom hovedlageret 10 til 12 imidlertid har batterireserve, kan startadressen variere. Denne klargjør systemet for å lagre på nytt i styrelageret 3-2 akkurat en side av hovedlageret 10-12. Tilbakestillings-lastemoduskommandofunksjonskoden med heksadesimal OF innbefatter et datafelt på heksadesimal 0000 0000. Porten på linjekommandoen, funksjonskoden OB innbefatter et datafelt med heksadesimal 0000 0000.

Signalene BSMREF og BSYELO ved "0" og "1" indikerer respektive ved SMF 20 genererte kommandoer. Signalet BSSWRIT ved "1" indikerer en busskrivekommando. Fig. 5C viser formatet til et SMF til hovedlagerkommandoen og den andre halvbussyklusreaksjonen på denne kommandoen. 32 bitadressebuss 2-6 feltet 0-23, A-H lagrer hovedlageret 10-12 sine adressesteder. Databussbitene 0 til 9 lagerer kanalnummeret til det mottagende delsystem ved den foretrukne utførelsesformen som et CPU-kanalnummer. Kommandobussen 2-2 sitt signal BSMREF indikerer en lagerreferansekommando. Den andre halvbussykluskommandoen blir initialisert i hovedlageret 10 til 12. Databussen 2-4 sine biter 0-31 inneholder inneholdet til adresselagerstedene. Adressebussen 2-6 sine biter 8-17 inneholder kanalnummeret til mottagerstedet CPU. Kommandobussen 2-2 sine signaler BSMREF og MSSHBC ved logiske "0" og "1" indikerer respektivt at kommandoene generert av hovedlageret 10 til 14 er som reaksjon på lageranmodningskom-mandoen. Fig. 5D viser formatet til en I/O-utgangskommando som innbefatter kanalnummeret til I/O-anordningen, i dette tilfellet et diskdrev eller en floppydisk og en funksjonskode. Databussen 2-4 sine biter innbefatter lagerstedet for dataen på disken. Kommandoen har to formater, et konfigura-sjons A-format med en funksjonskode med heksadesimal 11 og en konfigurasjon B-format med en funksjonskode med heksadesimal 13.

Databussen 2-4 sine biter til konfigurasjonen A innbefatter et sylindrisk nummer dersom anordningen er harddisk eller et sylindernummeret og et spornummer dersom anordningen er en diskett.

Databussen 2-4 sine biter til konfigurasjonen B innbefatter sektor- og spornummer for harddisk eller sektornummer og bytetetthet for diskett. I/O-utgangskommandoen med en funksjonkode i heksadesimal 07 indikerer ved databussens 2-4 biter om dette er en søkeopera-sjon eller en automatisk søkeoperasjon. Autosøk anmoder om en søkning og så lesing.

Kommandobussen 2-2 sitt signal BSWRIT indikerer en busskriveoperasjon.

Fig. 5E viser en tosyklus inngangs/utgangslast (IOLD) utgangskommando. For den første syklusadressebussen 2-6 sine biter A-H, 0-7 lagrer 16 høyordensadressebiter og databussens 2-4 biter 0-15 lagerer 16 lavordensadressebiter. Høyordens-og lavordensadressebiter indikerer startadressen i hovedlageret 10 til 12 som vil lagre overførte første databytene fra disken til hovedlageret.

For den andre syklusen lagerer databussens 2-4 biter området som er det totale antall biter som hovedlageret 10 til 14 vil motta fra disken.

En funksjonskode med heksadesimal 09 spesifiserer den første syklusen til IOLD utgangskommandoen og en funksjonskode med heksadesimal OD spesifiserer den andre syklusen til IOLD utgangskommandoen. Også kanalnummeret til 1/0 anordningen blir spesifisert. Kommandobussens 2-2 signal BSWRIT spesifiserer en busskriveoperasjon.

Fig. 6 viser blokkdiagrammet til fastvaren som laster styrelageret 3-2 for CSS'ene 3 til 5. Styrelagerfastvaren lagres på enten en fast disk, en fjernbar disk, eller en diskett og blir overført under SMF 20 styring til hovedlageret 10 til 12. Dersom ingen feil ble funnet etter overføringen til hovedlageret, så blir styrelagerfastvaren overført til styrelageret 3-2 under SMF 20 styring. Dersom både CSS 3 og CSS 5 krever samme f astvarelasten, så blir begge først lastet og så utføres en gyldighetskontroll etter mottagelse av de respektive porter på direktekoblings-kommandoene. Dersom begge CSS'ene 3 og 5 ikke har samme fastvarelast, så blir styrelageret til CSS 3 lastet og verifisert og styrelageret til CSS 5 blir lastet og verifisert .

SMF 20 har en revisjonspost for styrelagerfastvare som hver CSS krever og verifiserer at egnet revisjon av styrelagerfastvaren er lastet inn i sin CSS. Man ser derfor at forskjellige CSS'er kan ha forskjellige funksjonsmessige avhengigheter ved spesielle revisjoner av styrelagerfastvaren som den mottar. SMF 20 lagrer hardwarerevisjonsnummeret til hver CSS. Hardwarerevisjonen bestemmer fastvarerevisjonen som skal bli anvendt for å laste styrelageret til CSS.

Med henvisning til fig. 6 starter blokken 100 fastvarerutinen som er lagret i ROM'en til SMF 20.

Blokken 101 kontrollerer om hovedlageret 10 til 12 har reservebatteri og lagrer informasjonen i lagerstedet til SMF RAM 20-44.

Blokken 102 lagrer en peker i et register i SMF mikroprosessoren 20-2. Pekeren er lagerstedet i SMF RAM 20-44 som lagrer styreinformasjonen for påfølgende bruk. SMF 20 fremviser så ordene RAMVARE STARTET på SMF fremvisningskonsollet 34, hjelpeskriveren 32 og/eller fjernkonsollen 42.

Blokken 106 kontrollerer at portene er tilgjengelige. Systembussgrensesni ttet til hver CSS har to porter. De to CSS'ene 3 og 5 vist på fig. 1 vil ha fire porter. Blokken 106 sender en lesekommando til hver port for å sende innholdene til syndromregisteret til SMF 20. Foreliggende hit satt i syndromregisteret indikerer at CPU er tilgjengelig. Porten 0 blir identifisert av et kanalnummer med heksadesimal 00, porten 1 av et kanalnummer med heksadesimal 01, porten 2 av et kanalnummer med heksadesimal 02 og porten 3 av et kanalnummer med heksadesimal 03.

Blokken 106 leser også hardwarerevisjonsbitene til syndromregisteret. Disse bitene indikerer revisjonen mot hvilken CSS er oppbygd. Bitene lagres i SMF RAM 20-44 for senere bruk.

Avgjørelsesblokken 108 bestemmer om noen av portene er tilgjengelig og om ikke, avbryter operasjonen via blokken 110. En melding vil bli fremvist som indikerer at der er problem som krever en operatør.

Blokken 112 velger kanalnummeret til disken som lagrer styrelagerfastvaren. SMF 20 lagerer det kanalnummeret i lagerstedet til SMF RAM 20-44. Der er et valg for bruk av en av de to kanalene til CSS for å motta fastvarelast fra hovedlageret 10 til 12. Dersom den første kanalen (porten) ikke er tilgjengelig, så blir det gjort forsøk på å laste fastvaren gjennom den andre kanalen (porten).

Blokken 114 lagrer hovedlagerstartadressen i SMF RAM 20-44. Dette er hovedlagerets lagersted i hvilket det først mottatte styrelagerfastvareord lagres. Typisk vil adressen være heksadesimal 1000. Enhver adresse kan imidlertid bli lagret og spesielt dersom hovedlageret 10 til 12 har reservebatteri. Blokken 116 sender et antall kommandoer fra SMF til disken eller diskettstyreren som styrer disklagringen av styrelagerfastvaren. Disse kommandoene innbefatter informasjon som indikerer sylindernummeret, spornummeret, sektornummeret, og dersom informasjonen er lagret på en diskett også byte-tettheten. Fastvarerevisjonsnummeret blir funnet ved å anvende CSS hardwarerevisjonsnummeret fra en oppslagstabell lest fra diskanordningen eller disketten. Denne ble anvendt for å generere veinavnet til fastvarelasten lagret på anordningen. Dette veinavnet ble anvendt av diskstyreren for å lokalisere fastvarelasteinformasjonen lagret på overflaten til anordningen.

Dersom der er et hovedlagerbatteribakcup (reservebatteri), vil kommandoene anmode om overføring av sider, typisk 2048 byter pr. side. Dersom det ikke er noe lagerbatteribakcup vil kommandoene anmode om overføring for alle styrelagerfastvare-ordene.

Dersom fastvarerevisjonsnummeret er funnet, så vil styre-lagerf astvareordene bli lagret i hovedlageret 10 til 12 som starter ved en typisk adresse heksadesimal 1000.

Dersom batteribakcup forefinnes, så vil enhver feil bevirke at den angjeldende siden blir overført fra disken. Dersom det ikke er noen batteribakup, er hele overføringen mistenkelig dersom noen feil forefinnes. Fremvisningskonsollen 34 vil indikere i blokken 120 at styrelagerfastvaren er fullstendig lastet inn i hovedlageret 10 til 14.

Avgjørelsesblokken 118 resulterer i et avbrudd via utløpet 110 dersom det i blokken 116 ikke ble funnet fastvare med riktig revisjonsnummer på disken.

Blokken 122 setter forsøk på ny biten i et register i SMF mikroprosessoren 20-2 for å indikere at dette er det første forsøket ved lasting av styrelageret 3-2. Blokken 122 fremviser så på fremvisningskonsollen 34 kanalnummeret til alle CSS portene som er tilgjengelige.

Avgjørelsesblokken 124 avbrytes til utløpet 110 dersom ingen port er tilgjengelig.

Blokken 126 vil velge å fremvise kanalnummeret til porten for CSS gjennom hvilken styrelagerfastvarebytene er overført fra hovedlageret 10 til 12. Rekkefølgen på prioriteten er kanalnumrene med heksadesimal 00, 02, 01, 03. Dette gir to veier for lasting av hvert styrelager.

I blokken 128 sender SMF 20 en kommando til hovedlageret 10 til 12 for å lese og sletten dens status og ID-registrene. Hovedlagerstatusregisteret er således slettet for lagring av resultater til ytterligere diagnoser.

Avgjørelsesblokken 130 indikerer et avbrudd til utløpet 110 dersom hovedlagerstatusen og ID-registrene ikke kan bli slettet. Dette viser en hovedlagerfeil som krever operatør-inngrep.

Blokken 132 setter opp lagerstatusstyreordet som er lagret i SMF RAM 20-44. Bitene indikerer om en ny type lager er installert, om lager er innfelt, om der var en ikke-korrigerbar feil i hovedlageret 10 til 12, om det er første passering gjennom fastvaren, om gjenforsøkfeil, om der er et hoved-lagergjenlasting, gjenforsøk.

Blokken 134 starter overføring av styrelagerfastvarebyter fra hovedlageret 10 til 12 til styrelageret 3-2 via den valgte porten. SMF 20 genererer først en kommando for å starte lastemodussekvensen. SMF genererer så en kommando som frembringer startstyrelageradressen, typisk heksadesimal 0000. Startadressen kan være enhver verdi i tilfelle nettopp en del av styrelageret er lastet.

Avgjørelsesblokken 136 forgrenses til gjenforsøksblokken 177 dersom der ikke er noen reaksjon fra den adresserte CPU'en. Dersom det etter et gjenforsøk fremdeles ikke er noen CPU reaksjon, så vil fastvaren foregrene seg til neste tilgjengelige port, dvs. port 0 til port 1 eller port 2 til port 3.

Dersom CPU operasjonen gjennom porten 0 ikke reagerer etter gjenforsøket, så blir et masterslettesignal sendt som kopler ned den CPU klokken og et gjenforsøk blir gjort via porten 1.

Blokken 138 overfører styrelagerbyter fra hovedlageret 10 til 12 til styrelageret. SMF 20 sender en lesehovedlager-kommando til hovedlageret 10 til 12 som innbefatter CPU kanalnummeret. I løpet av den andre halvbussyklusen blir derfor kommandoen fra hovedlageret 10 til 12, som innbefatter fire styredatabyter (en dobbeltordoverføring) sendt til og mottat av den adresserte CPU'en.

SMF 20 venter en forutbestemt tid, typisk syv mikrosekunder, på CPU'en for å motta det doble ordet og for å utføre ethvert gjenforsøk for en bussyklus.

SMF 20 vil motta et kvitteringssignal fra hovedlageret 10 til 12 for å avslutte kommandoen siden SMF 20 ikke vil motta dataord fra lageret.

Normal operasjon er for en enhet å sende ut en lageran-modningskommando med en hovedlageradresse og sitt eget kanalnummer som hovedlagerkvittering. Hovedlageret genererer en andre busshalvsykluskommando med innholdet til det adresserte hovedlagerets lagersted og kanalnummeret til sendeenheten. Mottagerenheten sender et kvitteringssignal som blir mottatt av hovedlageret som indikerer at data blir mottatt.

Blokken 140 leser hovedlagerstatusen og ID-registrene for å kontrollere feil på hovedlageret 10 til 12 til styrelageret 3-2 sin overføring. Dersom hovedlageret ID indikerer et innfelt lager, så blir statusordet til hvert lager undersøkt.

Avgjørelsesblokken 142 initierer et gjenforsøk ved å forgrene til blokken 144 dersom ingen feil. Dersom der er en feil, avsluttes avgjørelsesblokken 142 via blokken 110.

Blokken 144 lagrer feil og gjenforsøksbiter fra hovedlageret 10 til 12 i SMF RAM 20-44.

Avgjørelsesblokken 148 tester etter et hovedlager ikke-korrigerbar (røde) feil og en blokk 146 fremviser forekomsten av røde feil på fremvisningskonsollen 34.

Avgjørelsesblokken 160 tester om hovedlagergjenlaste-gjenforsøksbiten er sendt og om det forefinnes avbrudd i operasjonen i blokken 168.

Blokken 162 setter lagergjenlastegjenforsøksbiten dersom den ikke tidligere var satt.

Blokken 164 gjenlaster hovedlageret 10 til 12 fra disken som ved blokken 116. Som før, dersom der var hovedlager-batteribakup, er overføringen ved blokk, derfor er start-hovedlageradressen den til tidligere side som var feil. Dersom ingen batteribakup blir hele styrelagerfastvaren sendt fra disk til hovedlager 10 til 12.

Avgjørelsesblokken 166 tester igjen om data var funnet på disken. Dersom ingen bevirker blokken 168 et avbrudd i ramvarelastefremvisningen og fastvaren går ut i blokken 259. Det skal bemerkes at enhver blokk 110 avbryter utløp gjennom blokken 168 og 259.

Dersom avgjørelsesblokken 166 indikerer at data var funnet på disken og lagret i hovedlageret 10 til 12, så fremviser blokken 170 det faktumet at hovedlageret 10 til 12 er lastet. Blokken 133 forgrenes så til blokken 134 og operasjonen blir gj entatt.

Dersom avgjørelsesblokken 148 indikerer at der ikke var noen rød feil, så tilbakestiller blokken 150 hovedlagergjen-lasting, gjenforsøksbiten dersom satt.

Avgjørelsesblokken 152 indikerer om hovedlageret 10 til 12 er en ny type lager og om avgjørelsesblokken 154 tester gjenforsøksfeilbiten fra hovedlageret 10 til 12 som indikerer om dette er en gjenforsøksfeil om å sende data, så starter blokken 177 et gjenforsøk.

Dersom avgjørelsesblokken 152 indikerer lager av gammel type som ikke har en gjensøksbit, så vil ved blokken 156 SMF 20 sende en kommando for å lese syndromregisteret til porten som var brukt for å utføre lastingen.

Avgjørelsesblokken 158 tester om inneholdene til syndromregisteret ble mottatt av SMF 20. Dersom inneholdene ikke ble mottatt, starter så blokken 177 et gjenforsøk. Ellers tester avgjørelsesblokken 172 syndromregisteret lastefeilbiten. Dersom den er satt, så fremviser blokken 176 lastefeilen på fremvisningskonsollen 134.

Avgjørelsesblokken 178 starter gjenforsøksoperasjonen ved å teste om gjenforsøksbiten ved SMF RAM 20-44 lagerstedet er satt. Dersom gjenforsøksbiten ikke er satt, så setter blokken 180 gjenforsøksbiten, blokken 182 fremviser "portgjenforsøk" og blokken 133 forgrenes til blokken 134 for å gjenta lastingen av styrelageret 3-2.

Dersom avgjørelsesblokken 178 indikerer at gjenforsøksbiten er satt, så fremviser blokken 184 "portgjenforsøksfeilen og er avbrudt" på fremvisningskonsollen 34.

Blokken 186 tilbakestiller portgjenforsøksbiten og blokken 188 sender et masterslettesignal for å aktivere porten for å slå ned dens CPU.

Blokken 190 fjerner portkanalnummeret til den feilede porten fra listen over tilgjengelige porter.

Avgjørelsesblokken 192 tester om den andre porten til CSS var valgt. Dersom ikke, velger blokken 194 den andre porten.

Avgjørelsesblokken 196 tester om den andre porten er tilgjengelig. Dersom ikke, tester avgjørelsesblokken 198 om den andre CSS har en port tilgjengelig. Dersom en port til den andre CSS ikke er tilgjengelig, så tester avgjørelses-blokken 208 om noen port er tilgjengelig. Dersom ingen porter er tilgjengelig, så bevirker blokken 121 en forgrening til blokken 122 som fremviser at ingen porter er tilgjengelig.

Avgjørelsesblokken 123 tester at ingen porter er tilgjengelig og blokken 110 bevirker et avbrudd i lastingen.

Dersom avgjørelsesblokken 198 indikerer at den andre CSS hadde en port tilgjengelig, så tester avgjørelsesblokken 200 om porten var valgt. Dersom porten har blitt tidligere valgt, så velger blokken 207 den nest laveste kanalnummerporten.

Dersom avgjørelsesblokken 200 indikerer at porten fra den andre CSS ikke var tidligere valgt, så velger 202 porten til den andre CSS med det lavere kanalnummeret.

Avgjørelsesblokken 204 tester om den porten er tilgjengelig. Dersom ikke, velger blokken 206 den andre porten til den andre CSS.

Dersom avgjørelsesblokken 196 eller 204 indikerer at en port er tilgjengelig eller om blokken 206 valgte en port, så lagrer blokken 216 det portkanalnummeret i SMF RAM 20-44. Dersom avgjørelsesblokken 210 finner at styrelageret 3-2 ikke er fullstendig lastet, vil blokken 212 bevirke at neste side med data blir lest fra hovedlageret 10 til 12 og lagret i styrelageret 3-2 dersom hovedlageret 10 til 12 har batteribakcup. Dersom ikke, blir den fullstendige styrelager-fastvarelasten lest fra disken og lagret i hovedlageret.

Blokken 214 tilveiebringer kanalnummeret til den aktive porten og blokken 216 lagrer kanalnummeret i SMF RAM 20-44.

Blokken 218 skriver kanalnummeret til den valgte porten og blokken 133 forgrener blokken 134 for å innstille CSS i lastemodus og lagre styrelagerstartadressen i telleren 3-4.

Dersom avgjørelsesblokken 210 tester at styrelagrene er lastet, så setter blokken 220 opp en arbeidskanal i SMF RAM 20-44 for å preparere styrelagerverifiseringsoperasjonen.

Blokken 222 starter verifiseringsoperasjonen ved å sende to kommandoer, en tilbakestillingslastemoduskommando med en funksjonskode med heksadesimal OF, og en port-direkte-koplingskommando med en funksjonskode med heksadesimal OB. CPU leser ut styrelagerdata, kontroller paritet og foretar en kontrollsum.

Avgjørelsesblokken 224 kontrollerer at systembussgrensesnittet kvitterer for kommandoene. Dersom en feilreaksjon blir mottatt, forgrener blokken 177 til blokken 178 for gjen-forsøksoperasjonen. Dersom ingen feil resulterer ved avgjørelsesblokken 224, så utsetter blokken 226 ytterligere operasjoner av SMF 20 i 10 millisekunder for å sikre at verifiseringsoperasjonen blir fullført av CPU'en.

Blokken 228 sender en kommando til den aktive porten for å sende innholdene til syndromregisteret til SMF 20. Avgjørelsesblokken 230 tester at innholdene til syndromregisteret ble mottatt av SMF 20. Dersom innholdene ble mottatt, så tester avgjørelsesblokken 232 om opptattbiten er satt. Dersom innholdene til syndromregisteret ikke ble mottatt eller opptattbiten ble satt, så fremviser blokken 244 "feil ved verifisering" på fremvisningskonsollet 34 og blokken 246 sender et masterslettesignal til den aktive porten. Den opptatte biten forblir satt dersom verifikasjons-operasjonen ikke ble tilfredsstillende fullført.

Avgjørelsesblokken 248 tester om feilgjenfforsøksbiten i SMF RAM 20-44 er satt. Dersom feilgjenforsøksbiten er satt under indikasjon på at dette er den andre verifiseringsfeilen, så tilbakestiller blokken 252 den porttilgjengelige biten i SMF RAM 20-44 og SMF 20 ser etter en annen port. Dersom av-gjørelsesblokken 248 indikerer at verifiseringsfeil-gjenforsøksbiten ikke er satt, så blir den satt av blokken 250.

Dersom avgjørelsesblokken 232 indikerer at opptattbiten ikke er satt, så fremvises blokken 234 "port lastet" på fremvisningskonsollen 34. Blokken 236 setter portbrukt bit i SMF RAM 20-44 for senere bruk.

Blokken 238 tilbakestiller kanalnummeret til porten gjennom hvilken styrelageret blir tilfredsstillende lastet.

Blokken 240 tilbakestiller det første portflagget lagret i SMF RAM 20-44. Avgjørelsesblokken 242 kontroller om alle portkanalnumrene ble anvendt. Blokken 227 forgrener seg til blokken 228 dersom ikke tilfelle for å kontrollere syndrom-registrene til de andre portene.

Dersom avgjørelsesblokken 242 indikerer at portflaggene lagret i SMF RAM 20-44 ikke alle er slettet, så forgrenes blokken 227 til blokken 228 for å lese syndromregisteret. Dersom portflaggene alle er slettet, tester avgjørelses-blokken 254 SMF RAM for å bestemme om noen av portene er tilgjengelige for gjenforsøk. Dersom en er tilgjengelig for gjenforsøk, så forgrener blokken 121 til 122 for å starte et gjenforsøk av porten som krever et gjenforsøk som har det laveste kanalnummeret.

Dersom ingen port krever gjenforsøk ved avgjørelsesblokken 254, dvs. alle styrelagrene er lastet, så lagrer blokken 256 informasjonen at portkanalnummeret var lastet.

Avgjørelsesblokken 258 tester ordene i SMF RAM 20-44 som lagrer revisjonsnummeret til systembussgrensesnittene for to CSS'er. Dersom to revisjonsnummer er like, så oppdaterer blokken 264 konsollfremvisningen 34 med den informasjonen som indikerer at alle styrelagrene er lastet.

Blokken 266 starter kvalitetslogikktesten til CPU'en, blokken 268 konkluderer lastfastvarerutinen ved frakobling og blokken 270 spesifiserer slutten av lasterutinen og SMF er tilgjengelig for neste operasjon.

Dersom avgjørelsesblokken 258 indikerer at to revisjonsnummer ikke er like, så leser blokken 260 det nye hardware-revisjonsnummeret for den andre CSS. Blokken 262 erstatter det første CSS revisjonsnummeret med det andre CSS revisjonsnummeret i SMF RAM 20-44 lagerstedet. Blokken 111 forgrenses så til blokken 112 for å laste styrelageret til den andre CSS med fastvare til det nye revisjonsnummeret. CSS 3 ville ha dens styrelagerfastvare til en revisjon og CSS 5 ville ha dens styrelagerfastvare til en andre revisjon, som gir CSS 3 og CSS 5 forskjellige personaliteter.

Tidsdiagram

Fig. 7 viser et tidsdiagram på styrelagerets 3-2 last og verifiseringsoperasjonen som anvender porten 0, kanalnummeret med heksadesimal 00 til systembussgrensesnittet

2-10Å. Tidsdiagrammet til laste- og verifiseringsoperasjonen ved bruk av porten 1 er lignende. Den eneste forskjellen er at signalene P1XXXX erstatter signalene POXXXX i tidsdiagrammet på fig. 7.

SMF 20 generer et busslettesignal BSMCLR over systembussen 2 som starter alle delsystemene. Nærmere bestemt sperrer bakflanken til signalet BSMCLR POMSYN signalet som igjen stopper CPUO 4-2 og CPU1 6-2 ved å holde klokkeringtelleren (ikke vist) i tidsgeneratoren 3-8. CPUO 4-2 blir sperret for lasteoperasjonen, men aktivert for verifiseringsoperasjonen siden CPUO 4-2 vil verifisere pariteten til styrelagersignalene den mottar.

SMF 20 sender skriveportkommandoen på fig. 5B ut på systembussen 2 med et kanalnummer med heksadesimal 00 og funksjonskode med heksadesimal OD. Kanalnummeret, heksadesimal 00, aktiverer CNTL 0 logikk 2-15, jfr. fig. 3. Funksjonskode-heksadesimal OD genererer styrelagerlastesignalet POCSLD. Signalet POCSLD tilfører styrelagerlastestyreren 3-6 som genererer signalene PXCSLD som styrer styrelagerlasteopera-sjonen og signalet PXCSLV som styrer laste- og verifiseringsoperasjonen. Det skal bemerkes at signalene PCCSLD og PXCSLV genereres dersom kanalnummeradressen er enten port 0 eller port 1.

SMF 20 sender så en lasteadressetellerkommando i form av den på fig. 5B innbefattende kanalnummer med heksadesimal 00 og funksjonskoden med heksadesimal 11. CNTL 0 2-15 reagerer på funksjonskodesignalene for å generere lasteadressesignalet P0LADD og lastesynkronsignalet P0LSYN.

Lastesynkronsignalet P0LSYN tilføres tidsgeneratoren 3-8 for å starte styrelagertidsringen for å generere tellesignalene CST1 til CST5. Signalene PXCSLD og CST5 generere klokkesignalet CSACLK som tilfører telleren 3-4. Signalet PXLADD genereres av signalet P0LADD som blir tilført lastestyreren 3-6. Signalet PXLADD tilføres telleren 3-4 for å sette telleren til verdien for datafeltet til lasteadressekommandoen, i dette eksempelet heksadesimal 0000. SMF 20 sender så en rekke med kommandoer i form som vist på fig. 5C til hovedlageret 10-12. Adressefeltet inneholder lagerstedet i hovedlageret 10-12 for hvert dobbeltord (32 biter) til styrelageret 3-2. Datafeltet inneholder kanalnummeret til mottagende CPU-port, ved dette eksempelet heksadesimal 00. Det vil si SMF 20 genererer en leselagerkommando og lest data fra hovedlageret sendes til CPUO 4-2.

Den andre halvbussykluskommandoen CPUO 4-2 kanalnummeret med heksadesimal 00 i adressefeltet og inneholdet til det adresserte hovedlagerets lagersted i datafeltet.

Signalet P0LSYN starter tidsringen for hver andre halvbussyklus. Det dobbelte ordet mottatt av hovedlageret 10 til 12 via mottageren 2-30, FIFO 2-34, registeret 2-12, registeret 2-14 lagres i lasteregisteret 0 4-14 ved tidspunktet CST1. Skriveklargjøringssignalene CSV/El til CSV/E4 genereres ved tidspunktet C SV/E 4 for skriving av inneholdet til regiseret 4-14 inn i styrelageret 3-2 ved adressen spesifisert av telleren 3-4. Signalet CSACLK genereres ved CST5 tidspunktet for å inkrementere telleren 3-4. Styrelageret 3-2 er klargjort av signalet CSV/El for å skrive det første dobbeltordet, CSV/E2 for det andre dobbeltordet, CSV/E3 for det tredje dobbeltordet og C SV/E 4 for det fjerde dobbeltordet. Telleren 3-4 inkrementeres for hver andre halvbussyklus-kommando for å skrive de neste fire dobbeltordene i det spesifiserte styrelagerets 3-2 lagersted.

SMF 20 sender en tilbakestillingslastemoduskommando, fig. 5B med funksjonskode med heksadesimal OF, og kanalnummer med heksadesimal 00 etter at styrelageret 3-2 er fullstendig lastet. Dette resulterer i CNTL 0 2-15 tilbakestillingssignalet POCSLD. Dette tilbakestiller signalet PXCSLD og genererer telleren 3-4 sitt slettesignal PXACLE i lastestyreren 3-6.

SMF 20 sender en port-direktekoblingskommando i form som vist på fig. 5B, som innbefatter det heksadesimale 00 kanalnummeret og funksjonskoden med heksadesimalen OB. Denne kommandoen omstarter mastersynkronstyreren POMSYN og genererer også klokkesignalet CSACLK som i forbindelse med signalet PXACLR tilbakestiller adressetelleren 3-4 til heksadesimalen 0000.

Signalet POMSYN starter ringtelleren for å generere det sykliske signalet P0TME4 som igjen genererer signalet CSACLK for å inkrementere telleren 3-4. Innholdet til hver av adressestedene for styrelageret 3-2 er lastet inn i registerene 4-12 og 3-10 inntil signalet CSDONE er generert som indikerer at hele styrelageret 3-2 er blitt verifisert.

SMF 20 venter i 10 millisekunder etter sendingen av port-direktekoplingskommandoen for å sende syndromregister-kommandoen. Dette skulle være nok tid for en tilfredsstillende fullføring av verifiseringsoperasjonen. Lesesyndrom-registerkommandoen innbefatter kanalnummeret med heksadesimal 00 og funksjonskoden med heksadesimal 00. Innholdene til syndromregisteret 2-13 sendes ut på systembussen 2 via registrene 2-14, 2-11 og driverne 2-32. SMF 20 undersøker opptattbiten som blir satt av signalet POCSBY. Dersom opptattbiten er satt, så var styrelagerlasten ikke tilfreds-stillene fullført. I det tilfelle kan SMF 20 gjenta laste- og verifiseringsoperasjonen gjennom samme porten 0 eller forsøke å laste gjennom porten 1 ved å sende lastekommandoen med et kanalnummer med heksadesimal 01.

1 det påfølgende er vist de Bolske ligningene for signalene til den foretrukne utførelsesf ormen. Som på fig. 7 er kun porten 0 signalene vist som lik P0XXXX. Lignende ligning i form av signalet P1XXXX som tilført porten 1 er ikke vist siden signalene til porten 0 er beslektet med signalene til porten 1 sin logikk.

Sperresignalet POINHS sperrer mastersynkronsignalet POMSYN fra syklusføring etter at frontflanken til signalet BSMCLR som derved sperrer CPU 0 4-2.

POINHS = BSMCLR

Signalet POINHS tilbakestilles av port-direktekoblings-kommandoen som har en funksjonskode med heksadesimal OB for å tilbakestille signalet POMSYN.

Signalet POCSLD blir satt av lastemoduskommandoen som har funksjonskoden med heksadesimal OD.

hvor signalet FOCMEN indikerer en kvittert SMF syklus til kanalnummeret med heksadesimal 00 med adressesignalet

18 og signalet BSRINT.

Signalet POCSLD blir tilbakestilt av tilbakestillings-lastemoduskommandoen med en funksjonkode med heksadesimal OF.

Signalet POLADD blir satt av lasteadressekommandoen med funksjonskoden med heksadesimal 11.

Signalet POLADD "blir tilbakestilt ved slutten av systembussen 2 sin syklus.

Signalet POLSYN ble også satt av funksjonskoden med heksadesimal 11 og går syklusmessig gjennom hver systembuss 2 sin lese SHBC kommando for hvilke lastemodussignalet POCSLD blir satt.

Når signalet DOSHBA blir satt for hver FIFO 2-34 syklus som mottar kanalnummeret med heksadesimal 00 for en SHBC kommando.

Signalet PXCSLV blir satt for både laste- og verifiserings-operasjonene og tilbakestilt av tilbakestillingssignalet

POCSRT.

Signalet CSACLK blir syklusmessig ført gjennom i løpet av lastemodusen som følgende. I løpet av verifiseringsmodusen

Signalet PTOSEL er CPUO 4-2 valgsignalet.

Signalet CSACLK er sperret på slutten av verifiseringssignalet av signalet CSDONE.

Signalet PXACLR klargjør tilbakestillingen av adressetelleren 3-4 ved starten av verifiseringsmodusen.

Signalet PXACLR tilbakestilles av signalet POCSVF som settes som følgende. Signalet PXMCLE utfører masterslettefunksjonen.

Signal POCSRT tilbakestiller signalet POCSVF.

Signalet PSLDER indikerer en lastefeil og signalet PXVFER indikerer en verifiseringsfeil.

Opptattsignalet POCSBY indikerer at porten 0 utfører en funksjon og er ikke tilgjengelig for systembussens 2 kommandoer.

Dersom tilbakestillingssignalet POCSRT ikke settes, indikeres en laste- eller verifiseringsfeil, og signalet PXCSLV forblir satt. Opptattsignalet POCSBY blir derfor ikke tilbakestilt og forblir i syndromregisteret 2-13.

SMF 20 sender en lesesyndromregisterkommando, funksjonskode med heksadesimal 00 for å generere signalet POSSYE.

Signalet POSSYE klargjør utgangen til syndromregisteret 2-13.

Styrelagerskriveklargjøringssignalene 3-4 genereres i telleren 3-4.

En intern teller i telleren 3-4 genererer signaler CSADGO og CSADG1 (ikke vist) som har fire tilstander og er inkrementert ved hver SHBC kommando. Signalet

PXLDER

indikerer at ingen lastefeil blir detektert.

Oppfinnelsen har blitt beskrevet og vist med henvisning til henvisning til en foretrukket utførelsesform, men det er klart at modifikasjon og endringer vil være mulig innenfor oppfinnelsens ramme.

Claims (3)

1. Databehandlingssystem, innbefattende en systembuss, et første delsystem koblet med systembussen for å generere og sende over bussen en kommando som krever en reaksj onskommando, et andre delsystem koblet med systembussen for å motta kommandoen og generere og sende over bussen reaksj onskommandoen, karakterisert ved at kommandoen innbefatter et første felt som identifiserer et visst tredje delsystem av flere tredje delsystemer, et andre felt som identifiserer det andre delsystemet og et tredje felt som spesifiserer oppgaven som det andre delsystemet skal utføre på vegne av det tredje delsystemet, at reaksjonskommandoen innbefatter et første felt som spesifiserer det tredje delsystemet identifisert av det første feltet i kommandoen, at de tredje delsystemene er koblet til systembussen, idet hvert av de tredje delsystemene overvåker kommunikasjonsoverføringen på bussen og reagerer på et kommandofelt som identifiserer nevnte ene av de tredje delsystemene for akseptering av kommunikasjonsoverføringen på bussen, idet det ene av de nevnte tredje delsystemer identifisert av feltet i reaksjonskommandoen mottar reaksj onskommandoen.

2. System ifølge krav 1, karakterisert ved at det første delsystemet mottar et kvitteringssignal fra det andre delsystemet når det andre delsystemet mottar nevnte kommando.

3. System ifølge krav 1-2, karakterisert ved at det første delsystemet innbefatter tidsinnretning for å verifisere at reaksjonskommandoen er mottatt av det første delsystemet innenfor en forutbestemt tid dersom det første feltet identifiserer det første delsystemet, idet tidsinnretningen reagerer på kvitteringssignalet for sperring av tidsinnretningen når det første feltet identifiserer det tredje delsystemet.