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Circuit de synchronisation pour équipement ä champs de me sure numériques duplex.
Fondement de l'invention
La présente invention concerne des systèmes de transmission numeriques et, plus particulièrement, la synchronisation d'exemplaires multiples d'un équipement à champs de mesure numériques à multiplexage dans le temps.
Les systemes modernes de telecommunica- tions transmettent rapidement d'importantes quantities de données entre des systèmes. On utilise des champs de mesure numériques pour raccorder ces systèmes et pour transmettre ces données. Le systeme de commutation comporte habituellement un certain nombre de champs. de mesure numériques, chacun d'eux transmettant des données ä grande vitesse entre des systèmes de commutation.
Pour des raisons d'ordre public, ces systèmes de commutation doivent être hautement fiables. Afin d'obtenir cette fiabilité, ces systèmes sont souvent mis en oeuvre avec un équipement redondant. Ce schéma redondant est une façon de conférer, au système, une insensibilité aux défaillances. En d'autres mots, si une partie du Systeme vient ä défaillir, une seconde partie de ce Systeme exécute exactement le meme processus. Ce système fonctionne correctement, mais dans un mode simplex.
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L'équipement redondant fonctionne specifiquement dans un mode synchrone, empêchant ainsi le temps de panne total du système suite au passage d'un exemplaire de l'equipement ä l'autre. On prevoit également un moyen de détection de défaillances si les deux exemplaires different l'un de l'autre.
Dans les brevets des Etats-Unis d'Amérique nO 4. 531. 210 et 4. 507. 780, on décrit des unités de controle ä champs de mesure numériques duplex pour un système de ce type. Ce système est le système GTD-5 EAX fabriqué par IIGTE Communication Systems Corporation", ä savoir la Demanderesse de la presente demande. Ces brevets révèlent des unités de controle numériques en duplex fonctionnant en synchronisme. Toutefois, ces unités de contr8le numériques desservent un certain nombre de champs de mesure numériques et, par consequent, elles nécessitent une opération de multiplexage.
Ces unités de contrôle numériques fonctionnent spécifiquement comme exemplaires opérants et en reserve valides. Lorsqu'un exemplaire est hors service
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pour l'une ou l'autre raison, il doit etre resynchro- nie avec l'exemplaire opérant Parmi les raisons pour lesquelles un exemplaire est mis hors service, on peut mentionner des opérations régulièrement programmées d'entretien, de dépannage ou de réparation.
En conséquence, un objet de la présente invention est de fournir un circuit en vue de resynchroniser rapidement et avec precision des exemplaires multiples d'un equipement de controle ä champs de mesure numériques.
Sommaire de l'invention
Un certain nombre de champs de mesure
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numeriques raccordent un système de telecommunica- tions ä d'autres. Un système de télécommunications englobe une paire duplex d'unités de contr81e numériques fonctionnant en synchronisme. Chacune des unités de contr81e numériques fonctionne pour transférer des données entre plusieurs champs de me sure numériques et le réseau de commutation du système de telecommunications. La paire duplex d'unités de contrôle numeriques englobe une unite de contrôle numerique qui fonctionne en un état
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"en ligne et opérant", tandis que l'autre unite de contr81e numerique fonctionne dans l'état "hors ligne".
Chaque unité de contrôle numérique comporte un circuit de synchronisation.
Le circuit de synchronisation de chaque unite de contrôle numerique comporte une horloge qui intervient pour émettre des signaux périodiques de tranches de temps. Un générateur d'impulsions est raccorde à chacun des champs de mesure numériques. Le générateur d'impulsions intervient en
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réponse ä une indication révélant que l'autre exemplaire de l'unite de contr81e numerique est dans le mode"asservi ou non operant". Le generateur d'impulsions produit un train de bits de données, chaque bit de donnée ayant une première valeur logique prédéterminée.
Le générateur d'impulsions intervient également en réponse à un signal valide de bit S pour émettre, dans le train de bits de données, un signal de bit de donnée d'une seconde valeur logique prédéterminée. -
De meme, chaque circuit de synchronisation comprend une installation de raccordement entre les exemplaires. Cette installation est raccordee a l'horloge, aux champs de mesure numériques, ä sa propre unité de contrôle numérique correspon-
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dante, au générateur d'impulsions et à l'autre unité de contrôle numérique. L'installation de raccordement entre les exemplaires intervient en réponse au train de bits de donnees afin de transférer ce train a l'autre unité de contrôle numérique.
Enfin, l'autre unité de contrôle numérique intervient en réponse au train de bits de données et au signal de bit de donnée pour établir une transition de l'etat"hors ligne"ä l'état"en ligne et en réserve". De plus, l'autre unite de controle numérique synchronise sa mise en service avec 11 uni té de contrôle numérique"en ligne et opérante".
Brève description des dessins annexés
La figure 1 est un schéma bloc d'un systeme de commutation caracterisant l'interconnexion de champs de mesure numériques au système de commutation ä l'intervention d'unités de controle numériques ; la figure 2 est une structure de bits et de séquences de transmission Tl pour les champs de mesure numériques illustrés en figure 1 ; la figure 3 est un schéma bloc d'une partie de l'unite de controle numerique en vue de transférer des données entre les champs de mesure numériques et le réseau de commutation ; la figure 4 est un schema bloc de la partie de circuit QSIC { = Quad Span Interface Circuit :
circuit d'interface de champs de mesure quadratiques) de l'unite de mesure numerique ; la figure 5 est un schema iHustrant les principes'. de mise en oeuvre de la presente invention.
Description de la forme de réalisation préférée
En figure 1, on représente un réseau
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de commutation numérique temps-espace-temps conjointement avec l'unite de contrôle commune correspondante. Comme le montre cette figure, des postes d'abonnés téléphoniques tels que les postes d'abonnes 1 et 2 sont raccordés ä l'unit6 de ligne analogique 13. L'unité de ligne analogique 13 est raccordée aux deux exemplaires de l'unite de contrôle analogique 14 et 14'. Des minuteries de départ 20 et 20' sont raccordées à la paire en duplex d'unités de commutateurs d'espace 30 et 30', lesquels sont, ä leur tour, raccordés aux minuteries de terminaison 21 et 21'.
Les unités de minuteries et de contr81e 21 et 21' sont raccordées aux unites de contrôle analogiques 14 et 14'et, finalement, aux postes d'abonnés téléphoniques 1 et 2 via le circuit de ligne analogique 13.
Les unites de contrôle numériques 15 et 15'raccordent les champs de me sure numériques au réseau de commutation. L'équipement ä champs de mesure numériques peut être réalisé en utilisant un équipement ä champs de mesure numériques T1 habituellement disponible dans le commerce, tel que le modèle 9004 fabriqué par "Siemens Transmission Systems Inc. ". De Ja même manière, une unité interurbaine analogique 16 raccorde des circuits interurbains au réseau de commutation. numérique via des unités de contrôle analogiques 17 et 17'.
Un processeur périphérique CPU 70 contrôle le réseau de commutation numérique et des unites de contrôle numériques et analogiques. L'unité de ligne analogique 13 et une paire en duplex d'unités de contrôle analogiques 14 et 14' sont connectées directement aux postes d'abonnés télé-
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phoniques. Une paire double d'unités de controle numériques 15 et 15'controle les données PCM entrantes provenant des champs de mesure numériques.
De la même manière, l'unite interurbaine analogique 16 et une paire en duplex d'unites de controle analogiques 17 et 17'sont connectées à des circuits interurbains. Les unités de contrôle analogiques et numériques sont chacune en double pour des raisons de fiabilité.
La nature d'un équipement de transmission de données de champs de mesure numériques Tl et sa structure sont représentées en figure 2.
Chaque échantillon vocal est constitué de huit bits, PCMO-PCM7. PCMO est un bit de signe. Les bits PCMI-PCM7 indiquent l'amplitude de l'échantillon vocal. Le bit PCM1 peut également être utilise pour transmettre des indications d'alarme. Le bit PCM7 est utilisé pour transmettre des informations de supervision au cours des séquences 6 et 12.
Vingt-quatre échantillons vocaux sont organises ensemble avec un bit S pour former une séquence. Chaque échantillon vocal de la séquence est associé ä un canal de voix (ou de données). Les canaux Bont numérotés de 0 à 23.
Le bit S est doté d'une configuration apériodique qui, lorsqu'elle est detectée, est utilisée pour identifier le début de chaque séquence de donnees.
Douze sequences de données sont organisées pour former une"supersequence". Au cours des sequences 6 et 12 de la superséquence, le bit PCM7 est utilise pour transmettre des informations de supervision. associées ä chacun des 24 canaux. La configuration périodique des données transmises par le bit S lui permet également d'identifier les séquences
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individuelles faisant partie d'une supersequence.
La configuration que comporte le bit S, est la suivante (le premier bit est associe ä la sequence 0) : "100011011100". On peut constater qu'au cours des séquences impaires, le bit S forme une configuration alternée de "1" et de "O", soit 11101010". Cette configuration alternée est appelée "configuration TS" et elle est utilisée pour identifier la position de départ des séquences.
Au cours des séquences paires, le bit S a la configuration "001110", dans laquelle le premier "l"indique le debut de la sequence 6. Cette configuration est appelée "configuration FS" et elle est utilisée pour identifier la position ä l'intérieur d'une supersequence.
Chaque fois qu'apparaît un bit TS, un detecteur de sequences le compare avec la valeur qu'il escompte apercevoir (des "1" au cours des séquences 1, 5 et 9 ; des 11011 au cours des séquences 3,7 et 11). Si le bit TS est en discordance avec la valeur escomptée, il est considéré comme une erreur. Si deux erreurs apparaissent au cours de cinq examens consécutifs quelconques de bits TS pour un champ de mesure numérique (support T), on considère alors que ce champ de mesure numérique est hors sequence. Alors, intervient un état d'alarme. En fin de compte, une tentative sera entreprise pour remettre ce support T en séquence.
L'examen de bits FS est un procédé analogue à celui des bits TS.
Lorsqu'on tente d'effectuer une remise en séquence pour un champ de mesure numérique, le détecteur de sequence examine chaque position de bit pour une période de 16 sequences. Si n'importe quelle position de bit a été logiquement
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introduite au cours de séquences alternées, on supposera alors que cette position de bit est la position de bit correcte de mise en séquence, tandis que le contenu d'un vecteur d'ecriture sera remis ä jour pour refléter la nouvelle position de bit S.
Si la configuration TS est correctement alignée, mais si la configuration FS est en erreur, le détecteur de sequence incrémentera un vecteur d'ecriture de quatre positions de sequence. Tel sera le cas chaque fois que la configuration FS est en erreur jusqu'a ce que finalement, le vecteur d'ecriture soit correctement aligné avec la configuration FS entrante.
La figure 3 illustre une partie de l'unite de contrôle numérique. La figure 3 est un Schema bloc illustrant une unité de contrôle numérique de la paire duplex 15 et 15'comme represente en figure 1. L'unité de contr8le numérique est raccordée entre un certain nombre de champs de mesure numériques et le réseau de commutation.
La figure 3 représente le raccordement A un seul champ de mesure numérique. -
Le circuit QSIC raccorde jusqu'à 4 champs de mesure numériques au réseau de commutation.
L'entrée de donnees provenant d'un champ de mesure numérique est transmise, via le circuit QSIC au LCFD (= Line Compensator and Frame Detector Circuit : circuit compensateur de ligne et détecteur de mise en séquence). Ensuite, les données introduites sont transférées du circuit LCFD au circuit SUPY (= Supervisory : surveillance). Ensuite, les données sont transferees du circuit SUPY au réseau de commutation.
La sortie de données acheminées au champ
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de mesure numérique est transferee du reseau de commutation au champ de me sure numérique via le circuit SUPY et le circuit QSIC.
La figure 4 est un schéma bloc des sections de réception et de transmission du circuit QSIC. Dans la section de transmission, les données sont transférées du circuit SUPY au circuit QSIC.
La case 401 du circuit QSIC illustre la conversion para11èle/série des données. Comme le montre cette figure, la case 401 reçoit un groupe de positions binaires (8 bits) d'un courant de données parallèle, pour le convertir en un courant de données série.
Les données sont ensuite transferees au convertisseur 403 qui convertit des données de "non-retour à zéro" (NRZ) en données d'une structure de"retour ä zero" (RZ). Cette opération consiste à combiner logiquement, dans une porte "ET", les données avec l'horloge de transmission. La sortie est constituée de bits"l"logiques qui sont des impulsions de 324 nanosecondes,
Le convertisseur 405 traite les données unipolaires RZ et il les convertit en deux trains de bits paralleles bipolaires. Un de ces trains de bits indique les bits de donnees particuliers qui doivent etre transmis sous forme d'impulsions positives. L'autre train de bits indique les bits qui seront transmis sous forme d'impulsions negatives.
Les amplificateurs de puissance 407 sont constitues de portes OU. Ces portes OU amplifient la puissance des enroulements du transformateur. Les claviers et les égaliseurs 409 sont facultativement branchés dans le circuit en fonction de la longueur de la ligne allant du circuit QSIC au circuit de connexion transversale DS1. Le
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circuit de validation de sortie 411 détermine s'il s'agit de commander le transformateur de champs de mesure numeriques avec les données provenant de cet exemplaire de l'unité de contrôle numérique ou de l'autre exemplaire. Normalement, les sorties des transmetteurs des deux exemplaires QSIC sont raccordées en para11èle, cependant qu'un seul des transmetteurs est valide pour commander la ligne via le transformateur.
Le transmetteur en réserve est invalidé et il est amené dans un état de haute impédance, tandis que le transformateur opérant commande 1a ligne.
Pour des données repues par le système de commutation, le champ de me sure numérique transmet les données, via le transformateur, au récepteur bipolaire 421, lequel reçoit des données de structure de signaux DSl en les convertissant en données unipolaires. A ce stade, les données sont compatibles avec la logique transistor-transistor (TTL).
Toutefois, les données de sortie du convertisseur 421 sont dans la structure de"retour & zérolt.
La boucle entourant le circuit 423 sélectionne la source du signal d'entrée devant être transmis ä l'échantillonneur 425 ä 12 mégahertz.
Normalement, la sortie du récepteur bipolaire 421 est transmise à l'échantillonneur 425 ä 12 mégahertz. Dans le mode d'entretien, certaines configurations de signalisation prédéterminées peuvent etre transmises de la section du transmetteur et renvoyées ä l'entree du récepteur via la connexion au convertisseur unipolaire/bipolaire 405. L'échantillonneur 425 ä 12 megahertz synchronise les données reçues de la boucle entourant le circuit 423 a raison de 12, 352 megahertz en employant le signal d'horloge du réseau.
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Le convertisseur RZ/NRZ 427 est raccordé à l'echantillonneur 425 ä 12 megahertz. Le con- vertisseur 427 étire, ä 648 nanosecondes, les impulsions à 324 nanosecondes reçues en provenance de l'échantillonneur 425. L'extracteur d'horloge
429 est également raccordé à 1'échantillonneur 425. L'extracteur d'horloge fait appel a une boucle de blocage de phase numérique pour extraire un signal d'horloge de 1, 544 mégahertz de la sortie de l'échantillonneur 425. Le signal d'horloge prove- nant de l'extracteur d'horloge 429 esten phase avec le signal de donnée reçu de l'échantillonneur 425.
Ceci signifie que les flancs ascendants du signal d'horloge se manifesteront normalement au milieu de chaque sortie de bits de données gräce au convertisseur RZ/NRZ 427.
Les données d'entrée sont transmises via le circuit de sélection d'exemplaire hor-loge/ données 431. Ce circuit sélectionne un des exem- plaires de circuits QSIC pour commander les deux exemplaires du réseau de commutation. Un exemplaire du circuit QSIC intervient pour commander les deux exemplaires du réseau dans'un mode opérant en ligne, tandis que l'autre exemplaire du circuit
QSIC est dans un mode en réserve valide" tout en fonction- nant en synchronisme avec le circuit QSIC opérant.
Le circuit 431 intervient également pour maintenir la synchronisation entre les deux exemplaires d'unités de contrôle numériques lorsque l'exemplaire en réserve. effectue une transition de l'état "hors ligne" à l'état. "en ligne".
Le circuit 433 assure la conversion serie/parallele des données. Le circuit 433 regelt la sortie du convertisseur 427 et il la pointe dans un registre ä decalage en utilisant le signal
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d'horloge derive provenantde l'extracteur d'horloge 429. Lorsque les hüit. bits de données série ont été recueillis par le circuit serie/parallele 433, ils sont transférés au tampon récepteur de données 435 : ou ces 8 bits sont verrouilles. Le circuit LCFD lit ensuite les données provenant du tampon 435 au moment voulu.
La figure 5 illustre une partie du circuit 431 de sElection d'exemplaire horloge/données représenté en figure 4. Cette figure 5 illustre un exemplaire du circuit de sélection d'exemplaire horloge/donnes. Chaque exemplaire de l'unite de contr81e numérique comporte un tel circuit de sélection d'exemplaire.
Chaque exemplaire est raccordé ä l'autre via un conducteur qui indique que l'autre exemplaire est dans un mode asservi. Le mode asservi indique que cet exemplaire tente de se mettre en synchronisme avec l'exemplaire opérant. Cette indication du mode asservi est représentée par le signal HISSLV qui est transmis, sur le conducteur correspondant, & l'inverseur 501. L'inverseur 501 est raccordé ä l'inverseur 502. L'inverseur'502 est raccordé aux portes NON-ET 510,512, 514 et 516 en vue de distribuer le signal HISSLV. Les. inverseurs 501 et 502 assurent une possibilité de commande pour le signal HISSLV.
Comme représenté, quatre-champs de mesure numériques (champs de mesure 0 ä 3) sont raccordés au circuit. Un autre circuit (non représente) émet un signal de données et egalement une version inverse du signal de donnees. Par exemple, le champ de mesure 0 a transmis des données sur le conducteur SDATO, tandis que le signal inversé a été transmis sur le conducteur-SDATO, lequel
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est raccordé ä une porte NI 511. La porte NON-ET 510 est raccordée à la porte NI 511. La porte NI 511 émet le signal CDATO qui est le signal de données entre exemplaires, lequel est transmis à l'autre exemplaire si cet exemplaire du circuit est l'exemplaire "opérant" (les deux exemplaires DCU) (= unités de controle de données) opérants).
Le signal d'horloge SCLKO pour le champ de mesure 0 est transmis conjointement avec le signal de données si cet exemplaire du circuit est l'exemplaire opérant. Un signal correct de bit S (-SBVO) est transmis ä la porte NON-ET 510.
Les champs de mesure 1 ä 3 sont disposés de la meme manière. Pour le champ de mesure humé- rique 1, le signal SDAT1 est transmis directement au multiplexeur quadratique 2 : 1 535. Le signal - SDAT1 est transmis, via le conducteur correspondant, ä la porte NI 513. Un autre circuit indique s t il pense que le bit S obtenu ä ce moment est valide pour ce champ de mesure numérique particulier.
Cette indication de bit S valide est transmise, via le conducteur -SBV1, lequel est raccordé ä la porte NI 512. La sortie de la porte NI 513 est le signal CDAT1, lequel est transmis au circuit de commande ä trois états 530, via le conducteur correspondant. Pour le champ de mesure numérique 1, le signal d'horloge est transmis directement au circuit de commande, 530 et au multiplexeur MUX 535 via le conducteur SCLK1.
Pour le champ de mesure 2, le signal de bit S valide est. transmis, via le conducteur - SBV2, à la porte NON-ET 514. L'inverseur 502 est raccorde ä l'autre entree de la porte NON-ET 514. La sortie de la porte NON-ET 514 est raccordée a une entrée de la porte NI 515. Le signal de
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donnees inversé -SDAT2 est raccordé ä l'autre entrée de la porte NI 515. L'exemplaire non inversé du signal de donnee pour le champ de mesure numérique 2 est raccordé directement au multiplexeur MUX 545. La sortie de la porte NI 515 est raccordée, via le conducteur CDAT2, au circuit de commande à trois états 540.
Enfin, pour le champ : : de mesure numérique 3, le signal de donnée non inversé SDAT3 est raccorde directement au multiplexeur MUX 545 2 : 1. Le signal de donnée inversé est transmis à la porte NI 517 via le conducteur correspondant - SDAT3. L'inverseur 502 est raccordé ä une entree de la porte NON-ET 516. L'autre entree de la porte NON-ET 516 est le signal indicateur de bit S valide pour le champ de mesure numerique 3 (-SBV3). La porte NON-ET 516 est raccordée & l'autre entree de la porte NI 517. La sortie de la porte NI 517 est le signal CDAT3 transmis au circuit de commande ä trois etats 540 via le conducteur correspondant.
Le signal de réserve SBY est transmis, via le conducteur correspondant, au circuit de commande ä trois etats 530, ainsi qu'ä l'inverseur 520. L'inverseur 520 transmet le signal de reserve au circuit de commande ä trois etats 540 via une connexion correspondante. L'inverseur 520 est également raccorde a la porte NI 521 en vue de transmettre le signal SBY. En outre, un signal LOOP (= boucle) est transmis ä la porte NI 521 via un conducteur correspondant. Les deux premières sorties du multiplexeur MUX 535 sont les conducteurs DDATO et DCLKO. Ces conducteurs contiennent respectivement les signaux de données et d'horloge pour le champ de mesure numérique 0. En définitive, ces signaux sont transmis au circuit LCFD.
De meme,
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les sorties DDAT1 et DCLK1 du multiplexeur MUX 535 sont des signaux de données et d'horloge pour le champ de mesure numérique 1.
Les deux premières sorties du multi plexeur MUX 545 sont les signaux DDAT2 et DCLK2.
Ces signaux sont les signaux de données et d'horloge pour le champ de mesure numerique 2. De même, les sorties DDAT3 et DCLK3 du multiplexeur MUX 545 sont les signaux de données et d'horloge pour le champ de mesure numérique 3.
Les signaux d'horloge pour les champs de mesure. numériques 0 et 1t (SCLKO et SCLK1) sont transmis au circuit de commande à trois états 530 via des conducteurs correspondants. De même, les signaux d'horloge SCLK2 et SCLK3 sont transmis, via des conducteurs correspondants, au circuit de commande ä trois états 540. Les signaux d'horloge et les signaux de données positifs pour les, champs de mesure O. et l sont transmis chacun au multiplexeur MUX 535. Les sorties du circuit de commande à trois états 530 sont raccordées chacune aux entrees du multiplexeur MUX 535. Ces sorties englobent les signaux d'horloge pour les champs de mesure 0 et l, ainsi que les signaux de données entre exemplaires (CDATO et CDAT1) pour les champs de mesure 0 et 1.
En outre, les sorties du circuit de commande ä trois tats 530 sont raccordées chacune val l'autre exemplaire de ce circuit via les conducteurs BDATO et BCLKO (signaux de données et d'horloge pour le champ de mesure 0) et les conducteurs BDATI et. BCLKl (signaux de données et d'horloge pour le champ de mesure 1).
Les signaux d'horloge et les signaux de données positifs pour les champs de mesure numériques 2 et 3, sont raccordés chacun directement
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au multiplexeur MUX 545, via des conducteurs correspondants. Les signaux d'horloge pour les champs de mesure numériques 2 et 3 (SCLK2 et SCLK3) sont transmis au circuit de commande ä trois états 540.
En outre, les signaux de données entre exemplaires CDATtet CDAT3 sont transmis au circuit de commande ä trois etats 540 via des conducteurs correspondants.
Les sorties du circuit de commande ä trois états 540 sont raccordées chacune à une entrée du multiplexeur MUX 545. En outre, les sorties du circuit de commande à trois états 540 sont raccordées ä l'autre exemplaire. Les conducteurs BDAT2 et BCLK2 transmettent les signaux de données et d'horloge pour le champ de mesure numérique 2.
Les conducteurs BDAT3 et BCLK3 transmettent les signaux de données et d'horloge pour le champ de mesure numérique 3.
La sortie de la porte NI. 521 est raccordee aux entrees de selection des multiplexeurs MUX 535 et 545. Ce conducteur sélectionnera un signal de donnée particulier et un signal d'horloge associe en vue de le transmettre pour chaque champ de me sure numérique.
Ainsi qu'on l'a mentionné précédemment, un des exemplaires de ce circuit est l'exemplaire "opérant", tandis que l'autre est l'exemplaire en reserve valide.-Si l'exemplaire de ce circuit représenté en figure 5 est l'exemplaire "opérant", le signal de réserve SBY sera alors ä un 0 logique.
En consequence, les circuits de commande ä trois états 530 et 540 seront validés et cet exemplaire du circuit commandera les deux exemplaires du circuit LCFD en aval. Si celui-ci est l'exemplaire en réserve du circuit, les circuits de commande à trois états 530 et 540 sont invalidés et les
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signaux émis par l'autre exemplaire sont amenés à passer ä travers les multiplexeurs 535 et 545 pour commander chacun des circuits LCFD en aval.
Pour le reste de la presente description, on supposera que cet exemplaire du circuit est
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l'exemplaire"operant". L'exemplaire"en reserve" du circuit peut etre dans le mode"hors ligne" en raison du démarrage du circuit initial ou de la mise ä 11épreuve du système. Lorsqu'on désire que l'exemplaire en réserve devienne un exemplaire en réserve valide, il doit être synchronisé avec l'exemplaire"opérant". Le signal d'asservissement HIS (HISSLV) est émis lorsque l'unite'n réserve" doit etre synchronisée avec l'unité "opérante".
Ce signal reçoit une capacité de commande supplémentaire par les circuits de commande d'inverseurs 501 et 502. Chaque exemplaire de ce circuit indiquant stil pense que la synchronisation (bit S) qu'il a couramment, est valide. Par exemple, cette indication valide de bit S est fournie sur le conducteur -SBVO pour le champ de mesure numérique 0. Le champ de mesure numérique 0 sera utilise a titre d'exemple. Chacun des autres champs de mesure numériques intervient de la mêrne manière avec ses composants respectifs, ainsi qu'on l'a indiqué.
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Lorsque l'autre exemplaire du circuit tente d'assurer une synchronisation,. que le signal HISSLV est egal ä ün 1 logique et que le bit S que possède à ce moment ce circuit, est estimé valide,-SBVO est égal à un 0 logique. La porte NON-ET 510 fournit une sortie logique 0. Etant donné que cette entrée à la porte 511 est ä nouveau inversée, un 1 logique est introduit dans cette porte 511. En conséquence, la sortie de données
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est un train constant de "1" logiques.
La sortie de la porte 511 est le signal de données entre exemplaires CDATO. Etant donné que cet exemplaire du circuit est l'exemplaire "opérant", le circuit de commande à trois états 530 est validé et le signal CDATO est transmis
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à l'autre exemplaire. De ce fait, l'autre exem- plaire reçoit un train constant de bits "1" logiques pour chaque position de bit dans le train de données. Ceci se poursuit jusqu' ce que la position de bit S soit atteinte. Ensuite, le signal -SBVO passe ä un "O" logique. En conséquence, l'autre exemplaire du circuit constatera que la position valide de bit S indique un bit S valide.
Cette position particulière de bit S sera le seul bit du train de données pouvant être un "0" logique.
Etant donné que l'autre exemplaire de ce circuit a ä présent trouvé la Jneme position de bit S que cet exemplaire, la synchronisation des deux circuits sera assurée et l'autre exemplaire du circuit sera amené à l'état en reserve valide.
Les installations de déclenchement représentées pour les champs de mesure 1 à 3 interviennent chacunede manière semblable pour leurs champs de mesure numériques respectifs.
Bien que l'on ait illustré la forme@ de réalisation préférée de l'invention et que celle-ci ait été décrite en détail, l'homme de métier comprendra aisément que-diverses modifications peuvent y être apportées sans se départir de l'esprit de l'invention ou du cadre des revendications ci-après.