JPH01112462A - Cpu二重化計算機システムの通信方式 - Google Patents

Cpu二重化計算機システムの通信方式

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JPH01112462A
JPH01112462A JP62269434A JP26943487A JPH01112462A JP H01112462 A JPH01112462 A JP H01112462A JP 62269434 A JP62269434 A JP 62269434A JP 26943487 A JP26943487 A JP 26943487A JP H01112462 A JPH01112462 A JP H01112462A
Authority
JP
Japan
Prior art keywords
cpu
communication
computer
operation command
operating
Prior art date
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Pending
Application number
JP62269434A
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English (en)
Inventor
Mikio Koga
古賀 幹生
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Mitsubishi Heavy Industries Ltd
Original Assignee
Mitsubishi Heavy Industries Ltd
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Filing date
Publication date
Application filed by Mitsubishi Heavy Industries Ltd filed Critical Mitsubishi Heavy Industries Ltd
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  • Multi Processors (AREA)
  • Detection And Prevention Of Errors In Transmission (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、プラントの制御監視を実行する二重化CPU
を親局とするコンピュータネットワークシステム等に用
いて好適なCPU二重化計算機システムの通信方式に関
する。
〔従来の技術〕
従来、稼動系CPUと待機系CPUを備えた中央コンピ
ュータとローカルコンピュータとの間で、デュアルポー
トRAMを介し通信データを送受するシステムに於いて
、上記CPUの切替時に於ける通信データの連続性を確
保するための回路は存在しない。
〔発明が解決しようとする問題点〕
近年、コンピュータのネットワーク化が進み、このネッ
トワークを通して中央制御室よシ遠隔制御、監視を実施
するシステムが開発されている。
この遠隔制御監視用CPUは、システムの信頼性向上を
図92重化される場合が多い。
2つのCPUは稼動系、待機系にそれぞれ分れ稼動系異
常時等の稼動系/待機系切換操作指令入力時に稼動系C
PUと待機系CPUが切換ることになる。
ローカルコンピュータとの通信処理は、当然、稼動系コ
ンピュータが実行することになるが、通信の負荷低減の
ため、中央からの操作指令はオーダ発生時にイベント通
信される。この通信途上でCPU切換が実行された場合
、通信データ(特に制御信号)の内容がローカルコンビ
、−夕側よシ受信されないという場合が考えられ、この
際は制御の連続性が々くなシ、安全上好ましくない事態
が発生する。
本発明は、この2重化CPU切換の際の通信データを保
護することを可能とする。
〔問題点を解決するための手段〕
オペレータの操作指令・遮断指令を中央コンピュータよ
シ、ローカルコンピュータへ通信する処理を稼動系CP
Uに加えて待機系CPUにも同時実行させ、ローカルコ
ンビ、−夕側はこれも稼動系中央コンピュータが送信し
てくる稼動中CPU番号を見て、2チヤネルの受信デー
タ(稼動系CPUからの操作指令と待機系CPUからの
操作指令)よシ選択スることで、中央コンピュータの稼
動系−待機系の切換え時の中央コンビ、−夕からローカ
ルコンピュータへの通信データ(操作指令)の欠落を防
止する。
〔作用〕
2重化されている中央コンピュータに独立に割当てた操
作指令のイベント通信回線により、中央からの操作指令
が稼動系及び待機系CPUよシ並行して通信されてくる
ととKなる。ローカルコンビ、−夕は、この2系統のデ
ータ(操作指令)を、これも中央コンビ、−夕から送信
されてくる稼動系CPU番号をペースに選択することで
、中央コンビ、−夕のCPU切換時にもイベント通信操
作指令通信データの連続性を保護する。
〔実施例〕
先ず本発明で対象とするシステム構成の従来の通信技術
を第1図を参照して説明する。
中央制御室には、中央コンビ、−夕を構成する2重化C
PU (CPU 01及びCPU o z )が装備さ
れ、操作盤03からの操作指令を通信用デュアルポー)
 RAM 04 K ?イト(WRITE )すること
で、同操作指令が通信路05を経てローカルコンビュー
タデ、アルポートRAM 06へ送信される。ここでロ
ーカルコンビ、−夕07は、この操作指令をデ。
アルポー) RAM 06をリード(READ )する
ことで読敗υ、これに従うて対応する弁又はポンプ等を
動作させるために入出力装置08へ操作信号を出力する
ここで中央コンビ、−夕は、 CPU o z又はCP
U02が稼動系又は待機系に切換選択されておシ、稼動
系CPUのみが、通信用−rユアルyle−) RAM
 4の操作指令イベント通信エリア09に操作盤03か
らの操作指令をライトする。
この操作指令は、ローカルコンピュータ側データ受信用
デュアルポー) RAM 06の操作指令イベント受信
エリア010に伝送され、ローカルコンピュータ7は、
この操作指令をリードすることになるが、この操作指令
を操作盤03よシ受取シ稼動系CPUが操作指令イベン
ト受信エリア09に完全にライトする直前に待機系へ切
換えられる場合、この送信直前の操作指令はローカルコ
ンビ、−タ07へ伝送されないことになる。
そこで本発明の実施例では第2図に示す構成によシ上記
通信データ(操作指令)の欠落防止を図りている。
第2図に於いて、中央コンピュータを構成するCPU 
1及びCPU Jは、操作盤15からの操作指令を受取
シ、各々イベント通信用fユアルーートRAM 4の中
の操作指令イベント通信チャネル(CM−01)9、及
び同チャネル(CH−02)10へ操作指令をライトす
る。
同時に稼動系に選択され九〇PU (CPU J又はC
PU 2)は自分のCPU番号をサイクリック通信用デ
、アル/−) RAM 3の該当アドレスIIFCサイ
クリックにライトしている。これは同様にローカルコン
ビ、−夕8へ、サイクリック通信用デ、アル/ −) 
RAM 7の中の該当アドレス12を介して送信される
ローカルコンピュータ8にイベント通信割込を受けて、
すぐ、このCPU番号をリードして、中央コンビ、−夕
のどちらのチャネルを選択するかを決定し、もし、稼動
系CPU番号が“1#であれば、イベント受信エリアC
CH−o1)1sを、又、稼動系CPU番号が@2”で
あればイベント受信エリアCCH−o;t)x aを主
にリードして中央からの操作指令を受信することになる
ここで、もしCPU 2が稼動系から待機系へ、CPU
 2が稼動系へ切換えられたケースについて考えると両
系ともに操作指令イベント通信処理を継続シ、ローカル
コンビ、−夕8は、イベント通信割込を受けて各イベン
ト受信エリア13及び14の内容を比較し、内容が異な
りていれば、CPU番号を該当アドレス12よシ再度確
認して、稼動系CPU番号に相当するチャネル(ここで
はイベント受信エリア14)を中央からの操作指令とし
て捕えることKなる。第3図及び第4図に中央コンピュ
ータ及ヒローカルコンピュータの送受信処理の流れ図を
示す・ 〔発明の効果〕 以上述べた本発明によれば次のような効果を奏する。
(02重化CPU構成を有するシステムに於るCPU稼
動系−待機系の切換時に伴う重要な操作指令データの欠
落を防止できる。
(2)  止環に関連して稼動系CPU異常時に伴うC
PU停止待機系CPUの稼動系への自動切換の際に於て
も操作指令データを連続的に保護できる。
(3)  稼動系−待機系の各CPUよシ同時に操作指
令が通信されるシステムとすることで、通信回線上の異
常をチャネルのデータを比較することで検知することも
可能となる。
【図面の簡単な説明】
第1図は本発明で対象とするシステムの従来の構成を示
すブロック図、第2図は本発明の一実施例を示すブロッ
ク図、第3図及び第4図は上記実施例の主たる操作指令
の送信及び受信の処理フローを示すフローチャートであ
る。 1.2−・・CPU、3.7・・・サイクリック通信用
デ為アル/ −) RAM、 4 、 r;−、・イベ
ント通信用デュアルポー)RAM、!・・・通信路、s
−・・ローカルコンビ、−タ、9.10・・・操作指令
イベント通信チャ ′ネル(CH−01,CH−02)
、11.12・・・該当アドレス、13.14・・・イ
ベント受信エリア(CH−OJ * CH−() J 
) * 出願人6代理人  弁理士 鈴 江 武 彦中央コンビ
ューダ操作指令通信フロー 第3図 ローカルコンピュータ操作指令受信フロー第4図

Claims (1)

    【特許請求の範囲】
  1. 稼動系CPUと待機系CPUを備えた中央コンピュータ
    と、同コンピュータに通信路を介して接続されるローカ
    ルコンピュータとを備えた計算機システムに於いて、上
    記中央コンピュータの各CPUにそれぞれに独立した操
    作指令通信回路を割当て、中央コンピュータ側からの操
    作指令を上記各操作指令通信回線を介し並行してローカ
    ルコンピュータに送信することを特徴としたCPU二重
    化計算機システムの通信方式。
JP62269434A 1987-10-27 1987-10-27 Cpu二重化計算機システムの通信方式 Pending JPH01112462A (ja)

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JP62269434A JPH01112462A (ja) 1987-10-27 1987-10-27 Cpu二重化計算機システムの通信方式

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JP62269434A JPH01112462A (ja) 1987-10-27 1987-10-27 Cpu二重化計算機システムの通信方式

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JPH01112462A true JPH01112462A (ja) 1989-05-01

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ID=17472380

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