JPH01122370A - トランジスタインバータ装置 - Google Patents
トランジスタインバータ装置Info
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- JPH01122370A JPH01122370A JP62279919A JP27991987A JPH01122370A JP H01122370 A JPH01122370 A JP H01122370A JP 62279919 A JP62279919 A JP 62279919A JP 27991987 A JP27991987 A JP 27991987A JP H01122370 A JPH01122370 A JP H01122370A
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- Japan
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- transistors
- transistor
- parallel
- bridges
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野）
この発明は、複数のトランジスタをブリッジ接続して成
るトランジスタインバータ装置に関するものである。
るトランジスタインバータ装置に関するものである。
〔従来の技術］
第３図は例えば富士時報Ｖｏ１．５７．Ｎｏ、７．１９
８４に示された従来のトランジスタインバータ装置を示
す回路図であり、図において、（ＩＬ （２）は直流電
源に接続された入力端子、（３Ａ）、（３Ｂ）、（３Ｃ
）は入力端子（１）、（２）に接続され３相交流（Ｕ相
、■相、Ｗ相）を出力するトランジスタ群である。
８４に示された従来のトランジスタインバータ装置を示
す回路図であり、図において、（ＩＬ （２）は直流電
源に接続された入力端子、（３Ａ）、（３Ｂ）、（３Ｃ
）は入力端子（１）、（２）に接続され３相交流（Ｕ相
、■相、Ｗ相）を出力するトランジスタ群である。
ここで、トランジスタ群（３Ａ）は、上下一対のトラン
ジスタＱＬ］ｔ 、 ＱＸｉ（ｉ−ｔ、２．−、Ｎ）か
ら成ルアーム（トランジスタアーム）をＮ組並列に接続
されて構成され、Ｎ組の上下アームの両端がそれぞれ入
力端子（１）、（２）に接続されている。
ジスタＱＬ］ｔ 、 ＱＸｉ（ｉ−ｔ、２．−、Ｎ）か
ら成ルアーム（トランジスタアーム）をＮ組並列に接続
されて構成され、Ｎ組の上下アームの両端がそれぞれ入
力端子（１）、（２）に接続されている。
また、同様に、トランジスタ群（３Ｂ）も、ＱＶｉ 。
ＱＹｉ（ｉ・１．２．・・・、Ｎ）から構成され、入力
端子（１）、（２）に接続されるとともに、トランジス
タ群（３Ｃ）も、ＱＷｉ 、 ＱＺｉ（ｉ＝１，２．”
・、Ｎ）から構成され、入力端子（１）、（２）に接続
されている。
端子（１）、（２）に接続されるとともに、トランジス
タ群（３Ｃ）も、ＱＷｉ 、 ＱＺｉ（ｉ＝１，２．”
・、Ｎ）から構成され、入力端子（１）、（２）に接続
されている。
一方、第３図において、（４）、（５）、 （６）は３
相交流（それぞれＵ相、■相、Ｗ相）の出力端子であり
、これらの出力端子（４）、（５）、（６）はそれぞれ
出力ライン（４ａ）、 （５ａ）、（６ａ）に接続され
ている。そして、出力ライン（４ａ）、（５ａ）、（６
ａ）は、それぞれトランジスタ群（３Ａ） 、 （３８
） 、 （３Ｃ：）におけるＮ組のアームを並列に接続
している。
相交流（それぞれＵ相、■相、Ｗ相）の出力端子であり
、これらの出力端子（４）、（５）、（６）はそれぞれ
出力ライン（４ａ）、 （５ａ）、（６ａ）に接続され
ている。そして、出力ライン（４ａ）、（５ａ）、（６
ａ）は、それぞれトランジスタ群（３Ａ） 、 （３８
） 、 （３Ｃ：）におけるＮ組のアームを並列に接続
している。
また、（１０）は入力端子（１）、（２）に介装された
平滑コンデンサ、（１１）〜（１６）はそれぞれトラン
ジスタＱＬ］ｉ、ＱＶｉ、ＱＷＩ、ＱＸｉ、ＱＹｉ、Ｑ
Ｚｉ、（ｉ＝１．２． ・・・、Ｎ） （Ｄベースにベ
ース電流（ベースドライブ信号）を供給する端子である
。
平滑コンデンサ、（１１）〜（１６）はそれぞれトラン
ジスタＱＬ］ｉ、ＱＶｉ、ＱＷＩ、ＱＸｉ、ＱＹｉ、Ｑ
Ｚｉ、（ｉ＝１．２． ・・・、Ｎ） （Ｄベースにベ
ース電流（ベースドライブ信号）を供給する端子である
。
このように、従来のトランジスタインバータ装置は、３
相交流（Ｕ相、■相、Ｗ相）ごとに３つのトランジスタ
群（３Ａ）、 （３Ｂ）、（３Ｃ）に分離して構成され
ている。
相交流（Ｕ相、■相、Ｗ相）ごとに３つのトランジスタ
群（３Ａ）、 （３Ｂ）、（３Ｃ）に分離して構成され
ている。
次に動作について説明する。入力端子（１）、（２）か
ら入力される直流電流は、各トランジスタ群（３Ａ）、
（３Ｂ） 、 （３Ｇ）へ供給され、各トランジスタ群
（３Ａ）、（３Ｂ） 、 （３Ｇ）において交流変換が
行なわれた後、出力端子（４）、（５）、（６）から３
相交流（Ｕ相、■相、Ｗ相）が出力される。
ら入力される直流電流は、各トランジスタ群（３Ａ）、
（３Ｂ） 、 （３Ｇ）へ供給され、各トランジスタ群
（３Ａ）、（３Ｂ） 、 （３Ｇ）において交流変換が
行なわれた後、出力端子（４）、（５）、（６）から３
相交流（Ｕ相、■相、Ｗ相）が出力される。
ところで、従来のトランジスタインバータ装置では、各
トランジスタ群（３Ａ）、（３Ｂ）、（３Ｃ）に流れる
電流値は出力電流値と等しく、各群内の電流の不平衡の
検出が困難であった。
トランジスタ群（３Ａ）、（３Ｂ）、（３Ｃ）に流れる
電流値は出力電流値と等しく、各群内の電流の不平衡の
検出が困難であった。
従来のトランジスタインバータ装置は以上のように構成
されているので、各アーム内トランジスタの電流の不平
衡が生じた場合のトランジスタ保護が困難であり、トラ
ンジスタ破壊が生じる問題があった。
されているので、各アーム内トランジスタの電流の不平
衡が生じた場合のトランジスタ保護が困難であり、トラ
ンジスタ破壊が生じる問題があった。
この発明は上記のような問題点を解消するためになされ
たもので、トランジスタアームの並列数に無関係に各ト
ランジスタの電流不平衡の場合のトランジスタ保護を可
能にし、トランジスタを破壊から保護出来るトランジス
タインバータ装置を得ることを目的とする。
たもので、トランジスタアームの並列数に無関係に各ト
ランジスタの電流不平衡の場合のトランジスタ保護を可
能にし、トランジスタを破壊から保護出来るトランジス
タインバータ装置を得ることを目的とする。
（問題点を解決するための手段〕
この発明に係るトランジスタインバータ装置は、トラン
ジスタをブリッジ接続して成る３相ブリッジ回路を複数
組相互に並列に接続して構成するとともに、上記各３相
ブリッジ回路の同相出力ラインを並列に接続し、各３相
ブリッジ回路毎に過電流検出回路を設けたものである。
ジスタをブリッジ接続して成る３相ブリッジ回路を複数
組相互に並列に接続して構成するとともに、上記各３相
ブリッジ回路の同相出力ラインを並列に接続し、各３相
ブリッジ回路毎に過電流検出回路を設けたものである。
この発明におけるトランジスタインバータ装置では、３
相ブリッジ回路は１組単位で相互に並列に接続されるた
め、各３相ブリッジ回路に流れる電流はトランジスタの
１並列分であり、その各３相ブリッジ回路毎に過電流検
出回路を容易に設けることができ、安価で保護が確実な
トランジスタインバータ装置となる。
相ブリッジ回路は１組単位で相互に並列に接続されるた
め、各３相ブリッジ回路に流れる電流はトランジスタの
１並列分であり、その各３相ブリッジ回路毎に過電流検
出回路を容易に設けることができ、安価で保護が確実な
トランジスタインバータ装置となる。
〔実施例）
以下、この発明の一実施例について説明する。
第１図はこの発明の一実施例によるトランジスタインバ
ータ装置を示す回路図であり、この第１図において、（
１）、（２）は直流電源に接続された入力端子、（４）
、（５）、（６）は３相交流（それぞれＵ相、■相、Ｗ
相）の出力端子（４Ａ）、 （５Ａ）、（６Ａ）はそれ
ぞれ出力端子（４）、（５）、（６）に接続された出力
ラインである。
ータ装置を示す回路図であり、この第１図において、（
１）、（２）は直流電源に接続された入力端子、（４）
、（５）、（６）は３相交流（それぞれＵ相、■相、Ｗ
相）の出力端子（４Ａ）、 （５Ａ）、（６Ａ）はそれ
ぞれ出力端子（４）、（５）、（６）に接続された出力
ラインである。
また、（７−１）、（７−２）、・・・、 （７−Ｎ）
はそれぞれ３相ブリッジ回路であり、各３相ブリッジ回
路７−ｉ（ｉ＝１゜２、・、Ｎ） は、６個のトランジ
スタＱＵ ｉ 、 ＱＶ ｉ 、 ｌ ｉ 。
はそれぞれ３相ブリッジ回路であり、各３相ブリッジ回
路７−ｉ（ｉ＝１゜２、・、Ｎ） は、６個のトランジ
スタＱＵ ｉ 、 ＱＶ ｉ 、 ｌ ｉ 。
ＱＸｉ、ＱＹｔ、ＱＺｉ（ｉ＝１．２．・・・、Ｎ）を
ブリッジ接続して構成されている。つまり、トランジス
タＱＵｉ 、ＱＸｉと、トランジスタｑｖｉ、ｑｙｉ
と、トランジスタＱＷｉ 。
ブリッジ接続して構成されている。つまり、トランジス
タＱＵｉ 、ＱＸｉと、トランジスタｑｖｉ、ｑｙｉ
と、トランジスタＱＷｉ 。
ＱＺｉ とがそれぞれ対をなして３つのアームを形成し
、これらのアームは入力端子（１）、（２）に並列に接
続されている。
、これらのアームは入力端子（１）、（２）に並列に接
続されている。
さらに、（１０）は入力端子（１）、（２）に介装され
た平滑コンデンサ、（１１）〜（１６）はそれぞれトラ
ンジスタＱＵｉ、ＱＶｉ、ＱＷｉ、ＱＸｉ、ＱＹｉ、Ｑ
Ｚｉ（ｉ−１，２，・・・、Ｎ） ｔｆ）ベースにベー
ス電流（ベースドライブ信号）を供給する端子である。
た平滑コンデンサ、（１１）〜（１６）はそれぞれトラ
ンジスタＱＵｉ、ＱＶｉ、ＱＷｉ、ＱＸｉ、ＱＹｉ、Ｑ
Ｚｉ（ｉ−１，２，・・・、Ｎ） ｔｆ）ベースにベー
ス電流（ベースドライブ信号）を供給する端子である。
一方、（１７−１）、（１７−２）、・・・、 （１７
−Ｎ）はそれぞれ３相ブリッジ回路（７−１）、 （７
−２）、・・・、（７−Ｎ）における同相出力ラインと
してのＵ相比カラインであり、これらのＵ相比カライン
（１７−１）、（１７−２）、・・・、 （１７−Ｎ）
は出力ライン（４Ａ）に並列に接続される。また、（１
８−１）、 （１８−２）、・・・、（１８−Ｎ）はそ
れぞれ３相ブリッジ回路（７−１）、（７−２）、・・
・、（７−Ｎ）における同相出力ラインとしてのＶ相比
カラインであり、これらのＶ相比カライン（１８−１）
、（１８−２１、・・・、 （１８−Ｎ）は出力ライン
（５Ａ）に並列接続される。
−Ｎ）はそれぞれ３相ブリッジ回路（７−１）、 （７
−２）、・・・、（７−Ｎ）における同相出力ラインと
してのＵ相比カラインであり、これらのＵ相比カライン
（１７−１）、（１７−２）、・・・、 （１７−Ｎ）
は出力ライン（４Ａ）に並列に接続される。また、（１
８−１）、 （１８−２）、・・・、（１８−Ｎ）はそ
れぞれ３相ブリッジ回路（７−１）、（７−２）、・・
・、（７−Ｎ）における同相出力ラインとしてのＶ相比
カラインであり、これらのＶ相比カライン（１８−１）
、（１８−２１、・・・、 （１８−Ｎ）は出力ライン
（５Ａ）に並列接続される。
同様に、（１９−１）、（１９−２）、・・・、 （１
９−Ｎ）はそれぞれ３相ブリッジ回路（７−１）、（７
−２）、・・・、（７−Ｎ）におけ相同相出力ラインと
してのＷ相比カラインであり、これらのＷ相比カライン
（１９−１）、 （１９−２）、・・・、 （１９−Ｎ
）は出力ライン（６Ａ）に並列接続される。
９−Ｎ）はそれぞれ３相ブリッジ回路（７−１）、（７
−２）、・・・、（７−Ｎ）におけ相同相出力ラインと
してのＷ相比カラインであり、これらのＷ相比カライン
（１９−１）、 （１９−２）、・・・、 （１９−Ｎ
）は出力ライン（６Ａ）に並列接続される。
しかして、（２（１−１） 、 （２０−２） 、−、
（２０−Ｎ）は各３相ブリッジ回路（７−１）、（７−
２）、・・・、（７−Ｎ）の直流側に設けられた過電流
検出回路である。
（２０−Ｎ）は各３相ブリッジ回路（７−１）、（７−
２）、・・・、（７−Ｎ）の直流側に設けられた過電流
検出回路である。
次に動作について説明する。入力端子（１）、（２）か
ら入力される直流電流は、各３相ブリッジ回路（７−１
＋、（７−，２Ｌ・・・、（７−Ｎ）へ供給され、各３
相ブリッジ回路（７−１）、（７−２）、・・・、（７
−Ｎ）において交流変換が行なわれる。そして、変換さ
れた３相交流（Ｕ相、■相、Ｗ相）は相ごとに出力ライ
ン（１７−ｔ）、 （ｌａ−ｔ）、（１９−ｉ） （ｉ
−１，２，・・・、Ｎ）から出力ライン（４Ａ）、（５
Ａ）、（６＾）へそれぞれ出力される。
ら入力される直流電流は、各３相ブリッジ回路（７−１
＋、（７−，２Ｌ・・・、（７−Ｎ）へ供給され、各３
相ブリッジ回路（７−１）、（７−２）、・・・、（７
−Ｎ）において交流変換が行なわれる。そして、変換さ
れた３相交流（Ｕ相、■相、Ｗ相）は相ごとに出力ライ
ン（１７−ｔ）、 （ｌａ−ｔ）、（１９−ｉ） （ｉ
−１，２，・・・、Ｎ）から出力ライン（４Ａ）、（５
Ａ）、（６＾）へそれぞれ出力される。
ところで、この発明の実施例では、１組の３相ブリッジ
回路（７−ｉ） （ｉ＝１．２．・・・、Ｎ）を流れる
電流値は出力端子（４）、（５）、（６）における出力
電流値の１／Ｎ倍となり、トランジスタ１並列分しか流
れないので、１組の３相ブリッジ回路毎に、直流側又は
交流側に過電流検出回路を設けることにより、トランジ
スタ１並列毎（３相ブリッジ回路毎）の保護が可能とな
る。
回路（７−ｉ） （ｉ＝１．２．・・・、Ｎ）を流れる
電流値は出力端子（４）、（５）、（６）における出力
電流値の１／Ｎ倍となり、トランジスタ１並列分しか流
れないので、１組の３相ブリッジ回路毎に、直流側又は
交流側に過電流検出回路を設けることにより、トランジ
スタ１並列毎（３相ブリッジ回路毎）の保護が可能とな
る。
従来回路では上、下アームで並列回路を構成しており、
トランジスタ１並列毎の電流検出回路を設けることは困
難であり、並列トランジスタの電流不平衡が生じた時の
検出ができずトランジスタの破壊が生じる。本実施例の
回路では、３相ブリツジ毎に検出回路を設ける為、並列
トランジスタの電流不平衡が生じた場合でも確実にトラ
ンジスタの保護が可能となる。
トランジスタ１並列毎の電流検出回路を設けることは困
難であり、並列トランジスタの電流不平衡が生じた時の
検出ができずトランジスタの破壊が生じる。本実施例の
回路では、３相ブリツジ毎に検出回路を設ける為、並列
トランジスタの電流不平衡が生じた場合でも確実にトラ
ンジスタの保護が可能となる。
なお、第１図実施例は、３相ブリッジ回路（７−１）、
（７−２）、・・・、（７−Ｎ）の直流側に過電流検出
回路（２０−１）、（２Ｇ−２）、・・・、 （２Ｇ−
Ｎ）を設けたが、第２図の過電流検出回路（２１−１）
、（２１−２）、・・・、 （２１−Ｎ）、（２２−１
）、（２２−２）、・・・、 （２２−Ｎ）のように交
流側に設けても良いのは勿論である。
（７−２）、・・・、（７−Ｎ）の直流側に過電流検出
回路（２０−１）、（２Ｇ−２）、・・・、 （２Ｇ−
Ｎ）を設けたが、第２図の過電流検出回路（２１−１）
、（２１−２）、・・・、 （２１−Ｎ）、（２２−１
）、（２２−２）、・・・、 （２２−Ｎ）のように交
流側に設けても良いのは勿論である。
（発明の効果〕
以上のように、この発明によれば、トランジスタをブリ
ッジ接続して成る３相ブリッジ回路を複数組相互に並列
に接続して構成し、その３相ブリッジ回路毎に電流検出
回路を設けたので、トランジスタ破壊を確実に防止でき
る効果がある。
ッジ接続して成る３相ブリッジ回路を複数組相互に並列
に接続して構成し、その３相ブリッジ回路毎に電流検出
回路を設けたので、トランジスタ破壊を確実に防止でき
る効果がある。
第１図はこの発明の一実施例によるトランジスタインバ
ータ装置を示す回路図、第２図はこの発明の他の実施例
を示す回路図、第３図は従来のトランジスタインバータ
装置を示す回路図である。 図において、 （７−１）、（７−２）、・・・、（７−Ｎ） 、
３相ブリッジ回路、（１７−１）、（１７−２１，・・
・、（１７−Ｎ） ；同相出力ラインとしてのＵ相比
カライン、 （１８−１）、（１８−２）、・・・、（１８−Ｎ）
；同相出力ラインとしてのＶ相比カライン、 （１９−１）、（１９−２）、・・・、（１９−Ｎ）
；同相出力ラインとしてのＷ相比カライン、 ＱＵＩ、Ｑ［Ｉ２、・ＱＵＮ、ＱＶＩ、ＱＶ２、・、Ｑ
ＶＮ、ＱＷＩ、ＱＷ２、・ＱＷＮ。 ＱＸＩ、ＱＸ２、−、ＱＸＮ、ＱＹＩ、ＱＹ２、・、Ｑ
ＹＮ、ＱＺＩ、ＱＺ２、・、 ＱｚＮ：トランジスタ。 （２０−１）、＜２Ｏ−２）、・、（２０−Ｎ） ；
直流側過電流検出口（２１−１）、（２１−２）、・・
・、（２１−Ｎ）、 （２２−１）、（２２−２）、
・・・、（２２−Ｎ） ；交流側過電流検出回路。 なお、各図中、同一の符号は同−又は相当部分を示して
いる。 代理人 大 岩 増 雄 第１図 第２図
ータ装置を示す回路図、第２図はこの発明の他の実施例
を示す回路図、第３図は従来のトランジスタインバータ
装置を示す回路図である。 図において、 （７−１）、（７−２）、・・・、（７−Ｎ） 、
３相ブリッジ回路、（１７−１）、（１７−２１，・・
・、（１７−Ｎ） ；同相出力ラインとしてのＵ相比
カライン、 （１８−１）、（１８−２）、・・・、（１８−Ｎ）
；同相出力ラインとしてのＶ相比カライン、 （１９−１）、（１９−２）、・・・、（１９−Ｎ）
；同相出力ラインとしてのＷ相比カライン、 ＱＵＩ、Ｑ［Ｉ２、・ＱＵＮ、ＱＶＩ、ＱＶ２、・、Ｑ
ＶＮ、ＱＷＩ、ＱＷ２、・ＱＷＮ。 ＱＸＩ、ＱＸ２、−、ＱＸＮ、ＱＹＩ、ＱＹ２、・、Ｑ
ＹＮ、ＱＺＩ、ＱＺ２、・、 ＱｚＮ：トランジスタ。 （２０−１）、＜２Ｏ−２）、・、（２０−Ｎ） ；
直流側過電流検出口（２１−１）、（２１−２）、・・
・、（２１−Ｎ）、 （２２−１）、（２２−２）、
・・・、（２２−Ｎ） ；交流側過電流検出回路。 なお、各図中、同一の符号は同−又は相当部分を示して
いる。 代理人 大 岩 増 雄 第１図 第２図
Claims (1)
- トランジスタをブリッジ接続して成る３相ブリッジ回路
を複数組相互に並列に接続してトランジスタインバータ
装置を構成するとともに、上記各３相ブリッジ回路の同
相出力ラインを並列接続し、その各３相ブリッジ回路毎
に過電流検出回路を設けて、電流不平衡を検出可能にし
たことを特徴とするトランジスタインバータ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62279919A JPH01122370A (ja) | 1987-11-05 | 1987-11-05 | トランジスタインバータ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62279919A JPH01122370A (ja) | 1987-11-05 | 1987-11-05 | トランジスタインバータ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01122370A true JPH01122370A (ja) | 1989-05-15 |
Family
ID=17617738
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62279919A Pending JPH01122370A (ja) | 1987-11-05 | 1987-11-05 | トランジスタインバータ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01122370A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010121540A1 (en) * | 2009-04-21 | 2010-10-28 | Byd Company Limited | Controllable inverter and electric motor comprising the same |
| JPWO2021014574A1 (ja) * | 2019-07-23 | 2021-01-28 | ||
| EP4089907A1 (en) * | 2021-05-10 | 2022-11-16 | Hitachi Energy Switzerland AG | Three-phase inverter power module and three-phase inverter power device |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5347929A (en) * | 1976-10-14 | 1978-04-28 | Toshiba Corp | Current detection system in current type inverters |
| JPS5722385A (en) * | 1980-07-15 | 1982-02-05 | Hitachi Ltd | Pulse width modulation type converter |
-
1987
- 1987-11-05 JP JP62279919A patent/JPH01122370A/ja active Pending
Patent Citations (2)
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| US12301132B2 (en) | 2019-07-23 | 2025-05-13 | Tmeic Corporation | Multiple power conversion system |
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