JPH011335A - 雑音発生防止回路付送信機 - Google Patents

雑音発生防止回路付送信機

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Publication number
JPH011335A
JPH011335A JP62-155504A JP15550487A JPH011335A JP H011335 A JPH011335 A JP H011335A JP 15550487 A JP15550487 A JP 15550487A JP H011335 A JPH011335 A JP H011335A
Authority
JP
Japan
Prior art keywords
transmitter
frequency
circuit
phase comparator
digital phase
Prior art date
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Pending
Application number
JP62-155504A
Other languages
English (en)
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JPS641335A (en
Inventor
伸一 藤沢
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Publication date
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Priority to JP62-155504A priority Critical patent/JPH011335A/ja
Publication of JPS641335A publication Critical patent/JPS641335A/ja
Publication of JPH011335A publication Critical patent/JPH011335A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は送信機、特に周波数安定化のためにデジタルの
位相比較器を使用した送信機に関する。
[従来の技術] 従来、この柱の送信機は、周波数を安定化させるため、
例えば、自動位相制御回路(AI)C)、自動周波数制
御回路(AFC)が用いられている。
第2図には、従来のA )) C方式の送信機の一例が
示されており、同図において、4は電圧制御発振器<V
CO) 、5は分周器、6はデジタルの位相比較器、7
は基準周波数発生器、8はローパスフィルタ(LPF)
、9はミキサー、10は高周波増幅器、11は局部発振
器である。
そして、この送信機は、VCO4の出力信号のの周波数
を分周器5を用いて位相比較可能周波数まで分周し、デ
ジタル位相比較器6に入力している。
デジタル位相比較器6は、この分周信号と基準周波数発
生器7からの信号とを位相比較し、その比軸信号をL 
11 F 8を介して出力しVCO4の出力制御を行い
、発振器の周波数を安定化させている。
[解決しようとする問題点] しかし、従来の送信機は、電源起動時に、VCo4の発
振周波数が中心より離れた所から立ち上り、数秒から士
数秒かけて引き込まれる。
この過程の中で1.デジタル位相比較器6からは、連続
的なパルス信号が出力されずに、デユーティ〜の異なる
段階的なパルス13号が出力されるため、L ))F 
8はこの段階的なパルス信号を充分乎滑できずにノイズ
成分を含んだままVCo4に向は出力してしまう。
このノイズ成分により、VCo4からはFM変調された
信号が出力され、これが受信側ではノイズと12で観測
されるという問題があった。
本発明は、この様な従来の課題にかんがみてなされたも
のであり、その目的は、電源起動時にノイズを発生する
ことのない雑音発生防止回路付送信機を提供することに
ある。
し問題点の解決手段1 前記目的を達成するため、本発明は、 送信出力周波数安定化にデジタル位相比較器を使用して
いる送信機において、 電源起動時にデジタル位相比較器から発生するノイズを
検出するAPC電圧判定回路と。
電源起動時に、ノイズ発生が終了してから所定の遅延時
間経過後に送信を開始する遅延スイ・ソチ回路と、 を含む構成としている。
「実施例」 次に、本発明の好適な実施例を、図面にもとづき説明す
る。なお、第2図に示す従来装置と対応する部材には同
一符号を付してその説明は省略する。
第1図には、本発明に係る雑音発生防止回路付送信機の
好適な一実施例が示されている。
本実施例の送信機には、A P C電圧判定回路1、遅
延回路2、スイッチ3が設けられている。
そして、APC電圧判定回路1は、L P F 8から
出力されるVCO制御電圧の正常、異常を判別し、正常
時には[1]、異常時には「0」の信号を遅延回路2に
向は出力する。
遅延回路2は、APC電圧が正常になってから完全に周
波数がロックされるまでの間、スイッチ3をオーブンに
制御する。また、APC制御電圧が異常を示す場合にも
、直ちにスイッチ3をオーブンに制御する。
すなわち、電源オンしてからある一定時間は、A P 
C制御電圧は異常を示すため、A P C電圧判定回路
1は“0″のロジック信号を遅延回路2に送出する。
遅延回路2は、“0″のロジック信号入力時に直ちにス
イッチ3をオーブンに制御する。
次にAPC制御電圧が正常値になると、APC電圧判定
回路1は111 I+のロジック信号を発生し、遅延回
路2は、送信出力周波数がロックされるのに必要とされ
る遅延時間が経過した後に、スイッチ3をオン制御する
し発明の効果−1 以上説明したように、本発明によれば、電源起動時に、
VCOの発振周波数が中心より離れた所から立ち上がっ
ても、雑音が発生することのない送信機を提供できると
いう効果がある。
【図面の簡単な説明】
第1図は本発明に係るAPC周波数安定化方式の送信機
の一実施例を示すブロック回路図、第2図は従来のAP
C周波数安定化送信機を示すブロック回路図である。 1:APC電圧判定回路 2:遅延回路 3:スイッチ 4:VCo 5:分周器 6:位相比較器 7:基準周波数発生器 8 : LPF 9:ミキサー 10:高周波増幅器 11:局部発振器 代理人  弁理士  渡 辺 喜 平 箔1図 第2図

Claims (1)

  1. 【特許請求の範囲】 送信出力周波数安定化にデジタル位相比較器を使用して
    いる送信機において、 電源起動時にデジタル位相比較器から発生するノイズを
    検出するAPC電圧判定回路と、 電源起動時に、ノイズ発生が終了してから所定の遅延時
    間経過後に送信を開始する遅延スイッチ回路と、 を含むことを特徴とする雑音発生防止回路付送信機。
JP62-155504A 1987-06-24 雑音発生防止回路付送信機 Pending JPH011335A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP62-155504A JPH011335A (ja) 1987-06-24 雑音発生防止回路付送信機

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP62-155504A JPH011335A (ja) 1987-06-24 雑音発生防止回路付送信機

Publications (2)

Publication Number Publication Date
JPS641335A JPS641335A (en) 1989-01-05
JPH011335A true JPH011335A (ja) 1989-01-05

Family

ID=

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2006025300A1 (ja) * 2004-08-30 2006-03-09 Jms Co., Ltd. 冠状動脈バイパス手術用補助具

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2006025300A1 (ja) * 2004-08-30 2006-03-09 Jms Co., Ltd. 冠状動脈バイパス手術用補助具

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