JPH01199440A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH01199440A JPH01199440A JP63024219A JP2421988A JPH01199440A JP H01199440 A JPH01199440 A JP H01199440A JP 63024219 A JP63024219 A JP 63024219A JP 2421988 A JP2421988 A JP 2421988A JP H01199440 A JPH01199440 A JP H01199440A
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- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、各種電子機器に利用される半導体装置の製造
方法に関するものである。
方法に関するものである。
従来の技術
従来の技術を第2図a−cとともに説明する。まず第2
図aに示すように、セラミック、ガラス、ガラスエポキ
ン等よりなる配線基板1の導体配線2を有する面に絶縁
性の樹脂6を塗布する。導体配線2は0r−Au、ム(
1,Cu、ito等であり、樹脂5は熱硬化型又は紫外
線硬化型のエボキン、シリコーン、アクリル等である。
図aに示すように、セラミック、ガラス、ガラスエポキ
ン等よりなる配線基板1の導体配線2を有する面に絶縁
性の樹脂6を塗布する。導体配線2は0r−Au、ム(
1,Cu、ito等であり、樹脂5は熱硬化型又は紫外
線硬化型のエボキン、シリコーン、アクリル等である。
次に第2図すに示すように半導体素子3の電極4と導体
配線2とを一致させ半導体素子3に加圧し、配線基板1
に押し当てる。電極4はAe、ムu、Cu等である。こ
の時。
配線2とを一致させ半導体素子3に加圧し、配線基板1
に押し当てる。電極4はAe、ムu、Cu等である。こ
の時。
導体配線2上の樹脂6は周囲に押し出され、半導体素子
3の電極4と導体配線2は電気的に接触する。次に半導
体素子3を加圧した状態で上部より紫外線8を照射する
ことにより、半導体素子3周縁の樹脂5を硬化させ仮固
定する。更に第2図Gに示すように半導体素子3をF6
.Ae等よりなる加圧治具9にて加圧しながら加熱する
ことにより。
3の電極4と導体配線2は電気的に接触する。次に半導
体素子3を加圧した状態で上部より紫外線8を照射する
ことにより、半導体素子3周縁の樹脂5を硬化させ仮固
定する。更に第2図Gに示すように半導体素子3をF6
.Ae等よりなる加圧治具9にて加圧しながら加熱する
ことにより。
樹脂5全体を硬化させ、この時半導体素子3の電極4の
導体配線2は樹脂5の接着力により電気的接続がなされ
、同時に半導体素子3を配線基板1に固着することがで
きる。
導体配線2は樹脂5の接着力により電気的接続がなされ
、同時に半導体素子3を配線基板1に固着することがで
きる。
発明が解決しようとする課題
以上のように従来の技術では、半導体素子3の電極4を
配線基板1の導体配線2に直接接触させる方法であるた
め、多端子、狭ピンチの半導体素子3のパッケージング
に有利な方法であるが半導体素子3を加圧しなから熱硬
化する時において。
配線基板1の導体配線2に直接接触させる方法であるた
め、多端子、狭ピンチの半導体素子3のパッケージング
に有利な方法であるが半導体素子3を加圧しなから熱硬
化する時において。
高温時にいったん樹脂5の接着力が低下するため、配線
基板1上に仮固定された複数個の半導体素子3全てに対
し均等に加圧し、電気的に接触した状態を保持する必要
がある。そのため加圧を治具化すると、全ての半導体素
子3をひずみ等が生じないようにするため、治具9は第
2図Cに示すごとく犬がかりなものとなる。よって熱容
量が大きくなることより、熱硬化時での昇温時間及び冷
却時間も長くなり生産性が悪くなる。
基板1上に仮固定された複数個の半導体素子3全てに対
し均等に加圧し、電気的に接触した状態を保持する必要
がある。そのため加圧を治具化すると、全ての半導体素
子3をひずみ等が生じないようにするため、治具9は第
2図Cに示すごとく犬がかりなものとなる。よって熱容
量が大きくなることより、熱硬化時での昇温時間及び冷
却時間も長くなり生産性が悪くなる。
課題を解決するだめの手段
上記課題を解決するために本発明は、半導体素子固着用
の樹脂を熱硬化する際、真空包装装置を用いることによ
り、工法を簡易化し複数個の半導体素子全てを同時に均
一に加圧する方法としたものである。
の樹脂を熱硬化する際、真空包装装置を用いることによ
り、工法を簡易化し複数個の半導体素子全てを同時に均
一に加圧する方法としたものである。
作用
上記方法により真空包装状態で作用する大気圧の力で半
導体素子を加圧することができ量産性に優れ、半導体素
子にひずみを与えることがなくなる。
導体素子を加圧することができ量産性に優れ、半導体素
子にひずみを与えることがなくなる。
実施例
以下、本発明の一実施例を第1図a −aとともに説明
する。
する。
1ず第1図aに示すように、セラミック、ガラス、エポ
キシ等よりなる配線基板11の後に半導体素子13を固
着する部分に(導体配線12上を含ンテ)エポキシ、シ
リコーン、アクリル等よりなる絶縁性樹脂15を塗布す
る。導体配線12は0r−Au、Ae、ito等よりな
る。次に第1図すに示すように、半導体素子13の突起
状の電極14と導体配線12を一致させ半導体素子13
を配線基板11に加圧ツール16により加圧する。電極
14はAe、ムu、Cu等である。この時、導体配線1
2上の樹脂15は周囲に押し出され、上部より紫外線1
8を照射することによって半導体素子13の周縁部の樹
脂16を硬化させ仮固定する。上記の方法で複数個の半
導体素子13が仮固定された配線基板11を第1図Cに
示すように、ナイロン。
キシ等よりなる配線基板11の後に半導体素子13を固
着する部分に(導体配線12上を含ンテ)エポキシ、シ
リコーン、アクリル等よりなる絶縁性樹脂15を塗布す
る。導体配線12は0r−Au、Ae、ito等よりな
る。次に第1図すに示すように、半導体素子13の突起
状の電極14と導体配線12を一致させ半導体素子13
を配線基板11に加圧ツール16により加圧する。電極
14はAe、ムu、Cu等である。この時、導体配線1
2上の樹脂15は周囲に押し出され、上部より紫外線1
8を照射することによって半導体素子13の周縁部の樹
脂16を硬化させ仮固定する。上記の方法で複数個の半
導体素子13が仮固定された配線基板11を第1図Cに
示すように、ナイロン。
ポリプロピレン等からなる真空袋17に入れ、真 。
空包装し、複数個の半導体素子13全てに大気圧による
均等な圧力を加える。この状態のまま加熱することによ
って樹脂16全体を硬化させ、その接着力により半導体
素子13の電極14と導体配線12の電気的接続と半導
体素子13の機械的保持が完了される。
均等な圧力を加える。この状態のまま加熱することによ
って樹脂16全体を硬化させ、その接着力により半導体
素子13の電極14と導体配線12の電気的接続と半導
体素子13の機械的保持が完了される。
なお、真空包装後に圧力容器等に入れ、大気圧以上もし
くは以下の圧力を加えることが可能なのも明らかである
。
くは以下の圧力を加えることが可能なのも明らかである
。
発明の効果
本発明の効果を以下に示す。
(1)複数個の半導体素子を簡易に加圧することができ
るため、量産性に優れる。また、大気圧を利用するため
、圧力が均等に加わり、半導体素子に与えるひずみをな
くすることができ、高品質を得ることができる。
るため、量産性に優れる。また、大気圧を利用するため
、圧力が均等に加わり、半導体素子に与えるひずみをな
くすることができ、高品質を得ることができる。
(2)真空包装材の熱容量が小さいため、熱硬化時の昇
温時間、冷却時間を短かくでき、生産性が向上する。
温時間、冷却時間を短かくでき、生産性が向上する。
第1図a−cは、本発明の半導体装置の製造方法の一実
施例を示す各工程の断面図、第2図a〜Cは従来の技術
を示す各工程の断面図である。 11・・・・・・配線基板、12・・・・・・導体配線
、13・・・・・・半導体素子、14・・・・・・半導
体素子の電極、15・・・・・・絶縁性の樹脂、16・
・・・・・加圧ツール、17・・・・・・真空袋、18
・・・・・紫外線。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 ノ、夕 第2図 1 \
施例を示す各工程の断面図、第2図a〜Cは従来の技術
を示す各工程の断面図である。 11・・・・・・配線基板、12・・・・・・導体配線
、13・・・・・・半導体素子、14・・・・・・半導
体素子の電極、15・・・・・・絶縁性の樹脂、16・
・・・・・加圧ツール、17・・・・・・真空袋、18
・・・・・紫外線。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 ノ、夕 第2図 1 \
Claims (2)
- (1)導体配線を有した配線基板上に樹脂により半導体
素子が固着され、かつ前記半導体素子の電極と前記配線
基板の導体配線が圧接させ、前記半導体素子を前記配線
基板に真空包装による気圧を用いて加圧した状態で前記
樹脂の硬化を行なう半導体装置の製造方法。 - (2)半導体素子の電極が突起電極である請求項1記載
の半導体装置の製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63024219A JPH01199440A (ja) | 1988-02-04 | 1988-02-04 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63024219A JPH01199440A (ja) | 1988-02-04 | 1988-02-04 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01199440A true JPH01199440A (ja) | 1989-08-10 |
| JPH0519306B2 JPH0519306B2 (ja) | 1993-03-16 |
Family
ID=12132174
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63024219A Granted JPH01199440A (ja) | 1988-02-04 | 1988-02-04 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01199440A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6058021A (en) * | 1996-07-25 | 2000-05-02 | Sharp Kabushiki Kaisha | Structure of mounting a semiconductor element onto a substrate |
| JP2002359264A (ja) * | 2001-05-31 | 2002-12-13 | Sony Corp | フリップチップ実装方法及び装置、半導体装置 |
| JP2003077953A (ja) * | 2001-09-06 | 2003-03-14 | Sony Corp | フリップチップ実装方法及び装置、半導体装置 |
| JP2007184653A (ja) * | 2007-04-09 | 2007-07-19 | Hitachi Chem Co Ltd | マルチチップモジュールの実装方法 |
| US7456050B2 (en) * | 2003-07-01 | 2008-11-25 | Stmicroelectronics, Inc. | System and method for controlling integrated circuit die height and planarity |
-
1988
- 1988-02-04 JP JP63024219A patent/JPH01199440A/ja active Granted
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6058021A (en) * | 1996-07-25 | 2000-05-02 | Sharp Kabushiki Kaisha | Structure of mounting a semiconductor element onto a substrate |
| JP2002359264A (ja) * | 2001-05-31 | 2002-12-13 | Sony Corp | フリップチップ実装方法及び装置、半導体装置 |
| JP2003077953A (ja) * | 2001-09-06 | 2003-03-14 | Sony Corp | フリップチップ実装方法及び装置、半導体装置 |
| US7456050B2 (en) * | 2003-07-01 | 2008-11-25 | Stmicroelectronics, Inc. | System and method for controlling integrated circuit die height and planarity |
| JP2007184653A (ja) * | 2007-04-09 | 2007-07-19 | Hitachi Chem Co Ltd | マルチチップモジュールの実装方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0519306B2 (ja) | 1993-03-16 |
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