JPH01241175A - 非晶質シリコン薄膜トランジスタの製造方法 - Google Patents
非晶質シリコン薄膜トランジスタの製造方法Info
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- JPH01241175A JPH01241175A JP63068697A JP6869788A JPH01241175A JP H01241175 A JPH01241175 A JP H01241175A JP 63068697 A JP63068697 A JP 63068697A JP 6869788 A JP6869788 A JP 6869788A JP H01241175 A JPH01241175 A JP H01241175A
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- amorphous silicon
- impurity
- layer
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- H10D30/01—Manufacture or treatment
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- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
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- H10P32/10—Diffusion of dopants within, into or out of semiconductor bodies or layers
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-
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10P—GENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
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- H10P32/171—Diffusion of dopants within, into or out of semiconductor bodies or layers characterised by the semiconductor material being group IV material
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- Y10S148/03—Diffusion
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- Thin Film Transistor (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野]
本発明は非晶質シリコン(以下、a−3tという)薄膜
トランジスタ(以下、TPTいう)の製造方法に関する
ものである。
トランジスタ(以下、TPTいう)の製造方法に関する
ものである。
[従来の技術]
a−SiTFTは、アクティブマトリクス型液晶表示器
等への応用を目指して各所で研究開発が行われている。
等への応用を目指して各所で研究開発が行われている。
第5図は上記a−3iTFTを示した断面図である。同
図において、1は絶縁性基板、2はゲート電極、3はゲ
ート絶縁層、4は非晶質シリコン層、5はリンを適量含
んだn型シリコン層、6はソース電極、7はドレイン電
極、8はソース配線、9は画素電極、10は保護絶縁層
、11は遮光層、12は配向膜である。同図のようにゲ
ート電極2とソース電極6及びドレイン電極7が、ゲー
ト絶縁層3、非晶質シリコン層4を挟んで対向して形成
され、しかもゲート電極2がソース電極6及びドレイン
電極7よりも絶縁性基板1側に形成された構造を有する
TPTを、逆スタガー型のTPTという。
図において、1は絶縁性基板、2はゲート電極、3はゲ
ート絶縁層、4は非晶質シリコン層、5はリンを適量含
んだn型シリコン層、6はソース電極、7はドレイン電
極、8はソース配線、9は画素電極、10は保護絶縁層
、11は遮光層、12は配向膜である。同図のようにゲ
ート電極2とソース電極6及びドレイン電極7が、ゲー
ト絶縁層3、非晶質シリコン層4を挟んで対向して形成
され、しかもゲート電極2がソース電極6及びドレイン
電極7よりも絶縁性基板1側に形成された構造を有する
TPTを、逆スタガー型のTPTという。
[解決しようとする課題]
第6図は、上記逆スタガー型のa−SiTPTの静特性
を示したものである。
を示したものである。
同図(a)において、横軸はゲート電圧Vgを表し、縦
軸はドレイン電流1dを表している。同図(b)は測定
回路を表わしたものであるが、ソース・ドレイン間の電
圧Vd5=7.5 (ボルト)を一定にし、遮光層に印
加する電圧vbをvb−0(ボルト)または7−10(
ボルト)としている。
軸はドレイン電流1dを表している。同図(b)は測定
回路を表わしたものであるが、ソース・ドレイン間の電
圧Vd5=7.5 (ボルト)を一定にし、遮光層に印
加する電圧vbをvb−0(ボルト)または7−10(
ボルト)としている。
同図(a)かられかるように、Vb−−10(ボルト)
ではドレイン電流IdがVg−0<ボルト)付近から立
ち上がっているのに対し、vb−。
ではドレイン電流IdがVg−0<ボルト)付近から立
ち上がっているのに対し、vb−。
(ボルト)ではドレイン電流1dはVg−−15(ボル
ト)付近から立ち上がり、明らかに両特性は異なったも
のとなっている。
ト)付近から立ち上がり、明らかに両特性は異なったも
のとなっている。
第7図は、上記特性の違いが生じる理由を示したもので
ある。通常TPTを流れる電流は、ゲート絶縁層3と非
晶質シリコン層4の界面を流れる電流、即ち同図に示さ
れるAの経路を流れる電流が主たるものとなっている。
ある。通常TPTを流れる電流は、ゲート絶縁層3と非
晶質シリコン層4の界面を流れる電流、即ち同図に示さ
れるAの経路を流れる電流が主たるものとなっている。
しかしながらTPTでは、保護絶縁層10と非晶質シリ
コン層4の界面にも同図に示されるBの電流経路が存在
する。
コン層4の界面にも同図に示されるBの電流経路が存在
する。
従って、第6図の特性では、Vb−−10(ボルト)の
ときは上記電流経路Bが遮断され、一方Vb−0(ボル
ト)では同電流経路が遮断されず、同図のような特性に
なる。即ち、Vb−0(ボルト)のときのVg−−15
(ボルト)付近からの立ち上がり電流は、上記電流経路
Bによるものである。
ときは上記電流経路Bが遮断され、一方Vb−0(ボル
ト)では同電流経路が遮断されず、同図のような特性に
なる。即ち、Vb−0(ボルト)のときのVg−−15
(ボルト)付近からの立ち上がり電流は、上記電流経路
Bによるものである。
ところで、通常の使用状態では遮光層に電圧が印加され
ないためTPTの静特性はVb−0(ボルト)の特性の
ようになる。この様な特性は、TPTのオフ電流の増加
をもたらし、使用上はなはだ不都合であった。
ないためTPTの静特性はVb−0(ボルト)の特性の
ようになる。この様な特性は、TPTのオフ電流の増加
をもたらし、使用上はなはだ不都合であった。
本発明は、上記従来の課題に対してなされたものであり
、TPTのオフ電流を減少させることを目的としている
。
、TPTのオフ電流を減少させることを目的としている
。
〔課題を解決するための手段]
本発明は非晶質シリコン層の、ゲート電極と対向しない
背面側をアクセプタとなる不純物を含んだガスを少なく
とも有する気相雰囲気に晒し、電界または光のエネルギ
ーにより上記不純物を活性化させ、上記活性化した不純
物を上記非晶質シリコン層の背面側より、非晶質シリコ
ン層にドーピングすることにより、上記課題を解決する
ものである。
背面側をアクセプタとなる不純物を含んだガスを少なく
とも有する気相雰囲気に晒し、電界または光のエネルギ
ーにより上記不純物を活性化させ、上記活性化した不純
物を上記非晶質シリコン層の背面側より、非晶質シリコ
ン層にドーピングすることにより、上記課題を解決する
ものである。
また、上記アクセプタとなる不純物を含んだガスは水素
化合物であることが好ましく、更に上記気相雰囲気はア
クセプタとなる不純物を含んだガスと酸化性のガスによ
り形成されていることが好ましい。
化合物であることが好ましく、更に上記気相雰囲気はア
クセプタとなる不純物を含んだガスと酸化性のガスによ
り形成されていることが好ましい。
[実施例]
以下、本発明における一実施例を図面に基いて説明する
。
。
第1図において、1はガラス等の絶縁性基板、2はゲー
ト電極、3はゲート絶縁層、4は非晶質シリコン層、5
はn型シリコン層、6はソース電極、7はドレイン電極
、13はアクセプタとなる、不純物を含んだ不純物層、
14はアクセプタとなる不純物を含んだガスを有する気
相雰囲気である。
ト電極、3はゲート絶縁層、4は非晶質シリコン層、5
はn型シリコン層、6はソース電極、7はドレイン電極
、13はアクセプタとなる、不純物を含んだ不純物層、
14はアクセプタとなる不純物を含んだガスを有する気
相雰囲気である。
本例は、同図に示されるように、非晶質シリコン層4の
、ゲート電極と対向しない背面側4aをアクセプタとな
る不純物を含んだガスを有する気相雰囲気14に晒し、
」ユ記不純物を電界または光のエネルギーにより活性化
して、この不純物を非晶質シリコン層4の裏面4aより
非晶質シリコン層へドーピングするものである。アクセ
プタとなる不純物を含んだガスは水素化合物が好ましく
、B2H6(ジボラン)等を用いることができる。
、ゲート電極と対向しない背面側4aをアクセプタとな
る不純物を含んだガスを有する気相雰囲気14に晒し、
」ユ記不純物を電界または光のエネルギーにより活性化
して、この不純物を非晶質シリコン層4の裏面4aより
非晶質シリコン層へドーピングするものである。アクセ
プタとなる不純物を含んだガスは水素化合物が好ましく
、B2H6(ジボラン)等を用いることができる。
具体的には、これに更にH2を加え、プラズマによりこ
れらのガスを分解して、B(ボロン)を活性化させ、ド
ーピングを行なえばよい。
れらのガスを分解して、B(ボロン)を活性化させ、ド
ーピングを行なえばよい。
第2図は、上記TPTの不純物ドーピングを行なう前と
行なった後のエネルギーバンドを示したものである。同
図において、2はゲート電極、3はゲート絶縁層、4は
非晶質シリコン層、10は保護絶縁層、11は遮光層、
13は不純物層である。不純物ドーピングを行う前は、
非晶質シリコン層4と保護絶縁層10の界面の非晶質シ
リコン層はn型になっており、伝導帯下端E c s価
電子帯上端Evは下向き(第2図a)になっている。
行なった後のエネルギーバンドを示したものである。同
図において、2はゲート電極、3はゲート絶縁層、4は
非晶質シリコン層、10は保護絶縁層、11は遮光層、
13は不純物層である。不純物ドーピングを行う前は、
非晶質シリコン層4と保護絶縁層10の界面の非晶質シ
リコン層はn型になっており、伝導帯下端E c s価
電子帯上端Evは下向き(第2図a)になっている。
このため伝導帯下端EcはフェルミレベルEfに近すき
、可動電子により上記界面で電流経路を形成している。
、可動電子により上記界面で電流経路を形成している。
一方不純物ドーピングを行なった後は、上記界面の非晶
質シリコン層はP型になり、伝導帯下端Ec、価電子帯
上端Evは上向き(第2図b)になる。従って可動電子
による電流経路は形成されなくなる。
質シリコン層はP型になり、伝導帯下端Ec、価電子帯
上端Evは上向き(第2図b)になる。従って可動電子
による電流経路は形成されなくなる。
第3図は、上記製造方法によりa−3iTFTを形成し
たときのa−8iTFTの静特性を示したものである。
たときのa−8iTFTの静特性を示したものである。
同図(b)はその測定u路を示したものである。同図(
a)に示される特性Aは同図(b)のAのΔ11定回路
により測定を行なったものである。即ち遮光層の電圧V
b−0(ボルト)として、ゲート電圧Vgを−25(ボ
ルト)から25 (ボルト)に変化させたときのドレイ
ン電流Idを示したものである。ドレイン電流1dは0
(ボルト)付近から立ち上がり、従来みられたー15(
ボルト)付近から立ち上がる電流は消滅している。特性
Bは、同図(b)のBの測定回路により測定を行なった
ものである。即ちゲート電圧Vg=0 (ボルト)とシ
テ、Vbを−25(ボルト)から25(ボルト)に変化
させたときのドレイン電流を測定したものである。これ
は、非晶質シリコン層と保護絶縁層の界面に形成される
電流経路の特性を示したものと言える。同図から解るよ
うに電流はVb−17(ボルト)付近から立ち上がって
いる。
a)に示される特性Aは同図(b)のAのΔ11定回路
により測定を行なったものである。即ち遮光層の電圧V
b−0(ボルト)として、ゲート電圧Vgを−25(ボ
ルト)から25 (ボルト)に変化させたときのドレイ
ン電流Idを示したものである。ドレイン電流1dは0
(ボルト)付近から立ち上がり、従来みられたー15(
ボルト)付近から立ち上がる電流は消滅している。特性
Bは、同図(b)のBの測定回路により測定を行なった
ものである。即ちゲート電圧Vg=0 (ボルト)とシ
テ、Vbを−25(ボルト)から25(ボルト)に変化
させたときのドレイン電流を測定したものである。これ
は、非晶質シリコン層と保護絶縁層の界面に形成される
電流経路の特性を示したものと言える。同図から解るよ
うに電流はVb−17(ボルト)付近から立ち上がって
いる。
以上の説明から、上記製造方法を用いて形成さたa−S
iTFTでは、非晶質シコン層背面側にアクセプタとな
る不純物をドーピングした為、背面側の非晶質シリコン
層がP型化し、非晶質シリコン層と保護絶縁層の界面に
形成される電流経路は、遮光層にある程度の正電圧を印
加しないと形成されないことが解る。従って従来みられ
た非晶質シリコン層と保護絶縁層の界面に形成される電
流経路に流れる電流に起因するオフ電流の増加を皆無に
することができる。
iTFTでは、非晶質シコン層背面側にアクセプタとな
る不純物をドーピングした為、背面側の非晶質シリコン
層がP型化し、非晶質シリコン層と保護絶縁層の界面に
形成される電流経路は、遮光層にある程度の正電圧を印
加しないと形成されないことが解る。従って従来みられ
た非晶質シリコン層と保護絶縁層の界面に形成される電
流経路に流れる電流に起因するオフ電流の増加を皆無に
することができる。
第4図゛は、本発明における他の実施例を示したもので
ある。これは上記実施例と同様に不純物を形成したあと
、不純物層13をa−8iTFTの中央部のみに残した
ものであるが、この不純物層13が存在する箇所で、界
面の非晶質シリコン層4はP型化しているため、この箇
所で電流経路は遮断されることになり、上記実施例と同
様の効果を得ることができる。
ある。これは上記実施例と同様に不純物を形成したあと
、不純物層13をa−8iTFTの中央部のみに残した
ものであるが、この不純物層13が存在する箇所で、界
面の非晶質シリコン層4はP型化しているため、この箇
所で電流経路は遮断されることになり、上記実施例と同
様の効果を得ることができる。
なお、a−8iTFTをアクティブマトリクス型液晶表
示器に用いる場合、不純物をドーピングするときに画素
電極となる170層が表面に露出している場合があるが
、このときには170層が還元されないようにするため
、気相雰囲気はアクセプタとなる不純物を含んだガスと
、酸化性のガス例えばN 01CO2等により形成され
ていることが好ましい。
示器に用いる場合、不純物をドーピングするときに画素
電極となる170層が表面に露出している場合があるが
、このときには170層が還元されないようにするため
、気相雰囲気はアクセプタとなる不純物を含んだガスと
、酸化性のガス例えばN 01CO2等により形成され
ていることが好ましい。
[発明の効果]
本発明によれば、電界あるいは光のエネルギーによりア
クセプタとなる不純物を活性化し、これを非晶質シリコ
ン層の背面側からドーピングするため、この背面側の非
晶質シリコン層はP型化し、非晶質シリコン層と保護絶
縁層の界面に、電流経路を形成しないため、上記電流経
路に起因するオフ電流の増加を皆無にすることができ、
非晶質シリコン薄膜トランジスタの特性向上に大きく寄
与する。 ゛
クセプタとなる不純物を活性化し、これを非晶質シリコ
ン層の背面側からドーピングするため、この背面側の非
晶質シリコン層はP型化し、非晶質シリコン層と保護絶
縁層の界面に、電流経路を形成しないため、上記電流経
路に起因するオフ電流の増加を皆無にすることができ、
非晶質シリコン薄膜トランジスタの特性向上に大きく寄
与する。 ゛
第1図は本発明の一実施例の製造方法によって製造した
非晶質シリコン薄膜トランジスタの断面図、第2図は不
純物ドーピング前およびドーピング後におけるエネルギ
ーバンドを示した説明図、第3図は第1図の構成の静特
性を示した特性図、第4図は本発明の他の製造方法によ
って製造した非晶質シリコン薄膜トランジスタを示した
断面図、第5図は従来の非晶質シリコン薄膜トランジス
タを示した断面図、第6図は第5図の従来例における静
特性を示した特性図、第7図は第5図の非晶質シリコン
薄膜トランジスタの電流経路を示した断面図である。 4・・・非晶質シリコン層 4a・・・背面側 6・・・ソース電極 7・・・ドレイン電極 14・・・気を1雰囲気 以 上 出 願 人 日本プレシジョン サーキッツ株式会吐 出 願 人 株式会社精工舎
非晶質シリコン薄膜トランジスタの断面図、第2図は不
純物ドーピング前およびドーピング後におけるエネルギ
ーバンドを示した説明図、第3図は第1図の構成の静特
性を示した特性図、第4図は本発明の他の製造方法によ
って製造した非晶質シリコン薄膜トランジスタを示した
断面図、第5図は従来の非晶質シリコン薄膜トランジス
タを示した断面図、第6図は第5図の従来例における静
特性を示した特性図、第7図は第5図の非晶質シリコン
薄膜トランジスタの電流経路を示した断面図である。 4・・・非晶質シリコン層 4a・・・背面側 6・・・ソース電極 7・・・ドレイン電極 14・・・気を1雰囲気 以 上 出 願 人 日本プレシジョン サーキッツ株式会吐 出 願 人 株式会社精工舎
Claims (3)
- (1)ソース電極およびドレイン電極間に位置する非晶
質シリコン層の、ゲート電極と対向しない背面側を、ア
クセプタとなる不純物を含んだガスを少なくとも有する
気相雰囲気に晒し、電界または光のエネルギーにより上
記不純物を活性化させ上記活性化した不純物を上記非晶
質シリコン層の上記背面側より非晶質シリコン層にドー
ピングすることを特徴とする非晶質シリコン薄膜トラン
ジスタの製造方法。 - (2)上記アクセプタとなる不純物を含んだガスが水素
化合物であることを特徴とする請求項1記載の非晶質シ
リコン薄膜トランジスタの製造方法。 - (3)上記気相雰囲気が、アクセプタとなる不純物を含
んだガスと酸化性のガスにより形成されていることを特
徴とする請求項1記載の非晶質シリコン薄膜トランジス
タの製造方法。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63068697A JPH01241175A (ja) | 1988-03-23 | 1988-03-23 | 非晶質シリコン薄膜トランジスタの製造方法 |
| US07/322,842 US4916090A (en) | 1988-03-23 | 1989-03-13 | Amorphous silicon thin film transistor and method of manufacturing the same |
| US07/626,375 US5045905A (en) | 1988-03-23 | 1990-12-12 | Amorphous silicon thin film transistor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63068697A JPH01241175A (ja) | 1988-03-23 | 1988-03-23 | 非晶質シリコン薄膜トランジスタの製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01241175A true JPH01241175A (ja) | 1989-09-26 |
Family
ID=13381217
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63068697A Pending JPH01241175A (ja) | 1988-03-23 | 1988-03-23 | 非晶質シリコン薄膜トランジスタの製造方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (2) | US4916090A (ja) |
| JP (1) | JPH01241175A (ja) |
Families Citing this family (24)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01302769A (ja) * | 1988-05-30 | 1989-12-06 | Seikosha Co Ltd | 逆スタガー型シリコン薄膜トランジスタの製造方法 |
| US5106773A (en) * | 1990-10-09 | 1992-04-21 | Texas Instruments Incorporated | Programmable gate array and methods for its fabrication |
| EP0499979A3 (en) * | 1991-02-16 | 1993-06-09 | Semiconductor Energy Laboratory Co., Ltd. | Electro-optical device |
| US5854494A (en) * | 1991-02-16 | 1998-12-29 | Semiconductor Energy Laboratory Co., Ltd. | Electric device, matrix device, electro-optical display device, and semiconductor memory having thin-film transistors |
| US6028333A (en) * | 1991-02-16 | 2000-02-22 | Semiconductor Energy Laboratory Co., Ltd. | Electric device, matrix device, electro-optical display device, and semiconductor memory having thin-film transistors |
| JP3556679B2 (ja) | 1992-05-29 | 2004-08-18 | 株式会社半導体エネルギー研究所 | 電気光学装置 |
| US5100827A (en) * | 1991-02-27 | 1992-03-31 | At&T Bell Laboratories | Buried antifuse |
| US5602403A (en) * | 1991-03-01 | 1997-02-11 | The United States Of America As Represented By The Secretary Of The Navy | Ion Implantation buried gate insulator field effect transistor |
| JP2845303B2 (ja) | 1991-08-23 | 1999-01-13 | 株式会社 半導体エネルギー研究所 | 半導体装置とその作製方法 |
| US5459343A (en) * | 1992-02-21 | 1995-10-17 | Texas Instruments Incorporated | Back gate FET microwave switch |
| TW222345B (en) * | 1992-02-25 | 1994-04-11 | Semicondustor Energy Res Co Ltd | Semiconductor and its manufacturing method |
| US6709907B1 (en) | 1992-02-25 | 2004-03-23 | Semiconductor Energy Laboratory Co., Ltd. | Method of fabricating a thin film transistor |
| EP0678907B1 (en) * | 1994-04-22 | 2002-02-27 | Nec Corporation | Method for fabricating reverse-staggered thin-film transistor |
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