JPH01248812A - デジタルクリップ回路 - Google Patents

デジタルクリップ回路

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JPH01248812A
JPH01248812A JP63076903A JP7690388A JPH01248812A JP H01248812 A JPH01248812 A JP H01248812A JP 63076903 A JP63076903 A JP 63076903A JP 7690388 A JP7690388 A JP 7690388A JP H01248812 A JPH01248812 A JP H01248812A
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JP
Japan
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output
clip
circuit
signal
input signal
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Application number
JP63076903A
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English (en)
Inventor
Tatsuyuki Ono
大野　達之
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication date
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Priority to DE89105429T priority patent/DE68907100T2/de
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    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10—Digital recording or reproducing
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00—Details of television systems
    • H04N5/76—Television signal recording
    • H04N5/91—Television signal processing therefor
    • H04N5/92—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback
    • H04N5/923—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback using preemphasis of the signal before modulation and deemphasis of the signal after demodulation
    • F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
    • F04—POSITIVE - DISPLACEMENT MACHINES FOR LIQUIDS; PUMPS FOR LIQUIDS OR ELASTIC FLUIDS
    • F04B—POSITIVE-DISPLACEMENT MACHINES FOR LIQUIDS; PUMPS
    • F04B39/00—Component parts, details, or accessories, of pumps or pumping systems specially adapted for elastic fluids, not otherwise provided for in, or of interest apart from, groups F04B25/00 - F04B37/00
    • F04B39/12—Casings; Cylinders; Cylinder heads; Fluid connections
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03G—CONTROL OF AMPLIFICATION
    • H03G11/00—Limiting amplitude; Limiting rate of change of amplitude
    • H03G11/002—Limiting amplitude; Limiting rate of change of amplitude without controlling loop
    • H—ELECTRICITY
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    • H04N5/91—Television signal processing therefor
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  • Picture Signal Circuits (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［発明の目的］ （産業上の利用分野） この発明は、例えば、デジタル化されたビデオテープレ
コーダ（以下、ＶＴＲと記す）において、ビデオ信号を
クリップするのに好適なデジタルクリップ回路に関する
。
（従来の技術） 従来、デジタル信号処理回路において、入力信号をクリ
ップする場合は、第４図に示すようなデジタルクリップ
回路を用いていた。
この第４図に示すデジタルクリップ回路は、入力信号Ｓ
１のレベルＬ１とそのクリップレベルＬ２を示す基準信
号Ｓ２とのレベルを比較する比較器１１と、入力信号Ｓ
１と基準信号Ｓ２とを択一的に選択可能なスイッチ回路
１２を有する。
上記構成においては、入力信号Ｓ１のレベルＬ１がクリ
ップレベルＬ２より大きくなると、スイッチ１２によっ
て、基準信号Ｓ２が選択される。
逆に、入力信号＄１のレベルＬ１がクリップレベルＬ２
より小さいと、スイッチ１２によって入力信号Ｓ１が選
択される。これにより、スイッチ回路１２からは、クリ
ップレベルＬ２でクリップされた入力信号Ｓ１が得られ
る。
しかし、このデジタルクリップ回路によって突堤される
クリップ特性はハードクリップ特性である。したがって
、このデジタルクリップ回路は、ＶＴＲのホワイト／ダ
ーククリップ回路などのように、ソフトクリップ特性を
必要とするデジタルクリップ回路には、信号の劣化を招
くため、使用することができない。
（発明が解決しようとする課題） 以上述べたように従来のデジタルクリップ回路は、ハー
ドクリップ特性によって入力信号をクリップするように
なっている。したがって、ソフトクリップ特性を必要と
するデジタル信号処理回路では、信号の劣化から使用す
ることができなかった。
そこで、この発明は、ソフトクリップ特性を有するデジ
タルクリップ回路を提供することを目的とする。
［発明の構成］ （課題を解決するための手段） 上記目的を達成するためにこの発明は、入力信号をクリ
ップレベルでクリップするハードクリップ手段と、クリ
ップがかかつている期間、所定の定数の積分出力を発生
する手段と、この積分出力とハードクリップ出力とを合
成する手段と゛を設けるようにしたものである。
（作用） 上記のように、所定の定数の積分出力とハードクリップ
出力を合成することにより、上記積分出力がハードクリ
ップ出力に緩やかな波形変化を与えるので、ソフトクリ
ップ特性を有するデジタルクリップ回路を得ることがで
きる。これにより、ＶＴＲのホワイト／ダーククリップ
回路に用いても信号の劣化のないクリップ出力を得るこ
とができる。
（実施例） 以下、図面を１照しながらこの発明の一実施例を詳細に
説明する。
第１図はこの発明の一実施例の構成を示す回路図である
。この第１図の各部に示す波形は、デジタル信号をアナ
ログ信号に変換したときの波形である。
この第１図において、１１は入力信号Ｓ１が供給される
入力端子である。この人ノコ端子１１に供給された入力
信号Ｓ１は比較器１２の一方の入力端子に供給されると
ともに、スイッチ１３の一方の固定端子に供給される。
１２は、上記入力信号８１のクリップレベルＬ２を示す
基準信号Ｓ２が供給される入力端子である。この入力端
子１４に供給される基準信号Ｓ２は、上記比較器１２の
他方の入力端子に供給されるとともに、上記スイッチ１
３の他方の固定端子に供給される。
上記比較器１２は、両信号８１　、Ｓ２のレベル１１　
、　Ｌ２の大小を比較し、レベルＬ１がレベルＬ２より
大きいか否かを示す比較結果を出力する。
比較器１２の比較結果は、上記スイッチ１３および定数
発生回路１５に供給される。スイッチ１３は、比較器１
２から入力信号レベルＬ１がクリップレベルＬ２より大
きいとの比較結果が得られた場合は、基準信＠Ｓ２を選
択し、逆に、クリップレベルＳ２より小さいとの比較結
果が得られた場合は、入力信号Ｓ１を選択する。これに
より、スイッチ１３からは、入力信号Ｓ１のハードクリ
ップ出力Ｓ３が得られる。
定数発生回路１５は、比較器１２から入力信号レベルＳ
１がクリップレベルＳ２より大きいとの比較結果が得ら
れると、所定の定数を示す信号Ｓ４を発生する。この定
数信号Ｓ４は、積分回路１６に供給され、所定の時定数
で積分される。これにより、この積分回路１６からは、
定数発生回路１５から定数信号Ｓ４が発生すると上記定
数に従って徐々に上昇し、発生しなくなると、上記時定
数に従って徐々に減衰する積分出力Ｓ５が得られる。
この積分出力Ｓ５と上記スイッチ１３の選択出力Ｓ３と
は、加算回路１７で加算合成される。これにより、合成
回路１７からは、入力信号レベルＬｌがクリップレベル
Ｌ２より大きくなると、徐々にレベルが上昇し、入力信
号レベルＬ１がクリップレベルＬ２より小さくなると、
徐々にレベルが低下するクリップ出力Ｓ６が得られる。
このクリップ出力は出力端子１８に供給される以上述べ
たようにこの実施例は、比較器１２とスイッチ１３から
なるハードクリップ回路により、入力信号Ｓ１をハード
クリップするとともに、ハードクリップ期間に定数発生
回路１５から定数信号Ｓ４を発生し、これを積分回路１
６で積分し、加算回路１７によりハードクリップ出力Ｓ
３と加算合成するようにしたものである、 このような構成によれば、ハードクリップ出力Ｓ３が積
分出力によって緩やかに変化する波形に変換されるので
、ソフトクリップ特性に従ったクリップ出力Ｓ６を得る
ことができる。
第２図はこの発明の第２の実施例の構成を示す回路図で
ある。
この実施例は、比較器１２の比較出力をビットシフトす
るビットシフト回路２１によって、定数信号Ｓ４を発生
するようにしたものである。
なお、第２図において、先の第１図と同一部には同一符
号を付す。
このような構成においても、ソフトクリップ特性によっ
てクリップされたクリップ出力Ｓ６を得ることができる
。
以上の説明では、入力信号Ｓ１の上限をクリップする場
合を説明したが、比較器１２の入力端子に対する入力信
号Ｓ１と基準信号Ｓ２との入力状態を反対にし、下限の
クリップレベル上２以下になった場合に、ハードクリッ
プがかかるようにするとともに、定数信号Ｓ４の積分出
力Ｓ５をハードクリップ出力Ｓ３から減するようにする
ことにより、下限をソフトクリップするようにすること
もできる。また、これと先の実施例を組み合せることに
より、上限および下限のソフトクリップを組み合せるこ
とができる。
第３図は、上限および下限のソフトクリップを組合わせ
た例の構成を示す回路図である。
なお、第３図において、上限に関係した信号およびレベ
ルに対しては、先の第１図の信号にＨを付し、下限に関
係した信号およびレベルに対してはＬを付し、上限およ
び下限に関係した信号に関しては、Ｈ，Ｌを付す。
第３図において、先の第１図と同一の符号を付す比較器
１２、スイッチ１３、定数発生回路１５、積分回路１６
は上限用の回路である。また、比較器２５、スイッチ２
６、定数発生回路２７、積分回路２８は下限のクリップ
用の回路であり、入力端子２９に供給される信号ＳＬ２
は下限のクリップレベルを示す基準信号である。
ここで、下限用のスイッチ２６は、上限のハードクリッ
プ出力ＳＨ３を出力するスイッチ１３の後段に接続され
、上限のハードクリップ出力ＳＨ３の下限をハードクリ
ップすることにより、上限および下限がハードクリップ
されたハードクリップ出力５ＨＬ３を得る。加算回路３
０は、このハードクリップ出力５Ｈ１３と積分回路１６
の積分出力ＳＨ５を加算合成するとともに、このハード
クリップ出力５Ｈ１３から積分回路２８の積分出力ＳＬ
５を減する。これにより、この加算回路３０からは、入
力信号の上限および下限がソフトクリップされたクリッ
プ出力５Ｈ１６が得られる。
以上この発明の実施例をいくつか説明したがこの発明は
このような実施例に限定されるものではなく、他にも発
明の要旨を逸脱しない範囲で種々様々変形実施可能なこ
とは勿論である。
［発明の効果］ 以上述べたようにこの発明によれば、入力信号をソフト
クリップ特性でクリップすることができるデジタルクリ
ップ回路を得ることができ、ハードクリップ特性を用い
ることで、信号の劣化を生じていたデジタル信号処理回
路においても、信号の劣化を防止することが可能である
。
【図面の簡単な説明】
を示す回路図、第３図はこの発明の第３の実施例の構成
を示す回路図、第４図は従来のデジタルクリップ回路の
構成を示す回路図である。 １１．１４．２９・・・入力端子、１２．２５・・・比
較器、１３．２６・・・スイッチ、１５．２７・・・定
数発生回路、１６．２８・・・積分回路、１７．３０・
・・加算回路、１８・・・出力端子。

Claims (1)

  1. 【特許請求の範囲】 入力信号のレベルとこの入力信号のクリップレベルとの
    大小を比較する比較手段と、 この比較手段から上記入力信号レベルが上記クリップレ
    ベルを越えるとの比較結果が得られた場合は、上記クリ
    ップレベルを示す信号を選択し、クリップレベルを越え
    ないとの比較結果が得られた場合は、上記入力信号を選
    択する選択手段と、上記比較手段から上記入力信号レベ
    ルが上記クリップレベルを越えるとの比較結果が得られ
    た場合、所定の定数信号を発生する定数発生手段と、こ
    の定数発生手段の出力を積分する積分手段と、この積分
    手段の出力と上記選択手段の出力とを合成する合成手段
    とを具備したことを特徴とするデジタルクリップ回路。
JP63076903A 1988-03-30 1988-03-30 デジタルクリップ回路 Pending JPH01248812A (ja)

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JP63076903A JPH01248812A (ja) 1988-03-30 1988-03-30 デジタルクリップ回路
US07/329,207 US4924121A (en) 1988-03-30 1989-03-27 Digital clipping circuit with soft clip characteristics
EP89105429A EP0335317B1 (en) 1988-03-30 1989-03-28 Digital clipping circuit with soft clip characteristics
DE89105429T DE68907100T2 (de) 1988-03-30 1989-03-28 Digitale Abschneidestufenschaltung mit sanften Abschneidungseigenschaften.
KR1019890003947A KR920003522B1 (ko) 1988-03-30 1989-03-29 디지탈 클립회로

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EP (1) EP0335317B1 (ja)
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EP0335317B1 (en) 1993-06-16
DE68907100D1 (de) 1993-07-22
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