JPH01257391A - 多層混成集積回路装置 - Google Patents
多層混成集積回路装置Info
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- JPH01257391A JPH01257391A JP1030630A JP3063089A JPH01257391A JP H01257391 A JPH01257391 A JP H01257391A JP 1030630 A JP1030630 A JP 1030630A JP 3063089 A JP3063089 A JP 3063089A JP H01257391 A JPH01257391 A JP H01257391A
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- Pending
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- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims abstract description 6
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Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/14—Structural association of two or more printed circuits
- H05K1/144—Stacked arrangements of planar printed circuit boards
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/40—Forming printed elements for providing electric connections to or between printed circuits
- H05K3/403—Edge contacts; Windows or holes in the substrate having plural connections on the walls thereof
Landscapes
- Coupling Device And Connection With Printed Circuit (AREA)
- Combinations Of Printed Boards (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(イ)産業上の利用分野
本発明は、混成集積回路基板が積層されかつ、夫々の混
成集積回路基板を離間し、前記夫々の基板の内側に接続
用電極が設けてなる多層混成集積回路装置に関する。
成集積回路基板を離間し、前記夫々の基板の内側に接続
用電極が設けてなる多層混成集積回路装置に関する。
(ロ)従来の技術
第4図は、従来の混成集積回路装置を示す断面図である
(特開昭58−159362号参照)。
(特開昭58−159362号参照)。
従来による多層混成集積回路に於いて、(1)は混成集
積回路基板、(2)は枠体の離間材、(3)は外部リー
ドである。この構造では別々の混成集積回路基板(1)
に別個の工程で所望の回路素子を付着し、外部リード(
3)を電極パッド(図示せず)に固着した後、枠状の離
間材(2)で両基板(1)(1)を一体化するものであ
る。
積回路基板、(2)は枠体の離間材、(3)は外部リー
ドである。この構造では別々の混成集積回路基板(1)
に別個の工程で所望の回路素子を付着し、外部リード(
3)を電極パッド(図示せず)に固着した後、枠状の離
間材(2)で両基板(1)(1)を一体化するものであ
る。
(八)発明が解決しようとする課題
上述した従来の混成集積回路技術では、基板の外にリー
ドが導出しているので電気ショート及びリードの曲折が
生じることもある。
ドが導出しているので電気ショート及びリードの曲折が
生じることもある。
(ニ)問題点を解決するための手段
本発明は、上述した点に鑑みて為されたものであり、第
1及び第2の混成集積回路基板の相対する一主面に設け
られた回路素子と、前記第1及び第2の混成集積回路基
板の対向する同一辺に、各々内部から延在される導電路
で形成された接続電極と、前記第1及び第2の混成集積
回路基板を離間し、かつ、前記接続用電極を枠外に配置
する枠体とを備え、前記接続用電極が形成された夫々の
混成集積回路基板周端部によって囲まれた領域をコネク
タハウジングとして用いて解決する。
1及び第2の混成集積回路基板の相対する一主面に設け
られた回路素子と、前記第1及び第2の混成集積回路基
板の対向する同一辺に、各々内部から延在される導電路
で形成された接続電極と、前記第1及び第2の混成集積
回路基板を離間し、かつ、前記接続用電極を枠外に配置
する枠体とを備え、前記接続用電極が形成された夫々の
混成集積回路基板周端部によって囲まれた領域をコネク
タハウジングとして用いて解決する。
(ホ〉作用
この様に本発明に依れば、第1及び第2の混成集積回路
基板の夫々の周端部に銅箔よりなる接続電極を設け、そ
の接続用電極が設けられた基板の周端部で囲まれた領域
をコネクタハウジングとして用いることにより、そのコ
ネクタハウジングに外部回路との接続用の外部コネクタ
を挿入することができ、従来のリード端子を必要としな
いリード端子レスの接続構造が行える。
基板の夫々の周端部に銅箔よりなる接続電極を設け、そ
の接続用電極が設けられた基板の周端部で囲まれた領域
をコネクタハウジングとして用いることにより、そのコ
ネクタハウジングに外部回路との接続用の外部コネクタ
を挿入することができ、従来のリード端子を必要としな
いリード端子レスの接続構造が行える。
(へ)実施例
第1図は本発明の実施例を示す斜視分解図、第2図は本
実施例の断面図であり、(50)は混成集積回路装置、
(10)(20)は混成集積回路基板、(11)(21
)は金属基板、(12)(22)は絶縁層、(13)<
23)は導電路、(14)(24)は接続用電極、(1
5)(25)は接着層、(16)(26)はメモリチッ
プ、(30)は枠体、(31)はガイド部、(32)は
段部、(33〉はスペーサ一部、(34)は離間部、(
35)はコネクタ一部である。
実施例の断面図であり、(50)は混成集積回路装置、
(10)(20)は混成集積回路基板、(11)(21
)は金属基板、(12)(22)は絶縁層、(13)<
23)は導電路、(14)(24)は接続用電極、(1
5)(25)は接着層、(16)(26)はメモリチッ
プ、(30)は枠体、(31)はガイド部、(32)は
段部、(33〉はスペーサ一部、(34)は離間部、(
35)はコネクタ一部である。
第1の混成集積回路基板(10)において、金属基板(
11)としてはアルミニウムが用いられ、その表面には
陽極酸化によって絶縁層(12)が形成されている。そ
の絶縁層(12)上には接着性を有するエポキシ等の絶
縁樹脂N!I(図示しない)を介して銅箔が貼若され、
その銅箔を所定のパターンにエツチングすることによっ
て導電路(13)が形成される。
11)としてはアルミニウムが用いられ、その表面には
陽極酸化によって絶縁層(12)が形成されている。そ
の絶縁層(12)上には接着性を有するエポキシ等の絶
縁樹脂N!I(図示しない)を介して銅箔が貼若され、
その銅箔を所定のパターンにエツチングすることによっ
て導電路(13)が形成される。
この導電路(13)は金属基板(11)の−側辺周端部
に延在きれ、その端部は接続用電極(14)となる。
に延在きれ、その端部は接続用電極(14)となる。
第2の混成集積回路基板(20)は、第1の混成集積回
路基板(10)と同様に形成され、導電路(23)は、
第1の混成集積回路基板(10)の接続用電極(14)
と同一辺に延在され、第1の混成集積回路基板(10)
と同様に接続用電極(24)が形成されている。
路基板(10)と同様に形成され、導電路(23)は、
第1の混成集積回路基板(10)の接続用電極(14)
と同一辺に延在され、第1の混成集積回路基板(10)
と同様に接続用電極(24)が形成されている。
夫々の導電路(13)(23)上には複数のトランジス
タ、IC、メモリIC(16)等の複数の回路素子が付
着されている。メモリーチップ(16)(26)は金属
基板(11)(21)の上に配置することにより放熱性
が優れ、基板当り8〜10個のメモリーチップ(16)
(26)が高密度に実装できる。またメモリーチップ(
16)(26)としては、ダイナミックRAM及び、ス
タティックRAMを用い所定の導電路上に固着されてい
る。
タ、IC、メモリIC(16)等の複数の回路素子が付
着されている。メモリーチップ(16)(26)は金属
基板(11)(21)の上に配置することにより放熱性
が優れ、基板当り8〜10個のメモリーチップ(16)
(26)が高密度に実装できる。またメモリーチップ(
16)(26)としては、ダイナミックRAM及び、ス
タティックRAMを用い所定の導電路上に固着されてい
る。
第1及び第2の混成集積回路基板(10)(20)は枠
体(30)によって所定間隔離間配置される。その枠体
(30)は合成樹脂等の絶縁物で形成され、ガイド部(
31)、段部(32)及び、スペーサ一部(33)を有
し、その断面はT型状である。
体(30)によって所定間隔離間配置される。その枠体
(30)は合成樹脂等の絶縁物で形成され、ガイド部(
31)、段部(32)及び、スペーサ一部(33)を有
し、その断面はT型状である。
第1、第2混成集積回路基板(10)(20)が、はめ
込まれる背面及び上面の夫々において、段部(32)及
び、スペーサ一部(33)の表面は同一面となり、スペ
ーサ一部(33)は第1及び第2の混成集積回路基板(
10)(20)との離間部(34)を保っている。ガイ
ド部(31)は第1及び第2混成集積回路基板(10)
(20)をはめ込む際の位置規制をするものである。
込まれる背面及び上面の夫々において、段部(32)及
び、スペーサ一部(33)の表面は同一面となり、スペ
ーサ一部(33)は第1及び第2の混成集積回路基板(
10)(20)との離間部(34)を保っている。ガイ
ド部(31)は第1及び第2混成集積回路基板(10)
(20)をはめ込む際の位置規制をするものである。
枠体(30)の段部(32)及びスペーサ一部(33)
の表面に接着シートを張り、第1混成集積回路基板け0
)の接続用電極(14)が設けられた一辺と枠体(30
)のスペーサ一部(33)とを接続用電極が枠外にでる
ように一致させ枠体(30)に挿入する。きらに第2混
成集積回路基板(20〉の接続用電極が設けられた一辺
と枠体(30)のコネクタ一部(33)を接続用電極が
枠外にでるように一致させ、夫々内側主面が対向するよ
うに挿入し枠体(30)を介して接着層(15)(25
〉により接着される。
の表面に接着シートを張り、第1混成集積回路基板け0
)の接続用電極(14)が設けられた一辺と枠体(30
)のスペーサ一部(33)とを接続用電極が枠外にでる
ように一致させ枠体(30)に挿入する。きらに第2混
成集積回路基板(20〉の接続用電極が設けられた一辺
と枠体(30)のコネクタ一部(33)を接続用電極が
枠外にでるように一致させ、夫々内側主面が対向するよ
うに挿入し枠体(30)を介して接着層(15)(25
〉により接着される。
接読用電極(14)(24)が形成された夫々の基板(
10)(20)の周端部によって囲まれた領域は外部コ
ネクタ(40)が挿入されるコネクタハウジングとじて
用いられる。コネクタハウジングは基板(10)(20
)及び枠体(30)によって囲まれた領域を示すもので
あり、そのコネクタハウジングに外部接続用の外部コネ
クタ(40)を挿入しても基板(10)(20)の周端
部によって外部コネクタ(40)は支持され安定した接
続が行える。
10)(20)の周端部によって囲まれた領域は外部コ
ネクタ(40)が挿入されるコネクタハウジングとじて
用いられる。コネクタハウジングは基板(10)(20
)及び枠体(30)によって囲まれた領域を示すもので
あり、そのコネクタハウジングに外部接続用の外部コネ
クタ(40)を挿入しても基板(10)(20)の周端
部によって外部コネクタ(40)は支持され安定した接
続が行える。
斯る本発明に依れば、第1及び第2の混成集積回路基板
の夫々の周端部に銅箔よりなる接続電極を設け、その接
続用電極が設けられた基板の周端部で囲まれた領域をコ
ネクタハウジングとして用いることにより、そのコネク
タハウジングに外部回路との接続用の外部コネクタを挿
入することができ、従来のリード端子を必要としないリ
ード端子レスの接続構造が行える。
の夫々の周端部に銅箔よりなる接続電極を設け、その接
続用電極が設けられた基板の周端部で囲まれた領域をコ
ネクタハウジングとして用いることにより、そのコネク
タハウジングに外部回路との接続用の外部コネクタを挿
入することができ、従来のリード端子を必要としないリ
ード端子レスの接続構造が行える。
(ト)発明の効果
以上に詳述した如く本発明に依れば、混成集積回路基板
に外部リードが無いので、取り扱いが容易になり、端子
間のショートを防ぐこともできる。
に外部リードが無いので、取り扱いが容易になり、端子
間のショートを防ぐこともできる。
また、基板が金属基板なので外力に対して割れることも
なく耐久性が良く、チャージの蓄積による高電圧の発生
から保護することができ、さらに外部からのノイズを堕
ぐことができる。
なく耐久性が良く、チャージの蓄積による高電圧の発生
から保護することができ、さらに外部からのノイズを堕
ぐことができる。
更に基板の周端部のコネクタハウジングによって外部コ
ネクタが支持され、安定したコネクタ接続が行える。
ネクタが支持され、安定したコネクタ接続が行える。
第1図は本発明の実施例を示す斜視分解図、第2図は本
実施例の断面図、第3図は本発明の使用例を示す斜視図
、第4図は従来例を示す断面図である。 (50)・・・混成集積回路装置、 (10)(20)
・・・混成集積回路基板、 (11)(21)・・・金
属基板、 (12)(22)・・・絶縁層、 (13)
(23)・・・導電路、 (14)(24)・・・接続
用電極、 (15)(25)・・・装着層、 (16)
(26)・・・メモリチップ、(30)・・・枠体、
(31)・・・ガイド部、(32)・・・段部、 (3
3)・・・スペーサ一部、 (34)・・・離間部、
(35)・・・コネクタ一部、 (40)・・・外部コ
ネクター。 第1 図 14 1j 11 第2図
実施例の断面図、第3図は本発明の使用例を示す斜視図
、第4図は従来例を示す断面図である。 (50)・・・混成集積回路装置、 (10)(20)
・・・混成集積回路基板、 (11)(21)・・・金
属基板、 (12)(22)・・・絶縁層、 (13)
(23)・・・導電路、 (14)(24)・・・接続
用電極、 (15)(25)・・・装着層、 (16)
(26)・・・メモリチップ、(30)・・・枠体、
(31)・・・ガイド部、(32)・・・段部、 (3
3)・・・スペーサ一部、 (34)・・・離間部、
(35)・・・コネクタ一部、 (40)・・・外部コ
ネクター。 第1 図 14 1j 11 第2図
Claims (3)
- 1.第1及び第2の混成集積回路基板と、該第1及び第
2の混成集積回路基板の相対する一主面に設けられた回
路素子と、前記第1及び第2の混成集積回路基板の対向
する同一辺に、各々内部から延在される銅箔よりなる導
電路で形成された接続用電極と、前記第1及び第2の混
成集積回路基板を離間し前記接続用電極を枠外に配置す
る枠体とを備え、 前記接続用電極が形成された夫々の混成集積回路基板周
端部によって囲まれた領域をコネクタハウジングとして
用いたことを特徴とする多層混成集積回路装置。 - 2.前記コネクタハウジングに外部回路との接続を行う
ための外部コネクタが挿入されてなることを特徴とする
請求項1記載の多層混成集積回路装置。 - 3.前記第1及び第2の混成集積回路基板は金属基板で
あることを特徴とする請求項1記載の多層混成集積回路
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1030630A JPH01257391A (ja) | 1989-02-08 | 1989-02-08 | 多層混成集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1030630A JPH01257391A (ja) | 1989-02-08 | 1989-02-08 | 多層混成集積回路装置 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60007817A Division JPS61166149A (ja) | 1985-01-18 | 1985-01-18 | 多層混成集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01257391A true JPH01257391A (ja) | 1989-10-13 |
Family
ID=12309170
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1030630A Pending JPH01257391A (ja) | 1989-02-08 | 1989-02-08 | 多層混成集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01257391A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2017224853A (ja) * | 2017-08-29 | 2017-12-21 | サトーホールディングス株式会社 | 基板ユニット |
-
1989
- 1989-02-08 JP JP1030630A patent/JPH01257391A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2017224853A (ja) * | 2017-08-29 | 2017-12-21 | サトーホールディングス株式会社 | 基板ユニット |
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