JPH0130238B2 - - Google Patents
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- Publication number
- JPH0130238B2 JPH0130238B2 JP56120500A JP12050081A JPH0130238B2 JP H0130238 B2 JPH0130238 B2 JP H0130238B2 JP 56120500 A JP56120500 A JP 56120500A JP 12050081 A JP12050081 A JP 12050081A JP H0130238 B2 JPH0130238 B2 JP H0130238B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- output
- synchronization
- counter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000000630 rising effect Effects 0.000 claims description 10
- 238000000605 extraction Methods 0.000 claims description 9
- 238000001514 detection method Methods 0.000 claims description 6
- 239000013256 coordination polymer Substances 0.000 description 9
- 238000010586 diagram Methods 0.000 description 4
- 230000005236 sound signal Effects 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
【発明の詳細な説明】
本発明は、デイジタル・オーデイオデイスクの
再生出力信号から同期信号を容易にかつ確実に取
り出すための同期信号取出し回路に関するもので
ある。
再生出力信号から同期信号を容易にかつ確実に取
り出すための同期信号取出し回路に関するもので
ある。
デイジタル・オーデイオデイスクは、オーデイ
オ信号および同期信号等をデイジタル化してデイ
スクの表面に線速度一定として光学的に高密度で
記録したものであり、デイスク上に記録される信
号フオーマツトは例えば第１図に示すように定め
られている。つまり、この方式に於いては１フレ
ームを一定数のビツト（例えば588ビツト）によ
つて構成し、このフレームを連続させて同一デイ
スク上に線速度一定として記録されている。そし
て、この各フレームの信号フオーマツトは、同期
部Ａと情報部Ｂとに区分されており、同期部Ａは
各フレームの冒頭部分にそれぞれ位置付けられて
いる。同期部Ａは第１図で示すように22ビツトに
よつて構成されており、最初の11ビツトが連続し
て“０”のときには続く11ビツトが連続して
“１”となり、最初の11ビツトが連続して“１”
のときには、続く11ビツトが連続して“０”とな
るように設定されている。
オ信号および同期信号等をデイジタル化してデイ
スクの表面に線速度一定として光学的に高密度で
記録したものであり、デイスク上に記録される信
号フオーマツトは例えば第１図に示すように定め
られている。つまり、この方式に於いては１フレ
ームを一定数のビツト（例えば588ビツト）によ
つて構成し、このフレームを連続させて同一デイ
スク上に線速度一定として記録されている。そし
て、この各フレームの信号フオーマツトは、同期
部Ａと情報部Ｂとに区分されており、同期部Ａは
各フレームの冒頭部分にそれぞれ位置付けられて
いる。同期部Ａは第１図で示すように22ビツトに
よつて構成されており、最初の11ビツトが連続し
て“０”のときには続く11ビツトが連続して
“１”となり、最初の11ビツトが連続して“１”
のときには、続く11ビツトが連続して“０”とな
るように設定されている。
そしてこの場合、最初の11ビツトはその前のフ
レームに於ける末尾ビツトに対して逆になるよう
に設定されており、このようにして予め定められ
た単位ビツト（11ビツト）で“０”または“１”
が連らなるフオーマツトは１フレーム中に於いて
この同期部Ａのみに限定されている。すなわち、
情報部Ｂはいかなる場合であつても11ビツト単位
の“０”または“１”が連らなるフオーマツトが
生じないように構成されている。また、情報部Ｂ
は無信号時に於ける直流化を防止するために、常
に３ビツト以上にわたつて“１”または“０”信
号が連続する信号となつており、従つて、情報部
Ｂは３＜Ｂ＜11ビツトの範囲にわたつてのみ連続
する信号として表わされることになる。
レームに於ける末尾ビツトに対して逆になるよう
に設定されており、このようにして予め定められ
た単位ビツト（11ビツト）で“０”または“１”
が連らなるフオーマツトは１フレーム中に於いて
この同期部Ａのみに限定されている。すなわち、
情報部Ｂはいかなる場合であつても11ビツト単位
の“０”または“１”が連らなるフオーマツトが
生じないように構成されている。また、情報部Ｂ
は無信号時に於ける直流化を防止するために、常
に３ビツト以上にわたつて“１”または“０”信
号が連続する信号となつており、従つて、情報部
Ｂは３＜Ｂ＜11ビツトの範囲にわたつてのみ連続
する信号として表わされることになる。
このように構成されたデイジタル・オーデイオ
デイスクは、デイスク上のデイジタル情報を予め
定められた線速度で光学的に再生し、この再生信
号中に含まれる同期信号を基準として情報部Ｂの
再生信号を取り出して復調することにより、高忠
実度のオーデイオ信号が容易に得られるものであ
る。
デイスクは、デイスク上のデイジタル情報を予め
定められた線速度で光学的に再生し、この再生信
号中に含まれる同期信号を基準として情報部Ｂの
再生信号を取り出して復調することにより、高忠
実度のオーデイオ信号が容易に得られるものであ
る。
この場合、高忠実度のオーデイオ信号を復調す
る上で最も重要な事は、デイスク再生信号から各
フレームの冒頭に設けられている同期信号を確実
に取り出すことであり、この同期信号の取り出し
を誤まると情報信号の区分けおよび復調が行なえ
なくなつてしまう。
る上で最も重要な事は、デイスク再生信号から各
フレームの冒頭に設けられている同期信号を確実
に取り出すことであり、この同期信号の取り出し
を誤まると情報信号の区分けおよび復調が行なえ
なくなつてしまう。
従つて、本発明による目的は、簡単な構成であ
りながらデイジタル・オーデイオデイスクの再生
信号から同期信号を確実に取り出すための同期信
号取出し回路を提供することである。
りながらデイジタル・オーデイオデイスクの再生
信号から同期信号を確実に取り出すための同期信
号取出し回路を提供することである。
このような目的を達成するために本発明は、再
生信号の立上りによつてクリアされてクロツクパ
ルスをカウントする第１カウンタと、再生信号の
立下りによつてクリアされてクロツクパルスをカ
ウントする第２カウンタとを設け、再生信号の立
下り時に於ける第１カウンタの出力と再生信号の
立上り時に於ける第２カウンタの出力が共にデイ
スクの同期部に定められている単位ビツトに対応
した設定値に一致する場合のみ同期信号と判別し
て同期検出信号を送出するものである。
生信号の立上りによつてクリアされてクロツクパ
ルスをカウントする第１カウンタと、再生信号の
立下りによつてクリアされてクロツクパルスをカ
ウントする第２カウンタとを設け、再生信号の立
下り時に於ける第１カウンタの出力と再生信号の
立上り時に於ける第２カウンタの出力が共にデイ
スクの同期部に定められている単位ビツトに対応
した設定値に一致する場合のみ同期信号と判別し
て同期検出信号を送出するものである。
以下、図面に示す実施例を用いて、本発明によ
るデイジタル・オーデイオデイスクの同期信号取
出し回路を詳細に説明する。
るデイジタル・オーデイオデイスクの同期信号取
出し回路を詳細に説明する。
第２図は本発明によるデイジタル・オーデイオ
デイスクの同期信号取出し回路の一実施例を示す
回路図である。同図に於いて１はデイジタル・オ
ーデイオデイスクの記録時に於けるビツトレート
に一致する例えば43218MHzのクロツクパルスCP
を送出するクロツク発振器であつて、水晶振動子
を用いて高精度に安定化されたクロツクパルス
CPを送出すように構成されている。２は入力端
子３に供給されるデイスクの光学的な読み取りに
よる再生信号Ａを入力し、その立上り部分を微分
して微分パルスP1を発生する第１微分回路であ
つて、コンデンサ４、ダイオード５および抵抗６
によつて構成される一般に周知の回路となつてい
る。７は再生信号Ａを反転するインバータ、８は
インバータ７から送出される出力の立上り部分、
つまり再生信号Ａの立下り部分を微分して微分パ
ルスP2を発生する第２微分回路であつて、第１
微分回路と同様にコンデンサ９、ダイオード１０
および抵抗１１とによつて構成されている。１２
は第１カウンタであつて、第１微分回路２から出
力される微分パルスP1によつてクリアされなが
らクロツクパルスCPを順次計数して出力する。
１３は第２カウンタであつて、第２微分回路８か
ら出力される微分パルスP2によつてクリアされ
ながらクロツクパルスCPを順次カウントして出
力する。１４，１５は保持回路を構成する第１、
第２シフトレジスタであつて、第１シフトレジス
タ１４は微分パルスP2の発生時に第１カウンタ
１２のカウント出力を取り込んでシフトすること
により出力し、第２シフトレジスタ１５は微分パ
ルスP1の発生時に於ける第２カウンタ１３のカ
ウント出力を取り込んでシフトすることにより出
力する。１６，１７は第１、第２デコーダであつ
て、第１デコーダ１６は第１シフトレジスタ１４
の出力を10進数に変換し、第２デコーダ１７は第
２シフトレンスタ１５の出力を10進数に変換して
出力する。１８は第１、第２デコーダ１６，１７
の出力端０11から出力される信号の一致を検出し
て同期検出信号SDを送出するアンドゲートであ
る。
デイスクの同期信号取出し回路の一実施例を示す
回路図である。同図に於いて１はデイジタル・オ
ーデイオデイスクの記録時に於けるビツトレート
に一致する例えば43218MHzのクロツクパルスCP
を送出するクロツク発振器であつて、水晶振動子
を用いて高精度に安定化されたクロツクパルス
CPを送出すように構成されている。２は入力端
子３に供給されるデイスクの光学的な読み取りに
よる再生信号Ａを入力し、その立上り部分を微分
して微分パルスP1を発生する第１微分回路であ
つて、コンデンサ４、ダイオード５および抵抗６
によつて構成される一般に周知の回路となつてい
る。７は再生信号Ａを反転するインバータ、８は
インバータ７から送出される出力の立上り部分、
つまり再生信号Ａの立下り部分を微分して微分パ
ルスP2を発生する第２微分回路であつて、第１
微分回路と同様にコンデンサ９、ダイオード１０
および抵抗１１とによつて構成されている。１２
は第１カウンタであつて、第１微分回路２から出
力される微分パルスP1によつてクリアされなが
らクロツクパルスCPを順次計数して出力する。
１３は第２カウンタであつて、第２微分回路８か
ら出力される微分パルスP2によつてクリアされ
ながらクロツクパルスCPを順次カウントして出
力する。１４，１５は保持回路を構成する第１、
第２シフトレジスタであつて、第１シフトレジス
タ１４は微分パルスP2の発生時に第１カウンタ
１２のカウント出力を取り込んでシフトすること
により出力し、第２シフトレジスタ１５は微分パ
ルスP1の発生時に於ける第２カウンタ１３のカ
ウント出力を取り込んでシフトすることにより出
力する。１６，１７は第１、第２デコーダであつ
て、第１デコーダ１６は第１シフトレジスタ１４
の出力を10進数に変換し、第２デコーダ１７は第
２シフトレンスタ１５の出力を10進数に変換して
出力する。１８は第１、第２デコーダ１６，１７
の出力端０11から出力される信号の一致を検出し
て同期検出信号SDを送出するアンドゲートであ
る。
このように構成されたデイジタル・オーデイオ
デイスクの同期信号取出し回路に於いて、入力端
子３に例えば第３図ａに示す再生信号Ａが供給さ
れると、第１微分回路２は再生信号Ａの立上り部
分を微分して時点t1，t3，t5，t7に第３図ｂに示
す微分パルスP1を出力する。一方、第２微分回
路８はインバータ７を介して供給される再生信号
Ａの立上り部分を微分する関係上、時点t2，t4，
t6，t8に第３図ｃに示す微分パルスP2を出力す
る。
デイスクの同期信号取出し回路に於いて、入力端
子３に例えば第３図ａに示す再生信号Ａが供給さ
れると、第１微分回路２は再生信号Ａの立上り部
分を微分して時点t1，t3，t5，t7に第３図ｂに示
す微分パルスP1を出力する。一方、第２微分回
路８はインバータ７を介して供給される再生信号
Ａの立上り部分を微分する関係上、時点t2，t4，
t6，t8に第３図ｃに示す微分パルスP2を出力す
る。
一方、クロツク発振器１は、デイスクの書き込
み時に於けるビツトレートに一致するクロツクパ
ルスCPを発生しており、第１、第２カウンタ１
２，１３は微分パルスP1およびP2によつてそれ
ぞれクリアされながらクロツクパルスCPを順次
カウントする。従つて、再生信号Ａが予め定めら
れた線速度一定の条件に一致しながら読み出され
たものであるならば、第１、第２カウンタ１２，
１３の値は第３図ｄ，ｅに示すように、第３図ａ
に示す再生信号Ａの立上り間および立下り間のビ
ツト数を正確にカウントするはずである。
み時に於けるビツトレートに一致するクロツクパ
ルスCPを発生しており、第１、第２カウンタ１
２，１３は微分パルスP1およびP2によつてそれ
ぞれクリアされながらクロツクパルスCPを順次
カウントする。従つて、再生信号Ａが予め定めら
れた線速度一定の条件に一致しながら読み出され
たものであるならば、第１、第２カウンタ１２，
１３の値は第３図ｄ，ｅに示すように、第３図ａ
に示す再生信号Ａの立上り間および立下り間のビ
ツト数を正確にカウントするはずである。
次に、第１シフトレジスタ１４は、シフト入力
端Ｓに再生信号Ａの立下り時に発生される微分パ
ルスP2を入力しているために、第１カウンタ１
２のカウント値をそのカウント動作の途中である
再生信号Ａの立下り時にパラレルに取り込んでシ
フトする。従つて、この第１シフトレジスタ１４
からは、再生信号Ａの立下り時である時点t2，
t6，t8に於いて第３図ｆに示すように出力値が変
化することになり、この第１シフトレジスタ１４
の出力値は再生信号Ａの各“１”期間に於けるク
ロツクパルスCPの数、つまりビツト数を表わし
ていることになる。また、第２シフトレジスタ１
５も同様に、再生信号Ａの立下り時にカウントを
開始する第２カウンタ１３のカウント値を再生信
号Ａの立上り時に発生される微分パルスP2によ
つて取り込んで第３図ｇに示すようにシフトして
いるために、この第２シフトレジスタ１５からは
再生信号Ａの“０”期間に於けるクロツクパルス
CPの数、つまりビツト数が出力されることにな
る。このようにして、第１、第２シフトレジスタ
１４，１５から出力される再生信号Ａの“１”お
よび“０”期間のビツト数を表わす信号は、それ
ぞれ第１、第２デコーダ１６，１７に於いて10進
数に変換されて出力される。この場合、上記第１
図に於いて説明した信号フオーマツトに於いて
は、同期部Ａのみに特殊な条件が与えられてい
た。つまり、同期信号部分は22ビツトによつて構
成されていて、その前半と後半の11ビツトが互い
に異なる信号（“０”と“１”）によつて連続され
ており、かつこの11ビツトにわたつて同一種類の
信号が連らなる部分はこの部分のみに特定されて
いる。従つて、11ビツトの“０”と11ビツト
“１”が連らなる部分を取り出すことにより同期
検出が行なえることになる。ここで、第１、第２
シフトレジスタ１４，１５の出力内容を示す第３
図ｆ，ｇを見ると、再生信号Ａの“１”期間t3〜
t4，t5〜t6，t7〜t8において再生信号Ａの“１”期
間のカウント数（ビツト数）を表わす信号と前記
“１”期間に続く“０”期間のカウント数（ビツ
ト数）を表わす信号とが時間的に重なつて出力さ
れることになる。従つて、第１、第２シフトレジ
スタ１４，１５の出力を10進数にデコードする第
１、第２デコーダ１６，１７の出力端０11から出
力される10進数の「11」を表わす両信号の一致を
アンドゲート１８に於いて求めることにより、11
ビツトの“０”と11ビツトの“１”が連らなる部
分、つまり同期信号が検出され、第３図ｆ，ｇに
示すカウント値「11」が重なる部分（t3〜t4）に
於いて同期検出信号SDが出力されることになる。
従つて、第１、第２シフトレジスタ１６，１７お
よびアンドゲート１８は同期信号判別回路を構成
していることになる。
端Ｓに再生信号Ａの立下り時に発生される微分パ
ルスP2を入力しているために、第１カウンタ１
２のカウント値をそのカウント動作の途中である
再生信号Ａの立下り時にパラレルに取り込んでシ
フトする。従つて、この第１シフトレジスタ１４
からは、再生信号Ａの立下り時である時点t2，
t6，t8に於いて第３図ｆに示すように出力値が変
化することになり、この第１シフトレジスタ１４
の出力値は再生信号Ａの各“１”期間に於けるク
ロツクパルスCPの数、つまりビツト数を表わし
ていることになる。また、第２シフトレジスタ１
５も同様に、再生信号Ａの立下り時にカウントを
開始する第２カウンタ１３のカウント値を再生信
号Ａの立上り時に発生される微分パルスP2によ
つて取り込んで第３図ｇに示すようにシフトして
いるために、この第２シフトレジスタ１５からは
再生信号Ａの“０”期間に於けるクロツクパルス
CPの数、つまりビツト数が出力されることにな
る。このようにして、第１、第２シフトレジスタ
１４，１５から出力される再生信号Ａの“１”お
よび“０”期間のビツト数を表わす信号は、それ
ぞれ第１、第２デコーダ１６，１７に於いて10進
数に変換されて出力される。この場合、上記第１
図に於いて説明した信号フオーマツトに於いて
は、同期部Ａのみに特殊な条件が与えられてい
た。つまり、同期信号部分は22ビツトによつて構
成されていて、その前半と後半の11ビツトが互い
に異なる信号（“０”と“１”）によつて連続され
ており、かつこの11ビツトにわたつて同一種類の
信号が連らなる部分はこの部分のみに特定されて
いる。従つて、11ビツトの“０”と11ビツト
“１”が連らなる部分を取り出すことにより同期
検出が行なえることになる。ここで、第１、第２
シフトレジスタ１４，１５の出力内容を示す第３
図ｆ，ｇを見ると、再生信号Ａの“１”期間t3〜
t4，t5〜t6，t7〜t8において再生信号Ａの“１”期
間のカウント数（ビツト数）を表わす信号と前記
“１”期間に続く“０”期間のカウント数（ビツ
ト数）を表わす信号とが時間的に重なつて出力さ
れることになる。従つて、第１、第２シフトレジ
スタ１４，１５の出力を10進数にデコードする第
１、第２デコーダ１６，１７の出力端０11から出
力される10進数の「11」を表わす両信号の一致を
アンドゲート１８に於いて求めることにより、11
ビツトの“０”と11ビツトの“１”が連らなる部
分、つまり同期信号が検出され、第３図ｆ，ｇに
示すカウント値「11」が重なる部分（t3〜t4）に
於いて同期検出信号SDが出力されることになる。
従つて、第１、第２シフトレジスタ１６，１７お
よびアンドゲート１８は同期信号判別回路を構成
していることになる。
なお、上記実施例に於いては、同期信号判別回
路を第１、第２デコーダ１６，１７とアンドゲー
ト１８の組合せによつて構成したが、第１、第２
デコーダ１６，１７をマグニチユードコンパレー
タによつて構成し、基準値（11）との一致出力を
それぞれアンドゲート１８に供給するように構成
しても良い。また、クロツクパルスCPは、デイ
スクの記録時に於けるビツトレートに一致する必
要はなく、整数倍等の対応関係にあれば良く、こ
の場合には上記対応関係に関連して第１、第２デ
コーダ１６，１７の出力取り出し位置およびマグ
ニチユードコンパレータの基準値を変更する必要
があることは言うまでもない。
路を第１、第２デコーダ１６，１７とアンドゲー
ト１８の組合せによつて構成したが、第１、第２
デコーダ１６，１７をマグニチユードコンパレー
タによつて構成し、基準値（11）との一致出力を
それぞれアンドゲート１８に供給するように構成
しても良い。また、クロツクパルスCPは、デイ
スクの記録時に於けるビツトレートに一致する必
要はなく、整数倍等の対応関係にあれば良く、こ
の場合には上記対応関係に関連して第１、第２デ
コーダ１６，１７の出力取り出し位置およびマグ
ニチユードコンパレータの基準値を変更する必要
があることは言うまでもない。
以上説明したように、本発明によるデイジタ
ル・オーデイオデイスクの同期信号取出し回路
は、再生信号の立上りによつてクリアされてクロ
ツクパルスをカウントする第１カウンタと、再生
信号の立下りによつてクリアされてクロツクパル
スをカウントする第２カウンタとを設け、再生信
号の立下り時に於ける第１カウンタの出力と再生
信号の立上り時に於ける第２カウンタの出力が共
にデイスクの同期部に定められている単位ビツト
数に対応した設定値に一致する場合のみ同期信号
と判別して同期検出信号を送出するものであるた
めに、簡単な構成でありながら確実な同期検出が
行なえる優れた効果を有する。
ル・オーデイオデイスクの同期信号取出し回路
は、再生信号の立上りによつてクリアされてクロ
ツクパルスをカウントする第１カウンタと、再生
信号の立下りによつてクリアされてクロツクパル
スをカウントする第２カウンタとを設け、再生信
号の立下り時に於ける第１カウンタの出力と再生
信号の立上り時に於ける第２カウンタの出力が共
にデイスクの同期部に定められている単位ビツト
数に対応した設定値に一致する場合のみ同期信号
と判別して同期検出信号を送出するものであるた
めに、簡単な構成でありながら確実な同期検出が
行なえる優れた効果を有する。
第１図はデイジタル・オーデイオデイスクに於
ける信号フオーマツトの一例を示す図、第２図は
本発明によるデイジタル・オーデイオデイスクの
同期信号取出し回路の一実施例を示す回路図、第
３図ａ〜ｇは第２図に示す回路の各部動作波形図
である。 １…クロツク発振器、２，３…第１、第２微分
回路、１２，１３…第１、第２カウンタ、１４，
１５…第１、第２シフトレジスタ、１６，１７…
第１、第２デコーダ、１８…アンドゲート。
ける信号フオーマツトの一例を示す図、第２図は
本発明によるデイジタル・オーデイオデイスクの
同期信号取出し回路の一実施例を示す回路図、第
３図ａ〜ｇは第２図に示す回路の各部動作波形図
である。 １…クロツク発振器、２，３…第１、第２微分
回路、１２，１３…第１、第２カウンタ、１４，
１５…第１、第２シフトレジスタ、１６，１７…
第１、第２デコーダ、１８…アンドゲート。
Claims (1)
- １ デイジタル・オーデイオデイスクの再生信号
に於ける立上り部分の微分出力を送出する第１微
分回路と、上記再生信号の立下り部分の微分出力
を送出する第２微分回路と、前記第１微分回路の
微分出力によつてクリアされてクロツクパルスを
カウントする第１カウンタと、前記第２微分回路
の微分出力によつてクリアされてクロツクパルス
をカウントする第２カウンタと、前記第２微分回
路の微分出力発生時に於ける第１カウンタの計数
値を保持する第１保持回路と、前記第１微分回路
の微分出力発生時に於ける第２カウンタの計数値
を保持する第２保持回路と、前記第１、第２保持
回路の出力値が共にデイスクの同期部に定められ
ている単位ビツトに対応した設定値に一致する場
合のみ同期信号と判別して同期検出信号を送出す
る同期信号判別回路とを備えたことを特徴とする
デイジタル・オーデイオデイスクの同期信号取出
し回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56120500A JPS5823312A (ja) | 1981-07-31 | 1981-07-31 | デイジタル・オ−デイオデイスクの同期信号取出し回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56120500A JPS5823312A (ja) | 1981-07-31 | 1981-07-31 | デイジタル・オ−デイオデイスクの同期信号取出し回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5823312A JPS5823312A (ja) | 1983-02-12 |
| JPH0130238B2 true JPH0130238B2 (ja) | 1989-06-16 |
Family
ID=14787733
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56120500A Granted JPS5823312A (ja) | 1981-07-31 | 1981-07-31 | デイジタル・オ−デイオデイスクの同期信号取出し回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5823312A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59221047A (ja) * | 1983-05-30 | 1984-12-12 | Victor Co Of Japan Ltd | デイジタル信号伝送における同期信号検出回路 |
| JP3757956B2 (ja) | 2002-05-17 | 2006-03-22 | セイコーエプソン株式会社 | 液晶表示装置及びその製造方法、並びに電子機器 |
-
1981
- 1981-07-31 JP JP56120500A patent/JPS5823312A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5823312A (ja) | 1983-02-12 |
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