JPH0143332B2 - - Google Patents
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- JPH0143332B2 JPH0143332B2 JP55091472A JP9147280A JPH0143332B2 JP H0143332 B2 JPH0143332 B2 JP H0143332B2 JP 55091472 A JP55091472 A JP 55091472A JP 9147280 A JP9147280 A JP 9147280A JP H0143332 B2 JPH0143332 B2 JP H0143332B2
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- JP
- Japan
- Prior art keywords
- image data
- data
- screen
- track
- bits
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T1/00—General purpose image data processing
- G06T1/0007—Image acquisition
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Processing Or Creating Images (AREA)
- Television Signal Processing For Recording (AREA)
- Storing Facsimile Image Data (AREA)
- Image Input (AREA)
Description
本発明は記憶媒体に記憶された画像データの１
部分を取り出すことのできる画像データ処理シス
テムに関する。 前記記憶装置としては磁気、光学デイスクの他
に機械式デイスク、磁気テープ、循環型メモリ等
が挙げられる。かかる記憶装置内の画像データの
一部を変更する必要が発生した場合、従来は１ト
ラツクづつのアクセスをシステムを制御するプロ
セツサが行なつていた。 かかる構成のシステムでは制御するプロセツサ
が記憶装置へのアクセスに非常に多くの時間を費
すことになり、しかも他に外部命令の判読、及び
システム状態表示等の種々の作動も行わなければ
ならない為に、プロセツサにかかる負担が増大
し、プログラムも煩雑になる。 また、上記記憶装置内の一画面分の画像データ
の中の一部を書き換えるためには、その一画面分
の画像データを全部読み出した後処理しなければ
ならず、処理時間が長くなり不便であつた。 本発明は上記従来技術の欠点をなくした画像デ
ータ処理システムの提供を目的としており、即
ち、本発明は、画像データを記憶するための複数
のレコード（REC）からなるセクタＳ０〜Ｓ１
５と複数のセクタからなるトラツク（TRK）を
有する記憶媒体１１８へ一画面の画像データＳを
記憶し、記憶された一画面の画像データの一部分
Ｄを読み出し処理する画像データ処理システムに
おいて、 一画面の画像データを１つがｎ×ｍビツトの画
像データからなる複数の画素ブロツクPC，Ｑに
分割し、画素ブロツク中のｎ×ｍビツトの画像デ
ータを１トラツクの中のｎ個のセクタＳ０〜Ｓ１
５のそれぞれの所定のレコードにｍビツトづつ分
割して記憶し、 かつ、一画面内の隣接する画素ブロツクのｎ×
ｍビツトの画像データを上記ｎ個の所定レコード
のそれぞれに隣接するレコードにｍビツトづつ分
割して記憶し、管理する手段（第４図ａ）と、 一画面の画像データの所望の領域を表わす位置
データを発生する手段１１０と、 上記発生手段からの位置データに基づいて、上
記所望の領域に対応する画素ブロツクの画像デー
タが記憶されているトラツク及びレコードを求め
る変換手段（第５図）と、 上記変換手段により求められたトラツク及びレ
コードに基づいて、上記求められたトラツクの中
のｎ個のセクタのそれぞれ上記求められたレコー
ドにｍビツトづつ分割されて記憶された画像デー
タを読み出し、上記所望の領域に対応する画素ブ
ロツクの画像データを読み出す手段１１４とを有
する画像処理システムの提供にある。 これにより、一画面の画像データの２次元座標
と記憶媒体での記録位置の対応が簡単になるの
で、一画面の画像データの所望領域の画像データ
が記録媒体のどこに記録されているかを容易に求
めることができ、所望領域の画像データを容易に
読み出すことができる。 以下、本発明を実施例に従い説明する。本実施
例においては前記記憶装置として磁気デイスクを
用いて説明を行なう。 第１図は２次元画像と磁気デイスク及びシステ
ムメモリとの対応関係を示す図であり、第１図ａ
は一画面Ｓ内の領域指定パラメータの与え方を示
している。Ｑは正方形の最小アクセス単位、Ｐは
座標（ｘ、ｙ）で表わされる領域の基点、XD，
YDはそれぞれの軸方向に対するＱの個数、をそ
れぞれ示している。 第１図ｂは第１図ａの画面Ｓにおける領域Ｄが
デイスクＢに１次元的に記憶されているようすを
ハンチング部ｄとして示す。 第１図ｃはデイスクＢ内のハンチング部ｄのデ
ータがシステムメモリＭのD′に、本インタフエ
ースを経由して、対応することを示す。 次に画像空間とデイスクメモリー空間との対応
づけについて具体例を用いて説明する。 第２図はデイスクＢ内のデータ構成例を示した
ものである。デイスクＢは片面（１ドライブ）
256トラツクで、１つのトラツクTRKは16のセク
タＳ０〜Ｓ１５から成り、さらに１つのセクタは
256のレコードRECの集合であり、１レコードは
16ビツトである。第３図は１つのセクターをとり
出して表わしてある。 第４図は１画像区画（ピクチユアーセル）PC
とデイスク内のデータブロツクとの対応を示した
ものである。第４図ａでピクチユアーセルの横軸
はレコード番号を示し縦軸はトラツク番号を示し
ている。アクセス（指定できる）する最小単位は
１ピクチユアーセルであり、第４図ｂで１ピクチ
ユアセルを16ビツト×16ビツトとすることを表わ
している。 例えばＱという単一セルの画素（16×16個）は
トラツクNo.２でレコードNo.４である16個の全セク
ターに存在することを示している。したがつてＱ
＝（４、２）と表わせる。 第５図では、画像領域の指定に前述の方法を拡
長している。 領域Ｄを表わすには、その構成セルの座標を全
て用いる必要はなく、最外郭対角線上に存在する
セルQ1，Q2を用いればよい。なぜならばＤは連
続領域であるから、
部分を取り出すことのできる画像データ処理シス
テムに関する。 前記記憶装置としては磁気、光学デイスクの他
に機械式デイスク、磁気テープ、循環型メモリ等
が挙げられる。かかる記憶装置内の画像データの
一部を変更する必要が発生した場合、従来は１ト
ラツクづつのアクセスをシステムを制御するプロ
セツサが行なつていた。 かかる構成のシステムでは制御するプロセツサ
が記憶装置へのアクセスに非常に多くの時間を費
すことになり、しかも他に外部命令の判読、及び
システム状態表示等の種々の作動も行わなければ
ならない為に、プロセツサにかかる負担が増大
し、プログラムも煩雑になる。 また、上記記憶装置内の一画面分の画像データ
の中の一部を書き換えるためには、その一画面分
の画像データを全部読み出した後処理しなければ
ならず、処理時間が長くなり不便であつた。 本発明は上記従来技術の欠点をなくした画像デ
ータ処理システムの提供を目的としており、即
ち、本発明は、画像データを記憶するための複数
のレコード（REC）からなるセクタＳ０〜Ｓ１
５と複数のセクタからなるトラツク（TRK）を
有する記憶媒体１１８へ一画面の画像データＳを
記憶し、記憶された一画面の画像データの一部分
Ｄを読み出し処理する画像データ処理システムに
おいて、 一画面の画像データを１つがｎ×ｍビツトの画
像データからなる複数の画素ブロツクPC，Ｑに
分割し、画素ブロツク中のｎ×ｍビツトの画像デ
ータを１トラツクの中のｎ個のセクタＳ０〜Ｓ１
５のそれぞれの所定のレコードにｍビツトづつ分
割して記憶し、 かつ、一画面内の隣接する画素ブロツクのｎ×
ｍビツトの画像データを上記ｎ個の所定レコード
のそれぞれに隣接するレコードにｍビツトづつ分
割して記憶し、管理する手段（第４図ａ）と、 一画面の画像データの所望の領域を表わす位置
データを発生する手段１１０と、 上記発生手段からの位置データに基づいて、上
記所望の領域に対応する画素ブロツクの画像デー
タが記憶されているトラツク及びレコードを求め
る変換手段（第５図）と、 上記変換手段により求められたトラツク及びレ
コードに基づいて、上記求められたトラツクの中
のｎ個のセクタのそれぞれ上記求められたレコー
ドにｍビツトづつ分割されて記憶された画像デー
タを読み出し、上記所望の領域に対応する画素ブ
ロツクの画像データを読み出す手段１１４とを有
する画像処理システムの提供にある。 これにより、一画面の画像データの２次元座標
と記憶媒体での記録位置の対応が簡単になるの
で、一画面の画像データの所望領域の画像データ
が記録媒体のどこに記録されているかを容易に求
めることができ、所望領域の画像データを容易に
読み出すことができる。 以下、本発明を実施例に従い説明する。本実施
例においては前記記憶装置として磁気デイスクを
用いて説明を行なう。 第１図は２次元画像と磁気デイスク及びシステ
ムメモリとの対応関係を示す図であり、第１図ａ
は一画面Ｓ内の領域指定パラメータの与え方を示
している。Ｑは正方形の最小アクセス単位、Ｐは
座標（ｘ、ｙ）で表わされる領域の基点、XD，
YDはそれぞれの軸方向に対するＱの個数、をそ
れぞれ示している。 第１図ｂは第１図ａの画面Ｓにおける領域Ｄが
デイスクＢに１次元的に記憶されているようすを
ハンチング部ｄとして示す。 第１図ｃはデイスクＢ内のハンチング部ｄのデ
ータがシステムメモリＭのD′に、本インタフエ
ースを経由して、対応することを示す。 次に画像空間とデイスクメモリー空間との対応
づけについて具体例を用いて説明する。 第２図はデイスクＢ内のデータ構成例を示した
ものである。デイスクＢは片面（１ドライブ）
256トラツクで、１つのトラツクTRKは16のセク
タＳ０〜Ｓ１５から成り、さらに１つのセクタは
256のレコードRECの集合であり、１レコードは
16ビツトである。第３図は１つのセクターをとり
出して表わしてある。 第４図は１画像区画（ピクチユアーセル）PC
とデイスク内のデータブロツクとの対応を示した
ものである。第４図ａでピクチユアーセルの横軸
はレコード番号を示し縦軸はトラツク番号を示し
ている。アクセス（指定できる）する最小単位は
１ピクチユアーセルであり、第４図ｂで１ピクチ
ユアセルを16ビツト×16ビツトとすることを表わ
している。 例えばＱという単一セルの画素（16×16個）は
トラツクNo.２でレコードNo.４である16個の全セク
ターに存在することを示している。したがつてＱ
＝（４、２）と表わせる。 第５図では、画像領域の指定に前述の方法を拡
長している。 領域Ｄを表わすには、その構成セルの座標を全
て用いる必要はなく、最外郭対角線上に存在する
セルQ1，Q2を用いればよい。なぜならばＤは連
続領域であるから、
【式】と表わせ、
Ｄ＝（Q1、Q2）とすれば
【式】と表わせる。
Ｄは連続領域であるから、デイスクＢ上の領域
Ｄに対応するメモリ領域Ｍは、 Ｍ＝〔REC（２→４）TRK（２→３）〕 と表わせる。 ここで１トラツクのセクター数とピクチユアー
セルのたて方向画素数を共に16として等しくした
ことによりＭにセクタのパラメータをいれる必要
がなくなり画像領域をレコード番号とトラツク番
号の２つのパラメータだけで指定できる。 本発明によれば内容の一部変更のときも１画面
Ｓの全情報あるいは指定外の情報をシステムメモ
リＭに展開しなくてよく必要な部分のみですむた
め、Ｍの使用容量も節約できる利点がある、また
本体CPUはｉ／ｏ制御のための細かな命令の実
行が不要となりCPUの負荷が軽減される。 第６図はシステム構成を示したものである。 入力回路９５、及び表示回路９７と接続される
入出力インタフエース１００、システムを統轄制
御する主プロセツサ（以下CPU）１０１、主プ
ロセツサ１０１の制御プログラムを格納するプロ
グラムメモリ１０２、ランダムアクセス可能なデ
ータメモリ１０３及びCPU１０１を介さずに直
接メモリ１０３をアクセスできるDMAチヤネル
１０９がシステムバス１０７により相互接続され
ている。 また、データハンドラ１１４は磁気デイスク１
１８とDMAチヤネル１０９のデータ線路中間に
位置しインタプリツタプロセツサ１１９がコント
ロールレジスタ１１０の内容により実行するシー
ケンスによつて、フローデータのバツフアリン
グ、セレクテイング、トランスフア機能を有する
データ処理ハードロジツク回路である。 一方第６図ｂはDMAチヤネル１０９内に設け
られたコントロールレジスタ１１０を示してい
る。これらレジスターは、CPU１０１からみて
プログラムメモリ１０２及びデータメモリ１０３
と共に同一アドレス空間に属し、一般命令で参
照・変更が可能でかつインタプリツタプロセツサ
１１９からは、その入出力ポートを通じて参照変
更が可能である。 レジスタ機能を説明すると、 ステータスレジスタSTRは本発明のインタフ
エースの動作状態を示すレジスタである。そのビ
ツトアサイメント（割り付け）を第６図ｃに示
す。ここでBusyは、インタフエース起動中チヤ
ネル側ハードウエアーでセツトされ、オペレータ
コール〔Operator Call〕信号OPCALLはデイス
ク装置が非接続かデイスク回転不良等の何らかの
オペレータの手動操作を要求されていることを示
すインタプリツタプロセツサ１１９によりセツト
されるビツトで、DATAENDは、インタフエー
ス処理の終了をCPUに割込みで通知するための
ビツトでインタプリツタ１１９によりセツトされ
る。またERRORは、DMA転送に何らかのハー
ド的エラーが検出されたときDMAチヤネルハー
ドウエアによつてセツトされる。このとき同時に
DATAENDもセツトされる。 コマンドレジスタCMRはインタフエースに対
する起動要求と起動モードをセツトするものであ
る。第６図ｄはそのビツトアサインメントを示し
たものである。コマンドコードとともにSTART
をオンすると、インタフエースは、第２図ｃのビ
ジービツトBUSYをオンとして実行を開始する。 メモリアドレスレジスタMARはデータメモリ
Ｍにおける対象となるアドレス領域の先頭番地を
セツトするためのものである。 バイトカウントレジスタBCRは転送バイト数
でこれはインタプリツタよりセツトされる。 第７図はデータハンドラー１１４の構成を具体
的に示したものである。 まずデイスク装置からの信号について説明す
る。INDEXはデイスク１回転に１回出力される
デイスク周上の起点を示すパルス信号である。 TRACK ADDRESSはトラツクの指定を行う
ために用いられる。読出命令信号READ
COMMANDを出力すると読出クロツクREAD
CLOCKと共にデイスクから読み出されたデータ
DEAD DISK DATAが出力する。同様に書込命
令信号WRIT COMMANDを出力して書き込み
クロツクWRIT CLOCKの入力に従つてデイス
クに書き込むデータWRIT DISKDATAをセツ
トする。 次に機能モジユールを説明する。 プリセツトカウンタ２１３は入力端子PREか
ら信号LOADによつてセツトされた数値から端
子CKに入力されたパルス数をカウントしてオー
バーフローとなつた時信号REPRE CARRYを出
力する。 デイジタルコンパレータ２０６はＡ端子入力と
してプリセツトカウンター値、Ｂ端子入力として
のSTART ADRESSを入力して比較し、その結
果を常時Ａ＝Ｂ、Ａ＞Ｂに出力する。 バツフアメモリ２１４は端子ADDRESに入力
されたプリセツトカウンタ２１３のカウント値に
よつて選ばれた１ビツトを記憶するものでWEは
書きこみパルス入力端子Ｄ−out Ｄ−inはそれぞ
れデータの入、出力端子である。 シリアルインパラレルアウトシフトレジスタ２
０１は、端子inのデータが端子ckへのシフトパル
ス入力に従つて内部シフトレジスタにセツトされ
ていく。シフトパルスは、またデータカウンタ２
１７にも入力されこれがカウントアツプした時レ
ジスタ２０１に全ビツトのデータがセツトされた
事を信号DATA READYで知らせる。 DMAチヤネル１０９側には読み出しデータ
READ DATAがレジスタ２０１のパラレル出力
端子outより、よみ出される。 パラレルロードシリアルアウトシフトレジスタ
２０２もレジスタ２０１と同様の動きであるが２
０１はシリアルデータをパラレルデータに、２０
２はシリアルデータをパラレルデータにそれぞれ
変換する機能をもつ。 以上の如く、構成すると、外部入力回路９５よ
り、磁気デイスク１１８内の画像データをメモリ
１０３内のデータと書き換えると、デイスク内で
のデータの置換、データの消去等が指令される、
CPU１０１が命令内容をDMAチヤネル１０９内
のコマンドレジスタ１１０に移し、後の動作はイ
ンタプリツタプロセサ１１９がコマンドレジスタ
１１０内の命令によりデータハンドラ１１４を使
つてデータ処理を行う。従つてデータ処理の間に
CPU１０１は自由状態となり、他の処理が可能
となり、システムへの多種の機能付加、及び
CPU１０１のプログラム作成の簡単化を図るこ
とができる。 そしてシステムメモリ（データメモリ１０３）
とデータハンドラ間をDMAチヤネルで接続する
ことにより高速度のデータ転送が可能となる。更
に磁気、光学等のデイスクを記憶装置として用い
た場合に１トラツクのセクタ数とピクチユアセル
の一方向の画素数を等しくとることにより、より
データの置換、消去を簡単化できる。 以上の如く本発明によりより効率的な画像デー
タ処理を行うことができる画像処理システムを提
供できる。
Ｄに対応するメモリ領域Ｍは、 Ｍ＝〔REC（２→４）TRK（２→３）〕 と表わせる。 ここで１トラツクのセクター数とピクチユアー
セルのたて方向画素数を共に16として等しくした
ことによりＭにセクタのパラメータをいれる必要
がなくなり画像領域をレコード番号とトラツク番
号の２つのパラメータだけで指定できる。 本発明によれば内容の一部変更のときも１画面
Ｓの全情報あるいは指定外の情報をシステムメモ
リＭに展開しなくてよく必要な部分のみですむた
め、Ｍの使用容量も節約できる利点がある、また
本体CPUはｉ／ｏ制御のための細かな命令の実
行が不要となりCPUの負荷が軽減される。 第６図はシステム構成を示したものである。 入力回路９５、及び表示回路９７と接続される
入出力インタフエース１００、システムを統轄制
御する主プロセツサ（以下CPU）１０１、主プ
ロセツサ１０１の制御プログラムを格納するプロ
グラムメモリ１０２、ランダムアクセス可能なデ
ータメモリ１０３及びCPU１０１を介さずに直
接メモリ１０３をアクセスできるDMAチヤネル
１０９がシステムバス１０７により相互接続され
ている。 また、データハンドラ１１４は磁気デイスク１
１８とDMAチヤネル１０９のデータ線路中間に
位置しインタプリツタプロセツサ１１９がコント
ロールレジスタ１１０の内容により実行するシー
ケンスによつて、フローデータのバツフアリン
グ、セレクテイング、トランスフア機能を有する
データ処理ハードロジツク回路である。 一方第６図ｂはDMAチヤネル１０９内に設け
られたコントロールレジスタ１１０を示してい
る。これらレジスターは、CPU１０１からみて
プログラムメモリ１０２及びデータメモリ１０３
と共に同一アドレス空間に属し、一般命令で参
照・変更が可能でかつインタプリツタプロセツサ
１１９からは、その入出力ポートを通じて参照変
更が可能である。 レジスタ機能を説明すると、 ステータスレジスタSTRは本発明のインタフ
エースの動作状態を示すレジスタである。そのビ
ツトアサイメント（割り付け）を第６図ｃに示
す。ここでBusyは、インタフエース起動中チヤ
ネル側ハードウエアーでセツトされ、オペレータ
コール〔Operator Call〕信号OPCALLはデイス
ク装置が非接続かデイスク回転不良等の何らかの
オペレータの手動操作を要求されていることを示
すインタプリツタプロセツサ１１９によりセツト
されるビツトで、DATAENDは、インタフエー
ス処理の終了をCPUに割込みで通知するための
ビツトでインタプリツタ１１９によりセツトされ
る。またERRORは、DMA転送に何らかのハー
ド的エラーが検出されたときDMAチヤネルハー
ドウエアによつてセツトされる。このとき同時に
DATAENDもセツトされる。 コマンドレジスタCMRはインタフエースに対
する起動要求と起動モードをセツトするものであ
る。第６図ｄはそのビツトアサインメントを示し
たものである。コマンドコードとともにSTART
をオンすると、インタフエースは、第２図ｃのビ
ジービツトBUSYをオンとして実行を開始する。 メモリアドレスレジスタMARはデータメモリ
Ｍにおける対象となるアドレス領域の先頭番地を
セツトするためのものである。 バイトカウントレジスタBCRは転送バイト数
でこれはインタプリツタよりセツトされる。 第７図はデータハンドラー１１４の構成を具体
的に示したものである。 まずデイスク装置からの信号について説明す
る。INDEXはデイスク１回転に１回出力される
デイスク周上の起点を示すパルス信号である。 TRACK ADDRESSはトラツクの指定を行う
ために用いられる。読出命令信号READ
COMMANDを出力すると読出クロツクREAD
CLOCKと共にデイスクから読み出されたデータ
DEAD DISK DATAが出力する。同様に書込命
令信号WRIT COMMANDを出力して書き込み
クロツクWRIT CLOCKの入力に従つてデイス
クに書き込むデータWRIT DISKDATAをセツ
トする。 次に機能モジユールを説明する。 プリセツトカウンタ２１３は入力端子PREか
ら信号LOADによつてセツトされた数値から端
子CKに入力されたパルス数をカウントしてオー
バーフローとなつた時信号REPRE CARRYを出
力する。 デイジタルコンパレータ２０６はＡ端子入力と
してプリセツトカウンター値、Ｂ端子入力として
のSTART ADRESSを入力して比較し、その結
果を常時Ａ＝Ｂ、Ａ＞Ｂに出力する。 バツフアメモリ２１４は端子ADDRESに入力
されたプリセツトカウンタ２１３のカウント値に
よつて選ばれた１ビツトを記憶するものでWEは
書きこみパルス入力端子Ｄ−out Ｄ−inはそれぞ
れデータの入、出力端子である。 シリアルインパラレルアウトシフトレジスタ２
０１は、端子inのデータが端子ckへのシフトパル
ス入力に従つて内部シフトレジスタにセツトされ
ていく。シフトパルスは、またデータカウンタ２
１７にも入力されこれがカウントアツプした時レ
ジスタ２０１に全ビツトのデータがセツトされた
事を信号DATA READYで知らせる。 DMAチヤネル１０９側には読み出しデータ
READ DATAがレジスタ２０１のパラレル出力
端子outより、よみ出される。 パラレルロードシリアルアウトシフトレジスタ
２０２もレジスタ２０１と同様の動きであるが２
０１はシリアルデータをパラレルデータに、２０
２はシリアルデータをパラレルデータにそれぞれ
変換する機能をもつ。 以上の如く、構成すると、外部入力回路９５よ
り、磁気デイスク１１８内の画像データをメモリ
１０３内のデータと書き換えると、デイスク内で
のデータの置換、データの消去等が指令される、
CPU１０１が命令内容をDMAチヤネル１０９内
のコマンドレジスタ１１０に移し、後の動作はイ
ンタプリツタプロセサ１１９がコマンドレジスタ
１１０内の命令によりデータハンドラ１１４を使
つてデータ処理を行う。従つてデータ処理の間に
CPU１０１は自由状態となり、他の処理が可能
となり、システムへの多種の機能付加、及び
CPU１０１のプログラム作成の簡単化を図るこ
とができる。 そしてシステムメモリ（データメモリ１０３）
とデータハンドラ間をDMAチヤネルで接続する
ことにより高速度のデータ転送が可能となる。更
に磁気、光学等のデイスクを記憶装置として用い
た場合に１トラツクのセクタ数とピクチユアセル
の一方向の画素数を等しくとることにより、より
データの置換、消去を簡単化できる。 以上の如く本発明によりより効率的な画像デー
タ処理を行うことができる画像処理システムを提
供できる。
第１図は２次元画面と、磁気デイスク及びシス
テムメモリとの対応関係を示す図、第２図はデイ
スク内のデータ構成例を示す図、第３図はデイス
ク内のセクタの構成を示す図、第４図は１画像区
画とデイスク内の記録位置の対応を示す図、第５
図は画像領域の指定を示す図、第６図はシステム
の構成図、第７図はデータハンドラ１１４の詳細
回路図である。 図において、１０１は主プロセツサ、１０３は
データメモリ、１０９はDMAチヤネル、１１０
はコマンドレジスタ、１１９はインタプリツタ・
プロセツサ、１１４はデータハンドラー、１１８
は記憶デイスクをそれぞれ示す。
テムメモリとの対応関係を示す図、第２図はデイ
スク内のデータ構成例を示す図、第３図はデイス
ク内のセクタの構成を示す図、第４図は１画像区
画とデイスク内の記録位置の対応を示す図、第５
図は画像領域の指定を示す図、第６図はシステム
の構成図、第７図はデータハンドラ１１４の詳細
回路図である。 図において、１０１は主プロセツサ、１０３は
データメモリ、１０９はDMAチヤネル、１１０
はコマンドレジスタ、１１９はインタプリツタ・
プロセツサ、１１４はデータハンドラー、１１８
は記憶デイスクをそれぞれ示す。
Claims (1)
- 【特許請求の範囲】 １ 画像データを記憶するための複数のレコード
からなるセクタと複数のセクタからなるトラツク
を有する記憶媒体へ一画面の画像データを記憶
し、記憶された一画面の画像データの一部分を読
み出し処理する画像データ処理システムにおい
て、 一画面の画像データを１つがｎ×ｍビツトの画
像データからなる複数の画素ブロツクに分割し、
画素ブロツク中のｎ×ｍビツトの画像データを１
トラツクの中のｎ個のセクタのそれぞれの所定の
レコードにｍビツトづつ分割して記憶し、 かつ、一画面内の隣接する画素ブロツクのｎ×
ｍビツトの画像データを上記ｎ個の所定レコード
のそれぞれに隣接するレコードにｍビツトづつ分
割して記憶し、管理する手段と、 一画面の画像データの所望の領域を表わす位置
データを発生する手段と、 上記発生手段からの位置データに基づいて、上
記所望の領域に対応する画素ブロツクの画像デー
タが記憶されているトラツク及びレコードを求め
る変換手段と、 上記変換手段により求められたトラツク及びレ
コードに基づいて、上記求められたトラツクの中
のｎ個のセクタのそれぞれ上記求められたレコー
ドにｍビツトづつ分割されて記憶された画像デー
タを読み出し、上記所望の領域に対応する画素ブ
ロツクの画像データを読み出す手段とを有するこ
とを特徴とする画像データ処理システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9147280A JPS5717073A (en) | 1980-07-04 | 1980-07-04 | Picture data processing system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9147280A JPS5717073A (en) | 1980-07-04 | 1980-07-04 | Picture data processing system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5717073A JPS5717073A (en) | 1982-01-28 |
| JPH0143332B2 true JPH0143332B2 (ja) | 1989-09-20 |
Family
ID=14027328
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9147280A Granted JPS5717073A (en) | 1980-07-04 | 1980-07-04 | Picture data processing system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5717073A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01149688A (ja) * | 1987-12-07 | 1989-06-12 | Mitsubishi Electric Corp | 静止画入出力システム |
| JPH0811083A (ja) * | 1994-06-28 | 1996-01-16 | Nec Corp | トリマ部品の自動調整装置 |
| JPH10207446A (ja) | 1997-01-23 | 1998-08-07 | Sharp Corp | プログラマブル表示装置 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4032081Y1 (ja) * | 1965-03-15 | 1965-11-10 | ||
| JPS4859742A (ja) * | 1971-11-24 | 1973-08-22 | ||
| NL7507050A (nl) * | 1975-06-13 | 1976-12-15 | Philips Nv | Geheugensysteem. |
| JPS5833588B2 (ja) * | 1977-12-12 | 1983-07-20 | 工業技術院長 | 映像処理装置 |
-
1980
- 1980-07-04 JP JP9147280A patent/JPS5717073A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5717073A (en) | 1982-01-28 |
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