JPH021065A - 画像表示装置 - Google Patents

画像表示装置

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JPH021065A
JPH021065A JP63329744A JP32974488A JPH021065A JP H021065 A JPH021065 A JP H021065A JP 63329744 A JP63329744 A JP 63329744A JP 32974488 A JP32974488 A JP 32974488A JP H021065 A JPH021065 A JP H021065A
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circuit
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JP63329744A
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English (en)
Inventor
Kazuhiko Iida
和彦 飯田
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication date
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Publication of JPH021065A publication Critical patent/JPH021065A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の技術分野] この発明は文書などの画像情報を記憶装置に記憶し、か
つこの記憶装置に記憶された各種画像情報のうちから必
要に応じて所要の画像情報を検索して読出し、それを目
視し得る状態に出力する画像情報記憶検索装置の画像表
示装置に関する。
[発明の技術的背景とその問題点] 最近、多量に発生する文書などの画像情報を光学的な2
次元走査によって読取り、この読取った画像′FW報全
記憶装置たとえば光デイスク装置に記憶しておくととも
に、この記憶装置に記憶されている各種画像情報のうち
から必要に応じて所要の画像情報全検索して読出し、そ
れをハードコピー装置で目視し得る状態に出力する画像
情報記憶検索装置が開発され、実用化されている。
そして、このような画像情報記憶検索装置においては、
読取速度と記憶速度との相違あるいは読、を速度と記憶
速度との相違に対処するため、読取った一単位分(−頁
分)の画像情報あるいは読出された一単位分の画像情報
音−旦ページノ(ソファメモリに記憶するようにしてい
る。ま念、表示用インターフェースおよびCRTデイス
プレィなどから成る画像情報表示装置を備えており、ペ
ージバッファメモリ内の画像情報全モニタ表示できるよ
うになっている。
ところで、第1図に示すように、上記ページバッファメ
モリは2048 bit X 280 Qラインの記憶
領域を有するものであるのに対し、上記表示用インタフ
ェース内のリフレッシュメモリは1024 bit X
 700ラインの記憶領域しかなく、このためページバ
ッファメモリ内の全ての画像情報を一括してCRTデイ
スプレィに表示することは不可能である。
そこで、従来では、表示用インタフェース内にす・fズ
変換回路?設け、ページバッファメモリから読出される
画像惰報全174に縮小してリフレッシ−メモリに記憶
することにより、第2図に示すようにページバッファメ
モリ内の全ての画像情報’i CRTデイスプレィに一
括して表示するようにしていた。
しかしながら、この場合、画像情報のサイズにかかわら
ず縮小率が一定であるため、CRTデイスプレィに表示
される画像情報の大きさはまちまちであり、CRTデイ
スプレィ上の表示領域が有効に利用されないという欠点
があった。
[発明の目的] この発明は上記のような事情に鑑みてなされたもので、
その目的とするところは、表示部の表示領域全体に画像
を表示し得るよう画像のサイズを変換することができ、
表示部の表示領域を有効に利用することができるすぐれ
次画像表示装置全提供することにある。
[発明の概要コ この発明はページメモリに記憶されている読取手段によ
って読取られた画像情報、あるいは光記憶手段から検索
出力された画像情報をサイズ変換手段で変換してリフレ
ッシュメモリに記憶し、かつこのリフレッシュメモリ内
の画像情報を表示手段で表示するものにおいて、制御手
段により原稿のサイズに係わりなくサイズ変換手段の変
換率を設定することにより、画像情報を一定のサイズで
しかも全体を表示手段の表示領域いっばいに表示せしめ
るものである。
[発明の実施例コ 以下、この発明の一実施例について図面全参照して説明
する。第3図および第4図において、1は主制御装置で
あり、各種制御を行なうCPU 2、各種ファイルセッ
ト(後述する光ディスクの集合)および各穐ファイル(
光ディスク)を管理するための管理情報が記憶された管
理情報記憶装置たとえばフロッピーディスク装置3、後
述する光デイスク装置9から読出されるタイトル情報を
一時記憶するためのタイトルメモリ4、少なくとも一単
位分(原稿−頁分)の画像情報に対応する記憶領域(2
048ビツトX2800ライン)を有するページバッフ
ァメモリ5、文字や記号などのパターン情報が格納され
念パターンジェネレータ6などから成っている。また、
7は読取装置たとえば2次元走査装置で、原稿(文書)
8上音2次元走査することによシ原稿8上の画像情報に
応じたビデオ信号を得るものである。9は大容量記憶装
置であるところの光デイスク装置で、上記2次元走査装
置で読取られる画像情報および主制御装置1で作成され
る画像情報を記憶媒体つまり光ディスクの専用記憶領域
にそれぞれ順次記憶するものである。10はキーが−ド
で、画像情報に対応する個有のタイトルおよび各種動作
指令などを入力するものである。11は出力装置である
ところのハードコピー装置で、2次元走査装置7で読取
られる画像情報あるいは光デイスク装置9から読出され
る画像惰報全ハードコピー12として出力するものであ
る。13は出力装置であるところの画像表示装置で、サ
イズ変換回路14、表示用インタフェース15、陰極線
管表示装置(以下CRTデイスプレィと称す)16など
から成シ、2次元走査装置7で読取られる画像情報ある
いは光ディスク獲置9から読出される画像情報全表示す
るもので、bる。
しかして、フロッピーディスク装置3、タイトルメモリ
4、ページバッファメモリ5、ノやターンジェネレータ
6.2次元走査装置7、光デイスク装置9、キーデート
10、ハードコピー装置11、サイズ変換回路14、表
示用インタフェース15はそれぞれCPU 2からのデ
ータバス20に接続される。まな、タイトルメモリ4、
ページバッファメモリ5、ノぐターンジェネレータ6.
2次元走査装置7、元ディスク装置9、ハードコピー装
置1ノ、サイズ変換回路14、表示用インタフニス15
はそれぞれイメージバス21に接続すれており、互いに
情報の転送がなされるようになっている。
ここで、第5図は上記2次元走査装置7を具体的に示す
ものである。丁なわち、31は給紙トレイで、このトレ
イ31上にセットされる原稿は取込みローラ32.32
によって本体内に取込まれ、さらに搬送ローラ33,3
3によって原稿台(ガラス板)34上へ供給される。そ
して、この原稿台34を経た原稿は搬送ローラ35,3
5および排紙ローラ36,36によって排紙トレイ37
上に排出される。上記原稿台34と対応する位置には1
対の露光ラング38.38が設けられており、このラン
プ38.38から発せられる光は搬送されてくる原稿上
に照射され、その反射光はミラー39および投影レンズ
40f介してCCDラインセンサ41に投影される。こ
うして、ラインセンサ41から原稿上の画像情報に応じ
たビデオ信号が得られるようになっている。なお、上記
取込みローラ32,32の近傍には、取込まれる原稿全
検知するための発光ダイオード42およびフォトトラン
ジスタ43から成るフォトカプラが配設されるとともに
、取込まれた原稿のサイズ全検矧するための発光ダイオ
ード41 & (44b、44e、44d)およびフォ
トトランジスタ45IL(45b、44c。
44d)から成るフォトカプラが配設される。
第6図(jL) (b)は上記フォトトランジスタ43
の出力に基づく動作制御回路の構成および動作を示すも
のである。すなわち、フォトトランジスタ43の出力は
インバータ45全介して第1タイマ46、第2タイマ4
7、第3タイマ48に供給される。
第1タイマ46は、原稿の先端が検知されてから一定時
間だけ上記各ローラおよびランf38゜38f動作させ
る念めの1嘔動信号全出力する。第2タイマ47は、原
稿の先端が検知されてから所定時間後にラインセンサ4
1全動作させるための読取開始信号を出力する。第3タ
イマ48は、原稿の先端が検知されてから所定時間後に
ラインセンサ41の動作全停止する几めの読取終了信号
を出力するようになっている。
また、第7図(a) aは上記フォトトランジスタ45
 & (45b、45e、45d)の配設状態およびそ
の出力に基づくサイズ検知回路の構成を示すものである
。すなわち、原稿の搬送方向と直交する方向に各発光ダ
イオードおよびそれに対応するフォトトランジスタ45
*、45b、45c、4561に一定間隔金もって配設
しており、搬送路上の側端全基準として投入される原稿
のサイズに応じて各フォトトランジスタの出力が異なる
ことにより、アンド回路49,50,51.52からそ
れぞれA、検知信号%  B4検知信号、A4検知信号
、Bs検知信号を得るようになっている。
ここで、上記のような構成においてどのような動作がな
されるか全簡単に説明しておく。
2次元走査装置7に原稿8全セツトすると、その原稿8
上の画像情報が読取られ、それがページバッファメモリ
5に順次記憶される。このとき、2次元走査装置7で検
知される原稿サイズはCPU2へ供給され、そのCPU
 l内のRAMに記憶される。
しかして、−単位分の画像情報が4−ジバッファメモリ
5に記憶されると、CPU2は検知された原稿サイズに
対応するサイズ変換$(縮小率)をROMから読出し、
それをサイズ変換回路14に設定する。こうして、ペー
ジバッファメモリ5内の画像情報はサイズ変換回路14
で所定のサイズまで縮小され、表示用インタフェース1
5内のリフレッシュメモリに記憶される。そして、その
リフレッシュメモリ内の画像情報がCRT 7″イスプ
レイ16で表示される。
また、光デイスク装置9から画像情報が読出されると、
その読出された画像情報はページバッファメモリ5に順
次記憶される。このとき、読出された画像tW報に対応
するインデックス情報に予め含まれている原稿サイズ情
報がCPU 2へ供給され、そのCPo 2内のRAM
に記憶される。しかして、−単位分の画像情報がページ
バッファメモリ5に記憶されると、CPtJ’は記憶し
ている原稿サイズ情報に対応するサイズ変換率(縮小″
4) ’e ROMから読出し、それをサイズ変換回路
14に設定する。
こうして、ページバッファメモリ5内の画像情報はサイ
ズ変換回路14で所定のサイズまで縮小され、表示用イ
ンタフェース15内のリフレッシュメモリに記憶される
。そして、そのリフレッシ−メモリ内の画像情報がCR
Tデイスプレィ16で表示される。
次に、上記したサイズ変換回路14、表示用インタフェ
ース15について詳しく説明する。まず、第8図はサイ
ズ変換回路14全示すものである。
すなわち、(−ジバッファメモリ5の1ラインの画像情
報はデータ入力端子400に供給される。
この場合、1ラインの画像情報は2048ピツトから成
る。端子400に供給される画像情報はRAM 401
と6ビツトのラッチ回路406に供給される。RAM 
401は2に×1ピットのものであ勺そのアドレスはカ
ウンタ413の出力によって指定される。しかして、5
つのRAM 401〜405並びに7つのラッチ回路4
06〜412が設けられる。これらRAM 402〜4
05並びにラッチ回路406〜412は、全て実線によ
って示される信号路teは二点鎖線で示される信号路を
介して主クロツク発生器414から供給されるクロック
信号により作動する。この場合、実線の信号路は縮小回
路として働くとき用いられ、二点鎖線の信号路は拡大回
路として働くとき用いられる。
カウンタ413のアドレス制御下において、2048ピ
ツトの最初の1ラインの画像情報は最初のRAM 40
1に格納される。次いで、第2ラインの画像情報の最初
のビットがRAM 40 Jに供給されるとき、RAM
(07に格納され友最初のライン画像情報の最初のビッ
トはそこから読出され、ラッチ回路406でラッチされ
る。一方、第2ラインの最初のビットはRAM 401
の最初のメモリ・o ケ−ジョンに格納される。次いで
、第2ラインの第2ビツトはRAM 401に格納され
、第1ラインの第2ビツトはそこから読出されてラッチ
回路406にラッチされる。同時に、ラッチ回路406
にラッチされ念力1ラインの第1ピツトはRAM402
に読出され、そこに格納される。このように、第2ライ
ンの最後(2048番目)のビットがRAMに格納され
ると、2048ピツトの最初の1ライン画像情報はRA
M 402にシフトされる。
したがって、2048ピツトの各1ライン画像惰報はR
AM 401〜405で順次シフトされる。最後に、第
1ライン〜第5ラインの画像清報はそれぞれRAM 4
05〜401に格納され、各第1ライン〜第5ラインの
画像情報の最初のビットがラッチ回路406にラッチさ
れ、同時に端子400に供給される第6ライン画像情報
の最初のビットと共にラッチ回路407に供給される。
第6ラインの第2ビツトが端子400に供給されると、
ラッチ回路401でラッチされた第1ライン〜第6ライ
ンの各最初のビットは次のラッチ回路408へ供給され
、第1ライン〜第6ラインの各第2ビツトはラッチ回路
407にラッチされる。同様にして、第6ラインの画像
情報の第7ピツトが端子400に供給されると、各第1
〜第6ラインの最初のビットはラッチ回路412でラッ
チされ、その第2ビツトはラッチ回路411にラッチさ
れ、第3ビツトはラッチ回路410にラッチされ、第4
ピツトはラッチ回路409にラッチされ、第5ビツトは
ラッチ回路408にラッチされ、そして第6ビツトはラ
ッチ回路407にラッチされる。したがって、ラッチ回
路407〜412にラッチされたそれぞれのビットがマ
トリックス・アレーに再配置されると、原画は第9図に
示すようにドツト画像として再生される。第9図では、
黒色ドツトはlビッユを表わし、白色ドツトは0ビラト
ラ表わす。したがって、6ビツ)(X方向)×6ライン
(Y方向)の局部画像清報がラッチ回、塔405〜41
2から演算ROM 415に供給され乙。
2つの加算器416,417と、2つのラッチ回路41
8,419と、比較器420と、カウンタ413とでX
方向の距離計算回路430を構成し、2の加算器421
.422と、2つのラッチ回路423,424と、比較
器425と、カウンタ426とでY方向の距離計算回路
431を構成する。これらの距離計算回路430,43
1はX。
Y方向においてサイズ変換された画像ドツト位置全計算
するために用いられる。CPU 2から供給されるX、
Y方向におけるサイズ変換(拡大1.縮小)率設定7”
−夕は、加算器416,417,421および422へ
供給される。第8図において、縮小率f−夕は一例とし
て示されている。縮小率の整数部は加算器416.42
1およびデコーダ427へ供給され、その小数部分はM
Jn器417゜422へ供給される。加算器416,4
17゜421.422の出力はラッチ回路418,41
9゜423.424へそれぞれ供給される。ラッチ回路
418,423の出力は比較器420,425゜の−入
力端にそれぞれ供給され、加算器416゜421の入力
側にフィードバックされる。比較器420.425の他
方側はカウンタ413,426゜からの入力を有する。
ラッチ回路419,424の出力はそれぞれ加算器41
7,422の入力側にフィードバックされる。
回路430の小数部分出力データの上位3ビツトと回路
431の小数部分出力データの上位3ピツトはそれぞれ
のラッチ回路419と424から取出され、アドレス指
定信号として演算ROM4J5へ供給される。このRO
M 415には縮小前の画素レベルがメモリされている
。この演算ROM 415から読出された出力f−夕は
比較器432の入力側へ供給され、比較器432の他端
にはスライスレベルデータ発掘器433から得られるス
ライスレベルデータが供給される。比較器432の一致
信号はフリップフロッグ434のD入力端子へ供給され
、アンドゲート435の出力はフリップフロッグのクロ
ック端子CLへ供給される。アンドf −) 4 J 
5の一入力端子には比較器420の一致出力XC0Mが
供給され、その他方入力端子には比較器425からの入
力YCOMが供給される。
ここで、このようなサイズ変換回路14の動作全第10
図にて詳しく説明する。CPU 2から指定される縮小
率が1/4.5であると仮定する。この場合、縮小率の
整数部は4であるのに対し、その小数部分は0.5であ
る。デジタル形成の数値データはそれぞれ加算器416
,417および421422にセットされる。
第10図では、原画の画像ドツト位置は記号″X”で指
定されるのに対し、サイズ変換された画像の画像ドツト
位置は黒色ドツトで指定される。
原画上の位置(1,j)の画像ドツトは、(Pl、j) 縮小された画像上の位置(1,J)の画像は、(Q、、
、 ) で定義される。
原画の2つの隣接画像ドツト間の距離は1として定義さ
れる。次いで、原画上の2つの縮小ドツト間の距離は縮
小率R,と等しい。
L = Rr この場合、定数りは4.5として設定される。中心位置
Q、、、t−有するLXL領域がSとして指定されると
、Sの平均グレーレベルは領域Sに属する画像ドラ)(
Pl、j)が存在するか否かの事実に基づいて計算され
る。原位置P1.jと変換位置Qf、Jとの間の距離t
rt、jとして定義すると、平均グレーレベルφ11.
全計算する加重ファクタα1.jが距離rt、jに逆比
例するように決定される。
したがって、ファクタαl、J 全Q、、、の位置で1
として設足し、L/2だけ離れた位置で0.5として設
定すると、ファクタα1.」は、 として表示できる。
よって、平均グレーレベルφ09.ハ、となる。次いで
、変換された画像ドツトQl、Jは、となり、所定のス
ライスレベルθを用いることによシ得られる。
しかして* CPU 2から供給される縮小率の整数部
分4は加算器416全介してラッチ回路418に供給さ
れる。カウンタ413の内容が4になると、一致信号X
C0Mが比較器420から送出され、ラッチ回路418
,419およびアンドゲート435へ供給される。一方
、小数部分0.5は加算器4ノiを介してラッチ回路4
19でラッチされる。したがって、信号XC0Mがラッ
チ回路418゜419に供給されると、0.5 + 0
.5 = 1の演算が加算器417で行なわれ、1の桁
上げが加算器416に供給される。よって、4+4+1
=9の演算が加算器416で行なわれ、新しいデータ″
91がラッチ回路418で設定される。このとき、カウ
ンタ413の内容が9になると、出力XC0Mが比較器
420の出力で得られる。次いで、9+4=13がラッ
チ回路418で設定される。
出力XC0Mはカウンタ413が13に達すると得られ
る。このとき、13+4+1の演算が加算器416で行
なわれ、新しいデータ“18”がラッチ回路418で設
定される。
こうして、カウンタ413の内容が”4.9゜13.1
8.22.27.・・・”になる毎に、出力XC0Mが
比較器420から出力される。この出力XC0Mは、ア
ンドゲート435の一人カへ供給される。
そして、回路430と同一の動作が回路431にても行
なわれる。出力YCOMはカウンタ426の内容が″4
.9.13.18.22.27.・・・1になる毎に、
比較器425からアンドゲート435の他方入力へ供給
される。入力XC0MとYCOMの両方がアンドゲート
435へ供給されると、出力はフリップフロラf434
のクロック端子に供給される。このとき、出力レベルφ
1..がスライスレベル発生器433の出力レベルを越
えると、出力は比較器432からフリップフロラf43
4のD端子へ供給され、第1θ図に示す如く黒色ドツト
の出力QI Jは7リツグフロツグ434から得られる
拡大動作において、たとえば0.5の拡大率はCPU 
2から加算器416 、417 、421 、422へ
供給される。この場合%QI、Jの数はP5」の数の2
倍であり、画像情報は2倍に拡大される。
つぎに、第11図は表示用インタフェース15を示し友
ものである。60はリフレッシュメモリで、1024ビ
ツト(X方向)X1400ライン(Y方向)の記憶領域
を有している。(CRT f″イスグレイ161024
ビツト×700ラインの表示領域を有する)。61は1
6ピツトレジスタで、前記サイズ変換回路14で縮小さ
れ且つ供給される画像情報を16ビツト毎にリフレッシ
ュメモリ60へ供給するものである。62はセレクタで
、16ビツトレジスタ61の出力または紡記ノ4ターン
ジェネレータ6からのパターン情報をセレクトするもの
である。63は書込みアドレスカウンタで、CPU2か
ら供給される画像情報書込みスタートアドレスを一旦保
持し、それをサイズ変換回路14(第8図に示すフリッ
プフロラf434からのクロック) ’i 1716分
周し、カウンタ64およびアンド回路65を介して供給
されるクロック信号によりカウントアツプしていくこと
により、リフレッシュメモリ60のX方向およびY方向
アドレスを指定するものである。また、この書込みアド
レスカウンタ63は、画像情報の書込み終了時、リフレ
ッシ、メモリ60の図示右下端部の特定領域に対応する
パターン情報書込みアドレスがCPU 2から供給され
る。この場合、アンド回路65の他方の入力端にはCP
U 2からIIO”信号が供給され、これによシ書込み
アドレスカウンタ63にクロック信号が供給されること
はない。
66はCRTコントローラで、カウンタ67、アドレス
レジスタ68および700ライン分検矧回路69などか
ら成り、リフレッシュメモリ60から’bTb像情報を
読出す際、そのリフレッシ−メモリ50のX方向および
Y方向に対してアドレス指定フ七行なうものである。こ
こで、カウンタ62は、発掘回路70から1/16カウ
ンタ71t−介して供給されるクロック信号をカウント
する1/64力ウンタ67mとこのカウンタ67aの桁
上げカウントを行なうカウンタ67bから成シ、そのカ
ウンタ67aの内容?X方向指定アドレスとし、カラy
り67bの内容’tY方、向指定アドレスとしている。
さらに、上記アドレスレジスタ68は、CPU2から供
給される読出しスタートアドレス(ラインアドレス)を
保持するものである。700ライン分検知回路69は、
カウンタ67bが1700#全カウントし念かどうかを
検知し、l700”をカウントしていればそのカウンタ
67bに上記アドレスレジスタ68のスタートアドレス
全所たにセットせしめるものである。22はセレクタで
、書込み時と読出し時とでアドレスカウンタ63のY方
向指定アドレスおよびカウンタ67bのY方向指定アド
レスのどちらか全セレクトするものである。73はセレ
クタで、書込み時と読出し時とでアドレスカウンタ63
のX方向指定アドレスおよびカウンタ67aのX方向指
定アドレスのどちらかをセレクトするものである。74
は16ビツトレジスタで、リフレッシ、メモリ60から
読出される16ビツトの画像情報を発振回路70の出力
全クロック信号としてシリアルに出力するものである。
80はカーソル設定回路で、上記CRTコントローラ6
6からCRTデイスプレィ16へ供給される水平同期信
号Hsync 、垂直同期信号Vsync、および発掘
回路20からのクロック信号に同期して所定のカーソル
(枠)に対応するカーソルビデオ信号を発するものであ
る。しかして、このカーソル設定回路80から発せられ
るカーソルビデオ信号および上記16ビツトレジスタ7
4から出力されるビデオ信号はオア回路200f介して
CRTf4スゲレイ16へ供給される。
ここで、第12図はカーソル設定回路80を示すもので
ある。第12図において、81はX方向カーソルメモリ
で、CPU2からの書込コード情報Jに応じてカーソル
の左右両側辺の位置情@tそれぞれ保持するものである
。82はY方向カーソルメモリで、CPU!’からの書
込コード情報Jに応じてカーソルの上辺および下辺の位
置情報をそれぞれ保持するものである。83はX方向ア
ドレスカウンタであり第14図(a)に示すクロック信
号(第11図に示す発掘回路70よシ供給される)をカ
ウントするものである。84はY方向アドレスカウンタ
で、CRTコントローラ66から供給される第14回軸
)に示す水平同期信号Hiync t−カウントするも
のである。85はデコーダで、カウンタ83の内容が両
側辺の位置情報にそれぞれ一致したとき第14図(c)
に示す論理″1m信号を出力するものである。86はデ
コーダで、カウンタ84の内容が上辺および下辺の位置
情報にそれぞれ一致し九とき第14図(d)に示す論理
″′1′信号を出力するものである。87.88はT−
7リツプフロツグであシ、それぞれ第14図(f)(g
)に示す信号音それぞれ出力する。89はオア回路であ
り、第14図(1)に示す信号を出力する。901.9
0.。
90、はアンド回路であり、このうちアンド回路901
.90.は第14図(e)へ)に示す信号をそれぞれ出
力する。Wはプリング信号、Cvはカーソルビデオ信号
である。
一方、第13図において、92はカーソルキーで、キー
ゲート10に設けられる。そして、93゜94.95.
96は移動キーで、押している間移動パルスが出る。C
PU 2はこのパルスを検出して画像またはカーソルを
矢印方向に移動させるようになっている。92はカーソ
ルまたはりフレフシ−メモリ60内の画像情報に対する
CRT fイスグレイ16の表示領域を左上端に移動さ
せる念めの移動キーである。98は拡大キー 99は縮
小キーである。
このような構成において、画像情報の表示がどのように
なされるか全説明する。
2次元走査装置7に原稿8がセットされると、その原稿
上の画像情報が読取られるとともに、原稿サイズが検知
される。そして、読取られ念画像情報は第15図に示す
ようにそれぞれのサイズに対応する大きさをもってペー
ジバックアメモリ5・(記憶される。このとき、W稿す
イズがB4であれば、CPU2はサイズ変換回路14の
縮小率を174に設定する。A4であれば縮小率は1/
3.3、B5であれば縮小率は1/2.7、Asであれ
ば縮小率は1/2と設定する。こうして、ページバッフ
ァ5内の画像情報はサイズ変換回路14で縮小され、リ
フレッシ、メモリ60に記憶される。リフレッシュメモ
リ60に画像情報が記憶されると、CPU 2はその画
像情報の原稿サイズに対応する文字パターンをパターン
ジェネレータ6から読出し、それをリフレッシュメモリ
60内の画像情報の特定領域に付加する。したがって、
第16図(&) (b) (e)(d)に示すように、
原稿サイズにかかわらず、各画像情報の全体が一定のサ
イズにてCRT r 4スプレイ16に表示され、その
CRTデイスプレィ16の表示領域が最大限に有効利用
される。しかも、この場合、表示される画像情報の右下
方部には原稿サイズが付加されているため、各画像情報
の原稿サイ−ef容易に認識できる。なお、ページバッ
クアメモリ5、リフレッシュメモリ60および原稿8が
横長の状態で用いられるものとすれば、画像情報は第1
7図(a) (b) (c) (d)に示すようにCR
Tデイスプレィ16の表示領域全体にわたって表示され
ることにな夛、その表示領域をさらに有効利用すること
ができる。
ところで、このような画像情報の全体表示では、その画
像情報に対する縮小率がある程度小さくなるため、解偉
度の点で問題がある。
そこで、キーデート10のカーソルキー92全操作する
ことにより、表示されている画像およびカーソルをPJ
r要の位置に移動し、この状態でカーソルによって所要
の画像を指定し、その指定した画像全拡大して表示する
ことが可能となっている。
この場合、CPU2では第18図のフローチャートに従
って制御が行なわれる。CPU 2では先ず、CRT 
コア )ローラ66のアドレスレジスタ68に″1#t
セットし、リフレッシュメモリ60の1ラインから70
0ラインまでを読出し、それをCRT f″イス!レイ
16表示せしめる(ステップS1)。すなわち、第19
図(a)に示すように、リフレッシュメモリ60の上半
分の領域(図示実線)の画像情報が表示される。また、
CPUjは第19図C&)に−点鎖線で示すようにカー
ソルSのアドレスをカーソル設定回路80に設定し、そ
のカーソルS i CRTデイスプレィ16で表示せし
める。この状態においてカーソルキー92の移動キー9
6がオンされると(ステップS2.S3.S4゜B5)
、CPU 2はCRTコントローラ66のアドレスレジ
スタ68の内容をたとえば+10する(ステラ7’S6
)。こうして、移動キー96がオンされる毎にリフレッ
シュメモリ60内の画像情報に対する表示領域が第19
図(b) (e)に示す如く順次下降移動していく。こ
の場合、表示領域とカーソルSとの対応位置に変化はな
い。しかる後、Y方向スタートアドレスが1700#に
達すると(ステップS 5 ) %  cpu zはカ
ーソル設定回路80におけるカーソルSのY方向アドレ
ス全カーソルキー96がオンされるごとに書替えていく
(ステップS7)。こうして、移動キー96がオンされ
る毎に第19図(d) (、)に示す如くカーソルSが
下降移動していく。
この状態から移動キー93をオンしていくと(ステップ
S2.B3.B4.B8.B9)、第20図(e) (
d) (c)の如く表示領域が上昇移動していき、つぎ
に第20図(b) (SL)の如くカーソルSが上昇移
動していく(ステップ810)、ま念、第21図(1)
の状態で移動キー95をオンすれば、(ステップS2.
B3)、表示領域に移動範囲がない念め、カーソルSが
右方向に移動して第21図(b)の状態となる(ステッ
プ511)。さらに、第22図(a)の状態で移動キー
94をオンすれば(ステップS2.B3)、カーソルS
のみが左方向に移動して第22図(b)の状態となる(
ステラfs11)。
そして、このような表示状態において拡大キー98をオ
ンすればカーソルS内の画像情報が拡大されて祈念に表
示される。また、縮小キー99をオンすれば元の表示が
なされる。
このように、リフレッシュメモリ6o内の画像情報に対
して一足領域全移動指定することによシ、その−尾領域
内の画像情報を即時に表示できるものであり、よって従
来のようにページバッファメモリからの読出しが不要と
なり、表示速度の大幅な向上が計れる。しかも、上記移
動指定による表示を行なうことにより、画像情報に対す
る縮小率はリフレッシュメモリ60の記憶容量に合わせ
ればよく、つまF) CRT f 4スゲレイの表示容
:tK合わせる場合に比して縮小率を大きくすることが
でき、よって解像度が高まって認識が容易である。
しかも、一定額域の移動指定をズームアツプ領域の移動
指定よりも優先して行なうようにし念ので、その各移動
指定に対する操作に1つの操作機構でまかなうことがで
き、実用上非常に便利である。
なお、上記実施例では一定領域の移動指定を優先して行
なうようにし念が、カーソルの移動指定全優先するよう
にしてもよい。その他、この発明は上記実施例に限定さ
れるものではなく、要旨を変えない範囲で種々変形実施
可能なことは勿論である。
[発明の効果コ 以上述べたようにこの発明によれば、表示部の表示領域
全体に画像を表示し得るよう画像のサイズ全変換するこ
とができ、表示部の光示領域を有効に利用することがで
きるすぐれた画像表示装置全提供できる。
【図面の簡単な説明】
第1図はページバッファメモリの記憶領域を示す図、第
2図は第1図における画像情報の表示状態の一例を示す
図、第3図はこの発明の一実施例に係る画像情報記憶検
索装置の全体的な概略構成図、第4図は第3図全詳細に
示す構成図、第5図は2次元走査装置の具体的な構成図
、第6図(a)(b)は第5図の動作制御5全示すもの
で、同図(IL)は回路構成図、同図(b)はタイムチ
ャート、第7図は第5図のサイズ検知部を示すもので、
同図(a)は平面構成図、同図(b)は回路構成図、第
8図はこの発明の一実施例におけるサイズ変換回路を具
体的に示す構成図、第9図および第10図は第8図の動
作を説明するための図、第11図はこの発明の一実施例
における表示用インタフェース全具体的に示す構成図、
第12図は第11図におけるカーソル設定回路全具体的
に示す構成図、第13図はカーソルキーの構成図、第1
4図は第12図の動作全説明するためのタイムチャート
、第15図は4−ジバノファメモリとそこに記憶される
各種サイズの画像情報との対応を示す構成図、第16図
(a)(b) (e)(d)および第17図(a) (
b) (e) (d)はこの発明の一実施例における画
像情報の全体表示状態全示す図、第18図は同実施例に
おける表示制御を示すフローチャート、第19図(&)
 (b) (e) (d) (e) I第20図(a)
(b)(e) (d) (e) 、第21図(a) (
b)および第22図(&) (b)は同実施例における
画像情報およびカーソル表示の一例を示す図である。 2・・・CPU、5・・・被−ジバッファメモリ、6・
・・ノやターンジェネンータ、13・・・画像情報表示
装置、14・・・サイズ変換回路、15・・・表示用イ
ンタフェース、16・・・CRT fイスプレイ、60
・・・リフレッシュメモリ、80・・カーソル設定回路
、92・・・カーソルキー 第1図 第50 第 図 (a) (F−) セ? T7 7図 図面の浄書(内容に変更なし) 第9 図 第10図 第13図 第14図 =2048 7 1     ヒント 第15図 手続補正書 (方式) %式% 1、事件の表ボ 特願昭63 329744号 2゜ 発明の名称 $19図 面 像 表 不 装 置 3゜ 補正をする者 事件との関係

Claims (1)

  1. 【特許請求の範囲】 各種の原稿サイズを有する画像を読取る読取手段と、 この読取手段で読取られた画像を記憶する光記憶手段と
    、 前記読取手段で読取られた画像又は前記光記憶手段から
    検索された画像を一時記憶するページメモリと、 このページメモリに記憶された画像のサイズを変換する
    変換手段と、 この変換手段によりサイズが変換された画像を記憶する
    リフレッシュメモリと、 このリフレッシュメモリに記憶されている画像を表示す
    る表示領域を有した表示手段と、前記読取手段で読取ら
    れた画像又は前記光記憶手段に記憶されている画像の原
    稿サイズに係わりなく、前記表示手段に表示される画像
    全体が略一定の大きさで、かつ前記表示手段の表示領域
    の略全体に表示されるように、前記変換手段によるサイ
    ズ変換率を設定する制御手段と、 を具備したことを特徴とする画像表示装置。
JP63329744A 1988-12-27 1988-12-27 画像表示装置 Pending JPH021065A (ja)

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JP63329744A JPH021065A (ja) 1988-12-27 1988-12-27 画像表示装置

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JP63329744A Pending JPH021065A (ja) 1988-12-27 1988-12-27 画像表示装置

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JP (1) JPH021065A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001028619A (ja) * 1999-05-13 2001-01-30 Matsushita Electric Ind Co Ltd 情報端末装置
US6674439B1 (en) 1999-05-13 2004-01-06 Matsushita Electric Industrial Co., Ltd. Information terminal device

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001028619A (ja) * 1999-05-13 2001-01-30 Matsushita Electric Ind Co Ltd 情報端末装置
US6674439B1 (en) 1999-05-13 2004-01-06 Matsushita Electric Industrial Co., Ltd. Information terminal device

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