JPH0447351B2 - - Google Patents

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JPH0447351B2
JPH0447351B2 JP57013166A JP1316682A JPH0447351B2 JP H0447351 B2 JPH0447351 B2 JP H0447351B2 JP 57013166 A JP57013166 A JP 57013166A JP 1316682 A JP1316682 A JP 1316682A JP H0447351 B2 JPH0447351 B2 JP H0447351B2
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JP57013166A
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Kazuhiko Iida
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Toshiba Corp
Original Assignee
Tokyo Shibaura Electric Co Ltd
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Publication date
Application filed by Tokyo Shibaura Electric Co Ltd filed Critical Tokyo Shibaura Electric Co Ltd
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Priority to DE8383100407T priority patent/DE3377447D1/de
Priority to US06/458,877 priority patent/US4520399A/en
Priority to EP83100407A priority patent/EP0085351B1/en
Publication of JPS58129679A publication Critical patent/JPS58129679A/ja
Publication of JPH0447351B2 publication Critical patent/JPH0447351B2/ja
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Description

【発明の詳細な説明】 [発明の技術分野] この発明は文書などの画像情報を記憶装置に記
憶し、かつこの記憶装置に記憶された各種画像情
報のうちから必要に応じて所要の画像情報を検索
して読出し、それを目視し得る状態に出力する画
像情報記憶検索装置の画像表示装置に関する。
[発明の技術的背景とその問題点] 最近、多量に発生する文書などの画像情報を光
学的な2次元走査によつて読取り、この読取つた
画像情報を記憶装置たとえば光デイスク装置に記
憶しておくとともに、この記憶装置に記憶されて
いる各種画像情報のうちから必要に応じて所要の
画像情報を検索して読出し、それをハードコピー
装置で目視し得る状態に出力する画像情報記憶検
索装置が開発され、実用化されている。
そして、このような画像情報記憶検索装置にお
いては、読取速度と記憶速度との相違あるいは読
出速度と記憶速度との相違に対処するため、読取
つた一単位分(一頁分)の画像情報あるいは読出
された一単位分の画像情報を一旦ページバツフア
メモリに記憶するようにしている。また、表示用
インターフエースおよびCRTデイスプレイなど
から成る画像情報表示装置を備えており、ページ
バツフアメモリ内の画像情報をモニタ表示できる
ようになつている。
ところで、第1図に示すように、上記ページバ
ツフアメモリは2048bit×2800ラインの記憶領域
を有するものであるのに対し、上記表示用インタ
フエース内のリフレツシユメモリは1024bit×700
ラインの記憶領域しかなく、このためページバツ
フアメモリ内の全ての画像情報を一括してCRT
デイスプレイに表示することは不可能である。
そこで、従来では、表示用インタフエース内に
サイズ変換回路を設け、ページバツフアメモリか
ら読出される画像情報を1/4に縮小してリフレツ
シユメモリに記憶することにより、第2図に示す
ようにページバツフアメモリ内の全ての画像情報
をCRTデイスプレイに一括して表示するように
していた。
しかしながら、この場合、画像情報のサイズに
かかわらず縮小率が一定であるため、CRTデイ
スプレイに表示される画像情報の大きさはまちま
ちであり、CRTデイスプレイ上の表示領域が有
効に利用されないという欠点があつた。
[発明の目的] この発明は上記のような事情に鑑みてなされた
もので、その目的とするところは、表示部の表示
領域全体に画像を表示し得るよう画像のサイズを
変えることができ、表示部の表示領域を有効に利
用することができるすぐれた画像表示装置を提供
することにある。
[発明の概要] この発明は画像情報をサイズ変換手段で変換し
てメモリに記憶し、かつこのメモリ内の画像情報
を表示手段で表示するものにおいて、画像情報が
記録された原稿のサイズと表示手段の表示領域と
の対応関係に基づいてサイズ変換手段の変換率を
設定することにより、画像情報を一定のサイズで
しかも全体を表示手段の表示領域いつぱいに表示
せしめるものである。
[発明の実施例] 以下、この発明の一実施例について図面を参照
して説明する。第3図および第4図において、1
は主制御装置であり、各種制御を行なうCPU2、
各種フアイルセツト(後述する光デイスクの集
合)および各種フアイル(光デイスク)を管理す
るための管理情報が記憶された管理情報記憶装置
たとえばフロツピーデイスク装置3、後述する光
デイスク装置9から読出されるタイトル情報を一
時記憶するためのタイトルメモリ4、少なくとも
一単位分(原稿一頁分)の画像情報に対応する記
憶領域(2048ビツト×2800ライン)を有するペー
ジバツフアメモリ5、文字や記号などのパターン
情報が格納されたパターンジエネレータ6などか
ら成つている。また、7は読取装置たとえば2次
元走査装置で、原稿(文書)8上を2次元走査す
ることにより原稿8上の画像情報に応じたビデオ
信号を得るものである。9は大容量記憶装置であ
るところの光デイスク装置で、上記2次元走査装
置で読取られる画像情報および主制御装置1で作
成される画像情報を記憶媒体つまり光デイスクの
専用記憶領域にそれぞれ順次記憶するものであ
る。10はキーボードで、画像情報に対応する個
有のタイトルおよび各種動作指令などを入力する
ものである。11は出力装置であるところのハー
ドコピー装置で、2次元走査装置7で読取られる
画像情報あるいは光デイスク装置9から読出され
る画像情報をハードコピー12として出力するも
のである。13は出力装置であるところの画像表
示装置で、サイズ変換回路14、表示用インタフ
エース15、陰極線管表示装置(以下CRTデイ
スプレイと称す)16などから成り、2次元走査
装置7で読取られる画像情報あるいは光デイスク
装置9から読出される画像情報を表示するもので
ある。
しかして、フロツピーデイスク装置3、タイト
ルメモリ4、ページバツフアメモリ5、パターン
ジエネレータ6、2次元走査装置7、光デイスク
装置9、キーボード10、ハードコピー装置1
1、サイズ変換回路14、表示用インタフエース
15はそれぞれCPU2からのデータバス20に
接続される。また、タイトルメモリ4、ページバ
ツフアメモリ5、パターンジエネレータ6、2次
元走査装置7、光デイスク装置9、ハードコピー
装置11、サイズ変換回路14、表示用インタフ
エース15はそれぞれイメージバス21に接続さ
れており、互いに情報の転送がなされるようにな
つている。
ここで第5図は上記2次元走査装置7を具体的
に示すものである。すなわち、31は給紙トレイ
で、このトレイ31上にセツトされる原稿は取込
みローラ32,32によつて本体内に取込まれ、
さらに搬送ローラ33,33によつて原稿台(ガ
ラス板)34上へ供給される。そして、この原稿
台34を経た原稿は搬送ローラ35,35および
排紙ローラ36,36によつて排紙トレイ37上
に排出される。上記原稿台34と対応する位置に
は1対の露光ランプ38,38が設けられてお
り、このランプ38,38から発せられる光は搬
送されてくる原稿上に照射され、その反射光はミ
ラー39および投影レンズ40を介してCCDラ
インセンサ41に投影される。こうして、ライン
センサ41から原稿上の画像情報に応じたビデオ
信号が得られるようになつている。なお。上記取
込みローラ32,32の近傍には、取込まれる原
稿を検知するための発光ダイオード42およびフ
オトトランジスタ43から成るフオトカプラが配
設されるとともに、取込まれた原稿のサイズを検
知するための発光ダイオード44a,44b,4
4c,44dおよびフオトトランジスタ45a,
45b,44c,44dからなるフオトイカプラ
が配設される。
第6図a,bは上記フオトトランジスタ43の
出力に基づく動作制御回路の構成および動作を示
すものである。すなわち、フオトトランジスタ4
3の出力はインバータ45を介して第1タイマ4
6、第2タイマ47、第3タイマ48に供給され
る。第1タイマ46は、原稿の先端が検知されて
から一定時間だけ上記各ローラおよびランプ3
8,38を動作させるための駆動信号を出力す
る。第2タイマ47は、原稿の先端が検知されて
から所定時間後にラインセンサ41を動作させる
ための読取開始信号を出力する。第3タイマ48
は、原稿の先端が検知されてから所定時間後にラ
インセンサ41の動作を停止するための読取終了
信号を出力するようになつている。
また、第7図a,bは上記フオトトランジスタ
45a,45b,45c,45dの配設状態およ
びその出力に基づくサイズ検知回路の構成を示す
ものである。すなわち原稿の搬送方向と直交する
方向に各発光ダイオードおよびそれに対応するフ
オトトランジスタ45a,45b,45c,45
dを一定間隔をもつて配設しており、搬送路上の
側端を基準として投入される原稿のサイズに応じ
て各フオトトランジスタの出力が異なることによ
り、アンド回路49,50,51,52からそれ
ぞれA3検知信号、B4検知信号、A4検知信号、B5
検知信号を得るようになつている。
ここで、上記のような構成においてどのような
動作がなされるかを簡単に説明しておく。
2次元走査装置7に原稿8をセツトすると、そ
の原稿8上の画像情報が読取られ、それがページ
バツフアメモリ5に順次記憶される。このとき、
2次元走査装置7で検知される原稿サイズは
CPU2へ供給され、そのCPU2内のRAMに記憶
される。しかして、一単位分の画像情報がページ
バツフアメモリ5に記憶されると、CPU2は検
知された原稿サイズに対応するサイズ変換(縮小
率)をROMから読出し、それをサイズ変換回路
14に設定する。こうして、ページバツフアメモ
リ5内の画像情報はサイズ変換回路14で所定の
サイズまで縮小され、表示用インタフエース15
内のリフレツシユメモリに記憶される。そして、
そのリフレツシユメモリ内の画像情報がCRTデ
イスプレイ16で表示される。
また、光デイスク装置9から画像情報が読出さ
れると、その読出された画像情報はページバツフ
アメモリ5に順次記憶される。このとき、読出さ
れた画像情報に対応するインデツクス情報に予め
含まれている原稿サイズ情報がCPU2へ供給さ
れ、そのCPU2内のRAMに記憶される。しかし
て、一単位分の画像情報がページバツフアメモリ
5に記憶されると、CPU2は記憶している原稿
サイズ情報に対応するサイズ変換率(縮小率)を
ROMから読出し、それをサイズ変換回路14に
設定する。こうして、ページバツフアメモリ5内
の画像情報はサイズ変換回路14で所定のサイズ
まで縮小され、表示用インタフエース15内のリ
フレツシユメモリに記憶される。そして、そのリ
フレツシユメモリ内の画像情報がCRTデイスプ
レイ16で表示される。
次に、上記したサイズ変換回路14、表示用イ
ンタフエース15について詳しく説明する。ま
ず、第8図はサイズ変換回路14を示すものであ
る。すなわち、ページバツフアメモリ5の1ライ
ンの画像情報はデータ入力端子400に供給され
る。この場合、1ラインの画像情報は2048ビツト
から成る。端子400に供給される画像情報は
RAM401と6ビツトのラツチ回路406に供
給される。RAM401は2K×1ビツトのもので
ありそのアドレスはカウンタ413の出力によつ
て指定される。しかして、5つのRAM401〜
405並びに7つのラツチ回路406〜412が
設けられる。これらRAM401〜405並びに
ラツチ回路406〜412は、全て実線によつて
示される信号路または二点鎖線で示される信号路
を介して主クロツク発生器414から供給される
クロツク信号により作動する。この場合、実線の
信号路は縮小回路として働くとき用いられ、二点
鎖線の信号路は拡大回路として働くとき用いられ
る。
カウンタ413のアドレス制御下において、
2048ビツトの最初の1ラインの画像情報は最初の
RAM401に格納される。次いで、第2ライン
の画像情報の最初のビツトがRAM401に供給
されるとき、RAM401に格納された最初のラ
イン画像情報の最初のビツトはそこから読出さ
れ、ラツチ回路406でラツチされる。一方、第
2ラインの最初のビツトはRAM401の最初の
メモリ・ロケーシヨンに格納される。次いで、第
2ラインの第2ビツトはRAM401に格納さ
れ、第1ラインの第2ビツトはそこから読出され
てラツチ回路406にラツチされる。同時に、ラ
ツチ回路406にラツチされた第1ラインの第1
ビツトはRAM402に読出され、そこに格納さ
れる。このように、第2ラインの最後(2048番
目)のビツトがRAMに格納されると、2048ビツ
トの最初の1ライン画像情報はRAM402にシ
フトされる。したがつて、2048ビツトの各1ライ
ン画像情報はRAM401〜405で順次シフト
される。最後に、第1ライン〜第5ラインの画像
情報はそれぞれRAM405〜401に格納さ
れ、各第1ライン〜第5ラインの画像情報の最初
のビツトがラツチ回路406にラツチされ、同時
に端子400に供給される第6ライン画像情報の
最初のビツトと共にラツチ回路407に供給され
る。
第6ラインの第2ビツトが端子400に供給さ
れると、ラツチ回路407でラツチされた第1ラ
イン〜第6ラインの各最初のビツトは次のラツチ
回路408へ供給され、第1ライン〜第6ライン
の各第2ビツトはラツチ回路407にラツチされ
る。同様にして、第6ラインの画像情報の第7ビ
ツトが端子400に供給されると、各第1〜第6
ラインの最初のビツトはラツチ回路412でラツ
チされ、その第2ビツトはラツチ回路411にラ
ツチされ、第3ビツトはラツチ回路410にラツ
チされ、第4ビツトはラツチ回路409にラツチ
され、第5ビツトはラツチ回路408にラツチさ
れ、そして第6ビツトはラツチ回路407にラツ
チされる。したがつて、ラツチ回路407〜41
2にラツチされたそれぞれのビツトがマトリツク
ス・アレーに再配置されると、原画は第9図に示
すようにドツト画像として再生される。第9図で
は、黒色ドツトは1ビツトを表わし、白色ドツト
は0ビツトを表わす。したがつて、6ビツト(X
方向)×6ライン(Y方向)の局部画像情報がラ
ツチ回路405〜412から演算ROM415に
供給される。
2つと加算器416,417と、2つのラツチ
回路418,419と、比較器420と、カウン
タ413とでX方向の距離計算回路430を構成
し、2つの加算器421,422と、2つのラツ
チ回路423,424と、比較器425と、カウ
ンタ426とでY方向の距離計算回路431を構
成する。これらの距離計算回路430,431は
X、Y方向においてサイズ変換された画像ドツト
位置を計算するために用いられる。CPU2から
供給されるX、Y方向におけるサイズ変換(拡
大、縮小)率設定データは、加算器416,41
7,421および422へ供給される。第8図に
おいて、縮小率データは一例として示されてい
る。縮小率の整数部は加算器416,421およ
びデコーダ427へ供給され、その小数部分は加
算器417,422へ供給される。加算器41
6,417,421,422の出力はラツチ回路
418,419,423,424へそれぞれ供給
される。ラツチ回路418,423の出力は比較
器420,425、の一入力側にそれぞれ供給さ
れ、加算器416,421の入力側にフイードバ
ツクされる。比較器420,425の他方側はカ
ウンタ413,426、からの入力を有する。ラ
ツチ回路419,424の出力はそれぞれ加算器
417,422の入力側にフイードバツクされ
る。
回路430の小数部分出力データの上位3ビツ
トと回路431の小数部分出力データの上位3ビ
ツトはそれぞれのラツチ回路419と424から
取出され、アドレス指定信号として演算ROM4
15へ供給される。このROM415には縮小前
の画素レベルがメモリされている。この演算
ROM415から読出された出力データは比較器
432の入力側へ供給され、比較器432の他端
にはスライスレベルデータ発振器433から得ら
れるスライスレベルデータが供給される。比較器
432の一致信号はフリツプフロツプ434のD
入力端子へ供給され、アンドゲート435の出力
はフリツプフロツプのクロツク端子CLへ供給さ
れる。アンドゲート435の一入力端子には比較
器420の一致出力XCOMが供給され、その他
方入力端子には比較器425からの入力YCOM
が供給される。
ここで、このようなサイズ変換回路14の動作
を第10図にて詳しく説明する。CPU2から指
定される縮小率が1/4.5であると仮定する。こ
の場合、縮小率の整数部は4であるのに対し、そ
の小数部分は0.5である。デジタル形成の数値デ
ータはそれぞれ加算器416,417および42
1,422にセツトされる。
第10図では、原画の画像ドツト位置は記号
“X”で指名されるのに対し、サイズ変換された
画像の画像ドツト位置は黒色ドツトで指定され
る。原画上の位置(i、j)の画像ドツトは、 {Pij} で定義される。
{Pij}=1…黒色ドツト 0…白色ドツト 縮小された画像像の位置(I、J)の画像は、 {QIJ} で定義される。
原画の2つの隣接画像ドツト間の距離は1とし
て定義される。次いで、原画上の2つの縮小ドツ
ト間の距離は縮小率Rrと等しい。
L=Rr この場合、定数Lは4.5として設定される。中
心位置QIJを有するL×L領域がSとして指定
されると、Sの平均グレーレベルは領域Sに属す
る画像ドツト{Pij}が存在するか否かの事実
に基づいて計算される。原位置Pijと変換位置
QIJとの間の距離をrijとして定義すると、平
均グレーレベルφIJを計算する加重フアクタ
αijが距離rijに逆比例するように決定される。
したがつて、フアクタαijをQIJの位置で1と
して設定し、L/2だけ離れた位置で0.5として
設定すると、フアクタαijは、 αij=1−0.5/L/2rij=1−rij/L として表示できる。
よつて、平均グレーレベルφIJは、 φIJ=〓αij・Pij/〓αij(Pij←S) となる。次いで、変換された画像ドツトQIJは、 {QIJ}=1…φIJ>θ 0…φIJ<θ となり、所定のスライスレベルθを用いることに
より得られる。
しかして、CPU2から供給される縮小率の整
数部分4は加算器416を介してラツチ回路41
8に供給される。カウンタ413の内容が4にな
ると、一致信号XCOMが比較器420から送出
され、ラツチ回路418,419およびアンドゲ
ート435へ供給される。一方、小数部分0.5は
加算器417を介してラツチ回路419でラツチ
される。したがつて、信号XCOMがラツチ回路
418,419に供給されると、0.5+0.5=1の
演算が加算器417で行なわれ、1の桁上げが加
算器416に供給される。よつて、4+4+1=
9の演算が加算器416で行なわれ、新しいデー
タ“9”がラツチ回路418で設定される。この
とき、カウンタ413の内容が9になると、出力
XCOMが比較器420の出力で得られる。次い
で、9+4=13がラツチ回路418で設定され
る。出力XCOMはカウンタ413が13に達する
と得られる。このとき、13+4+1の演算が加算
器416で行なわれ、新しいデータ“18”がラツ
チ回路418で設定される。
こうして、カウンタ413の内容が“4、9、
13、18、22、27、…”になる毎に、出力XCOM
が比較器420から出力される。この出力
XCOMは、アンドゲート435の−入力へ供給
される。
そして、回路430と同一の動作が回路431
にても行なわれる。出力YCOMはカウンタ42
6の内容が“4、9、13、18、22、27、…”にな
る毎に、比較器425からアンドゲート435の
他方入力へ供給される。入力XCOMとYCOMの
両方がアンドゲート435へ供給されると、出力
はフリツプフロツプ434のクロツク端子に供給
される。このとき、出力レベルφIJがスライス
レベル発生器433の出力レベルを越えると、出
力は比較器432からフリツプフロツプ434の
D端子へ供給され、第10図に示す如く黒色ドツ
トの出力QIJはフリツプフロツプ434から得
られる。
拡大動作において、たとえば0.5の拡大率は
CPU2から加算器416,417,421,4
22へ供給される。この場合、QIJの数はPij
の数の2倍であり、画像情報は2倍に拡大され
る。
つぎに、第11図は表示用インタフエース15
を示したものである。60はリフレツシユメモリ
で、1024ビツト(X方向)×1400ライン(Y方向)
の記憶領域を有している。(CRTデイスプレイ1
6は1024ビツト×700ラインの表示領域を有す
る)。61は16ビツトレジスタで、前記サイズ変
換回路14で縮小され且つ供給される画像情報を
16ビツト毎にリフレツシユメモリ60へ供給する
ものである。62はセレクタで、16ビツトレジス
タ61の出力または前記パターンジエネレータ6
からのパターン情報をセレクトするものである。
63は書込みアドレスカウンタで、CPU2から
供給される画像情報書込みスタートアドレスを一
旦保持し、それをサイズ変換回路14(第8図に
示すフリツプフロツプ434からのクロツク)を
1/16分周し、カウンタ64およびアンド回路6
5を介して供給されるクロツク信号によりカウン
トアツプしていくことにより、リフレツシユメモ
リ60のX方向およびY方向アドレスを指定する
ものである。また、この書込みアドレスカウンタ
63は、画像情報の書込み終了時、リフレツシユ
メモリ60の図示右下端部の特定領域に対応する
パターン情報書込みアドレスがCPU2から供給
される。この場合、アンド回路65の他方の入力
端にはCPU2から“0”信号が供給され、これ
により書込みアドレスカウンタ63にクロツク信
号が供給されることはない。66はCRTコント
ローラで、カウンタ67、アドレスレジスタ68
および700ライン分検知回路69などから成り、
リフレツシユメモリ60から画像情報を読出す
際、そのリフレツシユメモリ60のX方向および
Y方向に対してアドレス指定を行なうものであ
る。ここで、カウンタ67は、発振回路70から
1/16カウンタ71を介して供給されるクロツク
信号をカウントする1/64カウンタ67aとこの
カウンタ67aの桁上げカウントを行なうカウン
タ67bから成り、そのカウンタ67aの内容を
X方向指定アドレスとし、カウンタ67bの内容
をY方向指定アドレスとしている。さらに、上記
アドレスレジスタ68は、CPU2から供給され
る読出しスタートアドレス(ラインアドレス)を
保持するものである。700ライン分検知回路69
は、カウンタ67bが“700”をカウントしたか
どうかを検知し、“700”をカウントしていればそ
のカウンタ67bに上記アドレスレジスタ68の
スタートアドレスを新たにセツトせしめるもので
ある。72はセレクタで、書込み時と読出し時と
でアドレスカウンタ63のY方向指定アドレスお
よびカウンタ67bのY方向指定アドレスのどち
らかをセレクトするものである。73はセレクタ
で、書込み時と読出し時とでアドレスカウンタ6
3のX方向指定アドレスおよびカウンタ67aの
X方向指定アドレスのどちらかをセレクトするも
のである。74は16ビツトレジスタで、リフレツ
シユメモリ60から読出される16ビツトの画像情
報を発振回路70の出力をクロツク信号としてシ
リアルに出力するものである。80はカーソル設
定回路で、上記CRTコントローラ66からCRT
デイスプレイ16へ供給される水平同期信号
Hsync、垂直同期信号Vsync、および発振回路7
0からのクロツク信号に同期して所定のカーソル
(枠)に対応するカーソルビデオ信号を発するも
のである。しかして、このカーソル設定回路80
から発せられるカーソルビデオ信号および上記16
ビツトレジスタ74から出力されるビデオ信号は
オア回路200を介してCRTデイスプレイ16
へ供給される。
ここで、第12図はカーソル設定回路80を示
すものである。第12図において、81はX方向
カーソルメモリで、CPU2からの書込コード情
報Jに応じてカーソルの左右両側辺の位置情報を
それぞれ保持するものである。82はY方向カー
ソルメモリで、CPU2からの書込コード情報J
に応じてカーソルの上辺および下辺の位置情報を
それぞれ保持するものである。83はX方向アド
レスカウンタであり第14図aに示すクロツク信
号(第11図に示す発振回路70より供給され
る)をカウントするものである。84はY方向ア
ドレスカウンタで、CRTコントローラ66から
供給される第14図bに示す水平同期信号Hsync
をカウントするものである。85はデコーダで、
カウンタ83の内容が両側辺の位置情報にそれぞ
れ一致したとき第14図cに示す論理“1”信号
を出力するものである。86はデコーダで、カウ
ンタ84の内容が上辺および下辺の位置情報にそ
れぞれ一致したとき第14図dに示す論理“1”
信号を出力するものである。87,88はT−フ
リツプフロツプであり、それぞれ第14図f,g
に示す信号をそれぞれ出力する。89はオア回路
であり、第14図iに示す信号を出力する。90
,902,903はアンド回路であり、このうち
アンド回路901,902は第14図e,hに示す
信号をそれぞれ出力する。Wはブリング信号、
CVはカーソルビデオ信号である。
一方、第13図において、92はカーソルキー
で、キーボード10に設けられる。そして、9
3,94,95,96は移動キーで、押している
間移動パルスが出る。CPU2はこのパルスを検
出して画像またはカーソルを矢印方向に移動させ
るようになつている。97はカーソルまたはリフ
レツシユメモリ60内の画像情報に対するCRT
デイスプレイ16の表示領域を左上端に移動させ
るための移動キーである。98は拡大キー、99
は縮小キーである。
このような構成において、画像情報の表示がど
のようになされるかを説明する。
2次元走査装置7に原稿8がセツトされると、
その原稿上の画像情報が読取られるとともに、原
稿サイズが検知される。そして、読取られた画像
情報は第15図に示すようにそれぞれのサイズに
対応する大きさをもつてページバツフアメモリ5
に記憶される。このとき、原稿サイズがB4であ
れば、CPU2はサイズ変換回路14の縮小率を
1/4に設定する。A4であれば縮小率は/3.3、
B5であれば縮小率は1/2.7、A5であれば縮小率
は1/2と設定する。こうして、ページバツフア
5内の画像情報はサイズ変換回路14で縮小さ
れ、リフレツシユメモリ60に記憶される。リフ
レツシユメモリ60に画像情報が記憶されると、
CPU2はその画像情報の原稿サイズに対応する
文字パターンをパターンジエネレータ6から読出
し、それをリフレツシユメモリ60内の画像情報
の特定領域に付加する。したがつて、第16図
a,b,c,dに示すように、原稿サイズにかか
わらず、各画像情報の全体が一定のサイズにて
CRTデイスプレイ16に表示され、そのCRTデ
イスプレイ16の表示領域が最大限に有効利用さ
れる。しかも、この場合、表示される画像情報の
右下方部には原稿サイズが付加されているため、
各画像情報の原稿サイズを容易に認識できる。な
お、ページバツフアメモリ5、リフレツシユメモ
リ60および原稿8が横長の状態で用いられるも
のとすれば、画像情報は第17図a,b,c,d
に示すようにCRTデイスプレイ16の表示領域
全体にわたつて表示されることになり、その表示
領域をさらに有効利用することができる。
ところで、このような画像情報の全体表示で
は、その画像情報に対する縮小率がある程度小さ
くなるため、解像度の点で問題がある。
そこで、キーボード10のカーソルキー92を
操作することにより、表示されている画像および
カーソルを所要の位置に移動し、この状態でカー
ソルによつて所要の画像を指定し、その指定した
画像を拡大して表示することが可能となつてい
る。この場合、CPU2では第18図のフローチ
ヤートに従つて制御が行なわれる。CPU2では
先ず、CRTコントローラ66のアドレスレジス
タ68に“1”をセツトし、リフレツシユメモリ
60の1ラインから700ラインまでを読出し、そ
れをCRTデイスプレイ16で表示せしめる(ス
テツプS1)。すなわち、第19図aに示すよう
に、リフレツシユメモリ60の上半分の領域(図
示実線)の画像情報が表示される。また、CPU
2は第19図aに一点鎖線で示すようにカーソル
Sのアドレスをカーソル設定回路80に設定し、
そのカーソルSをCRTデイスプレイ16で表示
せしめる。この状態においてカーソルキー92の
移動キー96がオンされると(ステツプS2、S3、
S4、S5)、CPU2はCRTコントローラ66のア
ドレスレジスタ68の内容をたとえば+10する
(ステツプS6)。こうして、移動キー96がオン
される毎にリフレツシユメモリ60内の画像情報
に対する表示領域が第19図b,cに示す如く順
次下降移動していく。この場合、表示領域とカー
ソルSとの対応位置に変化はない。しかる後、Y
方向スタートアドレスが“700”に達すると(ス
テツプS5)、CPU2はカーソル設定回路80にお
けるカーソルSのY方向アドレスをカーソルキー
96がオンされるごとに書替えていく(ステツプ
S7)。こうして、移動キー96がオンされる毎に
第19図d,eに示す如くカーソルSが下降移動
していく。
この状態から移動キー93をオンしていくと
(ステツプS2、S3、S4、S8、S9)、第20図e,
d,cの如く表示領域が上昇移動していき、つぎ
に第20図b,aの如くカーソルSが上昇移動し
ていく(ステツプS10)。また、第21図aの状
態で移動キー95をオンすれば、(ステツプS2、
S3)、表示領域に移動範囲がないため、カーソル
Sが右方向に移動して第21図bの状態となる
(ステツプS11)。さらに、第22図aの状態で移
動キー94をオンすれば(ステツプS2、S3)、カ
ーソルSのみが左方向に移動して第22図bの状
態となる(ステツプS11)。そして、このような
表示状態において拡大キー98をオンすればカー
ソルS内の画像情報が拡大されて新たに表示され
る。また、縮小キー99をオンすれば元の表示が
なされる。
このように、リフレツシユメモリ60内の画像
情報に対して一定領域を移動指定することによ
り、その一定領域内の画像情報を即時に表示でき
るものであり、よつて従来のようにページバツフ
アメモリからの読出しが不要となり、表示速度の
大幅な向上が計れる。しかも、上記移動指定によ
る表示を行なうことにより、画像情報に対する縮
小率はリフレツシユメモリ60の記憶容量に合わ
せればよく、つまりCRTデイスプレイの表示容
量に合わせる場合に比して縮小率を大きくするこ
とができ、よつて解像度が高まつて認識が容易で
ある。しかも、一定領域の移動指定をズームアツ
プ領域の移動指定よりも優先して行なうようにし
たので、その各移動指定に対する操作を1つの操
作機構でまかなうことができ、実用上非常に便利
である。
なお、上記実施例では一定領域の移動指定を優
先して行なうようにしたが、カーソルの移動指定
を優先するようにしてもよい。その他、この発明
は上記実施例に限定されるものではなく、要旨を
変えない範囲で種々変形実施可能なことは勿論で
ある。
[発明の効果] 以上述べたようにこの発明によれば、表示部の
表示領域全体に画像を表示し得るよう画像のサイ
ズを変えることができ、表示部の表示領域を有効
に利用することができるすぐれた画像表示装置を
提供できる。
【図面の簡単な説明】
第1図はページバツフアメモリの記憶領域を示
す図、第2図は第1図における画像情報の表示状
態の一例を示す図、第3図はこの発明の一実施例
に係る画像情報記憶検索装置の全体的な概略構成
図、第4図は第3図を詳細に示す構成図、第5図
は2次元走査装置の具体的な構成図、第6図a,
bは第5図の動作制御部を示すもので、同図aは
回路構成図、同図bはタイムチヤート、第7図は
第5図のサイズ検知部を示すもので、同図aは平
面構成図、同図bは回路構成図、第8図はこの発
明の一実施例におけるサイズ変換回路を具体的に
示す構成図、第9図および第10図は第8図の動
作を説明するための図、第11図はこの発明の一
実施例における表示用イタフエースを具体的に示
す構成図、第12図は第11図におけるカーソル
設定回路を具体的に示す構成図、第13図はカソ
ルキーの構成図、第14図は第12図の動作を説
明するためのタイムチヤート、第15図はページ
バツフアメモリとそこに記憶される各種サイズの
画像情報の対応を示す構成図、第16図a,b,
c,dおよび第17図a,b,c,dはこの発明
の一実施例における画像情報の全体表示状態を示
す図、第18図は同実施例における表示制御を示
すフローチヤート、第19図a,b,c,d,
e、第20図a,b,c,d,e、第21図a,
bおよび第22図a,bは同実施例における画像
情報およびカーソル表示の一例を示す図である。 2……CPU、5……ページバツフアメモリ、
6……パターンジエネレータ、13……画像情報
表示装置、14……サイズ変換回路、15……表
示用インタフエース、16……CRTデイスプレ
イ、60……リフレツシユメモリ、80……カー
ソル設定回路、92……カーソルキー。

Claims (1)

  1. 【特許請求の範囲】 1 各種の原稿サイズを有する画像を読取る読取
    手段と、 この読取手段で読取つた画像のサイズを変換す
    る変換手段と、 この変換手段によりサイズが変換された画像を
    記憶する記憶手段と、 この記憶手段に記憶されている画像を表示する
    表示領域を有した表示手段と、 前記変換手段によりサイズ変換されて前記表示
    手段により表示される画像の表示サイズが、前記
    読取手段で読取られた画像の原稿サイズに係わり
    なく略一定の大きさで、かつ前記表示手段の表示
    領域の略全体の大きさとなるサイズ変換率が種々
    の原稿サイズに対応して記憶されたROMを有
    し、前記読取手段で読取られた画像に対応するサ
    イズ変換率を前記ROMから読出して前記変換手
    段に設定する制御手段と を具備したことを特徴とする画像表示装置。
JP57013166A 1982-01-29 1982-01-29 画像表示装置 Granted JPS58129679A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP57013166A JPS58129679A (ja) 1982-01-29 1982-01-29 画像表示装置
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US06/458,877 US4520399A (en) 1982-01-29 1983-01-18 Picture information display device
EP83100407A EP0085351B1 (en) 1982-01-29 1983-01-18 Picture information display device

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JP57013166A JPS58129679A (ja) 1982-01-29 1982-01-29 画像表示装置

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JPS58129679A JPS58129679A (ja) 1983-08-02
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JP57013166A Granted JPS58129679A (ja) 1982-01-29 1982-01-29 画像表示装置

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