JPH0211168B2 - - Google Patents
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- JPH0211168B2 JPH0211168B2 JP13549783A JP13549783A JPH0211168B2 JP H0211168 B2 JPH0211168 B2 JP H0211168B2 JP 13549783 A JP13549783 A JP 13549783A JP 13549783 A JP13549783 A JP 13549783A JP H0211168 B2 JPH0211168 B2 JP H0211168B2
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H7/00—Multiple-port networks comprising only passive electrical elements as network components
- H03H7/30—Time-delay networks
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- Coils Or Transformers For Communication (AREA)
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はインダクダンス素子とコンデンサを組
み合わせた電磁遅延線に係り、特に、超高周波で
の使用に適し遅延時間の比較的大きな電磁遅延線
の改良に関する。[Detailed Description of the Invention] [Technical Field of the Invention] The present invention relates to an electromagnetic delay line that combines an inductance element and a capacitor, and particularly to an improvement of an electromagnetic delay line that is suitable for use at ultra-high frequencies and has a relatively large delay time. Regarding.
この種の電磁遅延線としては、第1図および第
2図に示す構成のものがある。
This type of electromagnetic delay line has the configuration shown in FIGS. 1 and 2.
すなわち、偏平な棒状ボビン1に、線径Dの導
線2を所定のピツチPで単層ソレノイド状にスペ
ース巻きしてインダクタンス素子3を形成し、細
長い誘電体板4の一主面にアース電極5を設ける
とともに対向主面に前記導線2と同ピツチで容量
電極6を設けてコンデンサCを形成し、そのコン
デンサCの容量電極6とインダクタンス素子3の
導線2とを接続して複数区間を有する集中定数型
に構成したものである。 That is, an inductance element 3 is formed by space-winding a conductive wire 2 having a wire diameter D around a flat rod-shaped bobbin 1 at a predetermined pitch P in the shape of a single layer solenoid, and a ground electrode 5 is formed on one main surface of an elongated dielectric plate 4. A capacitor C is formed by providing a capacitor electrode 6 on the opposite main surface at the same pitch as the conductor wire 2, and connecting the capacitor electrode 6 of the capacitor C with the conductor wire 2 of the inductance element 3 to form a concentrated structure having multiple sections. It is configured as a constant type.
なお、両図において符号Wはボビン1における
断面長辺方向の距離であり、符号Bはボビン1の
断面短辺方向の距離であり、さらに符号Tは、ボ
ビン1の断面短辺方向における電流の向きが異な
る導線2の中心間の距離を示している。 In both figures, the symbol W is the distance in the long side direction of the cross section of the bobbin 1, the symbol B is the distance in the short side direction of the cross section of the bobbin 1, and the symbol T is the distance of the current in the short side direction of the cross section of the bobbin 1. It shows the distance between the centers of conducting wires 2 with different directions.
このように構成された電磁遅延線は、距離T,
B,Dの間に
T=B+D ………(1)
なる関係があり、ピツチPと距離Tの比を適当
(例えば0.2<P/T<1.9程度)に選定すること
により、良好な遅延特性例えば超高速の立ち上が
り特性を得ることが可能である。このような関係
については本出願人が既に特願昭57−27135号を
もつて開示した。 The electromagnetic delay line configured in this way has a distance T,
There is a relationship between B and D as follows: T=B+D (1), and by selecting an appropriate ratio of pitch P and distance T (for example, about 0.2<P/T<1.9), good delay characteristics can be obtained. For example, it is possible to obtain ultra-high-speed rise characteristics. This relationship has already been disclosed by the present applicant in Japanese Patent Application No. 57-27135.
そして、このような電磁遅延線にあつて、超高
速で遅延時間の比較的大きなものを得るために
は、巻数(区間数)を多くしなければならない。 In such an electromagnetic delay line, in order to obtain ultra-high speed and a relatively long delay time, the number of turns (number of sections) must be increased.
例えば100程度の区間数を有する電磁遅延線に
おいては、導線2の損失による超高周波域での減
衰が無視できなくなり、それを防ぐために導線2
の断面積を大きくする必要がある。 For example, in an electromagnetic delay line with about 100 sections, attenuation in the ultra-high frequency range due to loss in conductor 2 cannot be ignored, and to prevent this, conductor 2
It is necessary to increase the cross-sectional area of
しかし、上述の(1)式から明らかなように、導線
2の断面積を大きくするために線径Dを増やす
と、距離Tも大きくなつてピツチPと距離Tの関
係が遅延特性を良好にする上述の条件からずれて
くる。 However, as is clear from the above equation (1), when the wire diameter D is increased to increase the cross-sectional area of the conductor 2, the distance T also increases, and the relationship between the pitch P and the distance T improves the delay characteristics. This deviates from the above-mentioned conditions.
もっとも、ボビン1の距離Bを小さくて距離D
を増やしても距離Tが大きくならないようにすれ
ばよいが、ボビン1に導線2を巻く構成の電磁遅
延線にあつては、ボビン1の距離Bを零とするこ
とができず、(1)式から
B=T−D>0 ………(2)
の関係があり、結局、
T>D ………(3)
すなわち、導線2の距離Tが線径Dより大きく
なつていた。 However, if the distance B of bobbin 1 is made smaller, then the distance D
However, in the case of an electromagnetic delay line in which the conductor 2 is wound around the bobbin 1, the distance B of the bobbin 1 cannot be made zero, and (1) From the formula, there is a relationship of B=T-D>0 (2), and in the end, T>D (3) That is, the distance T of the conductor 2 was larger than the wire diameter D.
そのため、比較的遅延時間が大きい、換言すれ
ば区間数の多い電磁遅延線を構成する場合には、
導線2の損失を抑え、かつピツチPと距離Tの寸
法双方を上述した関係に選定するとともに小さく
して超小型および超高速の電磁遅延線を実現する
には限界がある。 Therefore, when configuring an electromagnetic delay line with a relatively large delay time, in other words, a large number of sections,
There is a limit to realizing an ultra-compact and ultra-high-speed electromagnetic delay line by suppressing the loss of the conducting wire 2, selecting both the pitch P and the distance T in the above-mentioned relationship, and reducing the loss.
本発明はこのような状況の下になされたもの
で、インダクタンス素子における導体の幅を大き
く保つたまま上述したピツチPや導体間の距離T
の寸法を小さくすることが可能で、損失が少な
く、超小型および超高速で構造の簡単な電磁遅延
線の提供を目的とする。
The present invention was made under such circumstances, and the pitch P and the distance T between the conductors can be reduced while keeping the width of the conductor in the inductance element large.
The purpose of the present invention is to provide an electromagnetic delay line that can be reduced in size, has low loss, is ultra-compact, ultra-high speed, and has a simple structure.
この目的を達成するために本発明は、導体を単
層ソレノイド状にスペース巻きした偏平なインダ
クタンス素子と、このインダクタンス素子の所定
のターン毎にアースとの間に接続したコンデンサ
を備具してなる電磁遅延線において、前記導体の
幅をDとし、前記インダクタンス素子の短辺方向
で対向する前記導体の中心間の間隔をTとし、前
記インダクタンス素子がD≧Tなる関係に設定さ
れてなるものである。
To achieve this object, the present invention comprises a flat inductance element in which a conductor is space-wound in the form of a single-layer solenoid, and a capacitor connected between each predetermined turn of this inductance element and ground. In the electromagnetic delay line, the width of the conductor is D, the distance between the centers of the conductors facing each other in the short side direction of the inductance element is T, and the inductance element is set in a relationship such that D≧T. be.
このような本発明の構成によれば、インダクタ
ンス素子における導体の幅を大きく保つたままピ
ツチPおよび距離Tの寸法を共に小さくすること
が可能となり、導体の損失を抑えてインダクタン
ス素子の望ましい結合係数を得ることができる。 According to the configuration of the present invention, it is possible to reduce both the pitch P and the distance T while keeping the width of the conductor in the inductance element large, suppressing loss in the conductor and increasing the desired coupling coefficient of the inductance element. can be obtained.
そのため、超高周波域での信号の減衰が少な
く、かつ良好な遅延特性例えば超高速の立ち上が
り特性が得られるとともに超小型化を図ることが
極めて容易となる。 Therefore, signal attenuation in the ultra-high frequency range is small, good delay characteristics, such as ultra-fast rise characteristics, can be obtained, and it is extremely easy to achieve ultra-miniaturization.
特に、区間数の多い電磁遅延線にあつては、導
体の損失が極めて少なくなるので、有用である。 This is particularly useful for electromagnetic delay lines with a large number of sections, since conductor loss is extremely reduced.
以下本発明の詳細を説明する。 The details of the present invention will be explained below.
第3図および第4図は本発明の一実施例を示す
平面図および断面図である。 FIGS. 3 and 4 are a plan view and a sectional view showing an embodiment of the present invention.
両図において、絶縁体からなり偏平で細長いボ
ビン7の幅の広い両主面(図中上面および下図)
には、幅方向に複数の巻溝8,9が所定のピツチ
Pで形成されている。ボビン7の上面および下面
に形成された巻溝8,9は、互いに若干オーバー
ラツプする深さ、かつ上面および下面の間で各々
半ピツチ分ずれるようにして形成されている。 In both figures, both wide main surfaces (top and bottom in the figure) of a flat and elongated bobbin 7 made of an insulator are shown.
A plurality of winding grooves 8 and 9 are formed at a predetermined pitch P in the width direction. The winding grooves 8 and 9 formed on the upper and lower surfaces of the bobbin 7 are formed to have depths that slightly overlap each other and to be offset by half a pitch between the upper and lower surfaces.
ボビン7の巻溝8,9には、巻溝8,9の幅と
略同じ幅すなわち線径Dを有する導線10が単層
ソレノイド状にスペース巻きされており、インダ
クタンス素子11が形成されている。そして、巻
溝8,9が互いに若干オーバーラツプする深さで
形成されているので、巻かれたインダクタンス素
子11は、ボビン7の短辺方向の導線10の中心
間の距離Tが導線10の線径Dよりも小さく、T
<Dとなつている。 In the winding grooves 8 and 9 of the bobbin 7, a conducting wire 10 having a width approximately the same as the width of the winding grooves 8 and 9, that is, a wire diameter D, is space-wound in a single-layer solenoid shape, and an inductance element 11 is formed. . Since the winding grooves 8 and 9 are formed at a depth that slightly overlaps each other, the wound inductance element 11 has a distance T between the centers of the conductive wire 10 in the short side direction of the bobbin 7, which is the diameter of the conductive wire 10. smaller than D, T
<D.
インダクタンス素子11の一側面(ボビン7の
短辺方向の一側面)において、第4図に示すよう
に、誘電体板12の一主面にアース電極13を形
成しかつ対向主面に導線10と同ピツチで容量電
極14を形成してなるコンデンサ素子Cが、その
容量電極14を導線10に半田付けして接続され
ており、複数区間を有する集中定数型の電磁遅延
線が構成されている。 On one side surface of the inductance element 11 (one side surface in the short side direction of the bobbin 7), as shown in FIG. A capacitor element C having capacitive electrodes 14 formed at the same pitch is connected to the conducting wire 10 by soldering, thereby forming a lumped constant electromagnetic delay line having a plurality of sections.
なお第3図中符号Pは、ボビン7の両主面各々
における隣合う導体10の中心間の間隔であり、
上述した第1図の電磁遅延線のピツチPに相当す
る。 Note that the symbol P in FIG. 3 is the distance between the centers of adjacent conductors 10 on each of both main surfaces of the bobbin 7,
This corresponds to the pitch P of the electromagnetic delay line in FIG. 1 mentioned above.
このように構成された電磁遅延線においては、
インダクタンス素子11が、ボビン7の短辺方向
の導線10の中心間の距離Tを導線10の線径D
よりも小さく、すなわちT<Dとしているので、
導線10の線径Dが大きくても導線10の中心間
の距離Tの寸法が小さくなる。 In the electromagnetic delay line configured in this way,
The inductance element 11 converts the distance T between the centers of the conductive wire 10 in the short side direction of the bobbin 7 to the wire diameter D of the conductive wire 10.
Since it is smaller than , that is, T<D,
Even if the wire diameter D of the conducting wire 10 is large, the distance T between the centers of the conducting wire 10 becomes small.
そのため、区間数が多くても導線10の損失を
抑えることが可能で、ピツチPおよび距離Tを小
さくかつ良好な条件に選定してインダクタンス素
子9における望ましい結合係数も確保することが
できる。 Therefore, even if the number of sections is large, it is possible to suppress the loss of the conducting wire 10, and by selecting the pitch P and the distance T to be small and under favorable conditions, it is also possible to secure a desirable coupling coefficient in the inductance element 9.
従つて、超高周波域において、減衰を改良でき
るし、良好な遅延特性例えば超高速の立ち上がり
特性を得ることができ、形状も小型となる。 Therefore, in the ultra-high frequency range, attenuation can be improved, good delay characteristics, such as ultra-high-speed rise characteristics, can be obtained, and the size can be reduced.
しかも、距離Tは、第1図のようにボビン1を
介して得られるものではなく、巻溝8,9の深さ
を適当に選択することにより、任意に、特に微小
に選定可能であつて構造が簡単である。 Moreover, the distance T is not obtained through the bobbin 1 as shown in FIG. 1, but can be arbitrarily selected, especially minutely, by appropriately selecting the depths of the winding grooves 8 and 9. The structure is simple.
第5図〜第7図は本発明の電磁遅延線の別の実
施例を示すものである。 5 to 7 show other embodiments of the electromagnetic delay line of the present invention.
この実施例においては、銅箔や銅板からなり所
定の長さH−I,I−J,J−K,……を有する
幅Dの導体片15〜17……を、その中心を交互
にずらせて一体的に連結して帯状導体18を形成
し、第6図に示すように、各導体片15〜17の
境界部H,I,J,K,……をじぐざぐ状に折り
曲げた偏平なインダクタンス素子11を形成し、
その帯状導体18の折り曲げ部に、第4図に示す
ようなコンデンサCの容量電極14を接続し、複
数区間を有する集中定数型の電磁遅延線が構成さ
れている。 In this embodiment, conductor pieces 15 to 17 made of copper foil or copper plate and having a predetermined length H-I, I-J, J-K, . are integrally connected to form a strip conductor 18, and as shown in FIG. 6, a flat conductor is formed by bending the boundaries H, I, J, K, . forming an inductance element 11;
A capacitive electrode 14 of a capacitor C as shown in FIG. 4 is connected to the bent portion of the band-shaped conductor 18, thereby constructing a lumped constant electromagnetic delay line having a plurality of sections.
このような電磁遅延線は、H−I,J−K間の
各導体片15,17の中心は、第5図に示す仮想
線Q−Qの上に位置し、I−J間の導体片16の
中心は仮想線R−Rの上に位置する。そのため、
上述した電磁遅延線の距離Tに相当する距離は、
帯状導体18が折り曲げられた場合に対向する導
体の中心間の距離、すなわち仮想線Q−QとR−
R間の距離となる。 In such an electromagnetic delay line, the center of each conductor piece 15, 17 between H-I and J-K is located on the virtual line Q-Q shown in FIG. 16 is located on the virtual line RR. Therefore,
The distance corresponding to the distance T of the electromagnetic delay line mentioned above is
When the band-shaped conductor 18 is bent, the distance between the centers of opposing conductors, that is, the virtual lines Q-Q and R-
This is the distance between R.
この場合にも、距離Tは、各導体片15,17
と導体片16の中心をずらせるだけで極めて小さ
くすることが可能となるうえ、導体片15〜17
の幅Dは距離Tより広くすることが可能であり、
損失を抑えることができる。 In this case as well, the distance T is
It is possible to make the conductor pieces 15 to 17 extremely small by simply shifting the center of the conductor pieces 16.
The width D of can be made wider than the distance T,
Loss can be reduced.
さらに、第6図に示すように、導体18が薄く
ピツチPも小さくできるので、ピツチPおよびT
を共に極めて小さく選定可能となり、そのため、
高密度化および超小型化を図りつつ良好な遅延特
性を得ることができる。 Furthermore, as shown in FIG. 6, since the conductor 18 is thin and the pitch P can be made small, the pitch P and T
Both can be selected to be extremely small, and therefore,
Good delay characteristics can be obtained while achieving high density and ultra-miniaturization.
また、上述の実施例においてインダクタンス素
子11の導線10や導体片18の幅Dと距離Tの
関係をD>Tとして構成したが、本発明にあつて
は少なくともD≧Tなる関係に選定すれば本発明
の目的達成が可能である。 Further, in the above-described embodiment, the relationship between the width D and the distance T of the conductor wire 10 and the conductor piece 18 of the inductance element 11 was configured as D>T, but in the present invention, it is preferable to select the relationship such that at least D≧T. The object of the invention can be achieved.
以上説明したように本発明の電磁遅延線は、偏
平なインダクタンス素子を構成する導体の幅をD
とし、短辺方向で対向する前記導体の中心間の間
隔をTとし、前記インダクタンス素子をD≧Tな
る関係に設定したので、導体の断面積を大きくし
たままPおよびTを共に小さくすることが可能と
なり、導体の損失が小さく、超小型化および超高
速化を達成することが可能であり、構造も簡単と
なる。 As explained above, in the electromagnetic delay line of the present invention, the width of the conductor constituting the flat inductance element is D.
Since the distance between the centers of the conductors facing each other in the short side direction is T, and the inductance element is set in the relationship D≧T, it is possible to reduce both P and T while increasing the cross-sectional area of the conductor. The conductor loss is small, it is possible to achieve ultra-miniaturization and ultra-high speed, and the structure is simple.
第1図および第2図は本発明の参考となる電磁
遅延線を示す正面図および側面図、第3図および
第4図は本発明の電磁遅延線の一実施例を示す平
面図および側面図、第5図〜第7図は本発明の電
磁遅延線の他の実施例を示す要部展開図、正面図
および概略側面図である。
1,7……ボビン、2,10,18……導体
(導線)、3,11……インダクタンス素子、4,
12……絶縁基板(誘電体板)、5,13……ア
ース電極、6,14……容量電極、15〜17…
…導体片、18……帯状導体、C……コンデン
サ。
1 and 2 are a front view and a side view showing an electromagnetic delay line as a reference for the present invention, and FIGS. 3 and 4 are a plan view and a side view showing an embodiment of the electromagnetic delay line of the present invention. , FIG. 5 to FIG. 7 are a developed view, a front view, and a schematic side view of essential parts showing other embodiments of the electromagnetic delay line of the present invention. 1, 7... Bobbin, 2, 10, 18... Conductor (conductor wire), 3, 11... Inductance element, 4,
12... Insulating substrate (dielectric plate), 5, 13... Earth electrode, 6, 14... Capacitive electrode, 15-17...
...Conductor piece, 18...Strip conductor, C...Capacitor.
Claims (1)
偏平なインダクタンス素子と、 このインダクタンス素子の所定のターン毎にア
ースとの間に接続したコンデンサを備具してなる
電磁遅延線において、 前記導体の幅をDとし、前記インダクタンス素
子の短辺方向で対向する前記導体の中心間の間隔
をTとし、前記インダクタンス素子がD≧Tなる
関係に設定されてなることを特徴とする電磁遅延
線。 2 インダクタンス素子が、偏平なボビンの対向
主面に各々所定のピツチで互いにオーバーラツプ
する深さで形成された巻溝に導体を巻いてなる特
許請求の範囲第1項記載の電磁遅延線。 3 インダクタンス素子が、所定の長さの導体片
複数をその導体片の中心を交互にずらせて一体的
に連続形成するとともに、隣合う導体片の境界部
を順次じぐざぐ状に折り曲げてなる特許請求の範
囲第1項記載の電磁遅延線。[Claims] 1. In an electromagnetic delay line comprising a flat inductance element in which a conductor is space-wound in the shape of a single-layer solenoid, and a capacitor connected between each predetermined turn of this inductance element and the ground. , wherein the width of the conductor is D, the distance between the centers of the conductors facing each other in the short side direction of the inductance element is T, and the inductance element is set in a relationship such that D≧T. delay line. 2. The electromagnetic delay line according to claim 1, wherein the inductance element is formed by winding a conductor in winding grooves formed on opposing principal surfaces of a flat bobbin at predetermined pitches and at depths that overlap each other. 3. A patent claim in which the inductance element is formed by integrally and continuously forming a plurality of conductor pieces of a predetermined length with the centers of the conductor pieces alternately shifted, and the boundaries between adjacent conductor pieces are sequentially bent in a zigzag shape. The electromagnetic delay line according to item 1.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13549783A JPS6027214A (en) | 1983-07-25 | 1983-07-25 | Electromagnetic delay line |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13549783A JPS6027214A (en) | 1983-07-25 | 1983-07-25 | Electromagnetic delay line |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6027214A JPS6027214A (en) | 1985-02-12 |
| JPH0211168B2 true JPH0211168B2 (en) | 1990-03-13 |
Family
ID=15153120
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13549783A Granted JPS6027214A (en) | 1983-07-25 | 1983-07-25 | Electromagnetic delay line |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6027214A (en) |
-
1983
- 1983-07-25 JP JP13549783A patent/JPS6027214A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6027214A (en) | 1985-02-12 |
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