JPH02143649U - - Google Patents

Info

Publication number
JPH02143649U
JPH02143649U JP4989689U JP4989689U JPH02143649U JP H02143649 U JPH02143649 U JP H02143649U JP 4989689 U JP4989689 U JP 4989689U JP 4989689 U JP4989689 U JP 4989689U JP H02143649 U JPH02143649 U JP H02143649U
Authority
JP
Japan
Prior art keywords
address
decoder
assigned
switch
input terminal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP4989689U
Other languages
English (en)
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed filed Critical
Priority to JP4989689U priority Critical patent/JPH02143649U/ja
Publication of JPH02143649U publication Critical patent/JPH02143649U/ja
Pending legal-status Critical Current

Links

Description

【図面の簡単な説明】
第1図及び第2図は夫々本考案の第1及び第2
実施例の回路図、第3図は従来の一例の回路図で
ある。 10,11,15〜18……アドレスデコーダ
、10a,11a,15a〜18a……アンドゲ
ート、11b,16b〜18b,18c……イン
バータ、12……ノアゲート、S,S,S
…スイツチ、Vcc……電源。

Claims (1)

  1. 【実用新案登録請求の範囲】 アドレスバスに接続して使用するデバイス1個
    宛に複数系統のアドレスが割当てられたシステム
    で、該アドレス系統に夫々対応して設けられたア
    ドレスデコーダを該1個のデバイスに対して択一
    的に選択することにより1つのアドレスを選択す
    るアドレス選択回路において、 上記アドレスデコーダの数より少ない数のスイ
    ツチ及び電源を夫々上記アドレスデコーダに対し
    て共通に用意し、 上記アドレスデコーダの切換選択入力端子に、
    該スイツチのオン、オフによつて該切換選択入力
    端子の論理が上記アドレスデコーダ毎に全て異な
    るように、論理素子及び上記スイツチ、電源を接
    続してなるアドレス選択回路。
JP4989689U 1989-04-27 1989-04-27 Pending JPH02143649U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP4989689U JPH02143649U (ja) 1989-04-27 1989-04-27

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP4989689U JPH02143649U (ja) 1989-04-27 1989-04-27

Publications (1)

Publication Number Publication Date
JPH02143649U true JPH02143649U (ja) 1990-12-05

Family

ID=31567978

Family Applications (1)

Application Number Title Priority Date Filing Date
JP4989689U Pending JPH02143649U (ja) 1989-04-27 1989-04-27

Country Status (1)

Country Link
JP (1) JPH02143649U (ja)

Similar Documents

Publication Publication Date Title
JPH02143649U (ja)
JP2658142B2 (ja) 論理装置
JPS632398U (ja)
JPS60140104U (ja) Cio/dio自動切換回路
JPH033052U (ja)
JPS6151547U (ja)
JPS6189945U (ja)
JPS62183236U (ja)
JPS62107304A (ja) プログラマブルコントロ−ラ
JPS6312934U (ja)
JPS61112454U (ja)
JPH02130027U (ja)
JPH02253435A (ja) 集積回路
JPH01138143U (ja)
JPS63152317U (ja)
JPS61204259U (ja)
JPS62173828U (ja)
JPS5915148U (ja) マイクロコンピユ−タ
JPS635527U (ja)
JPS6160302U (ja)
JPH05197615A (ja) Cpu起動用rom/ram切換回路
JPH02146814A (ja) タイマ回路
JPH02112026U (ja)
KR920014317A (ko) 전전자 교환기에서의 공간스위치 프로세서 이중화 제어방법
JPS6454134U (ja)