JPH02145818U - - Google Patents
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- Publication number
- JPH02145818U JPH02145818U JP5622189U JP5622189U JPH02145818U JP H02145818 U JPH02145818 U JP H02145818U JP 5622189 U JP5622189 U JP 5622189U JP 5622189 U JP5622189 U JP 5622189U JP H02145818 U JPH02145818 U JP H02145818U
- Authority
- JP
- Japan
- Prior art keywords
- output terminal
- region
- semiconductor
- prevention circuit
- layer
- Prior art date
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- Granted
Links
- 239000004065 semiconductor Substances 0.000 claims description 4
- 239000000758 substrate Substances 0.000 claims description 2
- 230000002265 prevention Effects 0.000 claims 2
- 230000015556 catabolic process Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Logic Circuits (AREA)
- Electronic Switches (AREA)
- Amplifiers (AREA)
Description
第１図ａは本考案の実施例を示す断面図、第１
図ｂは第１図ａに示された構造の回路図、第２図
ａは本考案の他の実施例を示す断面図、第２図ｂ
は第２図ａに示された構造の回路図である。 １，１２……半導体基板、２，１３……ソース
、３，１４……ドレイン、４，１５……ゲート、
５……Ｎ−ｗｅｌｌ、１６……Ｐ−ｗｅｌｌ、８
，１９……出力端子、９，２０……出力ＭＯＳト
ランジスタ、１０……ＰＮＰトランジスタ、２１
……ＮＰＮトランジスタ、１１，２２……接合容
量。
図ｂは第１図ａに示された構造の回路図、第２図
ａは本考案の他の実施例を示す断面図、第２図ｂ
は第２図ａに示された構造の回路図である。 １，１２……半導体基板、２，１３……ソース
、３，１４……ドレイン、４，１５……ゲート、
５……Ｎ−ｗｅｌｌ、１６……Ｐ−ｗｅｌｌ、８
，１９……出力端子、９，２０……出力ＭＯＳト
ランジスタ、１０……ＰＮＰトランジスタ、２１
……ＮＰＮトランジスタ、１１，２２……接合容
量。
Claims (1)
- 【実用新案登録請求の範囲】 出力端子と、該出力端子にドレインが接続され
たＭＯＳトランジスタを備えた集積回路の静電破
壊防止回路に於いて、 半導体基板中に形成された一導電型の半導体層
と、 該半導体層中に形成された逆導電型の第１及び
第２領域と、 を備え、 前記第１領域を前記出力端子に接続すると共に
前記第２領域を所定の電源に接続したことを特徴
とする静電破壊防止回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1989056221U JPH0753307Y2 (ja) | 1989-05-16 | 1989-05-16 | 静電破壊防止回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1989056221U JPH0753307Y2 (ja) | 1989-05-16 | 1989-05-16 | 静電破壊防止回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02145818U true JPH02145818U (ja) | 1990-12-11 |
| JPH0753307Y2 JPH0753307Y2 (ja) | 1995-12-06 |
Family
ID=31579854
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1989056221U Expired - Lifetime JPH0753307Y2 (ja) | 1989-05-16 | 1989-05-16 | 静電破壊防止回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0753307Y2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63146460A (ja) * | 1986-12-10 | 1988-06-18 | Mitsubishi Electric Corp | 半導体集積回路 |
-
1989
- 1989-05-16 JP JP1989056221U patent/JPH0753307Y2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63146460A (ja) * | 1986-12-10 | 1988-06-18 | Mitsubishi Electric Corp | 半導体集積回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0753307Y2 (ja) | 1995-12-06 |