JPH02158210A - パルス異常検出回路 - Google Patents
パルス異常検出回路Info
- Publication number
- JPH02158210A JPH02158210A JP31247988A JP31247988A JPH02158210A JP H02158210 A JPH02158210 A JP H02158210A JP 31247988 A JP31247988 A JP 31247988A JP 31247988 A JP31247988 A JP 31247988A JP H02158210 A JPH02158210 A JP H02158210A
- Authority
- JP
- Japan
- Prior art keywords
- pulse
- period
- abnormal
- circuit
- abnormality detection
- Prior art date
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- Pending
Links
- 230000005856 abnormality Effects 0.000 title claims abstract description 18
- 238000001514 detection method Methods 0.000 title claims description 12
- 230000002159 abnormal effect Effects 0.000 claims abstract description 19
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
Landscapes
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は一定周期で入力するパルスの異常だけでなく、
これらパルスの間に異常パルスが混合した場合も検出し
、パルス異常信号を出力するパルス異常検出回路に関す
る。
これらパルスの間に異常パルスが混合した場合も検出し
、パルス異常信号を出力するパルス異常検出回路に関す
る。
（従来の技術）
従来、この種のパルス異常検出回路は、モノマルチ回路
？１つ使づた構成となってい念。
？１つ使づた構成となってい念。
（発明が解決しようとする課題）
上述し九従来のパルス異常検出回路は、モノマルチを１
つ使つ次回路構成となっているので、入力されるべきパ
ルスが入力されない場合等のパルス異常は検出できるが
１周期Ｔ以内に異常なパルスが突出し九場合、パルスの
異常検出ができないという欠点があった。
つ使つ次回路構成となっているので、入力されるべきパ
ルスが入力されない場合等のパルス異常は検出できるが
１周期Ｔ以内に異常なパルスが突出し九場合、パルスの
異常検出ができないという欠点があった。
本発明の目的は上記欠点ｔ−解決するもので、周期Ｔ以
内に異常パルスが発生した場合、これを検出できるパル
ス異常検出回路全提供することにある。
内に異常パルスが発生した場合、これを検出できるパル
ス異常検出回路全提供することにある。
（課題を解決するための手段）
前記目的を達成するために本発明によるパルス異常検出
回路は一足周期（Ｔ）のパルスを入力トリガとし、パル
ス＠（Ｔ−ΔＴｓ）なるパルスを出力する第１モノマル
チ回路と、前記第１モノマルチ回路から出力されるパル
スを入力トリガとし、パルス＠（Ｔ＋ΔＴ２）なるパル
スを出力する第２モノマルチ回路とからなり、前記一定
周期のパルスの間に異常パルスが混入し九とき、前記第
２モノマルチ回路が異常信号全出力するように構成しで
ある。
回路は一足周期（Ｔ）のパルスを入力トリガとし、パル
ス＠（Ｔ−ΔＴｓ）なるパルスを出力する第１モノマル
チ回路と、前記第１モノマルチ回路から出力されるパル
スを入力トリガとし、パルス＠（Ｔ＋ΔＴ２）なるパル
スを出力する第２モノマルチ回路とからなり、前記一定
周期のパルスの間に異常パルスが混入し九とき、前記第
２モノマルチ回路が異常信号全出力するように構成しで
ある。
（実 施 例）
以下、図面を参照して本発明をさらに詳しく説明する。
第１図は本発明によるパルス異常検出回路の実施例を示
すブロック図であり、第２図は正常動ｆｉｌのタイムチ
ャート、ま友、第３図は異常パルス発往時のタイムチャ
ートである。
すブロック図であり、第２図は正常動ｆｉｌのタイムチ
ャート、ま友、第３図は異常パルス発往時のタイムチャ
ートである。
ｌｉｄ期Ｔのパルス１１をモノマルチ回路１に入力する
と、モノマルチ回路１は周期ＴよりΔＴ１短いパルス幅
のパルス１２を出力する。このパルス１２はモノマルチ
回路２に入力１ｔ−Ｅ−ノマルチ回路２より周期Ｔより
ΔＴ２長いパルス幅のパルス１３が出力される。なお、
ΔＴ ｌ、ΔＴ２は本回路の検出能力を決めるものであ
り。
と、モノマルチ回路１は周期ＴよりΔＴ１短いパルス幅
のパルス１２を出力する。このパルス１２はモノマルチ
回路２に入力１ｔ−Ｅ−ノマルチ回路２より周期Ｔより
ΔＴ２長いパルス幅のパルス１３が出力される。なお、
ΔＴ ｌ、ΔＴ２は本回路の検出能力を決めるものであ
り。
小さければ小さい程、検出能力は高くなる。ただし、零
よりは大きいものである。
よりは大きいものである。
いま、パルス１１が第２図のように正常な場合には、パ
ルス１３はリトリガされ続は常Ｋ”Ｈ＃状態である。
ルス１３はリトリガされ続は常Ｋ”Ｈ＃状態である。
しかし、第３図のパルス１１のように異常パルｘ２１が
発生すると、パルス１２のパルス２２は消滅してパルス
１３に１Ｌ”の状態が生じる。
発生すると、パルス１２のパルス２２は消滅してパルス
１３に１Ｌ”の状態が生じる。
つまりこの時、パルス１１に異常が生じ友ということが
検出でき、モノマルチ回路２の出力は異常状態を示す”
Ｌ”状態となる。
検出でき、モノマルチ回路２の出力は異常状態を示す”
Ｌ”状態となる。
（発明の効果）
以上、説明したように本発Ｆ３Ａは周期Ｔなるパルスを
入力トリガとし、パルス幅Ｔ−ΔＴｌなるパルスを出力
する第１モノマルチ回路と前記パルスを入力トリガとし
パルス幅Ｔ十ΔＴ２なるパルスを出力する第２モノマル
チ回路で構成することにより、周期Ｔ以内に異常なパル
スが突出した場合、パルスの異常を検出できるという効
果がある。
入力トリガとし、パルス幅Ｔ−ΔＴｌなるパルスを出力
する第１モノマルチ回路と前記パルスを入力トリガとし
パルス幅Ｔ十ΔＴ２なるパルスを出力する第２モノマル
チ回路で構成することにより、周期Ｔ以内に異常なパル
スが突出した場合、パルスの異常を検出できるという効
果がある。
第１図は本発明によるパルス異常検出回路の実施例を示
すブロック図、第２図は正常な場合のタイムチャート、
第３図は異常な場合のタイムチャートである。 ｌ・・・パルス＠Ｔ−ΔＴｌのパルス１２ｔ−出力する
モノマルチ回路 ２・・・パルス幅Ｔ＋ΔＴ２のパルス１３１ｔｌ力する
モノマルチ回路 １１・・・周期Ｔのパルス １２・・・モノマルチ回路ｌの出力パルス１３・・・モ
ノマルチ回路２の出力パルス（異常検出アラーム） ２１・・・異常パルス ２２・・・正常なパルス１１による正常なパルス１２の
ひとつのパルス 才１図 才２図 ２３図
すブロック図、第２図は正常な場合のタイムチャート、
第３図は異常な場合のタイムチャートである。 ｌ・・・パルス＠Ｔ−ΔＴｌのパルス１２ｔ−出力する
モノマルチ回路 ２・・・パルス幅Ｔ＋ΔＴ２のパルス１３１ｔｌ力する
モノマルチ回路 １１・・・周期Ｔのパルス １２・・・モノマルチ回路ｌの出力パルス１３・・・モ
ノマルチ回路２の出力パルス（異常検出アラーム） ２１・・・異常パルス ２２・・・正常なパルス１１による正常なパルス１２の
ひとつのパルス 才１図 才２図 ２３図
Claims (1)
- 一定周期（Ｔ）のパルスを入力トリガとし、パルス幅（
Ｔ−ΔＴ＿１）なるパルスを出力する第１モノマルチ回
路と、前記第１モノマルチ回路から出力されるパルスを
入力トリガとし、パルス幅（Ｔ＋ΔＴ＿２）なるパルス
を出力する第２モノマルチ回路とからなり、前記一定周
期のパルスの間に異常パルスが混入したとき、前記第２
モノマルチ回路が異常信号を出力するように構成したこ
とを特徴とするパルス異常検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31247988A JPH02158210A (ja) | 1988-12-09 | 1988-12-09 | パルス異常検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31247988A JPH02158210A (ja) | 1988-12-09 | 1988-12-09 | パルス異常検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02158210A true JPH02158210A (ja) | 1990-06-18 |
Family
ID=18029706
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31247988A Pending JPH02158210A (ja) | 1988-12-09 | 1988-12-09 | パルス異常検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02158210A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02266269A (ja) * | 1989-04-07 | 1990-10-31 | Toshiba Corp | 異常検出回路 |
-
1988
- 1988-12-09 JP JP31247988A patent/JPH02158210A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02266269A (ja) * | 1989-04-07 | 1990-10-31 | Toshiba Corp | 異常検出回路 |
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