JPH02170222A - 画像情報表示装置 - Google Patents
画像情報表示装置Info
- Publication number
- JPH02170222A JPH02170222A JP32742988A JP32742988A JPH02170222A JP H02170222 A JPH02170222 A JP H02170222A JP 32742988 A JP32742988 A JP 32742988A JP 32742988 A JP32742988 A JP 32742988A JP H02170222 A JPH02170222 A JP H02170222A
- Authority
- JP
- Japan
- Prior art keywords
- display
- memory
- window
- data
- line
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Digital Computer Display Output (AREA)
- Image Generation (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は、マルチウィンドウ表示するラスタ式の画情表
示装置に係り、特に表示画面中の任意のビット位置に複
数のウィンドウを表示するようにしたマルチウィンドウ
表示装置に関するものである。
示装置に係り、特に表示画面中の任意のビット位置に複
数のウィンドウを表示するようにしたマルチウィンドウ
表示装置に関するものである。
〈従来の技術〉
マルチウィンドウは最近のパーソナルコンピュータやワ
ークステーションにおけるマンマシンインターフェース
の１つとして脚光を浴びている。
ークステーションにおけるマンマシンインターフェース
の１つとして脚光を浴びている。
ラスク走査型のＣＲＴ装置に複数のウィンドウを表示さ
せる場合には、主に以下の２つの方法が考えらｎる。
せる場合には、主に以下の２つの方法が考えらｎる。
ｆｌ メモリ中に各ウィンドウの画像ブータラ格納し
ておき、別にＣＲＴ画面と一対一の表示のためのメモリ
領域、すなわチ、リフレッシュメモリを設け、各ウィン
ドウの画像データを表示優先順位にしたがってリフレッ
シュメモリに書き込んで、各ウィンドウの画像データを
表示させる方法。
ておき、別にＣＲＴ画面と一対一の表示のためのメモリ
領域、すなわチ、リフレッシュメモリを設け、各ウィン
ドウの画像データを表示優先順位にしたがってリフレッ
シュメモリに書き込んで、各ウィンドウの画像データを
表示させる方法。
（２）上記ｆｌのようなリフレッシュメモリは設ケス、
ＣＲＴのラスク走査に同期して、表示画面上の各ウィン
ドウの位置を検出しながら、メモリ上の別々の領域に格
納されている各ウィンドウの画像データを読み出して、
マルチウィンドウ表示を実現する方法。
ＣＲＴのラスク走査に同期して、表示画面上の各ウィン
ドウの位置を検出しながら、メモリ上の別々の領域に格
納されている各ウィンドウの画像データを読み出して、
マルチウィンドウ表示を実現する方法。
〈発明が解決しようとする課題〉
しかしながら、従来のｆｌ＋の方法は、リフレッシュメ
モリに書き込む時間が大きく、画面表示時間との関係か
らもスムーズな画面表示が行なえないという問題点があ
った。また、（２）の方法は画面表示時間とメモリ読み
出し時間との兼ねあいから、１ドツトずつメモリから読
み出していたのでは表示に間に合わなく、−度に数ドツ
ト単位で扱わなくてはならない。そうなると、１ドツト
単位のウィンドウ表示を実現するのが困難になるという
問題点もあった。
モリに書き込む時間が大きく、画面表示時間との関係か
らもスムーズな画面表示が行なえないという問題点があ
った。また、（２）の方法は画面表示時間とメモリ読み
出し時間との兼ねあいから、１ドツトずつメモリから読
み出していたのでは表示に間に合わなく、−度に数ドツ
ト単位で扱わなくてはならない。そうなると、１ドツト
単位のウィンドウ表示を実現するのが困難になるという
問題点もあった。
本発明は上記のような問題点を解決するために発明され
たものであり、１ドツト単位のスムーズな表示が可能な
画像情報表示装置を提供すること全目的にしている。
たものであり、１ドツト単位のスムーズな表示が可能な
画像情報表示装置を提供すること全目的にしている。
く課題を解決するための手段〉
上記目的を達成するために本発明においては、メモリに
格納された画像情報を順次読み出して表示部にマルチウ
ィンドウ表示するラスク式の画像情報表示装置において
、前記表示部に表示する各ウィンドウの画素データを記
憶する記憶手段、表示のための同期召号を発生する同期
信号発生手段、前記表示部に表示する複数のウィンドウ
の位置情報など全格納した一時記憶手段、前記同期信号
発生手段の出力、前記記憶手段の出力、および、前記一
時記憶手段の出力から表示の行単位の情報を記憶する行
情報記憶手段、該行情報記憶手段の出力よυ前記表示部
へのデータを生成する生成手段とを備えた画像情報表示
装置を提供するものであシ、このことによって上記目的
が達せらｎる。
格納された画像情報を順次読み出して表示部にマルチウ
ィンドウ表示するラスク式の画像情報表示装置において
、前記表示部に表示する各ウィンドウの画素データを記
憶する記憶手段、表示のための同期召号を発生する同期
信号発生手段、前記表示部に表示する複数のウィンドウ
の位置情報など全格納した一時記憶手段、前記同期信号
発生手段の出力、前記記憶手段の出力、および、前記一
時記憶手段の出力から表示の行単位の情報を記憶する行
情報記憶手段、該行情報記憶手段の出力よυ前記表示部
へのデータを生成する生成手段とを備えた画像情報表示
装置を提供するものであシ、このことによって上記目的
が達せらｎる。
〈作 用〉
そして上記のように構成された画像情報表示装置によっ
て、−走査線分の表示データは、あらかじめラインメモ
リに用意さｎて表示される。
て、−走査線分の表示データは、あらかじめラインメモ
リに用意さｎて表示される。
〈実施例〉
以下、本発明の実施例を図面にしたがって詳維に説明す
る。
る。
第１図は本発明に係る実施例を示すブロック図であり、
プロセッサ１は、各ウィンドウの画像ブタをメモリ６に
書き込んだり、ウィンドウ情像レジスタ２の設定等を行
なう。ウィンドウ情報レジヌタ２は、各ウィンドウの表
示位置、メモリ上の格納アドレス、ウィンドウの表示優
先順位などの表示情報を格納するためのものであり、そ
の出力は表示ウィンドウ情報出力回路に接続されている
。
プロセッサ１は、各ウィンドウの画像ブタをメモリ６に
書き込んだり、ウィンドウ情像レジスタ２の設定等を行
なう。ウィンドウ情報レジヌタ２は、各ウィンドウの表
示位置、メモリ上の格納アドレス、ウィンドウの表示優
先順位などの表示情報を格納するためのものであり、そ
の出力は表示ウィンドウ情報出力回路に接続されている
。
メモリアクセス調停回路３はプロセッサｌおよび画像デ
ータ出力回務４とメモリ６の間にあってメモリ６の同時
アクセスを回避するためのものである。
ータ出力回務４とメモリ６の間にあってメモリ６の同時
アクセスを回避するためのものである。
表示ウィンドウ情報出力回路５は、同期信号出力回路１
０に同期して、ウィンドウ間服レジスタ２の備にしたが
った表示メモリアドレスを画像データ出力回路４に出力
して、また、ビット境界情報として表示ビットアドレス
、および、表示有効ビラトララインメモリ８に出力して
いる。
０に同期して、ウィンドウ間服レジスタ２の備にしたが
った表示メモリアドレスを画像データ出力回路４に出力
して、また、ビット境界情報として表示ビットアドレス
、および、表示有効ビラトララインメモリ８に出力して
いる。
画像データ出力回路４ば、表示メモリアドレスを受は取
ると、メモリアクセス調停回路３を通じて８ビツトの画
像データをメモリ６から取り出してラインメモリ７に出
力している。
ると、メモリアクセス調停回路３を通じて８ビツトの画
像データをメモリ６から取り出してラインメモリ７に出
力している。
ラインメモリ７．８は表示のための画像データを格納す
る８ピツト構成のＦＩＦＯで、特にラインメモリ８は画
像データのビット境界情報、すなわち、データの何ビッ
ト目から有効かを示す表示ビットアドレスに４ピツトを
、表示有効ビットに４ビットヲ割り当てている。
る８ピツト構成のＦＩＦＯで、特にラインメモリ８は画
像データのビット境界情報、すなわち、データの何ビッ
ト目から有効かを示す表示ビットアドレスに４ピツトを
、表示有効ビットに４ビットヲ割り当てている。
ビット整形回路９は、ラインメモリ７かう出力されるパ
ラレル８ビツトの画像データをパラレル・シリアル変換
するためのシフトレジスタと、ワインメモリ８から出力
される有効ピッ）Ｑカウントするための４ビツトのカウ
ンタとシフトレジスタの出力端を選択するための８×１
のデータセレクタから成っており、その出力は表示画像
データとなって図示しない表示部に送られる。
ラレル８ビツトの画像データをパラレル・シリアル変換
するためのシフトレジスタと、ワインメモリ８から出力
される有効ピッ）Ｑカウントするための４ビツトのカウ
ンタとシフトレジスタの出力端を選択するための８×１
のデータセレクタから成っており、その出力は表示画像
データとなって図示しない表示部に送られる。
同期信号出力回路１０はラスタ走査型のＣＲＴ装置を駆
動するための水平および垂直同期信号と表示期間を示す
信号を発生する。
動するための水平および垂直同期信号と表示期間を示す
信号を発生する。
本発明の画像情報表示装置は上述のように構成されてお
シ、以下、その動作について説明する６表示部に表示す
る画面を第２図に示す。
シ、以下、その動作について説明する６表示部に表示す
る画面を第２図に示す。
この場合のウィンドウの表示優先順位はウィンドウ２，
１．Ｏの順で、ウィンドウ情報レジスタ２には、この優
先順位とウィンドウ０．１．２のメモリ６中の格納アド
レスと表示画面上の各ウィンドウの位置が格納されてい
る。同期信号出力回路１０よシラスタ走査線Ｘを表示す
るための信号が出力されると、表示ウィンドウ情報出力
回路５はウィンドウ情報レジスタ２にしたがって、ウィ
ンドウ００バイトアドレスｗａｄｄｌｆｔ出力し、同時
にウィンドウのビット境界情報として、表示ビットアド
レス０と表示有効ビット８と全出力し、ラインメモリ８
に設定する。画像データ出力回路４は、このバイトアド
レスｗａｄｄ Ｏを受は取ると、メモリアクセス調停回
路３を介して画像データ（表示画面上ではラヌタ走査線
Ｘ上のドツト０〜７）をメモリから読み出し、ラインメ
モリ７に設定する。同様に、ウィンドウＯのバイトアド
レスｗａｄｄｏ＋１から得られる画像データ（ドツト８
〜１５）と表示ビットアドレス０と表示有効ビット８を
ラインメモリ７および８に設定する。
１．Ｏの順で、ウィンドウ情報レジスタ２には、この優
先順位とウィンドウ０．１．２のメモリ６中の格納アド
レスと表示画面上の各ウィンドウの位置が格納されてい
る。同期信号出力回路１０よシラスタ走査線Ｘを表示す
るための信号が出力されると、表示ウィンドウ情報出力
回路５はウィンドウ情報レジスタ２にしたがって、ウィ
ンドウ００バイトアドレスｗａｄｄｌｆｔ出力し、同時
にウィンドウのビット境界情報として、表示ビットアド
レス０と表示有効ビット８と全出力し、ラインメモリ８
に設定する。画像データ出力回路４は、このバイトアド
レスｗａｄｄ Ｏを受は取ると、メモリアクセス調停回
路３を介して画像データ（表示画面上ではラヌタ走査線
Ｘ上のドツト０〜７）をメモリから読み出し、ラインメ
モリ７に設定する。同様に、ウィンドウＯのバイトアド
レスｗａｄｄｏ＋１から得られる画像データ（ドツト８
〜１５）と表示ビットアドレス０と表示有効ビット８を
ラインメモリ７および８に設定する。
次にウィンドウ０とウィンドウ１の境界上に差しかかっ
たばあい、ウィンドウＯのバイトアドレスｗａｄｄ Ｏ
＋２から得られる表示すべき画像データ２ビツト（ドツ
ト１６〜１７）と、ウィンドウ１の下に隠れる画像デー
タ６ビツトと表示ビットアドレスＯと表示有効ビット２
がラインメモリ７および８にｌラスタ走査線分のデータ
が設定されている。
たばあい、ウィンドウＯのバイトアドレスｗａｄｄ Ｏ
＋２から得られる表示すべき画像データ２ビツト（ドツ
ト１６〜１７）と、ウィンドウ１の下に隠れる画像デー
タ６ビツトと表示ビットアドレスＯと表示有効ビット２
がラインメモリ７および８にｌラスタ走査線分のデータ
が設定されている。
この時の様子を第３図および第４図に示す。
また、ラインメモリ７および８の出力を受けるビット整
形回路９の内部構成を第５図に示す。
形回路９の内部構成を第５図に示す。
同期信号出力回路１０から表示期間を示す信号が出力さ
れると、ラインメモリ７および８の読み出しが始まる。
れると、ラインメモリ７および８の読み出しが始まる。
まず、ラインメモリ７の画像データの１バイト目がシフ
トレジスタ１１にロードされ、ラインメモリ８から表示
有効ビットがカウンタ１２にロードされ、表示ビットア
ドレスは、データセレクタ１３のセレクト値として入力
される。
トレジスタ１１にロードされ、ラインメモリ８から表示
有効ビットがカウンタ１２にロードされ、表示ビットア
ドレスは、データセレクタ１３のセレクト値として入力
される。
カウンタ１２には図示しないクロックが供給されており
、このクロックに同期して画像データが表示有効ビット
分、表示ビットアドレスでセレクトされるシフトレジス
タのシリアルアウト端子から出力され、カウンタが０を
示すと次のデータをラインメモリ７および８から読み出
し、画像データを出力する。
、このクロックに同期して画像データが表示有効ビット
分、表示ビットアドレスでセレクトされるシフトレジス
タのシリアルアウト端子から出力され、カウンタが０を
示すと次のデータをラインメモリ７および８から読み出
し、画像データを出力する。
以上の一連のシーケンスを繰シ返して１ラスタ走査線分
の表示画像データを表示し、１ドツト単位のウィンドウ
表示が可能になる。
の表示画像データを表示し、１ドツト単位のウィンドウ
表示が可能になる。
〈発明の効果〉
以上述べたように本発明は構成されているので、１ドツ
ト単位のヌムーズな表示のできるマルチウィンド表示装
置を実現することができる。
ト単位のヌムーズな表示のできるマルチウィンド表示装
置を実現することができる。
第２図は表示画面の一例を示す説明図、第３図はライン
メモリの内容の一例を示す説明図、第４図は画面上のド
ツト位置の一例を示す説明図、第５図はビット整形部の
構成を示すブロック図である。
メモリの内容の一例を示す説明図、第４図は画面上のド
ツト位置の一例を示す説明図、第５図はビット整形部の
構成を示すブロック図である。
１：プロセッサ、 ２：ウィンドウ情報レジスタ、
３：メモリアクセス調停回路、 ４：画像データ出力回
路、 ５：表示ウィンドウ情報出力回路、 ６：メモ
リ、 ７：ラインメモリ（画像データ）、 ８ニラ
インメモリ（ビット境界情報）、 ９：ビット整形回
路、 １０：同期信号出力回路、 １１：シフトレ
ジスタ。
３：メモリアクセス調停回路、 ４：画像データ出力回
路、 ５：表示ウィンドウ情報出力回路、 ６：メモ
リ、 ７：ラインメモリ（画像データ）、 ８ニラ
インメモリ（ビット境界情報）、 ９：ビット整形回
路、 １０：同期信号出力回路、 １１：シフトレ
ジスタ。
１２：カウンタ、 １３：データセレクタ。
２０：ウィンドウ０． ２１：ウィンドウ１゜２２：ウ
ィンドウ２゜ 代理人 弁理士 杉 山 毅 至（他１名）倶 ！ 図 、４６ よ： ／Ｉ ト”ｉ／ト 忙Ｖイ耳＝第 ■ 纂 図 第 図 第 図
ィンドウ２゜ 代理人 弁理士 杉 山 毅 至（他１名）倶 ！ 図 、４６ よ： ／Ｉ ト”ｉ／ト 忙Ｖイ耳＝第 ■ 纂 図 第 図 第 図
Claims (1)
- 【特許請求の範囲】 １、メモリに格納された画像情報を順次読み出して表示
部にマルチウィンドウ表示するラスタ式の画像情報表示
装置において、 前記表示部に表示する各ウィンドウの画素データを記憶
する記憶手段、 表示のための同期信号を発生する同期信号発生手段、 前記表示部に表示する複数のウィンドウの位置情報など
を格納した一時記憶手段、 前記同期信号発生手段の出力、前記記憶手段の出力、お
よび、前記一時記憶手段の出力から表示の行単位の情報
を記憶する行情報記憶手段、該行情報記憶手段の出力よ
り前記表示部へのデータを生成する生成手段とを備えた
ことを特徴とする画像情報表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32742988A JPH02170222A (ja) | 1988-12-22 | 1988-12-22 | 画像情報表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32742988A JPH02170222A (ja) | 1988-12-22 | 1988-12-22 | 画像情報表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02170222A true JPH02170222A (ja) | 1990-07-02 |
Family
ID=18199071
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32742988A Pending JPH02170222A (ja) | 1988-12-22 | 1988-12-22 | 画像情報表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02170222A (ja) |
-
1988
- 1988-12-22 JP JP32742988A patent/JPH02170222A/ja active Pending
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