JPH02189944A - 半導体集積回路装置 - Google Patents
半導体集積回路装置Info
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- JPH02189944A JPH02189944A JP1010602A JP1060289A JPH02189944A JP H02189944 A JPH02189944 A JP H02189944A JP 1010602 A JP1010602 A JP 1010602A JP 1060289 A JP1060289 A JP 1060289A JP H02189944 A JPH02189944 A JP H02189944A
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- pads
- integrated circuit
- circuit device
- printed wiring
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
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- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/36—Assembling printed circuits with other printed circuits
- H05K3/361—Assembling flexible printed circuits with other printed circuits
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- H10W72/07551—Connecting or disconnecting of bond wires characterised by changes in properties of the bond wires during the connecting
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- H10W72/541—Dispositions of bond wires
- H10W72/5449—Dispositions of bond wires not being orthogonal to a side surface of the chip, e.g. fan-out arrangements
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- H10W72/541—Dispositions of bond wires
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Wire Bonding (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体集積回路装置に関する。
従来、半導体集積回路装置の形態は、第3図に示すごと
く、半導体チップ1.半導体チップの接続用パッド(以
下パッドと略す)2.パッケージ6、外部接続用の端子
7からなっている。
く、半導体チップ1.半導体チップの接続用パッド(以
下パッドと略す)2.パッケージ6、外部接続用の端子
7からなっている。
この内、パッド2どパッケージの端子5との間の接続部
の詳細は第4図に示す通りで、半導体チップ1のパッド
2とパッケージの端子5との間はポンディングワイヤー
4により接続されている。
の詳細は第4図に示す通りで、半導体チップ1のパッド
2とパッケージの端子5との間はポンディングワイヤー
4により接続されている。
この場合、ポンディングワイヤー4同志が接触して、集
積回路装置が機能しないかあるいは故障してしまう問題
があった。
積回路装置が機能しないかあるいは故障してしまう問題
があった。
更に最近、半導体技術の進歩に伴い、ICの高度集積化
が進み、1個のICに大規模複雑な機能を持たせること
が可能となってきたが、このためには、半導体チップ上
のパッド数を増加する必要がある。
が進み、1個のICに大規模複雑な機能を持たせること
が可能となってきたが、このためには、半導体チップ上
のパッド数を増加する必要がある。
一つの半導体チップ11に、より多くのパッド12を設
ける方式として第5図に示すパッドが考案された。これ
は半導体チップ11上のパッド12を千鳥状に2列にす
るものであるが、この方式ではポンディングワイヤー1
4同志の接触及びポンディングワイヤー14とパッド1
2との接触による事故の可能性が高くなり、パッド間の
間隔をあまり小さくできず、又、多くのパッド]2を設
けるためには半導体チップ11を大型化しなければなら
ない問題があった。
ける方式として第5図に示すパッドが考案された。これ
は半導体チップ11上のパッド12を千鳥状に2列にす
るものであるが、この方式ではポンディングワイヤー1
4同志の接触及びポンディングワイヤー14とパッド1
2との接触による事故の可能性が高くなり、パッド間の
間隔をあまり小さくできず、又、多くのパッド]2を設
けるためには半導体チップ11を大型化しなければなら
ない問題があった。
この様な問題に対処するため、ボンディングワイヤーに
被覆材を使うことが考案された。
被覆材を使うことが考案された。
(昭和59年 特許願]、 2434号 発明者:根本
守雄氏) そうすることによってボンディングワイヤー同志による
接触不良の問題はさげられる。
守雄氏) そうすることによってボンディングワイヤー同志による
接触不良の問題はさげられる。
上述した従来のボンディングワイヤーに被覆材を使う方
法においては、ボンディングワイヤー1本、1本に対し
て被覆をしなければいけないので、非常に時間と工数が
かかる。又、接触問題はないが、ポンチインクワイヤー
が移動することによって、ボッディングワイヤー相互間
の関係位置が変って、ICの周波数特性などに影響を与
える心配がある。そこで、本発明の目的は隣接したボン
ディングワイヤーが接触する恐れのないことは勿論、そ
れに対する作業の工数がかからず、更に接続配線相互間
の関係位置が変らず、ICの性能変化のない半導体集積
回路装置を提供することにある。
法においては、ボンディングワイヤー1本、1本に対し
て被覆をしなければいけないので、非常に時間と工数が
かかる。又、接触問題はないが、ポンチインクワイヤー
が移動することによって、ボッディングワイヤー相互間
の関係位置が変って、ICの周波数特性などに影響を与
える心配がある。そこで、本発明の目的は隣接したボン
ディングワイヤーが接触する恐れのないことは勿論、そ
れに対する作業の工数がかからず、更に接続配線相互間
の関係位置が変らず、ICの性能変化のない半導体集積
回路装置を提供することにある。
本発明の半導体集積回路装置は、半導体チッソの接続用
パッドとパッケージの端子間を可撓性の印刷配線板で接
続されることにより構成される。
パッドとパッケージの端子間を可撓性の印刷配線板で接
続されることにより構成される。
次に本発明について図面を参照して説明する。
第1図ならびに第2図はそれぞれ本発明の一実施例の半
導体集積回路装置について、2層配線された可撓性の印
刷配線板26を用いた半導体集積回路装置のパッドとパ
ッケージの端子との接続状態を示した部分斜視図ならび
に第1図のA−A’縦断面図である。
導体集積回路装置について、2層配線された可撓性の印
刷配線板26を用いた半導体集積回路装置のパッドとパ
ッケージの端子との接続状態を示した部分斜視図ならび
に第1図のA−A’縦断面図である。
この実施例では、可撓性の印刷配線板の中で2層に配線
されており、接触事故を起すことなく、必ず絶縁が保た
れ、更に多くのパッドを設けることができる。又、接続
配線相互間の関係位置も一定に保たれており、移動する
心配がないので、工Cの性能が変化するおそれがない。
されており、接触事故を起すことなく、必ず絶縁が保た
れ、更に多くのパッドを設けることができる。又、接続
配線相互間の関係位置も一定に保たれており、移動する
心配がないので、工Cの性能が変化するおそれがない。
更に、あらかじめ可撓性の印刷配線板を何層かに作って
おいて、−気にパッドとパッケージの端子に接続すれば
、パッド数に関係なく、1回の工程で接続可能になる。
おいて、−気にパッドとパッケージの端子に接続すれば
、パッド数に関係なく、1回の工程で接続可能になる。
以上の説明においては、例としてパッドを千鳥状に2列
に構成して、2層配線したものを使用するものとしたが
、これに限られることなく、パッドを千鳥状にしなくて
よいし、又、パッドが1列、3列、4列でもよい。又、
この可撓性の印刷配線板も2層に限られるものではなく
、3層、4層など更に多層にすること、あるいは単層の
印刷配線板を複数枚重ねて使用することによっても、同
様の効果が得られ、本発明の目的を達成することができ
る。
に構成して、2層配線したものを使用するものとしたが
、これに限られることなく、パッドを千鳥状にしなくて
よいし、又、パッドが1列、3列、4列でもよい。又、
この可撓性の印刷配線板も2層に限られるものではなく
、3層、4層など更に多層にすること、あるいは単層の
印刷配線板を複数枚重ねて使用することによっても、同
様の効果が得られ、本発明の目的を達成することができ
る。
以上説明したように本発明の半導体集積回路装置は、可
撓性の印刷配線板を使用することで、接触不良は勿論、
パッド間隔の制約を受ける事なく、パッドを半導体チッ
プ上に構成できるため、多くのパッドを設けられ、更に
接続配線相互間の関係位置も一定になり、ICの性能が
失われないなど、本発明の効果は著しいものである。
撓性の印刷配線板を使用することで、接触不良は勿論、
パッド間隔の制約を受ける事なく、パッドを半導体チッ
プ上に構成できるため、多くのパッドを設けられ、更に
接続配線相互間の関係位置も一定になり、ICの性能が
失われないなど、本発明の効果は著しいものである。
第1図は本発明の部分斜視図、第2図は第1図のA−A
’縦面図、第3図は従来の半導体集積回路装置の外観斜
視図、第4図、第5図は接続部分上面図である。 1.11.21・・・・・・半導体チッソ、2,12゜
22・・・・・・パッド、3,13.33・・・・・・
アイランド、4.14・・・・・・ボンディングワイヤ
ー 5.15゜25・・・・・・パッケージの端子、2
6・・・・・2層配線された可撓性の印刷配線板、27
・・・・・・1層配線、28・・・・・・2層配線。 代理人 弁理」= 内 原 晋
’縦面図、第3図は従来の半導体集積回路装置の外観斜
視図、第4図、第5図は接続部分上面図である。 1.11.21・・・・・・半導体チッソ、2,12゜
22・・・・・・パッド、3,13.33・・・・・・
アイランド、4.14・・・・・・ボンディングワイヤ
ー 5.15゜25・・・・・・パッケージの端子、2
6・・・・・2層配線された可撓性の印刷配線板、27
・・・・・・1層配線、28・・・・・・2層配線。 代理人 弁理」= 内 原 晋
Claims (1)
- 半導体チップと外部接続用の端子を有し、前記半導体チ
ップを内部に収容するパッケージとを含む半導体集積回
路装置において、前記半導体チップの接続用パッドと前
記パッケージの端子とは可撓性の印刷配線板で接続され
ていること特徴とする半導体集積回路装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1010602A JPH02189944A (ja) | 1989-01-18 | 1989-01-18 | 半導体集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1010602A JPH02189944A (ja) | 1989-01-18 | 1989-01-18 | 半導体集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02189944A true JPH02189944A (ja) | 1990-07-25 |
Family
ID=11754795
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1010602A Pending JPH02189944A (ja) | 1989-01-18 | 1989-01-18 | 半導体集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02189944A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0452755U (ja) * | 1990-09-12 | 1992-05-06 | ||
| US5977617A (en) * | 1996-05-10 | 1999-11-02 | Nec Corporation | Semiconductor device having multilayer film carrier |
-
1989
- 1989-01-18 JP JP1010602A patent/JPH02189944A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0452755U (ja) * | 1990-09-12 | 1992-05-06 | ||
| US5977617A (en) * | 1996-05-10 | 1999-11-02 | Nec Corporation | Semiconductor device having multilayer film carrier |
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