JPH0220939A - ループネットワークのループ制御方式 - Google Patents

ループネットワークのループ制御方式

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JPH0220939A
JPH0220939A JP17069588A JP17069588A JPH0220939A JP H0220939 A JPH0220939 A JP H0220939A JP 17069588 A JP17069588 A JP 17069588A JP 17069588 A JP17069588 A JP 17069588A JP H0220939 A JPH0220939 A JP H0220939A
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Shigeo Nanbu
南部 滋雄
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) 本発明は、複数の場所に散在配置されたモニター機器、
制御機器等の工業用ネットワーク化、企業内情報機器の
ネットワーク化、更には特定地域内の端末機器のネット
ワーク化等に使用されるループネットワークのループ制
御方式に係わり、特にループに柔軟性を持たせる手段を
付加したループネットワークのループ制御方式に関する
(従来の技術) 近年、伝送路のループネットワーク化は、設備費用の低
廉化、インターフェースの簡素化、多様なニーズに対処
し得る融通性、ステーションおよび端末機器の拡張性に
優れていること等から種々の用途の通信網に利用される
傾向にある。
ところで、この種のループネットワークは、−船釣には
第2図に示す如くループ伝送路1にフレームを送信する
制御ステーション2のほか、送受信部およびインターフ
ェイス等をもフた複数のステーション3.・・・が接続
され、かつ、これらのステーション3.・・・にはそれ
ぞれ1個以上の端末機器4が接続されている。
このようなループネットワークにおいては各ステーショ
ン2,3・・・がループ伝送路1を時分割的に共同使用
しながらデータを伝送する必要性から種々の多重化方式
が考えられているが、その中でもチャンネル多重方式は
制御局2から第3図に示すようなフレームヘッダFHを
含んで所定数のタイムスロットT、、T2.・・・・・
・Tnを寄せ集めて構成されたフレームFが定周期で繰
り返しループ伝送路1へ伝送される様になっている。こ
のフレームFの長さは例えば回線交換型のネットワーク
では125μsであり、かつ、フレームFの先Rである
フレームヘッダFHにはフレームの切れ目を識別させる
ための特殊なパターンが挿入される。
他のステーション3.・・・は前記フレームヘッダFH
を検出後、伝送路1上のキャリアから抽出したクロック
をカウントし、このカウント値と予め定められた自己ス
ロット値とを比較し、両値が一致したときに当該スロッ
トが自己のスロットであると認識し、このタイムスロッ
ト内に自ステーションから送信すべきデータをループ伝
送路1へ伝送している。なお、データ伝送の一巡により
生じたループ遅延は専ら制御局2内のエラスチックバッ
ファメモリによって調整されている。
ところで、従来、以上のように各フレームFのフレーム
ヘッダFHを検出しながら下流ステーションへ順次移行
するフレーム同期式ループネットワークでは、各ステー
ション3.・・・からデータを送出するにあたり一例と
してレジスタインサージョン方式が上げられる。この方
式は、ループ伝送路1の各ノード位置に設置される各ス
テーション2.3・・・に最大パケット長に相応するビ
ット数のシフトレジスタが設置され、上流側から伝送さ
れてきた各スロットのパケットデータを一時的にシフト
レジスタに格納し、自己ステーション3の端末機器4に
おける処理データの送信後にシフトレジスタのパケット
データをループ伝送路1へ送出する方式である。
従って、以上のようなレジスタインサージョン方式を用
いたフレーム同期式ループネットワークでは、シフトレ
ジスタの段数がパケット長により一義的に固定化されて
いるので、各ノードステーション3の端末機器4の処理
を遅らすことができない。このことは、特に最近のよう
に1つのループ伝送路1を用いて音声データ、コードデ
ータ。
画像データ等の各種データを伝送する複合型ネットワー
クの場合には各ステーション3ごとに接続端末機器4の
種類および接続機器の数等に応じて内部処理時間が大幅
に異なり、これに伝送系の遅れが加わること等を考えれ
ば、データ通信網としては柔軟な対応ができない不具合
があった。
(発明が解決しようとする問題点) 従って、レジスタインサージョン方式を採用した従来の
フレーム同期式ループネットワークは、各スロットのパ
ケットデータを一時的に格納するシフトレジスタが固定
化されていることがら、各ステーション2,3・・・に
多様な端末機器4・・・を接続することはこれら端末機
器の遅延時間にバラツキがあるために難しく、今後益々
発展する分野である複合型ネットワークに充分対応でき
ない問題点があった。
本発明は上記実情に鑑みてなされたもので、各ステーシ
ョンの内部処理時間を考慮しつつ柔軟にデータを下流側
ループ伝送路へ伝送し得、これによって種々の端末機器
の接続を可能とし、がっ、複合型の場合にも充分対処し
得るループネットワークのループ制御方式を提供するこ
とを目的とする。
[発明の構成コ (問題点を解決するための手段) 本発明によるループネットワークのループ制御方式は、
各ステーションに、ループ伝送路の上流側から伝送され
てくるフレーム同期信号を検出する同期信号検出手段と
、この同期信号検出手段により検出された同期信号以降
のデータを可変長受信バッファメモリに記憶するととも
に前記フレーム同期信号に基づいて自ステーションにお
いて所要とする内部処理を行い、この内部処理終了後に
送信すべきデータを送信バッファメモリに記憶して同期
信号の再送出要求を行う可変遅延手段と、この可変遅延
手段によって送出された同期信号再送出要求に基づいて
再度同期信号を送出し、かつ、この同期信号に前記送信
すべきデータを付加し下流側ループ伝送路へ送出するデ
ータ送出手段とを備えたものである。
(作用) 従って、本願は、以上のような手段とすることにより、
同期信号検出手段で上流側から伝送されてくる同期信号
を検出した後、この同期信号検出信号に基づいて可変遅
延手段では前記同期信号以降のデータをシリアル・パラ
レル変換して可変長受信バッファメモリに格納するとと
もに、自ステーションの内部処理の終了後には送信すべ
きデータを送信バッファメモリに格納して送信準備がで
きたとき、同期信号の再送出要求を行う。ここで、可変
遅延手段から同期信号再送出要求を受けると、データ送
出手段は同期信号°を送出し、かつ、この同期信号に送
信すべきデータを付加して下流側ループ伝送路に伝送す
る。このように各ステーション毎に異なるデータ処理時
間による遅延を許容し柔軟なループネットワークを得る
ものである。
(実施例) 以下、本発明の一実施例について図面を参照して説明す
る。先ず、本発明のループネットワークは第2図と同様
に構成され、かつ、同期をとりながら各ステーション2
,3.・・・で必要な内部処理を行い、下流側ステーシ
ョンへ順次データを伝送して移行していくものとする。
しかして、以上のようなループネットワークにおいて各
ステーション2.3.・・・には第1図に示すような手
段が備えられている。すなわち、本発明方式は、ループ
伝送路1の各ノードに設置されたステーションに上流側
から伝送されてくるフレームFを受信する受信部11お
よび下流側ステーションへ後述するデータを伝送する送
信部12が設けられている。13はループインターフェ
イス、14はフレーム制御部である。
このフレーム制御部14においては、前記フレームFの
うち同期用のフレームヘッダFHを検出する同期信号検
出手段15、このフレームヘッダFH以降のデータをシ
リアルに受けてパラレルに変換して出力する例えばシフ
トレジスタ等の直並列変換部16、送信すべきデータを
パラレルに受けてシリアルに変換して出力する例えばシ
フトレジスタ等の並直列変換部17および同期用フレー
ムヘッダFHを記憶する同期信号送出手段18等により
構成されている。
20はループネットワーク1とステーションに接続され
る1個以上の端末機器30との間に設けてデータの送受
信制御の役目を司る送受信制御部である。この送受信制
御部20は、例えば入力ボート21、直並列変換部16
から出力される並列データを記憶する可変長受信バッフ
ァメモリ22、CPUその他の必要に応じて電気回路等
によって構成され前記同期信号検出手段15による同期
検出信号を受けて端末機器30に所要とするデータ処理
指令を与え、あるいは端末機器30の処理データのうち
送信すべきデータを受取って送信バッファメモリ23に
格納する制御部24および出力ボート25等によって構
成されている。なお、この制御部24は端末機器30に
よる内部処理の終了後に出力ボート25を介して前記フ
レーム制御部14の同期信号送出手段18へ同期信号再
要求指令を出力するようになっている。
次に、以上のように構成されたループネットワークのル
ープ制御方式の動作について説明する。
ループ伝送路1の上流側からフレームヘッダFHに他の
ステーションのデータを付加したフレームFが伝送され
てくると、当該ノードのステーションはそのフレームF
を受信部11で受信した後、ループインターフェイス1
3を介してフレーム制御部14へ送る。このフレーム制
御部14では、フレームFのうちフレームヘッダFHを
同期信号検出手段15で検出すると、そのフレームヘッ
ダ検出信号を入力ポート21または直接制御部24へ送
出する。このとき、フレームFのうち前記フレームヘッ
ダFH以降のデータは直並列変換部16にシリアルに導
入され、ここでパラレルに変換されている。そこで、制
御部24は、前述したようにフレームヘッダ検出信号を
受けると、データ書き込み指令を出力して直並列変換部
16のデータを可変長受信バッファメモリ22に記憶す
るとともに、そのバッファメモリ22のデータ内容に基
づき、あるいは自発的に端末機器30へ当該ステーショ
ンの順番に当たっていることを報告する。このとき、必
要とする端末機器30は処理を実行し、その処理終了後
、あるいは既に処理済みのデータを含めて送信すべきデ
ータを制御部24を介して送信バッファメモリ23に記
憶する。なお、制御部24は可変長受信バッファメモリ
22に格納されているデータのうち他の下流側ステーシ
ョンに送信すべきデータがあれば、そのデータをも送信
バッファメモリ23に記憶する。
このようにして送信すべきデータの送信準備が完了する
と、制御部24は直接または出力ポート25を介してフ
レームヘッダ再送出要求指令を同期信号送出手段18へ
与える。そうすると、同期信号送出手段18からフレー
ムFのフレームヘッダFHが出力され、このフレームヘ
ッダFHを先頭としこれに並直列変換部17で変換され
た送信すべきデータがシリアルに付加され、ループイン
ターフェイス13を経て送信部12から下流側ループ伝
送路1へ伝送される。
従って、以上のような実施例の構成によれば、上流側か
ら送られてくるフレームFのフレームヘッダFHを検出
した後、必要な端末機器30へ指令を与えて内部処理を
行わせ、かつ、この内部処理の終了後にフレームヘッダ
の再送出要求を行い、この要求に基づいてフレームヘッ
ダに送信すべきデータを付加し下流側ループ伝送路1へ
伝送するようにしたので、各ステーションにおいて端末
機器30の処理時間に合せて自由に遅延させて次のステ
ーションへ移行させることができる。このことは、既設
の各ステーションにおいて端末機器を容易に増設でき、
かつ、各ステーション相互間で接続端末機器が異なり、
あるいは処理時間の遅い端末機器を所持している場合で
も充分に対処できる。また、今後益々発展する音声デー
タや画像データ等の各種データを多重化して伝送する複
合型ネットワークにも充分対処できる。
[発明の効果] 以上詳記したように本発明によれば、各ステーションご
とに内部処理時間を考慮しつつループに柔軟性を持たせ
てデータを伝送でき、これにより種々の端末機器の接続
が可能であり、かつ、複合型の場合にも充分対処できる
ループネットワークのループ制御方式を提供できる。
【図面の簡単な説明】
第1図は本発明方式の一実施例を示す各ステーションの
概略構成図、第2図および第3図は従来方式を説明する
ために示したもので、第2図は従来の一般的なループネ
ットワークの模式図、第3図は伝送フレームのフォーマ
ット図である。 1・・・ループ伝送路、2・・・制御ステーション、3
・・・ステーション、11・・・受信部、12・・・送
信部、14・・・フレーム制御部、15・・・同期信号
検出手段、16・・・直並列変換部、17・・・並直列
変換部、18・・・同期信号送出手段、20・・・送受
信制御部、23・・・可変長受信バッファメモリ、23
・・・送信バッファメモリ、24・・・制御部、30・
・・端末機器。 出願人代理人 弁理士 鈴江武彦 第 図

Claims (1)

  1. 【特許請求の範囲】 ループ伝送路に複数のステーションが接続され、各ステ
    ーションが所要とする処理を実行しながら次のステーシ
    ョンに順次移行していくチャンネル多重方式のループネ
    ットワークにおいて、 前記ループ伝送路の上流側から伝送されてくるフレーム
    同期信号を検出する同期信号検出手段と、この同期信号
    検出手段により検出された同期信号以降のデータを可変
    長受信バッファメモリに記憶するとともに前記フレーム
    同期信号に基づいて自ステーションにおいて所要とする
    内部処理を行い、この内部処理終了後に送信すべきデー
    タを送信バッファメモリに記憶して同期信号の再送出要
    求を行う可変遅延手段と、この可変遅延手段によって送
    出された同期信号再送出要求に基づいて再度同期信号を
    送出し、かつ、この同期信号に前記送信すべきデータを
    付加し下流側ループ伝送路へ送出するデータ送出手段と
    を備え、各ステーションで処理時間に応じて任意に遅延
    可能としたことを特徴とするループネットワークのルー
    プ制御方式。
JP63170695A 1988-07-08 1988-07-08 ループネットワークのループ制御方式 Expired - Lifetime JPH0671272B2 (ja)

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JPH0220939A true JPH0220939A (ja) 1990-01-24
JPH0671272B2 JPH0671272B2 (ja) 1994-09-07

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS58170147A (ja) * 1982-03-31 1983-10-06 Hitachi Ltd ル−プ伝送システムの多重化制御装置
JPS61245731A (ja) * 1985-04-24 1986-11-01 Shinko Electric Co Ltd 同期補正回路

Patent Citations (2)

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JPS61245731A (ja) * 1985-04-24 1986-11-01 Shinko Electric Co Ltd 同期補正回路

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