JPH02214130A - 電子素子実装用プリント基板 - Google Patents
電子素子実装用プリント基板Info
- Publication number
- JPH02214130A JPH02214130A JP1035254A JP3525489A JPH02214130A JP H02214130 A JPH02214130 A JP H02214130A JP 1035254 A JP1035254 A JP 1035254A JP 3525489 A JP3525489 A JP 3525489A JP H02214130 A JPH02214130 A JP H02214130A
- Authority
- JP
- Japan
- Prior art keywords
- mounting
- electronic element
- bonding pads
- circuit board
- holes
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistors
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistors
- H05K3/303—Assembling printed circuits with electric components, e.g. with resistors with surface mounted components
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistors
- H05K3/32—Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits
- H05K3/34—Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3421—Leaded components
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/67—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their insulating layers or insulating parts
- H10W70/68—Shapes or dispositions thereof
- H10W70/682—Shapes or dispositions thereof comprising holes having chips therein
Landscapes
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
本発明はピングリッドアレイ(P G A )等の電子
素子実装用プリント基板に関する。
素子実装用プリント基板に関する。
従来より、#I8図に示すようにプリント基板A′の電
子素子1の実装部2を中心にして最内周のスルホール3
の内側にボンディングパット4が形成され、第9図及び
第10図に示すように実装部2、に電子素子1が載置さ
れワイヤボンディング6及びテープキャリア7により電
気的に接続されて電子素子1が実装されている。
子素子1の実装部2を中心にして最内周のスルホール3
の内側にボンディングパット4が形成され、第9図及び
第10図に示すように実装部2、に電子素子1が載置さ
れワイヤボンディング6及びテープキャリア7により電
気的に接続されて電子素子1が実装されている。
従来にあっては、プリント基板A′の電子素子1の実装
部2を中心にして最内周にボンディングパット4が形成
されているので、実装する電子素子1のサイズやボンデ
ィングパット4の幅及び数に制約を受けていた。 本発明は上記課題を解決するために為されたものであり
、その目的とするところは電子素子のサイズを大きくす
ることができ、しかもボンディングパットの幅及び数に
制約を受けることがな(、実装性に優れた電子素子実装
用プリント基板を提供することにある。 [!!題を解決するための手段] 本発明の電子素子実装用プリント基板は、電子素子1の
実装部2を中心にして最内周に位置するスルホール3の
外側もしくは最内周のスルホール3と同位置にボンディ
ングパット4を形成して成ることを特徴とするものであ
り、この構成により上記課題が解決されたものである。 [作用] 実装部2を中心にして最内周に位置するスルホール3の
外側もしくは同位置にボンディングパット4を形成して
いるので、従来と同じ実装部2の大きさであっても、従
来よりサイズの大きい電子素子1を*装でき、又、ボン
ディングパット4の幅を大きくできるので、実装時のボ
ンディングの密着性を向上でき、しかもボンディングパ
ット4の数を多く形成できるので、端子数の多い電子素
子の実装に対応できるなど実装性に優れるものである。 [実施例] 第1図に示す実施例にあっては、プリント配線板Aの方
形の凹所である実装部2には周縁に沿ってスルホール3
が形成されている。この最内周のスルホール3の外側に
絶縁間隔を置いて複数のボンディングパット4が形成さ
れている。各ポンディングパッド部4には好ましくは金
めつきが施されている。スルホール3の外側に形成され
ているので、実装部2とスルホール3との間隔に制約さ
れることなくボンディングパット4の幅Wを大きくする
ことができる。 第2図及び第3図に示す実施例にあっては、最内周と第
2列のスルホール3間及び第2列と第3列間に絶縁間隔
を置いて複数のボンディングパット4が形成されている
。 第5図示す実施例にあっては、最内周のスルホール3閏
に絶縁間隔を置いて複数のボンディングパット4が形r
!tされている。 これらのプリント配線板Aには第6図及び第7図に示す
ようにスルホール3に端子ピン5が挿着され、実装部2
に電子素子1が載置されてワイヤボンディング6及びテ
ープキャリア7により電気的に接続されて電子素子1が
実装されている。
部2を中心にして最内周にボンディングパット4が形成
されているので、実装する電子素子1のサイズやボンデ
ィングパット4の幅及び数に制約を受けていた。 本発明は上記課題を解決するために為されたものであり
、その目的とするところは電子素子のサイズを大きくす
ることができ、しかもボンディングパットの幅及び数に
制約を受けることがな(、実装性に優れた電子素子実装
用プリント基板を提供することにある。 [!!題を解決するための手段] 本発明の電子素子実装用プリント基板は、電子素子1の
実装部2を中心にして最内周に位置するスルホール3の
外側もしくは最内周のスルホール3と同位置にボンディ
ングパット4を形成して成ることを特徴とするものであ
り、この構成により上記課題が解決されたものである。 [作用] 実装部2を中心にして最内周に位置するスルホール3の
外側もしくは同位置にボンディングパット4を形成して
いるので、従来と同じ実装部2の大きさであっても、従
来よりサイズの大きい電子素子1を*装でき、又、ボン
ディングパット4の幅を大きくできるので、実装時のボ
ンディングの密着性を向上でき、しかもボンディングパ
ット4の数を多く形成できるので、端子数の多い電子素
子の実装に対応できるなど実装性に優れるものである。 [実施例] 第1図に示す実施例にあっては、プリント配線板Aの方
形の凹所である実装部2には周縁に沿ってスルホール3
が形成されている。この最内周のスルホール3の外側に
絶縁間隔を置いて複数のボンディングパット4が形成さ
れている。各ポンディングパッド部4には好ましくは金
めつきが施されている。スルホール3の外側に形成され
ているので、実装部2とスルホール3との間隔に制約さ
れることなくボンディングパット4の幅Wを大きくする
ことができる。 第2図及び第3図に示す実施例にあっては、最内周と第
2列のスルホール3間及び第2列と第3列間に絶縁間隔
を置いて複数のボンディングパット4が形成されている
。 第5図示す実施例にあっては、最内周のスルホール3閏
に絶縁間隔を置いて複数のボンディングパット4が形r
!tされている。 これらのプリント配線板Aには第6図及び第7図に示す
ようにスルホール3に端子ピン5が挿着され、実装部2
に電子素子1が載置されてワイヤボンディング6及びテ
ープキャリア7により電気的に接続されて電子素子1が
実装されている。
本発明にあっては、実装部を中心にして最内周に位置す
るスルホールの外側もしくは最内周のスルホールと同位
置にボンディングパットを形成しているので、従来と同
じ実装部の大きさであっても、ボンディングパットが邪
魔になることがな(、従来よりサイズの大きい電子素子
を実装できるものであり、又、ボンディングパットの幅
は実装部とスルホール間の間隔に制約を受けることなく
大きくできるので、実装時のボンデイン〆の密着性を向
上でき、しかもボンディングパットの数を多く形成でき
るので、端子数の多い電子素子の実装に対応できるなど
実装性に優れるものである。
るスルホールの外側もしくは最内周のスルホールと同位
置にボンディングパットを形成しているので、従来と同
じ実装部の大きさであっても、ボンディングパットが邪
魔になることがな(、従来よりサイズの大きい電子素子
を実装できるものであり、又、ボンディングパットの幅
は実装部とスルホール間の間隔に制約を受けることなく
大きくできるので、実装時のボンデイン〆の密着性を向
上でき、しかもボンディングパットの数を多く形成でき
るので、端子数の多い電子素子の実装に対応できるなど
実装性に優れるものである。
第1図、第2図、第3図、第4図及び第5図はそれぞれ
本発明の実施例を示す平面図、第6図及び第7図は同上
への電子素子の実装を示す断面図、第8図は従来例を示
す平面図、第9図及び@10図は同上への電子素子の実
装を示す断面図であって、Aはプリント配線板、1は電
子素子、2は実装部、3はスルホール、4はボンディン
グパットである。 第8図 第9図 X \ w!、八 v
本発明の実施例を示す平面図、第6図及び第7図は同上
への電子素子の実装を示す断面図、第8図は従来例を示
す平面図、第9図及び@10図は同上への電子素子の実
装を示す断面図であって、Aはプリント配線板、1は電
子素子、2は実装部、3はスルホール、4はボンディン
グパットである。 第8図 第9図 X \ w!、八 v
Claims (2)
- (1)電子素子の実装部を中心にして最内周に位置する
スルホールの外側にボンディングパットを形成して成る
ことを特徴とする電子素子実装用プリント基板。 - (2)電子素子実装部を中心にして最内周に位置するス
ルホールと同位置にボンディングパットを形成して成る
ことを特徴とする電子素子実装用プリント基板。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1035254A JPH02214130A (ja) | 1989-02-15 | 1989-02-15 | 電子素子実装用プリント基板 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1035254A JPH02214130A (ja) | 1989-02-15 | 1989-02-15 | 電子素子実装用プリント基板 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02214130A true JPH02214130A (ja) | 1990-08-27 |
Family
ID=12436687
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1035254A Pending JPH02214130A (ja) | 1989-02-15 | 1989-02-15 | 電子素子実装用プリント基板 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02214130A (ja) |
-
1989
- 1989-02-15 JP JP1035254A patent/JPH02214130A/ja active Pending
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