JPH0221786A - ノンインターレース変換回路 - Google Patents

ノンインターレース変換回路

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Publication number
JPH0221786A
JPH0221786A JP63172305A JP17230588A JPH0221786A JP H0221786 A JPH0221786 A JP H0221786A JP 63172305 A JP63172305 A JP 63172305A JP 17230588 A JP17230588 A JP 17230588A JP H0221786 A JPH0221786 A JP H0221786A
Authority
JP
Japan
Prior art keywords
signal
interlaced
conversion circuit
circuit
video signal
Prior art date
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Pending
Application number
JP63172305A
Other languages
English (en)
Inventor
Masahiro Yamada
雅弘 山田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
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Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP63172305A priority Critical patent/JPH0221786A/ja
Publication of JPH0221786A publication Critical patent/JPH0221786A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) この発明は、画像表示装置に用いられ、インターレース
の映像信号をノンインターレースの信号に変換するノン
インターレース変換回路に関する。
(従来の技術) 近年、大形のテレビジョン受像機が開発され画面が大形
化している。大形画面では、通常のインターレース信号
をそのまま走査したのでは走査線が目立ち画質が粗にな
るので、走査線が目立たないように、ノンインターレー
ス変換を行ない走査線数を倍増させて走査している。
第5図はノンインターレース変換を行なう従来の回路で
ある。入力端子1に映像信号が供給され、ラインメモリ
3で1水平期間(以下IHという)遅延される。ライン
メモリ3からの遅延信号と入力端子1からの直接信号と
は加算器4で加算され、その加算信号は、係数器5で1
ノ2倍される。この係数器5からの映像信号がいわゆる
補間信号である。
この補間信号と入力端子1からの直接信号とは、倍速変
換器8に入力されて、時間圧縮され、交互に出力端子9
に導出される。このように導出された映像信号は、ノン
インターレースの映像信号であり走査線密度が倍増して
いる。
上記したノンインターレース変換回路によると、走査線
密度は倍増するが、垂直方向の成分を見るとローパスフ
ィルタを通したのと同様な副作用がある。
第6図は、インターレース信号を2次元空間周波数で表
わしている。縦軸は、垂直周波数であり。
横軸は時間方向周波数である。今、インターレース信号
に(0、525/2 )の成分があり、これが動画とし
て動いたとすると、(30,525/2 )の座標方向
へ移動する。またインターレース信号によって生じてい
た折返し成分1 (30,0)の座標周辺に現れる)は
、(0,0)の座標方向へ移動する。
このように、折返し成分が(0,0)に近付くことによ
って、折返しによる妨害(モアレのようなもの)の時間
周波数が0に近付く。これは折返しによる疑似画像が止
まって見える方向にあり目立つよになる。インターレー
ス状態では本来必要な部分は残っているが、ノンインタ
ーレース化を行なうことにより、本来必要とする成分が
減少し、相対的には折返し成分のみが残ることになり、
折返しによる不自然さが・−層強調されることになる。
(発明が解決しようとする課題) 上記したように従来のノンインターレース変換回路によ
ると、垂直方向の高域成分を持つ動画が処理された場合
、画像が不自然となる問題があった。
そこでこの発明は、インターレース信号をノンインター
レース化した場合、動画が存在しても不自然な映像を生
じないようにしたノンインターレース変換回路を提供す
ることを目的とする。
[発明の構成] (課題を解決するための手段) この発明は、インターレースの映像信号のライン間を補
間信号により埋めてノンインターレースの信号を得る場
合、前記インターレースの映像信号と補間信号とが中間
輝度レベルで輝度差を得るように、この両信号の少なく
とも一方の信号を非線形回路に通して倍速変換器1こ、
入力するようにしたものである。
(実施例) 以下、この発明の実施例を図面を参照して説明′する。
第1図はこの発明の一実施例である。入力端子11に映
像信号が供給され、ラインメモリ12で1水平期間遅延
される。ラインメモリ12からの遅延信号と入力端子1
1からの直接信号とは加算器13で加算され、その加算
信号は、係数器14で1ノ2倍される。この係数器14
からの映像信号が補間信号である。
ここで、入力端子11からの直接信号と補間信号とは、
それぞれ非線形回路15.16に供給され、中間輝度信
号レベルでは互いのレベル(輝度)差が強調されるよう
に処理される。この非線形回路15.16の出力信号は
、倍速変換器17に入力されて、時間圧縮され、交互に
出力端子18に導出される。このように導出された映像
信号は、ノンインターレースの映像信号であり走査線密
度が倍増している。
上記の非線形回路15と16の特性は、第2図(a)あ
るいは(b)に示すような特性である。
つまり、中間輝度レベルの入力に対しては、非線形回路
15の方がレベルを持上げ、非線形回路16がレベルを
下げるように設定されている。なお、この関係は逆であ
っても良く、また少なくとも片方の信号に対してレベル
制御を施してもよい。
また、第2図(b)に示すように折線特性であるとハー
ドウェアも低減できる。
上記のように処理された場合、中間輝度レベルの信号は
、走査線増倍されても高域成分が損われることは無い。
その原理を第3図を参照して説明する。
第3図において、横軸を走査線の位置、縦軸をレベル、
図紙面の裏方向を時間(フィールド)方向とする。そし
て・・・○・・・・・・X・・・・・・O・・・を第1
のフィ−ルド、・・・Δ・・・・・・X・・・・・・Δ
・・・を第2のフィールドとする。またXは補間信号で
あり、0とΔは元のインターレース信号である。通常な
らばこのように・・・・・・のラインで示すようにノン
インターレス信号を表すことができる。しかし、本発明
にょると非線形回路を用いたために、−・−−X−−・
−と、−ムーーX−−ム−で示すように各フィールドの
信号を表すことができる。つまり、ノンインターレース
のライン間にレベル差が生じることである。このことは
、中間輝度レベルの信号における高域成分が完全に無く
なることがなく残存することを意味する。したがって、
動画が存在し。
前フィールドのラインと次のフィールドの同一ラインと
の間に輝度の変化があってもその変化が疑似的に作り出
されて画像に現れることになる。従来の回路であると、
ライン補間を行なうと垂直方向に解像度の高い画像が動
くと、その本来のスペクトル(高域成分)が低下し、折
返し成分により画像の歪みが現れたが、本発明の回路に
よると高域成分が残存するので画像の歪みを緩和できる
第4図はこの発明の他の実施例である。先の実施例は、
インターレース信号の上下のラインの信号和を用いて補
間信号を作成したが、上下のラインのどちらかの信号を
用いて補間信号を作成しても良い。第4図の例は、たと
えば同じラインの信号を補間信号として用いている。つ
まり、入力端子11からの映像信号は、非線形回路15
a116aに供給され、例えば非線形回路16aの出力
信号が補間信号として倍速変換器17に供給される。こ
れにより出力端子18には走査線が増倍された映像信号
が得られる。
[発明の効果] 以上説明したようにこの発明によれば、ライン補間を行
ないノンインターレース信号を得る場合、動画などの垂
直方向の高域成分の劣化を押え、画像の不自然を低減す
ることができる。
【図面の簡単な説明】
第1図はこの発明の一実施例を示す回路図、第2図は第
1図に示した非線形回路の特性例を示す図、第3図は本
発明の回路の動作を説明するために示した説明図、第4
図はこの発明の他の実施例を示す回路図、第5図は従来
のノンインターレース回路を示す図、第6図はインター
レース信号のスペクトルと、ライン間の和により得られ
る信号通過帯域を示す図である。 12・・・ラインメモリ、13・・・加算器、14・・
・係数器、15.16・・・非線形回路、17・・・倍
速変換器。 出願人代理人 弁理士 鈴江武彦 第1 図 (b) 第2 図 フィーλ叶万勾 第 図 第5 図

Claims (1)

  1. 【特許請求の範囲】 インターレースの映像信号のライン間を補間信号により
    埋めてノンインターレースの信号を得るノンインターレ
    ース変換回路において、 前記インターレースの映像信号と補間信号とが中間輝度
    レベルで輝度差を得るように、この両信号の少なくとも
    一方の信号を非線形回路に通して倍速変換器に入力する
    ように構成したことを特徴とするノンインターレース変
    換回路。
JP63172305A 1988-07-11 1988-07-11 ノンインターレース変換回路 Pending JPH0221786A (ja)

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Application Number Priority Date Filing Date Title
JP63172305A JPH0221786A (ja) 1988-07-11 1988-07-11 ノンインターレース変換回路

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JP63172305A JPH0221786A (ja) 1988-07-11 1988-07-11 ノンインターレース変換回路

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JPH0221786A true JPH0221786A (ja) 1990-01-24

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ID=15939459

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JP63172305A Pending JPH0221786A (ja) 1988-07-11 1988-07-11 ノンインターレース変換回路

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