JPH02267936A - 化合物半導体のエッチング方法 - Google Patents

化合物半導体のエッチング方法

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JPH02267936A
JPH02267936A JP1088982A JP8898289A JPH02267936A JP H02267936 A JPH02267936 A JP H02267936A JP 1088982 A JP1088982 A JP 1088982A JP 8898289 A JP8898289 A JP 8898289A JP H02267936 A JPH02267936 A JP H02267936A
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JP
Japan
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etching
ion beam
compound semiconductor
substrate
group compound
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JP1088982A
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English (en)
Inventor
Tatsuya Asaga
浅賀 達也
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Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、II−Vl族化合物半導体のエツチング[従
来の技術] セレン化亜鉛(ZnSe)、硫化亜鉛(ZeS)など、
およびこれらの混晶より成るIf−Vl族化合物半導体
の従来の微細加工方法は、フォトレジストあるいは二酸
化シリコンなどの絶縁膜をマスクとするウェットエツチ
ング技術、ドライエツチング技術がある。ウェットエツ
チング技術において、エツチング液として主に用いられ
ているのは、水酸化ナトリウム水溶液、塩酸、硝酸−塩
酸一水の混合液が挙げられ、これらのエツチング液は、
所望のエツチング速度を得るために、適当な温度、ある
いは組成で使用されている。
一方ドライエツチング技術は、平行平板電極を用いたA
rなどの不活性ガスによるイオンエツチング、BCl3
などの反応性ガスによる反応性イオンエツチングが挙げ
られる。
[発明が解決しようとする課題] しかし、前述の従来技術によるIf−VI族化合物半導
体の加工には、以下の問題がある。
ウェットエツチング技術については、一般的な問題とし
て、再現性にかけることが挙げられる。
温度、エツチング液の組成などをかなり厳密にコントロ
ールしなければ一定したエツチング速度が得られない。
さらに揮発性の物質を含むエツチング液の場合、時間と
共にエツチング液の組成が変化するのでエツチング液を
作製したときと、時間が経過したときとでは、エツチン
グ速度が大きく変わってしまうという問題がある。
さらに、ウェットエツチング技術では、エツチングが等
方向に進行し、サイドエッチが起こるので、マスクの寸
法通りには、パターンを形成することはできない。また
加工断面形状も限られてしまい、例えば、垂直断面の形
成、縦横比の大きい深い溝の形成は、困難である。
II−VI族化合物半導体のウェットエツチングは、他
のm−v族化合物半導体などに比べ、問題が多い。例え
ば、Zn5eを塩酸−硝酸系エツチング液でエツチング
を行う場合、エツチング液がZn5e中にしみ込み、長
時間の水洗を行っても完全に除去することは困難であり
、膜質の特性を著しく悪化させる。また、Zn S e
、  Z n SXS el−xを、NaOH水溶液で
エツチングを行う場合、表面モホロジーが極端に悪化し
てしまい、精密なエツチングに適しているとはいえない
。塩酸を用いた場合は、エツチング速度が非常に遅く、
II−VI族化合物半導体を用いたデバイス作製には実
用的ではない。
一方Arなどの不活性ガスを用いたイオンエ、。
チング技術は、エツチング速度を実用的レベルにするに
はプラズマ放電のパワーを強くする必要があり、半導体
基板に大きなダメージを与えてしまう。また、BCl3
などの反応性ガスを用いた反応性イオンエツチングは、
イオンエツチングに比べれば、多少基板に与えるダメー
ジは低減できるが、許容される範囲のものではない。単
にダメージを低減するには、低い放電パワーでもガス圧
力を高くすれば良いが、イオンシース幅とイオンと中性
粒子の平均自由行程とがほぼ同程度となり、イオンビー
ムに指向性がなくなるため、サイドエツチングが大きく
なり、微細加工という点からみれば大きな欠点を有する
このように、従来の方法によるn −VI族化合物半導
体のエツチングは、非常に困難であり、特にエツチング
深さのバッチ間の再現性が乏しいので1l−VI族化合
物半導体を用いたデバイスの量産技術において大きな障
害となっていた。そこで本発明は、上記問題点を解決す
るもので、その目的とするところは、再現性、実用性が
あり、またエツチング後の基板の損傷が極めて小さく、
様々な加工形状を作ることができるTI−VI族化合物
半導体のエツチング方法を提供するところにある。
[課題を解決するための手段] 本発明の化合物半導体のエツチング方法は、エツチング
マスクを形成する工程と、反応性ガスを放電室分離型の
マイクロ波励起・ECRプラズマ室で活性化させ、被処
理材料に一様な方向を持つたイオンビームを照射するこ
とによりドライエツチングを行う工程を含むII−VI
族化合物半導体の加工手段において、該イオンビームに
よりドライエツチングを行う前に、該II−VI族化合
物半導体の表面に水素イオンビームを照射する工程を含
むことを特徴とする。
[実  施  例コ 以下本発明の方法によりII−VI族化合物半導体にエ
ツチング加工を施した実施例を示す。
まず、第5図には本発明の実施例における工・ソチング
装置の構成概略断面図を示す。反応性の強いハロゲン元
素を含むガスをエツチングガスとして用いるため、試料
準備室6とエツチング室7とがゲートバルブ19により
分離された構造となっており、エツチング室7は常に高
真空状態に保たれている。8は電子・サイクロトロン共
鳴(ECR)プラズマ室であり、磁場発生用円筒ドーナ
、ソツ型コイル9で囲まれ、マイクロ波導波管10との
接続部には、マイクロ波導入石英窓がある。マイクロ波
で電離・発生した電子は、軸対称磁場によりサイクロト
ロン運動を行いながらガスと衝突を繰り返す。この回転
周期は、磁場強度が、例えば875ガウスのときマイク
ロ波の周波数、例えば2.45GHzと一致し、電子系
は共鳴的にマイクロ波のエネルギーを吸収する。このた
め低いガス圧でも放電が持続し、高いプラズマ密度が得
られ、反応性ガスが長寿命で使用できる。さらに中心部
での高い電解分布により、電子・イオンが中心部に集束
するので、イオンによるプラズマ室側壁のスパッタ効果
が小さく、高清浄なプラズマが得られる。ECRプラズ
マ室8で発生したイオンは、メツシュ状の引出し電極部
11で加速され、試料12に照射される。サンプルホル
ダー13は、マニピユレータ14により鉛直方向を軸と
して360°回転させることができ、試料に入射するイ
オンビームの方向を変えることができる。
第1図は、第5図の装置により、ZnS eをエツチン
グ加工したときの一実施例の断面図である。
第1図(a)は、エツチング前の断面図であり、1はZ
n5e、2はエツチングマスクである。エツチングマス
ク2は、フォトレジスト(ポジタイプ)を用いており、
通常のフォトリソ工程によりマスク作製を行ったため、
マスクの断面形状はテーパ状となる。基板をサンプルホ
ルダー13に設置した後、エツチングを行う前に水素イ
オンビームによる基板表面のクリーニングを次のように
行った。純水素(99,9999%)を用い、ガス圧力
1.0xlO−’Pa、vイクロ波入射出六入射出力1
00W電圧400 V、試料温度25°Cで基板に対し
垂直に水素イオンビームを照射する。
水素イオンビームにより基板表面の残留不純物がスパッ
タされ清浄な基板表面が得られる。しかるのち、反応性
ガスとして純塩素(99,999%)を用い、ガス圧力
1.0XIO−’Pa、  マイクロ波入射出力100
 W、  引出し電圧500■、試料温度25°C1イ
オンビームの照射方向は基板に対し垂直方向でエツチン
グを行った。第1図(b)は、エツチング後の断面図で
ある。Zn5eのエツチング速度は、約600 A/分
、一方フオドレジスト(ポジタイプ)のエツチング速度
は、ポストベークの条件を120℃、30分間としたと
き、約200A/分である。エツチングマスクの形状が
テーパーを持っておりエツチングマスクもスパッタによ
りエツチングが多少起こるため、加工断面形状は、第1
図(b)に示す形状となり、イオンビームを垂直に入射
しても垂直断面とならないが、エツチング速度に関して
いえば、実用上問題ない。またエツチング前の水素イオ
ンビームのクリーニングにより、これを行わない時より
もエツチング速度の安定化及び再現性が向上する。さら
にエツチング速度の面内分布は、20mmX20mmの
基板内で±5%以下、加工後の表面モホロジーは、加工
前とほとんど変わらないものであった。第2図(a)、
 (b)は、エツチング前のZn5e基板と、上記条件
でエツチングを行った後のZn5eのフォトルミネッセ
ンスを比べたものである。 (a)はエツチング前の、
 (b)はエツチング後のフォトルミネッセンスである
。バンド端の発光による相対強度と、深い準位による発
光の相対強度比は、エツチング前後とも約50と変化が
なく、エツチングによる半導体層の損傷はほとんどない
ことがわかる。
第3図には、ZnS eの垂直断面加工の一実施例につ
いて示す。まず、第3図(a)に示すようにZn5el
上にフォトレジスト3 (ポジタイプ)をスピンコード
し、200 ”Cで30〜120分べ一りし、TI4を
約100 OA、 電子ビーム蒸着法などでフォトレジ
スト上に形成する。次に第3図(b)に示すように、通
常のフォトリソグラフィ工程により、フォトレジスト5
のパターン形成を行う。次に第3図(C)に示すように
フォトレジスト5をマスクとしてT14のエツチングを
行う。エツチング方法は、ウェットエツチングでは、緩
衝フッ酸溶液を用い、ドライエツチングでは、CF4ガ
スを用いた反応性イオンエツチング(RIE)法を用い
るが、精密なパターン転写を行うには、サイドエツチン
グ量の僅少なドライエツチングの方が望ましい。次に第
3図(d)に示すように、T14をマスクとして、フォ
トレジスト3のエツチングを酸素プラズマを用いたRI
E法により行う。このとき注意しなければならないこと
は、酸素ガスの圧力である。テーパを持たない垂直な断
面形状のエツチングマスクの作製には、通常の平行平板
型のドライエツチング装置を用いた場合、酸素ガスの圧
力は5Pa程度が望ましい。
圧力を高くし過ぎると、エツチングが等方向に進行する
ので、この場合適していない。フォトレジスト3のエツ
チングマスクとして用いたT14はZnS e 1のエ
ツチング前に緩衝フッ酸溶液などで除去してお(。次に
、第1図の実施例と同様の条件で、基板表面の水素イオ
ンビームによるクリーニング及び純塩素ガスによるZn
5eのエツチングを行えば第3図(e)に示すような垂
直断面が形成される。またこのときサイドエッチはほと
んど起こらない。そのため、多少工程は複雑化するが、
異方性エツチングに関していえば、第3図の方法は有効
な手段といえる。また基板表面の水素イオンビームによ
るクリーニングはサイドエッチの抑制に効果があった。
第4図は、イオンビームを、znSe基板1の表面に対
して、斜めの方向から入射させ、エツチングを行った実
施例を示すものである。第4図(a)はエツチング前の
状態、第4図(b)は(a)の基板に対し、矢印で示す
方向よりイオンビームを入射させ、エツチングを行った
ときの断面図である。イオンビームの入射方向に優先的
にエツチングが進行し、斜め方向に溝が形成されている
本実施例においては、If−VI族化合物半導体として
Zn5eについて説明を行ったが、 ZnS。
5et−x(0<x≦1)等、他のn−vr族化合物半
導体についても有効である。またエツチングマスクとし
てフォトレジストを用いて説明を行ったが、被エツチン
グ材料に対して、選択比のとれるもの、例えばZn5e
を被エツチング材料とした場合、S I Ox、S i
 Nxなどの絶縁物、 Mo。
N1などの金属についても有効である。また、エツチン
グガスとして、純塩素ガスを用いているが、ハロゲン元
素を含むガス、例えば BCl3、あるいはCC12F
2、などでもよい。
[発明の効果コ 以上述べたように、本発明によれば以下の効果が得られ
る。
n−vr族化合物半導体のエツチング方法として、マイ
クロ波励起・ECRプラズマによる反応性イオンビーム
を用いることにより、従来のウェットエツチング技術、
あるいは、イオンエツチング、反応性イオンエツチング
などのドライエツチング技術と比べ、再現性、制御性の
格段に優れたエツチングを行うことができる。また、特
に従来の■−■族化合物半導体のドライエツチング技術
と比べ、半導体層に与える損傷を大幅に低減することが
できる。さらに、イオンビーム、エツチングマスクの形
状を制御することにより、テーバ状の溝、垂直断面、斜
めの溝などの加工が可能となり、■−■族化合物半導体
を用いたデバイスを、再現性、信頼性よく、かつ容易に
作製することができる。
さらに、エツチング前の水素イオンビームによる基板表
面のクリーニングを行うことにより、基板表面の酸素、
炭素等の不純物がスパッタ作用により取り除かれる。そ
の結果、II−VI族化合物半導体のドライエツチング
に於けるエツチング速度の安定化及びバッチ間の再現性
の向上、垂直断面加工の際のサイドエッチの抑制、また
異なるII−VI族化合物半導体の等速エツチング等が
可能となり多様なデバイスの作製が可能となる。
【図面の簡単な説明】
第1図(a)、 (b)は、本発明の方法により、フォ
トレジストをエツチングマスクとしてZn5eのエツチ
ングを行った一実施例を示す工程断面図。 第2図(a)、 (b)は、それぞれ本発明の方法の実
施例によるエツチングの前後のZn5e層のフォトルミ
ネッセンスを示す図。 第3図(a)〜(e)は、本発明により、Zn5eの垂
直端面加工を行った一実施例を示す工程断面図。 第4図(a)、 (b)は、本発明の方法により、Zn
5eの斜め溝の加工を行った一実施例を示す工程断面図
。 第5図は、本発明の実施例に用いたエツチング装置の構
成概略説明図。 ・Zn5e基板 ・フォトレジスト ・フォトレジスト ・TI ・フォトレジスト ・試料r$備室 ・・エツチング室 ・ECRプラズマ発生室 ・・電磁石 ・マイクロ波導波管 ・引出し電極 ・試料 ・・サンプルホルダー ・・マニピュレータ ・・ガス導入部 204オンe′−ムの間開 (b) ・・搬送棒 ・・排気系 ・・排気系 ・ゲートバルブ 以上 出願人セイコーエプソン株式会社 代理人弁理土鈴木喜三部(他1名) 7オトシエ)ルイ一(色V) (久) 7丁トン工斧ルギー(tY> (トン 第2b (A) 茅 φ 朗

Claims (1)

    【特許請求の範囲】
  1. エッチングマスクを形成する工程と、反応性ガスを放電
    室分離型のマイクロ波励起・ECRプラズマ室で活性化
    させ、被処理材料に一様な方向を持ったイオンビームを
    照射することによりドライエッチングを行う工程を含む
    II−VI族化合物半導体の加工手段において、該イオンビ
    ームによりドライエッチングを行う前に、該II−VI族化
    合物半導体の表面に水素イオンビームを照射する工程を
    含むことを特徴とする化合物半導体のエッチング方法。
JP1088982A 1989-02-23 1989-04-07 化合物半導体のエッチング方法 Pending JPH02267936A (ja)

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JP1088982A JPH02267936A (ja) 1989-04-07 1989-04-07 化合物半導体のエッチング方法
DE69033151T DE69033151T2 (de) 1989-02-23 1990-02-20 Ätzverfahren für Verbindungshalbleiter
EP90103252A EP0386518B1 (en) 1989-02-23 1990-02-20 Etching method for compound semiconductors
KR1019900002105A KR940002737B1 (ko) 1989-02-23 1990-02-21 화합물 반도체의 에칭 방법
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HK98115552.1A HK1014297B (en) 1989-02-23 1998-12-24 Etching method for compound semiconductors

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS58101429A (ja) * 1981-12-12 1983-06-16 Semiconductor Res Found ドライエツチング方法
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