JPH033234A - 化合物半導体のエッチング方法 - Google Patents

化合物半導体のエッチング方法

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JPH033234A
JPH033234A JP1136802A JP13680289A JPH033234A JP H033234 A JPH033234 A JP H033234A JP 1136802 A JP1136802 A JP 1136802A JP 13680289 A JP13680289 A JP 13680289A JP H033234 A JPH033234 A JP H033234A
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JP
Japan
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etching
substrate
compound semiconductors
gas
sample
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JP1136802A
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Tetsuya Seki
哲也 関
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Seiko Epson Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、■−■族化合物半導体の工・シチング方法に
関するものである。
[従来技術] セレン化亜鉛(ZnSe)、硫化亜鉛(ZeS)など、
およびこれらの混晶より成るII−VI族化合物半導体
の従来の微細加工方法は、フォトレジストあるいは二酸
化シリコンなどの絶縁膜をマスクとするウェットエツチ
ング技術、ドライエツチング技術がある。ウェットエツ
チング技術において、エツチング液として主に用いられ
ているのは、水酸化ナトリウム水溶液、塩酸、硝酸−塩
酸一水の混合液が挙げられ、これらのエツチング液は、
所望の、工・ノチング速度を得るために、適当な温度、
あるいは組成で使用されている。
一方ドライエツチング技術は、平行平板電極を用いたA
rなどの不活性ガスによるイオンエツチング、BCla
などの反応性ガスによる反応性イオンエツチングが挙げ
られる。
[発明が解決しようとする課題] しかし、前述の従来技術によるII−VI族化合物半導
体の加工には、以下の問題がある。
半導体基板表面のみならず、側面の原子面レベルでの平
滑なエツチングは、II−VI族化合物半導体を用いた
発光ダイオード(LED)、あるいは半導体レーザ(L
D)などの共振器の作製に重要な技術であるが、従来の
エツチング方法では不可能である。
まず、ウェットエツチング技術については、般的な問題
として、再現性にかけることが挙げられる。温度、エツ
チング液の組成などをかなり厳密にコントロールしなけ
れば一定したエツチング速度が得られない。さらに揮発
性の物質を含むエツチング液の場合、時間と共にエツチ
ング液の組成が変化するのでエツチング液を作製したと
きと、時間が経過したときとでは、エツチング速度が大
きく変わってしまうという問題がある。
さらに、ウェットエツチング技術では、エツチングが等
方的に進行し、サイドエッチが起こるので、マスクの寸
法通りには、パターンを形成することはできない。また
加工断面形状も限られてしまい、例えば、垂直断面の形
成、縦横比の大きい深い溝の形成は、困難である。
It−VI族化合物半導体のウェットエツチングは、他
のm−v族化合物半導体などに比べ、問題が多い。例え
ば、Zn5eを塩酸−硝酸系エツチング液でエツチング
を行う場合、エツチング液がZn5e中にしみ込み、長
時間の水洗を行っても完全に除去することは困難であり
、膜質の特性を著しく悪化させる。また、Zn5e、Z
n5xSe+−xを、NaOH水溶液でエツチングを行
う場合、表面モホロジーが極端に悪化してしまい、原子
面レベルの精密なエツチングに不可能である。塩酸を用
いた場合は、エツチング速度が非常に遅く、■−■族化
合物半導体を用いたデバイス作製には実用的ではない。
一方Arなどの不活性ガスを用いたイオンエツチング技
術は、エツチング速度を実用的レベルにするにはプラズ
マ放電のパワーを強くする必要があり、半導体基板に大
きなダメージを与えてしまう。また、BCl3などの反
応性ガスを用いた反応性イオンエツチングは、イオンエ
ツチングに比べれば、多少基板に与えるダメージは低減
できるが、許容される範囲のものではない。単にダメー
ジを低減するには、低い放電パワーでもガス圧力を高く
すれば良いが、イオンシース幅とイオンと中性粒子の平
均自由行程とがほぼ同程度となり、イオンビームに指向
性がな(なるため、サイドエツチングが大きくなり、微
細加工という点からみれば大きな欠点を有する。
このように、従来の方法によるII−VI族化合物半導
体の低損傷でかつ原子面レベルでの平滑なエツチングは
、非常にむずかしく、II−VI族化合物半導体を用い
たデバイス作製の大きな障害となっていた。そこで本発
明は、上記問題点を解決するもので、その目的とすると
ころは、再現性、実用性があり、またエツチング後の基
板の損傷が極めて小さく、原子面レベルで平滑であり、
様々な加工形状を作ることができるII−VI族化合物
半導体のエツチング方法を提供するところにある。
し課題を解決するための手段] 本発明の化合物半導体のエツチング方法は、反応性ガス
を放電室分離型のマイクロ波励起・ECRプラズマ室で
活性化させ、被処理材料に一様な方向を持ったイオンビ
ームを照射することによりドライエツチングを行う工程
を含むI[−VI族化合物半導体の加工手段において、
前記被処理材料のエツチング時の温度は、0°C以上g
 o ’c以下であることを特徴とする。
[実 施 例] 以下本発明の方法によりIt−VI族化合物半導体にエ
ツチング加工を施した実施例を示す。
まず、第6図には本発明の実施例におけるエツチング装
置の構成概略断面図を示す。反応性の強いハロゲン元素
を含むガスをエツチングガスとして用いるため、試料準
備室5とエツチング室6とがゲートバルブ18により分
離された構造となっており、エツチング室6は常に高真
空状態に保たれている。7は電子・サイクロトロン共鳴
(ECR)プラズマ室であり、磁場発生用円筒ドーナッ
ツ型コイル8で囲まれ、マイクロ波導波管9との接続部
には、マイクロ波導入石英窓がある。マイクロ波で電離
・発生した電子は、軸対称磁場によりサイクロトロン運
動を行いながらガスと衝突を繰り返す。この回転周期は
、磁場強度が、例えば8′″!5ガウスのときマイクロ
波の周波数、例えば2.45GH2と一致し、電子系は
共鳴的にマイクロ波のエネルギーを吸収する。このため
低いガス圧でも放電が持続し、高いプラズマ密度が得ら
れ、反応性ガスが長寿命で使用できる。さらに中心部で
の高い電解分布により、電子・イオンが中心部に集束す
るので、イオンによみプラズマ室側壁のスパッタ効果が
小さく、高清浄なプラズマが得られる。ECRプラズマ
室8で発生したイオンは、メツシュ状の引出し電極部l
Oで加速され、試料11に照射される。サンプルホルダ
ー12は、冷却加熱部と、試料設置部とが分離しており
、試料準備室5より搬送棒15により搬送された試料設
置部は、冷却加熱部と完全に接触する構造となっている
。冷却加熱部には、水冷パイプとヒータが装着されてお
り、試料の温度を制御することができる。制御範囲は、
−20℃から400℃である。10°C以下の冷却には
、メタノールなどの有機溶媒を用いる。また、サンプル
ホルダー12は、マニピュレータ13により鉛直方向を
軸として360°回転させることができ、試料に入射す
るイオンビームの方向を変えることができる。
第1図は、第6図の装置により、Zn5eをエツチング
加工したときの一実施例の断面図である。
エツチング条件は、反応性ガスとして純塩素(99,9
99%)を用い、ガス圧力1.0X10’Pa、  マ
イクロ波入射出力100W、  引出し電圧500V、
イオンビームの照射方向は基板に対し垂直方向である。
第1図(a)は、基板温度25℃、第1図(b)は、基
板温度120℃でエツチングを行った結果である マス
クは、フォトレジスト(ポジタイプ)を用いており、マ
スクの断面形状を基板に対して垂直にするため、第2図
に示す工程により作製した。まず、第2図(a)に示す
ようにZn5el上にフォトレジスト2(ポジタイプ)
をスピンフートし、200°Cで30〜120分ベーク
し、Ti3を約1000 AS 電子ビーム蒸着法など
でフォトレジスト上に形成する。
次に第2図(b)に示すように、通常のフォトリソグラ
フィ工程により、フォトレジスト4のパターン形成を行
う。次に第2図(C)に示すようにフォトレジスト4を
マスクとしてTi3のエツチングを行う。エツチング方
法は、ウェットエツチングでは、緩衝フッ酸溶液を用い
、ドライエツチングではs  CF aガスを用いた反
応性イオンエツチング(RI E)法を用いるが、精密
なパターン転写を行うには、サイドエツチング量の僅少
なドライエツチングの方が望ましい。次に第2図(d)
に示すように、Ti3をマスクとして、フォトレジスト
2のエツチングを酸素プラズマを用いたRIE法により
行う。このとき注意しなければならないことは、酸素ガ
スの圧力である。テーパを持たない垂直な断面形状のエ
ツチングマスクの作製には、通常の平行平板型のドライ
エツチング装置を用いた場合、酸素ガスの圧力は5Pa
程度が望ましい。圧力を高(し過ぎると、エツチングが
等方向に進行するので、この場合適していない。フォト
レジスト2のエツチングマスクとして用いたTi3はZ
n5elのエツチング前に緩衝フッ酸溶液などで除去し
てお(。
エツチング後の断面形状は、25°Cの場合垂直である
が、120℃の場合は垂直とはならず、ウェストを持っ
た形状となる。また、側壁のモホロジーを、走査電子顕
微鏡(SEM)で観察したところ、25℃の場合は、5
0000〜100000倍の倍率で平滑な面が得られた
のに対し、120℃の場合は、非常に荒れていた。この
理由として、25℃では、エツチング中に生成されるZ
r+CIX、5eC1xなどの塩化物が表面で散乱した
イオンビームから側壁を保護するが、これら塩化物は、
揮発性が高いため、120℃では蒸発してしまい、側面
の保護がなくなるため、サイドにエツチングが起こり、
モホロジーも悪化すると考えられる。これら塩化物が、
保護膜として有効に働く温度範囲は、80°C以下であ
る。80°Cより高い温度では蒸発してしまう。第3図
は、基板温度に対するZn5eの工・ノチング速度を示
した図であるが、80℃付近でエツチング速度が上昇し
始め、上記結果と対応する。
またO′C以下では、エツチング速度が低下することと
、基板ホルダーが周囲に比べかなり温度が低くなるため
試料に塩素が付着し易くなり、後々の試料の取扱いが複
雑となり適当ではない。
第4図(a)、 <b>は、エツチング前のZn5e基
板と、上記条件でエツチングを行った後のZn5eの基
板表面のフォトルミネッセンスを比べたものである。 
(a)はエツチング前の、 (b)はエツチング後のフ
ォトルミネッセンスである。
バンド端の発光による相対強度と、深い準位による発光
の相対強度比は、エツチング前後とも約50と変化がな
く、エツチングによる半導体層表面の損傷はほとんどな
いことがわかる。側壁の損傷状態を調べる有効な手段は
ないが、側壁の方が、基板表面よりもイオンビームによ
る損傷が少ないことから、側壁もほとんど損傷を受けて
いないと考えられる。
第5図は、イオンビームを、Zn5e基板1の表面に対
して、斜めの方向から入射させ、基板温度25℃でエツ
チングを行った実施例を示すものである。第4図(a)
はエツチング前の状態、第4図(b)は(a)の基板に
対し、矢印で示す方向よりイオンビームを入射させ、エ
ツチングを行ったときの断面図である。イオンビームの
入射方向に優先的にエツチングが進行し、斜め方向に溝
が形成されており、このときの側壁のモホロジー並びに
損傷状態は、第1図の実施例と同様の結果であった。
本実施例においては、II−VI族化合物半導体として
Zn5eについて説明を行ったが、Z n S x S
e +−x (0< x≦l)等についても同様の結果
が得られた。また、エツチングガスとして、純塩素ガス
を用いているが、ハロゲン元素を含むガス、例えばBC
l3、CC12F2、などでもよい。
[発明の効果コ 以上述べたように、本発明によれば以下の効果が得られ
る。
マイクロ波励起・ECRプラズマによる反応性イオンビ
ームを用いるII−VI族化合物半導体のエツチング方
法において、エツチング時の試料の温度を0°C以上8
0°C以下にすることにより、エツチング側壁を原子面
レベルで平滑にすることが可能となる。また、半導体表
面、並びに側面の損傷はほとんどな(、II−VI族化
合物半導体を用いたデバイス、特に半導体レーザの共振
器面の作製などを、再現性、信頼性よく、かつ容易に作
製することが可能となる。
【図面の簡単な説明】
第1図(a)、 (b)は、本発明の方法により、Zn
5eのエツチングを行った一実施例を示す図。 第2図(a)〜(d)は、第1図の実施例のエツチング
マスクの作製工程図を示した図。 第3図は、基板温度に対するZn5eのエツチング速度
を示した図。 第4図(a)、 (b)は、それぞれ本発明の方法によ
るエツチングの前後のZn5eJiのフォトルミネッセ
ンスを示す図。 第5図(a)、 (b)は、本発明の方法により、Zn
5eの斜め溝の加工を行った一実施例を示す図。 第6図は、本発明の実施例に用いたエツチング装置の構
成概略断面図を示す。 1 ・ 2 ・ 3 ・ 4 ・ 5 ・ 6 ・ 7 ・ 8 ・ 9 ・ 0 ・ 1 ・ 2 ・ 3 ・ 4 ・ 5 ・ 6 ・ ・Zn5e基板 ・フォトレジスト ・Ti ・フォトレジスト ・試料準備室 ・エツチング室 ・ECRプラズマ発生室 ・電磁石 ・マイクロ波導波管 ・・引出し電極 ・試料 ・サンプルホルダー Φマニビーレーク ・ガス導入部 ・搬送棒 ・排気系 7 排気系 ・ゲー トバルブ 以上

Claims (1)

    【特許請求の範囲】
  1. 反応性ガスを放電室分離型のマイクロ波励起・ECRプ
    ラズマ室で活性化させ、被処理材料に一様な方向を持っ
    たイオンビームを照射することによりドライエッチング
    を行う工程を含むII−VI族化合物半導体の加工手段
    において、前記被処理材料のエッチング時の温度は、0
    ℃以上80℃以下であることを特徴とする化合物半導体
    のエッチング方法。
JP1136802A 1989-02-23 1989-05-30 化合物半導体のエッチング方法 Pending JPH033234A (ja)

Priority Applications (6)

Application Number Priority Date Filing Date Title
JP1136802A JPH033234A (ja) 1989-05-30 1989-05-30 化合物半導体のエッチング方法
DE69033151T DE69033151T2 (de) 1989-02-23 1990-02-20 Ätzverfahren für Verbindungshalbleiter
EP90103252A EP0386518B1 (en) 1989-02-23 1990-02-20 Etching method for compound semiconductors
KR1019900002105A KR940002737B1 (ko) 1989-02-23 1990-02-21 화합물 반도체의 에칭 방법
US07/484,786 US5145554A (en) 1989-02-23 1990-02-22 Method of anisotropic dry etching of thin film semiconductors
HK98115552.1A HK1014297B (en) 1989-02-23 1998-12-24 Etching method for compound semiconductors

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JP1136802A JPH033234A (ja) 1989-05-30 1989-05-30 化合物半導体のエッチング方法

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JPH033234A true JPH033234A (ja) 1991-01-09

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